JPH07321326A - 電子素子及びその製造方法 - Google Patents
電子素子及びその製造方法Info
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- JPH07321326A JPH07321326A JP6106935A JP10693594A JPH07321326A JP H07321326 A JPH07321326 A JP H07321326A JP 6106935 A JP6106935 A JP 6106935A JP 10693594 A JP10693594 A JP 10693594A JP H07321326 A JPH07321326 A JP H07321326A
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-
- H—ELECTRICITY
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/095—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00 with a principal constituent of the material being a combination of two or more materials provided in the groups H01L2924/013 - H01L2924/0715
- H01L2924/097—Glass-ceramics, e.g. devitrified glass
- H01L2924/09701—Low temperature co-fired ceramic [LTCC]
Abstract
(57)【要約】
【目的】 本発明は、絶縁耐圧が従来よりも極めて良好
な電子素子と、高耐圧絶縁膜を高い歩留まりで安定して
得られる電子素子の製造方法を提供することを目的とす
る。 【構成】 少なくとも表面が絶縁性である基体の該表面
に、導電性の配線パターンが形成されており、前記基体
及び前記配線パターンの一部又は全部を覆って絶縁層が
形成されている電子素子において、前記絶縁層は、少な
くとも前記パターンのステップ部付近の酸素含有量が1
0atom%以下の窒化珪素膜で構成されていることを
特徴とする。また、前記絶縁層をプラズマCVD法によ
り、成膜温度T(℃)、イオンフラックスI(A)、成
膜速度v(nm/min)としたとき、T≧−651
(I/v)+390、150≦ T≦350(但し、イ
オンフラックスは60x60cm2当たりの電流量
(A)を示す)の関係式を満たす条件で成膜することを
特徴とする。
な電子素子と、高耐圧絶縁膜を高い歩留まりで安定して
得られる電子素子の製造方法を提供することを目的とす
る。 【構成】 少なくとも表面が絶縁性である基体の該表面
に、導電性の配線パターンが形成されており、前記基体
及び前記配線パターンの一部又は全部を覆って絶縁層が
形成されている電子素子において、前記絶縁層は、少な
くとも前記パターンのステップ部付近の酸素含有量が1
0atom%以下の窒化珪素膜で構成されていることを
特徴とする。また、前記絶縁層をプラズマCVD法によ
り、成膜温度T(℃)、イオンフラックスI(A)、成
膜速度v(nm/min)としたとき、T≧−651
(I/v)+390、150≦ T≦350(但し、イ
オンフラックスは60x60cm2当たりの電流量
(A)を示す)の関係式を満たす条件で成膜することを
特徴とする。
Description
【0001】
【産業上の利用分野】本発明は、電子素子及びその製造
方法に係り、より詳細には、絶縁性基体の表面に配線パ
ターンが形成されており、その表面を覆って窒化珪素絶
縁膜が形成されている電子素子に関する。
方法に係り、より詳細には、絶縁性基体の表面に配線パ
ターンが形成されており、その表面を覆って窒化珪素絶
縁膜が形成されている電子素子に関する。
【0002】
【関連する技術】電子素子として図7に示すようなアク
ティブマトリクス液晶表示素子の駆動に用いられる薄膜
トランジスタ(以下『TFT』という。)を例にとり関
連する技術を説明する。
ティブマトリクス液晶表示素子の駆動に用いられる薄膜
トランジスタ(以下『TFT』という。)を例にとり関
連する技術を説明する。
【0003】図8は図7の−’断面図であり、TF
T部が概念的に示されている。なお、図8は概念的に書
かれたものであり、その寸法等は実際の素子とは全く異
なっている。
T部が概念的に示されている。なお、図8は概念的に書
かれたものであり、その寸法等は実際の素子とは全く異
なっている。
【0004】図8において、9は、基板5上にパターニ
ングされたゲート電極(配線パターン)であり、10は
ゲート配線(配線パターン)である。3が絶縁膜であ
り、そのうち3aがゲート絶縁膜、3bが配線交差部の
層間絶縁膜である。
ングされたゲート電極(配線パターン)であり、10は
ゲート配線(配線パターン)である。3が絶縁膜であ
り、そのうち3aがゲート絶縁膜、3bが配線交差部の
層間絶縁膜である。
【0005】11はソース電極、12はソース配線、1
3はドレイン電極である。
3はドレイン電極である。
【0006】このゲート絶縁膜3aやTFTアレーの多
層金属配線の交差部の絶縁膜3bとして窒化珪素薄膜が
多用されている。
層金属配線の交差部の絶縁膜3bとして窒化珪素薄膜が
多用されている。
【0007】この窒化珪素薄膜の組成としては、珪素:
窒素の原子比が約3:4であり、膜質安定化のために水
素が微量含まれているものが好ましいとされている。こ
のような絶縁膜は主にプラズマCVD法(化学気相堆積
法)で成膜されている。通常原料ガスとして、シラン−
窒素系、シラン−アンモニア−窒素系、シラン−アンモ
ニア−水素系、シラン−窒素−水素系、さらにはシラン
−アンモニア−窒素−水素系が用いられる。
窒素の原子比が約3:4であり、膜質安定化のために水
素が微量含まれているものが好ましいとされている。こ
のような絶縁膜は主にプラズマCVD法(化学気相堆積
法)で成膜されている。通常原料ガスとして、シラン−
窒素系、シラン−アンモニア−窒素系、シラン−アンモ
ニア−水素系、シラン−窒素−水素系、さらにはシラン
−アンモニア−窒素−水素系が用いられる。
【0008】しかるに、このような窒化珪素絶縁膜をゲ
ート絶縁膜3aや多層配線の交差部の層間絶縁膜3bと
して用いたTFTに代表される電子素子では、ゲート電
極9、ゲート配線10と、絶縁膜を介して形成されてい
る配線(ソース配線12、ソース電極11等)との間で
電気的短絡が生ずる場合がある。特に、高集積度あるい
は大面積基板においてはかかる短絡の確率は非常に高く
なる。かかる短絡は、最終製品の使用中において、ある
いは製造過程において生じる。最終製品の場合にあって
は製品の信頼性の低下を招くという欠点がある。また、
製造工程の場合にあっては歩留まりの低下を招くという
欠点がある。例えば、ソース配線12等を形成後、コン
タクトホール形成等のためにフォトレジスト工程が行わ
れるが、その工程中にソース配線12と、ゲート配線1
0あるいはゲート電極9との間で絶縁破壊が生じること
がある。
ート絶縁膜3aや多層配線の交差部の層間絶縁膜3bと
して用いたTFTに代表される電子素子では、ゲート電
極9、ゲート配線10と、絶縁膜を介して形成されてい
る配線(ソース配線12、ソース電極11等)との間で
電気的短絡が生ずる場合がある。特に、高集積度あるい
は大面積基板においてはかかる短絡の確率は非常に高く
なる。かかる短絡は、最終製品の使用中において、ある
いは製造過程において生じる。最終製品の場合にあって
は製品の信頼性の低下を招くという欠点がある。また、
製造工程の場合にあっては歩留まりの低下を招くという
欠点がある。例えば、ソース配線12等を形成後、コン
タクトホール形成等のためにフォトレジスト工程が行わ
れるが、その工程中にソース配線12と、ゲート配線1
0あるいはゲート電極9との間で絶縁破壊が生じること
がある。
【0009】この欠点は絶縁膜中にピンホールが存在す
ることに起因するとの考えに基づき特開昭58−190
042号公報では、ノンドープのアモルファスシリコン
層15をゲート配線10とソース配線12との交差部に
積層するいわゆる多層絶縁膜構造を採用することにより
上記欠点の解決を図ろうとしている。しかし、この技術
はそもそも絶縁層は一層構造ではなく、多層絶縁膜構造
であることを必須としている以上、製造工程が複雑にな
ることは避け難い。
ることに起因するとの考えに基づき特開昭58−190
042号公報では、ノンドープのアモルファスシリコン
層15をゲート配線10とソース配線12との交差部に
積層するいわゆる多層絶縁膜構造を採用することにより
上記欠点の解決を図ろうとしている。しかし、この技術
はそもそも絶縁層は一層構造ではなく、多層絶縁膜構造
であることを必須としている以上、製造工程が複雑にな
ることは避け難い。
【0010】そこで、一層絶縁層構造であっても絶縁特
性に優れ、しかも容易に製造可能なTFTに代表される
電子素子が望まれる。
性に優れ、しかも容易に製造可能なTFTに代表される
電子素子が望まれる。
【0011】特に、現在、電子素子は過酷な環境下で使
用される頻度が高いため、絶縁膜の絶縁耐圧を6MV/
cm以上保有せしめることが望まれる。また、電子素子
の微細化という観点から絶縁膜の膜厚として500nm
以下、好ましくは200nm〜400nmに抑えること
が望まれている。従って、200nm程度の薄い膜厚で
あっても6MV/cm以上の絶縁耐圧を有する絶縁膜を
有する素子が望まれる。
用される頻度が高いため、絶縁膜の絶縁耐圧を6MV/
cm以上保有せしめることが望まれる。また、電子素子
の微細化という観点から絶縁膜の膜厚として500nm
以下、好ましくは200nm〜400nmに抑えること
が望まれている。従って、200nm程度の薄い膜厚で
あっても6MV/cm以上の絶縁耐圧を有する絶縁膜を
有する素子が望まれる。
【0012】現在かかる要請に応じることができる電子
素子は開発されていない。
素子は開発されていない。
【0013】
【発明が解決しようとする課題】本発明は、絶縁耐圧が
従来よりも極めて良好である電子素子を提供することを
目的とする。
従来よりも極めて良好である電子素子を提供することを
目的とする。
【0014】また、かかる絶縁膜を、高い歩留まりで安
定して得られる電子素子の製造方法を提供することを目
的とする。
定して得られる電子素子の製造方法を提供することを目
的とする。
【0015】
【課題を解決するための手段】上記課題を解決するため
の本発明の電子素子は、少なくとも表面が絶縁性である
基体の該表面に、導電性の配線パターンが形成されてお
り、前記基体及び前記配線パターンの一部又は全部を覆
って絶縁層が形成されている電子素子において、前記絶
縁層は、少なくとも前記パターンのステップ部付近の酸
素含有量が10atom%以下の窒化珪素膜で構成され
ていることを特徴とする。
の本発明の電子素子は、少なくとも表面が絶縁性である
基体の該表面に、導電性の配線パターンが形成されてお
り、前記基体及び前記配線パターンの一部又は全部を覆
って絶縁層が形成されている電子素子において、前記絶
縁層は、少なくとも前記パターンのステップ部付近の酸
素含有量が10atom%以下の窒化珪素膜で構成され
ていることを特徴とする。
【0016】また、本発明の電子素子の製造方法は、少
なくとも表面が絶縁性である基体の該表面に、導電性の
配線パターンが形成されており、前記基体及び前記配線
パターンの一部又は全部が窒化珪素絶縁層により覆われ
た電子素子の製造方法において、前記窒化珪素絶縁層
を、成膜温度T(℃)、イオンフラックスI(A)、成
膜速度v(nm/min)としたとき、 T≧−651(I/v)+390 150≦ T≦350 (但し、イオンフラックスは60x60cm2当たりの
電流量(A)を示す)の関係式を満たす条件で成膜する
ことを特徴とする。
なくとも表面が絶縁性である基体の該表面に、導電性の
配線パターンが形成されており、前記基体及び前記配線
パターンの一部又は全部が窒化珪素絶縁層により覆われ
た電子素子の製造方法において、前記窒化珪素絶縁層
を、成膜温度T(℃)、イオンフラックスI(A)、成
膜速度v(nm/min)としたとき、 T≧−651(I/v)+390 150≦ T≦350 (但し、イオンフラックスは60x60cm2当たりの
電流量(A)を示す)の関係式を満たす条件で成膜する
ことを特徴とする。
【0017】
【作用】本発明は、従来の電子素子の基本的見直しを行
う中で発見した事実に基づいて完成したものである。
う中で発見した事実に基づいて完成したものである。
【0018】即ち、窒化珪素絶縁膜に関し、従来の高い
絶縁耐圧が安定して得られない理由として、主に、配線
パターンのステップ部における局所的な膜の欠陥・欠損
等によるものと考えられてきたが、本発明者は、新たに
膜中それもステップ部周辺の酸素含有量が絶縁耐圧に大
きく影響することを見いだした。
絶縁耐圧が安定して得られない理由として、主に、配線
パターンのステップ部における局所的な膜の欠陥・欠損
等によるものと考えられてきたが、本発明者は、新たに
膜中それもステップ部周辺の酸素含有量が絶縁耐圧に大
きく影響することを見いだした。
【0019】絶縁耐圧と膜中酸素含有量との関係は従来
全く考慮されておらず、特にステップ周辺に高濃度の酸
素を含む領域が形成されること及びこの高濃度酸素領域
が絶縁耐圧を低下させる原因となることは全く知られて
いなかった。
全く考慮されておらず、特にステップ周辺に高濃度の酸
素を含む領域が形成されること及びこの高濃度酸素領域
が絶縁耐圧を低下させる原因となることは全く知られて
いなかった。
【0020】現在のところ、ステップ部周辺で酸素が高
濃度に含まれる理由及びこれが絶縁耐圧を低下させる理
由については明かではないが、酸素含有量を10ato
m%以下にすることにより、絶縁耐圧を6MV/cm以
上の高耐圧の絶縁膜とすることができ、高特性で信頼性
の高い電子素子を提供することが可能となる。また、容
易に高耐圧とすることができるため、設計の自由度が増
し、TFTのみならず広範囲の電子素子に応用すること
ができる。
濃度に含まれる理由及びこれが絶縁耐圧を低下させる理
由については明かではないが、酸素含有量を10ato
m%以下にすることにより、絶縁耐圧を6MV/cm以
上の高耐圧の絶縁膜とすることができ、高特性で信頼性
の高い電子素子を提供することが可能となる。また、容
易に高耐圧とすることができるため、設計の自由度が増
し、TFTのみならず広範囲の電子素子に応用すること
ができる。
【0021】一方、ステップ部周辺の酸素含有量の少な
い窒化珪素絶縁膜は、プラズマCVD法の成膜温度T
(℃)、イオンフラックスI(A)及び成膜速度v(n
m/min)を適正化することにより得ることができ
る。
い窒化珪素絶縁膜は、プラズマCVD法の成膜温度T
(℃)、イオンフラックスI(A)及び成膜速度v(n
m/min)を適正化することにより得ることができ
る。
【0022】即ち、以上の3つのパラメータを次式で示
す範囲に設定して成膜することにより、高絶縁耐圧の窒
化珪素絶縁膜が形成できる。
す範囲に設定して成膜することにより、高絶縁耐圧の窒
化珪素絶縁膜が形成できる。
【0023】T≧−651(I/v)+390 ここで、イオンフラックスIは、特願平2−25284
7号に記載された通りであり、 I=Pwrf/Vpp Pwrf:RF電極に入力される電力 Vpp:RF電極にかかる高周波電位の最大値及び最小
値の差(ピーク・ツー・ピーク値) で定義される量である。本発明において、イオンフラッ
クスは、RF電極の大きさ60x60cm2で規格化し
てある。
7号に記載された通りであり、 I=Pwrf/Vpp Pwrf:RF電極に入力される電力 Vpp:RF電極にかかる高周波電位の最大値及び最小
値の差(ピーク・ツー・ピーク値) で定義される量である。本発明において、イオンフラッ
クスは、RF電極の大きさ60x60cm2で規格化し
てある。
【0024】かかる条件で成膜することにより、イオン
が効果的に膜堆積に寄与し、ステップ部周辺の酸素含有
量の少ない窒化珪素膜が得られるものと考えられる。
が効果的に膜堆積に寄与し、ステップ部周辺の酸素含有
量の少ない窒化珪素膜が得られるものと考えられる。
【0025】なお、成膜温度が350℃を越えると、基
板が変形や電子素子の他の製造工程で形成した膜等の応
力歪による亀裂が発生したりする場合があるため、成膜
温度は350℃以下がよい。また、150℃より低い温
度では、高耐圧膜の形成に要求されるイオンフラックス
量が非常に大きくなり、あるいは成膜速度を小さくせね
ばならず、装置上及び生産性に問題を生じるため、成膜
温度は150℃以上がよい。
板が変形や電子素子の他の製造工程で形成した膜等の応
力歪による亀裂が発生したりする場合があるため、成膜
温度は350℃以下がよい。また、150℃より低い温
度では、高耐圧膜の形成に要求されるイオンフラックス
量が非常に大きくなり、あるいは成膜速度を小さくせね
ばならず、装置上及び生産性に問題を生じるため、成膜
温度は150℃以上がよい。
【0026】
【実施態様例】以下に本発明の構成を実施態様例ととも
に分説する。 (電子素子)本発明で対象とする電子素子は、少なくと
も表面が絶縁性である基体の該表面に、導電性の配線パ
ターンが形成されており、前記基体及び前記配線パター
ンの一部又は全部を覆って窒化珪素絶縁膜が形成されて
いる電子素子である。
に分説する。 (電子素子)本発明で対象とする電子素子は、少なくと
も表面が絶縁性である基体の該表面に、導電性の配線パ
ターンが形成されており、前記基体及び前記配線パター
ンの一部又は全部を覆って窒化珪素絶縁膜が形成されて
いる電子素子である。
【0027】かかる電子素子としては、例えば、TFT
素子、容量素子、発光素子、光センサー、太陽電池等が
あげられる。
素子、容量素子、発光素子、光センサー、太陽電池等が
あげられる。
【0028】なお、基体は少なくとも表面が絶縁性であ
ればよく、それ自身が絶縁性である基体(例えば、ガラ
ス等のセラミック基板)をそのまま使用してもよいし、
導電性基体、半導体基板の表面上に絶縁膜(例えば、S
iO2膜、Si3N4等)を形成したものを使用してもよ
い。電子素子の種類により適宜選択すればよい。
ればよく、それ自身が絶縁性である基体(例えば、ガラ
ス等のセラミック基板)をそのまま使用してもよいし、
導電性基体、半導体基板の表面上に絶縁膜(例えば、S
iO2膜、Si3N4等)を形成したものを使用してもよ
い。電子素子の種類により適宜選択すればよい。
【0029】導電線の配線パターンとしては、その材料
は特に限定されないが、例えばCr,Al,Cu、その
他の金属あるいは合金が適宜用いられる。また、配線パ
ターンの線幅は、ゲート電極では10μm以下が好まし
く、7μm以下がより好ましく、5μmが最も好まし
い。厚さは材料の導電率によって変わるが、Crの場
合、100〜200nmが好ましい。この範囲とすると
TFTアレイ上の配向膜表面の段差を少なくすることが
でき、LCDの表示性能の改善を図ることもできる。 (配線パターンステップ部の角度)本発明では、配線パ
ターンが基板表面となす接触角度θを60°〜90°で
も高い絶縁特性が得られる。
は特に限定されないが、例えばCr,Al,Cu、その
他の金属あるいは合金が適宜用いられる。また、配線パ
ターンの線幅は、ゲート電極では10μm以下が好まし
く、7μm以下がより好ましく、5μmが最も好まし
い。厚さは材料の導電率によって変わるが、Crの場
合、100〜200nmが好ましい。この範囲とすると
TFTアレイ上の配向膜表面の段差を少なくすることが
でき、LCDの表示性能の改善を図ることもできる。 (配線パターンステップ部の角度)本発明では、配線パ
ターンが基板表面となす接触角度θを60°〜90°で
も高い絶縁特性が得られる。
【0030】配線パターンの接触角度を60°未満とし
て窒化珪素絶縁膜を被覆すれば、電極間の絶縁耐圧は良
好になるが、電極の線幅あるいは厚さのいずれかを必要
以上に大きくとらざるを得なくなる。けだし、電極ある
いは配線の発熱等を防止するためには、所定以上の断面
積の確保が必要であるが、60°未満の接触角度を付け
た場合には削られた部分を補填するために線幅を広くす
るか、厚さを厚くせざるをえないからである。
て窒化珪素絶縁膜を被覆すれば、電極間の絶縁耐圧は良
好になるが、電極の線幅あるいは厚さのいずれかを必要
以上に大きくとらざるを得なくなる。けだし、電極ある
いは配線の発熱等を防止するためには、所定以上の断面
積の確保が必要であるが、60°未満の接触角度を付け
た場合には削られた部分を補填するために線幅を広くす
るか、厚さを厚くせざるをえないからである。
【0031】電極の線幅あるいは厚さのいずれかを必要
以上に大きくとることは素子の微細化の要請に反する。
特に、液晶の表示素子の駆動に用いられるTFTの場合
には、外部光が電極(配線)により遮蔽される面積を小
さくするために線幅を7μm以下とすることが望まれる
がその要請に反する。
以上に大きくとることは素子の微細化の要請に反する。
特に、液晶の表示素子の駆動に用いられるTFTの場合
には、外部光が電極(配線)により遮蔽される面積を小
さくするために線幅を7μm以下とすることが望まれる
がその要請に反する。
【0032】そのために60°以上とすることが要請さ
れる。しかるに、従来は、60°以上になると絶縁特性
の悪化が著しくなるという問題が生じたが、本発明はま
さにかかる問題を解決するものにほかならない。
れる。しかるに、従来は、60°以上になると絶縁特性
の悪化が著しくなるという問題が生じたが、本発明はま
さにかかる問題を解決するものにほかならない。
【0033】なお、60°以上に制御するのは、例え
ば、ウエットエッチング又はドライエッチングで異方性
エッチングを行えばよい。 (絶縁層膜厚)本発明において、電子素子の高集積化及
び高速動作の観点から、絶縁膜の厚さは500nm以下
が好ましく、200〜400nmがより好ましい。20
0nmという薄い場合であっても6MV/cmV以上の
絶縁耐圧を示し得ることに大きな特徴がある。
ば、ウエットエッチング又はドライエッチングで異方性
エッチングを行えばよい。 (絶縁層膜厚)本発明において、電子素子の高集積化及
び高速動作の観点から、絶縁膜の厚さは500nm以下
が好ましく、200〜400nmがより好ましい。20
0nmという薄い場合であっても6MV/cmV以上の
絶縁耐圧を示し得ることに大きな特徴がある。
【0034】
【実施例】以下に本発明の実施例を挙げて詳細に説明す
る。なお、当然のことではあるが、本発明の範囲は以下
の実施例に限定されるものではない。
る。なお、当然のことではあるが、本発明の範囲は以下
の実施例に限定されるものではない。
【0035】実施例では、TFTを用いたアクティブマ
トリクス液晶表示素子におけるTFTの多層金属配線の
交差部に本発明を適用した例を示す。
トリクス液晶表示素子におけるTFTの多層金属配線の
交差部に本発明を適用した例を示す。
【0036】本実施例におけるTFTは逆スタガ構造で
あり、図1及び図2に基づき説明する。
あり、図1及び図2に基づき説明する。
【0037】ガラス基板(コーニング#7059)5の
表面に、ITOを成膜後、パターニングを行い画素電極
となる透明電極(ITO電極)7を形成した。
表面に、ITOを成膜後、パターニングを行い画素電極
となる透明電極(ITO電極)7を形成した。
【0038】次いで、Cr膜を厚さ100nmで成膜
し、次いで、レジストの塗布・現像後、エッチングによ
り、線幅5μmのゲート配線10と、線幅7μmのゲー
ト電極9を形成した。
し、次いで、レジストの塗布・現像後、エッチングによ
り、線幅5μmのゲート配線10と、線幅7μmのゲー
ト電極9を形成した。
【0039】エッチングに際しては、ウエットエッチン
グ又はドライエッチングの異方性をを制御することによ
り、基板5とゲート配線10あるいはゲート電極9との
角度を制御した。本例では、その角度をほぼ90°とし
た。
グ又はドライエッチングの異方性をを制御することによ
り、基板5とゲート配線10あるいはゲート電極9との
角度を制御した。本例では、その角度をほぼ90°とし
た。
【0040】次に、プラズマCVD法により窒化珪素絶
縁膜を基板5及びゲート電極9、ゲート配線10を覆う
ように窒化珪素膜を形成した。成膜は、以下に示す種々
の条件で行った。この窒化珪素絶縁膜は、TFTのゲー
ト絶縁膜及び層間絶縁膜となる。
縁膜を基板5及びゲート電極9、ゲート配線10を覆う
ように窒化珪素膜を形成した。成膜は、以下に示す種々
の条件で行った。この窒化珪素絶縁膜は、TFTのゲー
ト絶縁膜及び層間絶縁膜となる。
【0041】(窒化珪素絶縁膜の形成条件) 成膜装置:アネルバ社製平行平板型インラインタイプ RF電極面積:60x60cm2 導入ガス(sccm) SiH4: 50 NH3 :150 N2 :500 Ar :500 圧力:150Pa 基板温度:150〜400℃ RF電力:100〜500W 励起周波数:13.56MHz 膜厚:200nm、300nm 次いで、不純物を添加しないアモルファスシリコンより
なる半導体層(i:a−Si層)15を約100nmの
厚さに常法により成膜し、続いて同一チャンバー内でオ
ーミックコンタクト層17としてPを添加したアモルフ
ァスシリコン層(n+:a−Si層)を約20nm積層
した。
なる半導体層(i:a−Si層)15を約100nmの
厚さに常法により成膜し、続いて同一チャンバー内でオ
ーミックコンタクト層17としてPを添加したアモルフ
ァスシリコン層(n+:a−Si層)を約20nm積層
した。
【0042】レジスト工程後、TFTのチャネル部のみ
を残し、他の部分のアモルファスシリコン膜をウエット
エッチングにより除去した。エッチング液はHFを含む
エッチャントにより行った。この時アモルファスシリコ
ン膜を除去することによって露出した窒化珪素膜表面は
オーバーエッチングの時間、エッチング液に晒されてお
り、わずかにエッチングされる。
を残し、他の部分のアモルファスシリコン膜をウエット
エッチングにより除去した。エッチング液はHFを含む
エッチャントにより行った。この時アモルファスシリコ
ン膜を除去することによって露出した窒化珪素膜表面は
オーバーエッチングの時間、エッチング液に晒されてお
り、わずかにエッチングされる。
【0043】次に、レジスト工程後透明電極(ITO)
7に達するコンタクトホールを形成した。このコンタク
トホールはドライエッチングにより形成した。
7に達するコンタクトホールを形成した。このコンタク
トホールはドライエッチングにより形成した。
【0044】次に、Cr膜を300nm成膜し、パター
ニングによりソース電極11及びソース配線12並びに
ドレイン電極13及びドレイン配線18を形成した。な
お、本実施例では、図2に示すように、ソース配線12
はゲート配線10上を横切るように設計した。また、透
明電極(ITO)7上の適宜の位置に設けたコンタクト
ホールを介してドレイン配線18と透明電極7とを接続
した。なお、このTFTのチャネル長は4μmとし、チ
ャネル幅は6μmとした。
ニングによりソース電極11及びソース配線12並びに
ドレイン電極13及びドレイン配線18を形成した。な
お、本実施例では、図2に示すように、ソース配線12
はゲート配線10上を横切るように設計した。また、透
明電極(ITO)7上の適宜の位置に設けたコンタクト
ホールを介してドレイン配線18と透明電極7とを接続
した。なお、このTFTのチャネル長は4μmとし、チ
ャネル幅は6μmとした。
【0045】[評価試験]以上の種々の条件で作製した
TFT素子について、絶縁耐圧を測定し、これと成膜条
件から得られるイオンフラックスと成膜速度の比(I/
v)との関係を調べた。結果を図3に示す。なお、絶縁
耐圧の測定は、ヒューレットパッカード社製の#414
2Bを用い、ゲート電極とドレイン電極との間に電圧を
印加することにより行った。
TFT素子について、絶縁耐圧を測定し、これと成膜条
件から得られるイオンフラックスと成膜速度の比(I/
v)との関係を調べた。結果を図3に示す。なお、絶縁
耐圧の測定は、ヒューレットパッカード社製の#414
2Bを用い、ゲート電極とドレイン電極との間に電圧を
印加することにより行った。
【0046】図3が示すように、各成膜温度において
も、I/vの増加にともない耐圧は増加し、これを適当
な値以上とすると6MV/cm以上の耐圧が得られるこ
とが分かる。
も、I/vの増加にともない耐圧は増加し、これを適当
な値以上とすると6MV/cm以上の耐圧が得られるこ
とが分かる。
【0047】図3の耐圧が6MV/cmとなる点を、成
膜温度TとI/vについてプロットしたのが図4の直線
(1)である。図4の直線は、傾き651(℃・nm/
A・min)、切片390(℃)の直線であり、この直
線の上方(原点と反対側)で成膜すると耐圧6MV/c
m以上の窒化珪素膜が得られることを示している。
膜温度TとI/vについてプロットしたのが図4の直線
(1)である。図4の直線は、傾き651(℃・nm/
A・min)、切片390(℃)の直線であり、この直
線の上方(原点と反対側)で成膜すると耐圧6MV/c
m以上の窒化珪素膜が得られることを示している。
【0048】また、成膜温度400℃では、ガラス基板
の歪やゲート電極の応力歪により、膜に微小な亀裂が生
じる場合があった。したがって、実用上6MV/cmの
耐圧が得られるのは、図4で直線(1)と(2)で囲ま
れた領域となる。
の歪やゲート電極の応力歪により、膜に微小な亀裂が生
じる場合があった。したがって、実用上6MV/cmの
耐圧が得られるのは、図4で直線(1)と(2)で囲ま
れた領域となる。
【0049】次に、種々の耐圧を有する試料について、
窒化珪素絶縁膜中の酸素含有量と絶縁耐圧の関係を調べ
た。透過型電子顕微鏡及びエネルギー分散型X線分析計
(VG社製HB501)を用いて、ステップ部の断面T
EM像を観察するとともに、酸素含有量を測定した。
窒化珪素絶縁膜中の酸素含有量と絶縁耐圧の関係を調べ
た。透過型電子顕微鏡及びエネルギー分散型X線分析計
(VG社製HB501)を用いて、ステップ部の断面T
EM像を観察するとともに、酸素含有量を測定した。
【0050】一例として、耐圧0.8MV/cmの窒化
珪素絶縁膜の酸素含有量を図5の模式的断面図に示す。
図5が示すように、斜線で示したステップ部付近では、
他の領域に比べ高濃度の酸素が検出されることが分かっ
た。このステップ部付近の酸素含有量と絶縁耐圧との関
係をプロットしたのが図6である。
珪素絶縁膜の酸素含有量を図5の模式的断面図に示す。
図5が示すように、斜線で示したステップ部付近では、
他の領域に比べ高濃度の酸素が検出されることが分かっ
た。このステップ部付近の酸素含有量と絶縁耐圧との関
係をプロットしたのが図6である。
【0051】図から明らかなように、ステップ部付近の
酸素含有量が10atom%を越えると、耐圧が6MV
/cmから急激に低下することが分かる。逆に、酸素含
有量を10atom%以下に抑えれば、6MV/cm以
上の絶縁耐圧が得られることが分かる。
酸素含有量が10atom%を越えると、耐圧が6MV
/cmから急激に低下することが分かる。逆に、酸素含
有量を10atom%以下に抑えれば、6MV/cm以
上の絶縁耐圧が得られることが分かる。
【0052】(他の特性)本実施例で作製したTFTの
内、耐圧6MV/cm以上の窒化珪素絶縁膜を有するT
FTは、安定して以下の特性を示し、長時間の連続使用
においても何等特性が低下することはなかった。
内、耐圧6MV/cm以上の窒化珪素絶縁膜を有するT
FTは、安定して以下の特性を示し、長時間の連続使用
においても何等特性が低下することはなかった。
【0053】
【0054】
【発明の効果】本発明によれば、絶縁耐圧が6MV/c
m以上の高耐圧絶縁膜が安定して且つ容易に形成できる
ため、高特性で信頼性の高い電子素子を高い歩留まりで
製造することが可能となる。
m以上の高耐圧絶縁膜が安定して且つ容易に形成できる
ため、高特性で信頼性の高い電子素子を高い歩留まりで
製造することが可能となる。
【0055】また、本発明の電子素子は、絶縁耐圧が高
くまた均一であるため、設計の自由度が増し、広範囲な
応用が可能となる。
くまた均一であるため、設計の自由度が増し、広範囲な
応用が可能となる。
【図1】実施例において製造したTFTを示す平面図で
ある。
ある。
【図2】図1の−’断面図である。
【図3】窒化珪素絶縁膜の絶縁耐圧とイオンフラックス
(I)/成膜速度(v)との関係を示すグラフである。
(I)/成膜速度(v)との関係を示すグラフである。
【図4】高耐圧絶縁膜が得られる成膜条件を示すグラフ
である。
である。
【図5】ステップ部のTEM像と酸素含有量の分布を示
す模式図である。
す模式図である。
【図6】ステップ部の酸素含有量と絶縁耐圧の関係を示
すグラフである。
すグラフである。
【図7】従来例に係るTFTを示す平面図である。
【図8】図7の−’断面図である。
1 チャネル部、 3 絶縁膜、 3a ゲート絶縁膜、 3b 交差部の層間絶縁膜、 5 基板、 7 透明電極(ITO電極)、 9 ゲート電極、 10 ゲート配線、 11 ソース電極、 12 ソース配線、 13 ドレイン電極、 15 a−Si、 17 n+−a−Si、 18 ドレイン配線。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 大場 知文 東京都大田区雪谷大塚町1番7号アルプス 電気株式会社内 (72)発明者 岩崎 千里 東京都大田区雪谷大塚町1番7号アルプス 電気株式会社内 (72)発明者 笠間 泰彦 東京都大田区雪谷大塚町1番7号アルプス 電気株式会社内 (72)発明者 大見 忠弘 宮城県仙台市青葉区米ケ袋2の1の17の 301
Claims (6)
- 【請求項1】 少なくとも表面が絶縁性である基体の該
表面に、導電性の配線パターンが形成されており、前記
基体及び前記配線パターンの一部又は全部を覆って絶縁
層が形成されている電子素子において、前記絶縁層は、
少なくとも前記パターンのステップ部付近の酸素含有量
が10atom%以下の窒化珪素膜で構成されているこ
とを特徴とする電子素子。 - 【請求項2】 前記絶縁層は、プラズマCVD法で形成
されたことを特徴とする請求項1に記載の電子素子。 - 【請求項3】 前記絶縁層の層厚は、200nm〜40
0nmであることを特徴とする請求項1または2に記載
の電子素子。 - 【請求項4】 前記配線パターンの前記基体との接触角
度θは60°〜90°であることを特徴とする請求項1
〜3のいずれか1項に記載の電子素子。 - 【請求項5】 前記電子素子は、逆スタガ型の薄膜トラ
ンジスタであり、前記配線パターンはゲート配線であ
り、前記窒化珪素膜はゲート絶縁膜であることを特徴と
する請求項1〜4のいずれか1項に記載の電子素子。 - 【請求項6】 少なくとも表面が絶縁性である基体の該
表面に、導電性の配線パターンが形成されており、前記
基体及び前記配線パターンの一部又は全部が窒化珪素絶
縁層により覆われた電子素子の製造方法において、前記
絶縁層をプラズマCVD法により、成膜温度T(℃)、
イオンフラックスI(A)、成膜速度v(nm/mi
n)としたとき、 T≧−651(I/v)+390 150≦ T≦350 (但し、イオンフラックスは60x60cm2当たりの
電流量(A)を示す)の関係式を満たす条件で成膜する
ことを特徴とする電子素子の製造方法。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6106935A JP2752582B2 (ja) | 1994-05-20 | 1994-05-20 | 電子素子及びその製造方法 |
KR1019950010964A KR0171673B1 (ko) | 1994-05-20 | 1995-05-04 | 전자소자 및 그 제조방법 |
US08/442,906 US5623161A (en) | 1994-05-20 | 1995-05-17 | Electronic element and method of producing same |
TW084105149A TW278252B (ja) | 1994-05-20 | 1995-05-23 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6106935A JP2752582B2 (ja) | 1994-05-20 | 1994-05-20 | 電子素子及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
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