JPH07226626A - 同期ビデオ検出器用制御発振器 - Google Patents

同期ビデオ検出器用制御発振器

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JPH07226626A
JPH07226626A JP6309320A JP30932094A JPH07226626A JP H07226626 A JPH07226626 A JP H07226626A JP 6309320 A JP6309320 A JP 6309320A JP 30932094 A JP30932094 A JP 30932094A JP H07226626 A JPH07226626 A JP H07226626A
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differential
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    • H03B2200/0098—Functional aspects of oscillators having a balanced output signal

Abstract

(57)【要約】 （修正有） 【目的】 モノリシック集積回路により発振周波数及び
位相を制御できる発振器を提供する。 【構成】 従続差動増巾器は、端子Ｔ２，Ｔ３に外部接
続され、タンク回路と組合わされて、帰還発振を形成
し、その出力はトランジスタＱ５，Ｑ６；Ｑ７、増幅器
Ｑ８により形成される二組のエミッターフォロワーから
二組の矩形波出力として取り出される。他方自動周波数
位相制御（ＡＦＰＣ）入力は端子Ｔ９に接続され、トラ
ンジスタＴ９，Ｔ１０により電流ミラー増幅されて、ト
ランジスターＱ１１，Ｑ１２；Ｑ１３，Ｑ１４により構
成される従続差動増巾器の共通エミッターと接地の間に
入力される。トランジスタＱ１１Ｑ１２のベースは両者
ともターミナルＴ３に接続され、タンク回路に存在する
信号によっても同時に影響される。差動対Ｑ１１Ｑ１２
の出力は同じく差動対Ｑ１３Ｑ１４のエミッターから、
それぞれコンデンサーＣ４，Ｃ５により差動対Ｑ１１，
Ｑ１２及びタンク回路に帰還される。また抵抗Ｒ２９，
Ｒ３０を通して差動対Ｑ１Ｑ２のベースバイアス負荷回
路とも結合される。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、同期ビデオの検出器の
実現に使用され得る発振周波数及び位相を電気的に制御
できる発振器に関する。
【０００２】
【従来の技術】自動周波数及び位相制御（ＡＦＰＣ）を
有する発振器は、例えば同期ビデオ検出器の実現に使用
されている。同一モノリシック集積回路（ＩＣ）の範囲
内で同期ビデオ検出器を複数段ビデオ中間周波数（Ｉ
Ｆ）増幅器として構成することは、典型的な実施例であ
る。同期検出器は、差動モードトランスコンダクタンス
増幅器として動作される第１対のエミッタ結合されたト
ランジスタのコレクタ電流が単極双投電流モードスイッ
チとして動作されるエミッタ結合されたトランジスタの
それぞれの追加対により同期的にスイッチされる“ツリ
ー”タイプが通常的である。このツリータイプの同期検
出器は、少しの変換利得（約２０ｄＢ程度）を有するよ
うに設計されて第１対のエミッタ結合された差動増幅ト
ランジスタのベース電極に増幅されたビデオＩＦ信号を
供給する画像（ＰＩＸ）ＩＦ増幅器内のビデオＩＦ電圧
利得に対する必要性を減少させる。
【０００３】テレビジョン信号受信装置のＩＦフィルタ
リング及び利得機能を実現することと関連して最近の実
施例は、モノリシック集積回路内で直結従属配列された
複数段を含む利得ブロック増幅器の前に集中（ｌｕｍｐ
ｅｄ）または“ブロック”フィルタを使用する。このブ
ロックフィルタは、テレビジョン受信機により獲得され
た隣接チャンネル減衰及び全通過帯域シェープを提供す
るために使用される表面弾性波（ＳＡＷ）フィルタが通
常的である。内部段同調は前記利得ブロックＩＣ増幅器
内に使用されていない。利得ブロックＩＣ増幅器から増
幅されたＩＦ信号は、前記集積回路から４．５ＭＨｚベ
ースバンド複合映像信号及びサウンドＩＦとして現すた
めに、実質に前記モノリシックＩＣ内部で連続的に検出
される。前記増幅されたＩＦ信号は、利得ブロック増幅
器が発振させる再発生の可能性を減少させるためにこの
ような信号からフィルタリングされる。ＳＡＷフィルタ
とブロックフィルタリング及び増幅に対する付加的な情
報は、例えば“ＴＥＬＥＶＩＳＩＯＮ ＥＮＧＩＮＥＥ
ＲＩＮＧ ＨＡＮＤＢＯＯＫ；Ｋ．Ｂｌａｉｒ Ｂｅｎ
ｓｏｎ，Ｅｄｉｔｏｒ ｉｎ Ｃｈｉｅｆ；ＭｃＧｒａ
ｗ−Ｈｉｌｌ Ｂｏｏｋ Ｃｏｍｐａｎｙ，Ｎｅｗ Ｙ
ｏｒｋ；１９８６”という本の第１３章で探すことがで
きる。参考として本明細書に合体され、Ｊａｃｋ Ｒｕ
ｄｏｌｐｈＨａｒｆｏｒｄにより１９９３年６月２４日
付で出願された米国特許出願第０８／０８０，７０５号
の題名“ＰＡＲＡＬＬＥＬ ＵＮＴＵＮＥＤ ＶＩＤＥ
ＯＩＦ ＡＭＰＬＩＦＩＥＲＳ ＳＵＰＰＬＩＥＤ Ｓ
ＩＧＮＡＬＳ ＦＲＯＭＴＶ １ST ＤＥＴＥＣＴＯＲ
ＶＩＡ ＲＥＳＰＥＣＴＩＶＥ ＩＮＰＵＴＦＩＬＴ
ＥＲＳ”は、テレビジョン受信機内のＳＡＷフィルタの
使用及び中間周波数に対する利得ブロック増幅器と関連
した負荷情報を提供する。
【０００４】同期検出器の次にくる利得ブロック構成内
でのビデオＩＦ増幅器を有する従来の集積回路は、以下
の一般的な形態を有する制御発振器を使用してきた。Ｌ
Ｃタンク回路は、飽和した導電とカットオフとの間をス
イッチするために、トランジスタのベース電極への再発
生帰還により過駆動されたトランジスタに対するコレク
タ負荷として動作する。しかしながら、この通常的な配
列は多少の問題点を有している。
【０００５】前記ＬＣタンク回路にかかる電圧信号は本
質的に弱いピーク対ピーク電圧であるので、ビデオＩＦ
増幅器の入力に対する漂流結合が重要になる傾向があ
る。これは、商業的な要求に応答してＩＦ感度がより大
きくなる場合に問題を発生させる。スイッチングされた
トランジスタに対するコレクタ負荷として使用されるＬ
Ｃタンク回路は回路にかかる電圧信号を有し、フィルタ
リンク時に回路からハーモニック成分が除去されるが、
スイッチングされたトランジスタの電流の流れは、前記
集積回路の“グラウンド”接続を通じて不均等に導電さ
れ、若干のハーモニック成分を有する。集積回路がのせ
られるプリント回路ボード上の前記グラウンドパスは、
このハーモニック成分をチューナ反対方向に放射してチ
ャンネル−８受信等を有する問題を発生させる。このよ
うな問題は多少の通常モードハーモニック成分が存在す
るので、前記ＬＣタンク回路が、相互に反対位相でスイ
ッチされた一対のトランジスタによりプッシュプルで駆
動される場合にも発生する。
【０００６】発明者は、チューナー及びＩＦ増幅器の入
力ポートの反対方向に放射される問題を最少化するため
に、前記レベルが最高に位置するより最低に位置する場
合にＬＣタンク回路が回路の一部になる発振器を講じ
た。集積回路に対する動作供給バス上に現れる発振及び
ハーモニックスを減少させるために、発明者はバランス
された構成を有する発振器を講じた。構成内での一対の
エミッタ結合されたバイポーラトランジスタを使用する
所謂“ロングテール対”形態の差動増幅器は、モノリシ
ック集積回路内に挿入するに適当な平衡構成を有する有
利な回路である。前記ＬＣタンク回路をコレクタ電極間
に位置させるよりは、むしろ、エミッタ結合されたトラ
ンジスタのベース電極間に位置させることが入力バイア
ッシングを簡略にし、タンクコイルを通じる低抵抗経路
をし実質に同一な直流電位にベース電極を維持せしめ
る。
【０００７】
【発明が解決しようとする課題】本発明の目的は、モノ
リシック集積回路内に一部として構成される発振器を提
供することにある。本発明の他の目的は、モノリシック
集積回路内に一部として構成された制御発振器を提供す
ることにある。
【０００８】
【課題を解決するための手段】このような目的を達成す
るために本発明は、差動入力、差動出力及び差動増幅器
は前記モノリシック集積回路内に位置する。この差動増
幅器は外部素子と連結不能な第１及び第２出力端を有
し、外部素子と連結可能な第１及び第２入力端を有す
る。モノリシック集積回路内に位置した第１抵抗分圧器
は、前記差動増幅器の第１出力端に現れる電位を所定比
に分けて前記差動増幅器の第１入力端にその分けられた
電位を印加するために連結される。それにより第１直結
再発生帰還連結を達成する。前記モノリシック集積回路
内に位置した第２抵抗分圧器は、前記差動増幅器の第２
出力端に現れる電位を同一な所定比に分けて前記差動増
幅器の第２入力端にその分けられた電位を印加するため
に連結される。それにより第２直結再発生帰還連結を達
成する。前記モノリシック集積回路の外部に位置したイ
ンダクタは、前記差動増幅器の第１及び第２入力端にそ
れぞれ連結された巻線の第１及び第２終端を有する。キ
ャパシタは、前記発振器からの元の発振周波数を決定し
たり、あるいは決定することを助ける反共振回路を前記
インダクタと共に形成するために、前記差動増幅器の第
１及び第２入力端にそれぞれ連結された第１及び第２プ
レートを有する。このキャパシタは、前記モノリシック
集積回路の外部または内部に位置されることができ、ま
た、前記モノリシック集積回路の内部に位置した第１成
分キャパシタと前記モノリシック集積回路の外部に位置
した第２成分キャパシタとを並列にすることにより形成
されることができる。
【０００９】
【実施例】図１は、示されていないモノリシック集積回
路内の構成に適合な制御発振器を他の回路と共に示す。
前記モノリシック集積回路の端子Ｔ１及びＴ２は、バッ
テリとして示される動作電圧Ｂから相対的な負動作供給
電圧Ｂ−及び相対的な正動作供給電圧Ｂ＋をそれぞれ受
信するために示されるが、家庭用メインからのステップ
ダウンインポテンシャル（ｓｔｅｐｐｅｄ−ｄｏｗｎ−
ｉｎ−ｐｏｔｅｎｔｉａｌ）交流電流を整流してフィル
タリングすることにより、一般的に供給される。モノリ
シック集積回路の基板には相対的な負動作供給電圧が印
加されるが、この負動作供給電圧を“グラウンド”電位
と称する。端子Ｔ２での相対的に正の動作供給電圧Ｂ＋
は例えばほぼ９Ｖであり、“動作”電位と称する。端子
Ｔ３及びＴ４は、前記モノリシック集積回路の外部に位
置した発振器タンクコイルＬ１間に連結される。端子Ｔ
５及びＴ６は発振器の発振に応答する第１セットのプッ
シュプル矩形波を提供し、端子Ｔ７及びＴ８は発振器の
発振に応答する第２セットのプッシュプル矩形波を提供
する。前記発振器の通常な４５．７５ＭＨｚの周波数及
び位相は、端子Ｔ９に印加される自動周波数位相制御
（ＡＦＰＣ）信号電圧により後述する方法をもって制御
される。
【００１０】発振器タンクコイルＬ１は、キャパシタＣ
１と、前記キャパシタＣ１に並列である他のキャパシタ
との結合されたキャパシタンスに対して同調を行なう。
前記他のキャパシタは前記モノリシック集積回路内に位
置する。この並列である他のキャパシタ中の一つは、前
記端子Ｔ３及びＴ４をグラウンドに分ける漂遊キャパシ
タＣ２及びＣ３の直列キャパシタンスである。この並列
である他のキャパシタ中のまた一つは、前記端子Ｔ９に
印加されるＡＦＰＣ信号に応答してミラー効果により制
御可能に乗算されるキャパシタＣ４及びＣ５の直列キャ
パシタンスである。前記キャパシタＣ４及びＣ５は、メ
タル絶縁半導体（ＭＩＳ）構造になっている。
【００１１】以下でより詳細に説明する。約１２５ｍＶ
のピーク対ピークの４５．７５ＭＨｚ発振は前記端子Ｔ
３及びＴ４間に連結された発振器タンクに亘って持続さ
れ、それぞれのＮＰＮトランジスタＱ１及びＱ２のベー
ス電極に連結される。前記タンクコイルＬ１の巻線を通
じる低抵抗経路は、実質に同一な直流電位に前記ＮＰＮ
トランジスタＱ１及びＱ２のベース電極を維持させる。
結合抵抗Ｒ１は、トランジスタＱ１及びＱ２の相互連結
されたエミッタからＩＣのグラウンドまでを連結させ
る。抵抗Ｒ２及びＲ３はそれぞれＮＰＮトランジスタＱ
１及びＱ２にコレクタ負荷を提供し、そのコレクタから
ノードＮ１までを連結させる。降下用抵抗Ｒ４は供給端
Ｔ２を前記ノードＮ１に連結し、それぞれＢ＋に対して
減少した正動作電位（例えば７．３Ｖ）を前記ノードＮ
１に提供する。トランジスタＱ１及びＱ２は、それらの
ベース電極間の発振を１．２Ｖのピーク対ピーク発振に
増幅するためにエミッタ結合された差動増幅器として連
結される。コレクタ電極間のピーク対ピーク発振はＮＰ
ＮトランジスタＱ３及びＱ４のベース電極に連結され
る。トランジスタＱ１及びＱ２を含むエミッタ結合され
た差動増幅器は、ベース電極間の４５．７５ＭＨｚ発振
が約１２５ｍＶのピーク対ピークになるように制限され
るため、線形増幅器として動作する。このスイングは、
トランジスタＱ１及びＱ２のどちらも発振器の動作を遂
行する間に完全に導電されないだけ十分に小さい。結合
抵抗Ｒ１を通じた通常のモード電流の流れは影響力ある
直流電流の流れであり、事実上偶数ハーモニックである
相対的に小さく整流された４５．７５ＭＨｚ発振は、Ｖ
ＨＦテレビジョン帯域の外部にかたよる。
【００１２】またトランジスタＱ３及びＱ４は、それの
相互連結されたエミッタとグラウンドとの間に連結され
た結合抵抗Ｒ５と共にエミッタ結合された差動増幅器と
して連結される。しかしながら、このベース電極間の前
記１．２Ｖのピーク対ピーク駆動はリミッタ動作を発生
させるために十分に大きく、トランジスタＱ３及びＱ４
は抵抗により負荷されたコレクタに現れる矩形波電圧を
生成しながら、このリミッタ動作内で完全な導電及び非
導電に交互的にスイッチングされる。たとえ矩形波電流
を伝導するが、エミッタ結合されたトランジスタＱ３及
びＱ４は平衡ベース（ｂａｓｉｓ）でそれらの電流を伝
導させ、前記ＩＣダイ内に配列される。矩形波電流が供
給レールから隔離することを防止するために、動作供給
レールに対する連結中でそれに相応することは同一なポ
イントである。供給端Ｔ２からトランジスタＱ３及びＱ
４のコレツタまでをそれぞ連結する抵抗Ｒ６及びＲ７
は、前記抵抗負荷の一部を形成する。トランジスタＱ３
及びＱ４のコレクタ間に直列に連結された抵抗Ｒ８，Ｒ
９及びＲ１０は抵抗負荷のまた他の一部を提供する。ト
ランジスタＱ３のコレクタは、それのコレクタとグラウ
ンドとの間に直列に連結された抵抗Ｒ１１，Ｒ１２及び
Ｒ１３を含む抵抗分圧器によりさらに抵抗的に負荷され
る。トランジスタＱ４のコレクタは、それのコレクタと
グラウンドとの間に直列に連結された抵抗Ｒ１４，Ｒ１
５及びＲ１６を含む抵抗分圧器によりさらに抵抗的に負
荷される。これら抵抗分圧器は、それらの間に連結され
たタンク回路内の発振を持続するためにトランジスタＱ
１及びＱ２のそれぞれのベース電極に再発生帰還接続を
提供する。発振器タンクコイルの共振Ｑはそのタンクに
亘る５ｋΩと等価である分路抵抗程度であり、この等価
分路抵抗はより高い程度の差動モード電圧分配を提供
し、トランジスタＱ３及びＱ４に多少強い抵抗コレクタ
負荷を提供する。トランジスタＱ３及びＱ４の抵抗的に
負荷されるコレクタで現れる７００ｍＶのピーク対ピー
ク矩形波電圧は、タンク回路により降下分配されてフィ
ルタリングされ、端子Ｔ３及びＴ４間の約１２０ｍＶの
ピーク対ピーク正弦波電圧を印加する。前記矩形波電圧
は、トランジスタＱ１及びＱ２のベース電極にそれぞれ
連結される。
【００１３】抵抗Ｒ１８，Ｒ１９，Ｒ２０及びＲ２１は
共通コレクタ増幅器ＮＰＮトランジスタＱ５，Ｑ６，Ｑ
７及びＱ８にそれぞれのエミッタ負荷抵抗を供給する。
抵抗的に負荷されるトランジスタＱ３及びＱ４のコレク
タに現れる７００ｍＶのピーク対ピーク矩形波電圧は、
トランジスタＱ５及びＱ６のベース電極に４００ｍＶの
ピーク対ピーク矩形波電圧を供給するために、それらの
間に直列に連結された抵抗Ｒ８，Ｒ９及びＲ１０により
分配される。トランジスタＱ５及びＱ６のそれぞれのエ
ミッタフォロワー動作は、ＡＦＰＣ信号を発振させる回
路に対する今後の応用のために分配された矩形波電圧を
端子Ｔ５及びＴ６に印加する。たとえ矩形波電流を伝導
するが、この二個のエミッタフォロワートランジスタＱ
５及びＱ６は、バランスされたベース上でそれらの電流
を伝導させて前記ＩＣ型内に配列される。矩形波電流が
供給レールから隔離することを防止するこめに、動作供
給レールに対する連結中でそれに相応することは同一な
ポイントである。トランジスタＱ７及びＱ８のそれぞれ
のエミッタフォロワー動作は、モノリシック集積回路内
に構成されることができるので、他の回路に対する今後
の応用において電圧の分配なくてもトランジスタＱ３及
びＱ４のコレクタで現れる７００ｍＶのピーク対ピーク
矩形波電圧を端子Ｔ７及びＴ８に印加する。たとえ矩形
波電流を伝導するが、この二個のエミッタフォロワート
ランジスタＱ７及びＱ８は、バランスされたベース上で
それらの電流を伝導させ前記ＩＣ型内に配列される。こ
れは、矩形波電流が供給レールから隔離することを防止
するために、動作供給レールに対する連結中でそれに相
応することは同一なポイントである。矩形波電流が前記
供給レールで隔離することを防止することは、前記動作
供給接続を通じて発振器での放射及び集積回路での放射
を減少させる。
【００１４】前記発振器のＡＦＰＣを説明する。前述し
たようにキャパシタＣ４及びＣ５のキャパシタンスは、
端子Ｔ９に印加された前記ＡＦＰＣ信号に応答してミラ
ー効果により制御可能に乗算される。前記ＡＦＰＣ信号
は端子Ｔ９に対する電圧として供給され、抵抗Ｒ２２の
一端に印加される。前記抵抗Ｒ２２の他端は、ＮＰＮト
ランジスタＱ９及びＱ１０とそのトランジスタのエミッ
タ逆発生を提供する抵抗Ｒ２３及びＲ２４とを含む電流
ミラー増幅器（ＣＭＡ）の入力接続と連結される。前記
抵抗Ｒ２３及びＲ２４の一端は、前記ＣＭＡの共通接続
を提供するためにグラウンドに連結され、抵抗Ｒ２３及
びＲ２４の他端はそれぞれトランジスタＱ９及びＱ１０
のエミッタに連結される。トランジスタＱ１０のコレク
タは前記ＣＭＡの出力接続になり、これは、端子Ｔ９に
印加される前記ＡＦＰＣ信号電圧に対して比例する電流
を有する。
【００１５】この電流は、ＮＰＮトランジスタＱ１１及
びＱ１２の相互連結されたエミッタからテール電流とし
て回収される。このトランジスタのそれぞれのベース電
極は、発振器タンクを横断する高くなった４５．７５Ｍ
Ｈｚ発振を受信するために端子Ｔ３及びＴ４に連結され
る。トランジスタＱ１及びＱ２のエミッタ結合された差
動増幅接続での増幅を線形化するために、１２５ｍＶの
ピーク対ピークに対して端子Ｔ３及びＴ４間に現れる発
振の振幅に対する調整作業は、トランジスタＱ１１及び
Ｑ１２のエミッタ結合された差動増幅接続での増幅に対
して同様に線形化を提供する。増幅の線形性は、キャパ
シタＣ４及びＣ５のキャパシタンスを乗算するミラー増
幅器であるトランジスタＱ１１及びＱ１２のエミッタ結
合された差動増幅接続の動作に対して必須的である。抵
抗Ｒ２５及びＲ２６は、供給端Ｔ２からトランジスタＱ
１１及びＱ１２のコレクタまでを連結する。抵抗Ｒ２５
及びＲ２６の抵抗値が相互同一であると仮定すると、ト
ランジスタＱ１１及びＱ１２のエミッタ結合された差動
増幅接続の電圧利得は、トランジスタＱ１１及びＱ１２
の相互コンダクタンスと抵抗値との積になる。トランジ
スタＱ１１及びＱ１２の相互コンダクタンスは、相互連
結されたエミッタから回収されたテール電流に対して比
例する。従って、端子Ｔ９に印加される前記ＡＦＰＣ信
号電圧に対して比例するようになる。
【００１６】キャパシタＣ４及びＣ５の第１プレートに
連結される端子Ｔ３及びＴ４間の発振に対してトランジ
スタＱ１１及びＱ１２のコレクタでの増幅された出力
は、共通コレクタ増幅器であるＮＰＮトランジスタＱ１
３及びＱ１４のそれぞれのエミッタフォロワー動作によ
り前記キャパシタの第２プレートに印加される。これ
は、キャパシタＣ４及びＣ５のキャパシタンスを乗算す
るミラー帰還ループ接続を完成させる。これらキャパシ
タンスのミラー乗算量は、トランジスタＱ１１及びＱ１
２のエミッタ結合された差動増幅接続の電圧利得により
制御される。結局、この電圧利得は端子Ｔ９に印加され
るＡＦＰＣ信号電圧により制御される。したがって、キ
ャパシタＣ４及びＣ５のキャパシタンスのミラー乗算及
び発振器タンク回路の同調は、前記端子Ｔ９に印加され
るＡＦＰＣ信号電圧に応答して制御される。
【００１７】抵抗Ｒ２７及びＲ２８は、共通コレクタ増
幅トランジスタＱ１３及びＱ１４のそれぞれにエミッタ
負荷抵抗を提供する。抵抗Ｒ２９はトランジスタＱ１４
のエミッタから相互連結された抵抗Ｒ１１及びＲ１２ま
でを連結し、抵抗Ｒ３０は、トランジスタＱ１３のエミ
ッタから相互連結された抵抗Ｒ１４及びＲ１５までを連
結する。抵抗Ｒ２９及びＲ３０は、ミラー増幅がキャパ
シタＣ４及びＣ５の明らかなキャパシタンスを増加させ
るにつれ発振器利得を増加させる制御された再発生帰還
を提供する。これは、また他のミラー帰還として発生で
きる発振器利得の減衰を補償する。このミラー帰還は本
質的な増加側面からみて逆発生になる。なぜならば、ト
ランジスタＱ１１及びＱ１２のエミッタ結合された差動
増幅接続の制御された電圧利得による帰還効果及び補償
の追跡は、素子のインピーダンス値を適当に調節するこ
とにより自動的に達成されることができるからである。
【００１８】
【発明の効果】本発明は、モノリシック集積回路内に一
部として構成され、発振周波数及び位相を電気的に制御
できる発振器を提供するという効果がある。
【図面の簡単な説明】
【図１】本発明の基本原理を具体化した制御発振器を示
す概略図である。
【符号の説明】
Ｔ１〜Ｔ９ 端子 Ｂ 動作電圧 Ｂ− 負動作供給電圧 Ｂ＋ 正動作供給電圧 Ｌ１ 発振器タンクコイル Ｃ１ キャパシタ Ｃ２〜３ 漂遊キャパシタ Ｃ４〜５ キャパシタ Ｑ１〜１２ トランジスタ Ｌ１ タンクコイル Ｒ１ 結合抵抗 Ｒ２〜Ｒ３０ 抵抗 Ｎ１ ノード ＣＭＡ 電流ミラー増幅器

Claims (7)

    【特許請求の範囲】
  1. 【請求項１】 モノリシック集積回路の内部に一部を構
    成する発振器において、 外部素子と連結可能な第１及び第２入力端及び外部素子
    と連結不可能な第１及び第２出力端を有し、前記第１及
    び第２入力端のそれぞれからの非反転差動モード電圧利
    得及び相応する序数通りの前記出力端中の一つからの前
    記電圧利得を示す前記モノリシック集積回路の内部に設
    置された第１差動入出力の第１差動増幅器と、 前記第１差動増幅器の前記第１出力端に現れる電位を所
    定比で分けて前記第１差動増幅器の前記第１入力端に提
    供するために連結され、前記モノリシック集積回路内に
    位置して第１直結再発生の帰還接続をなす第１抵抗分圧
    器と、 前記第１差動増幅器の前記第２出力端に現れる電位を所
    定比で分けて前記第１差動増幅器の前記第２入力端に提
    供するために連結され、前記モノリシック集積回路内に
    位置して第２直結再発生の帰還接続を達成する第２抵抗
    分圧器と、 前記第１差動増幅器の前記第１及び第２入力端にそれぞ
    れ連結された第１及び第２終端を有する巻線を含み、前
    記モノリシック集積回路の外部に位置するインダクタ
    と、 反共振タンク回路内で前記インダクタに対して同調する
    ためのキャパシティブ手段とよりなることを特徴とする
    発振器。
  2. 【請求項２】 前記第１差動増幅器は、 前記第１差動増幅器の前記第１及び第２入力端にそれぞ
    れ連結されたベース電極と、相互共通連結されたエミッ
    タ電極と、それぞれのコレクタ電極とを有する第１及び
    第２トランジスタと、 前記第１及び第２トランジスタの前記コレクタ電極にそ
    れぞれ直結されたベース電極と、相互共通連結されたエ
    ミッタ電極と、前記第１差動増幅器の前記第１及び第２
    出力端にそれぞれ直結されたコレクタ電極とを有する第
    ３及び第４トランジスタと、 発振器動作を遂行する間に、前記第３及び第４トランジ
    スタが交替に導電する十分に高いそれぞれの負荷抵抗値
    を示す前記第１及び第２トランジスタに対する平衡コレ
    クタ負荷と、 発振器動作を遂行する間に、前記所定比の電圧分配が前
    記第１及び第２トランジスタ中のどちらも完全に導通さ
    れない状態で行われ、前記第１及び第２抵抗分圧器をそ
    れぞれ含む負荷である前記第３及び第４トランジスタに
    対する平衡コレクタ負荷と、を含むことを特徴とする請
    求項１記載の発振器。
  3. 【請求項３】 前記第１差動増幅器の前記第１及び第２
    入力端にそれぞれ連結された第１プレート及びそれぞれ
    の第２プレートを有し、反共振タンク回路内で前記イン
    ダクタに対して同調を行うための前記キャパシティブ手
    段内に含まれる第１及び第２キャパシタと、 前記第１及び第２キャパシタの有効なキャパシタンスを
    乗算するミラー帰還を提供するために、前記第１差動増
    幅器の前記第１及び第２入力端にそれぞれ連結された第
    １及び第２入力端と、前記第１キャパシタの前記第２プ
    レート及び前記第２キャパシタの前記第２プレートにそ
    れぞれ連結された第１及び第２出力端とを有し、前記第
    １及び第２入力端のそれぞれからの反転差動モード電圧
    利得及び相応する手順通りに前記出力端中のいずれか一
    つからの前記電圧利得を現すために、前記集積回路の内
    部に設置された第２差動入出力の第２差動増幅器とを更
    に備えることを特徴とする請求項２記載の発振器。
  4. 【請求項４】 前記発振器は、制御信号に応答して発振
    周波数及び位相が変わることができる形態であり、前記
    制御信号に応答して前記第２差動増幅器により現れる前
    記反転差動モード電圧利得を制御するための手段を含む
    ことを特徴とする請求項３記載の発振器。
  5. 【請求項５】 前記発振器は、前記第２差動増幅器の前
    記第１及び第２出力端から第２及び第１入力端までの信
    号を再発生的に帰還するための手段を含むことを特徴と
    する請求項４記載の発振器。
  6. 【請求項６】 前記第２差動増幅器の前記第１及び第２
    出力端から第２及び第１入力端までの信号を再発生的に
    帰還するための前記手段は、前記第２差動増幅器の前記
    第１及び第２出力端にそれぞれ連結された第１終端と、
    前記第２抵抗分圧器内の一点及び前記第１抵抗分圧器内
    の一点にそれぞれ連結された第２終端とを有する一対の
    追加抵抗を含むことを特徴とする請求項５記載の発振
    器。
  7. 【請求項７】 前記第２差動増幅器は、 前記第２差動増幅器の第１及び第２入力端にそれぞれ連
    結されたベース電極と、相互共通連結されたエミッタ電
    極と、前記第２差動増幅器の前記第１及び第２出力端に
    それぞれ連結したコレクタ電極とを有する第５及び第６
    トランジスタと、 前記第５及び第６トランジスタに対する平衡コレクタ負
    荷と、 前記制御信号に従って前記第５及び第６トランジスタの
    前記エミッタ電極を通じて流れる静止電流を決定し、前
    記第５及び第６トランジスタのそれぞれの相互コンダク
    タンスを決定する手段と、を含むことを特徴とする請求
    項４記載の発振器。
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