JPH0652938B2 - 液晶表示装置 - Google Patents
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- JPH0652938B2 JPH0652938B2 JP61016520A JP1652086A JPH0652938B2 JP H0652938 B2 JPH0652938 B2 JP H0652938B2 JP 61016520 A JP61016520 A JP 61016520A JP 1652086 A JP1652086 A JP 1652086A JP H0652938 B2 JPH0652938 B2 JP H0652938B2
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- G—PHYSICS
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- G09G3/2011—Display of intermediate tones by amplitude modulation
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- Transforming Electric Information Into Light Information (AREA)
- Liquid Crystal (AREA)
Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は例えばテレビの表示に用いられる液晶表示装置
に関するものである。
に関するものである。
［従来の技術］ 現在、液晶テレビが商品化され、その需要が急速に高ま
ってきている。一般に、液晶テレビでは、ＮＴＳＣ式の
テレビ放送が用いられているが、これによると、１秒に
６０フィールドを伝送しており、液晶を交流駆動するた
めに映像信号を１フィールドごとに極性を反転すると、
３０Ｈｚ駆動となってしまう。
ってきている。一般に、液晶テレビでは、ＮＴＳＣ式の
テレビ放送が用いられているが、これによると、１秒に
６０フィールドを伝送しており、液晶を交流駆動するた
めに映像信号を１フィールドごとに極性を反転すると、
３０Ｈｚ駆動となってしまう。
一般に、液晶は、４０Ｈｚ以上で駆動しないと、フリッ
カーが目立つものである。
カーが目立つものである。
そこでフリッカーを除去するものとして特開昭５９−１
５３３８８号に記載された技術がある。これは、１フィ
ールドごとに映像信号と所定の直流電位を切り換えて画
素に供給するようにしたものである。これによると、供
給される信号が１極性のみのため、フリッカーを押える
ことができるのである。
５３３８８号に記載された技術がある。これは、１フィ
ールドごとに映像信号と所定の直流電位を切り換えて画
素に供給するようにしたものである。これによると、供
給される信号が１極性のみのため、フリッカーを押える
ことができるのである。
［発明が解決しようとする問題点］ ところが上記のものでは、画面の上方と下方とでシェー
ディングむらが生じてしまう欠点がある。すなわち、画
面の上方の画素は、ソースラインに映像信号あるいは直
流電位に切り換った直後において信号が書き込まれ、そ
の後ソースラインはその信号状態に保持されるため、画
素に蓄えられた電荷のソースラインへの洩れは比較的す
くなく、あまり問題とはならない。ところが、画面下方
の画素は、フィールド走査の終り頃に映像信号あるいは
直流電位が書き込まれるため、この書込み直後にソース
ラインが直流電位あるいは映像信号に切り換ってしま
い、画素に蓄えられた電位とソースラインの電位との差
が大きいため、電荷の洩れが生じるものである。しかも
ほぼ１フィールド期間に近い時間の間、電荷の洩れがつ
づくため、画面下方では忠実な画像が再生されず、画面
上方とでシェーディングむらを生じてしまうのである。
ディングむらが生じてしまう欠点がある。すなわち、画
面の上方の画素は、ソースラインに映像信号あるいは直
流電位に切り換った直後において信号が書き込まれ、そ
の後ソースラインはその信号状態に保持されるため、画
素に蓄えられた電荷のソースラインへの洩れは比較的す
くなく、あまり問題とはならない。ところが、画面下方
の画素は、フィールド走査の終り頃に映像信号あるいは
直流電位が書き込まれるため、この書込み直後にソース
ラインが直流電位あるいは映像信号に切り換ってしま
い、画素に蓄えられた電位とソースラインの電位との差
が大きいため、電荷の洩れが生じるものである。しかも
ほぼ１フィールド期間に近い時間の間、電荷の洩れがつ
づくため、画面下方では忠実な画像が再生されず、画面
上方とでシェーディングむらを生じてしまうのである。
本発明は、フリッカーおよびシェーディングむらのない
液晶表示装置を提供するものである。
液晶表示装置を提供するものである。
［問題点を解決するための手段］ 本発明は、１フィールド走査期間中に映像信号と所望の
直流電位とを選択的かつ一定の順序で画素に供給するこ
とにより、上記目的を達成するものである。
直流電位とを選択的かつ一定の順序で画素に供給するこ
とにより、上記目的を達成するものである。
［実施例］ 第１図において、１はソースラインを選択するシフトレ
ジスタ、２は映像信号のサンプルホールド回路、Ｓ11，
Ｓ12…およびＳ21，Ｓ22…はソースラインＳに映像信号
および所望の直流電位ＶＨを選択的に供給するためのス
イッチング素子である。３は後に詳述するゲートドライ
バ、４はタイミングの制御回路である。Ｌ11，Ｌ12…は
液晶からなる画素、Ｍ11，Ｍ12…はスイッチング素子で
ある。
ジスタ、２は映像信号のサンプルホールド回路、Ｓ11，
Ｓ12…およびＳ21，Ｓ22…はソースラインＳに映像信号
および所望の直流電位ＶＨを選択的に供給するためのス
イッチング素子である。３は後に詳述するゲートドライ
バ、４はタイミングの制御回路である。Ｌ11，Ｌ12…は
液晶からなる画素、Ｍ11，Ｍ12…はスイッチング素子で
ある。
つぎに第２図のタイムチャートを参照しながら動作につ
いて説明する。制御回路４には第２図示の垂直同期信号
Ｖ・ＳＹＮＣおよび水平同期信号Ｈ・ＳＹＮＣが供給さ
れており、これからのタイミング信号によってシフトレ
ジスタ１およびゲートドライバ３の動作が制御される。
まずシフトレジスタ１からの出力によって１水平走査ご
とに映像信号がサンプルホールド回路２にサンプルホー
ルドされる。この映像信号はバッファアンプＳ11，Ｓ12
…に供給されている。
いて説明する。制御回路４には第２図示の垂直同期信号
Ｖ・ＳＹＮＣおよび水平同期信号Ｈ・ＳＹＮＣが供給さ
れており、これからのタイミング信号によってシフトレ
ジスタ１およびゲートドライバ３の動作が制御される。
まずシフトレジスタ１からの出力によって１水平走査ご
とに映像信号がサンプルホールド回路２にサンプルホー
ルドされる。この映像信号はバッファアンプＳ11，Ｓ12
…に供給されている。
一方、スイッチング素子Ｓ21，Ｓ22…には所望の直流電
位ＶＨが供給されている。この直流電位ＶＨと映像信号
とは第２図Ｂに示したパルスによって、１水平走査期間
中に１回ずつ切り換えられてソースラインＳに供給され
る。すなわち、端子Ｂが“１”のときは直流電位ＶＨが
“０”のときには映像信号がソースラインＳに供給され
るのである。
位ＶＨが供給されている。この直流電位ＶＨと映像信号
とは第２図Ｂに示したパルスによって、１水平走査期間
中に１回ずつ切り換えられてソースラインＳに供給され
る。すなわち、端子Ｂが“１”のときは直流電位ＶＨが
“０”のときには映像信号がソースラインＳに供給され
るのである。
このソースラインＳに生じる信号がゲートドライバ３か
らの信号によって以下のように各画素に書き込まれるも
のである。ゲートドライバ３からはゲートラインＧ1 ，
Ｇ2 …に第２図Ｇ1 ，Ｇ2 …に示すパルスが発生し、こ
のパルスによって各画素には１フィールド走査期間中
に、１回ずつ映像信号および直流電位ＶＨが書き込まれ
るものである。
らの信号によって以下のように各画素に書き込まれるも
のである。ゲートドライバ３からはゲートラインＧ1 ，
Ｇ2 …に第２図Ｇ1 ，Ｇ2 …に示すパルスが発生し、こ
のパルスによって各画素には１フィールド走査期間中
に、１回ずつ映像信号および直流電位ＶＨが書き込まれ
るものである。
まずゲートラインＧ1 には、制御回路４からの第２図Ｃ
の映像信号の書込みスタートパルスに同期して第２図Ｇ
1 に示すパルスｐ1 が発生する。このパルスは、ソース
ラインＳに映像信号が供給されているタイミングで発生
するため、画素Ｌ11，Ｌ12，Ｌ13…には映像信号が書き
込まれる。
の映像信号の書込みスタートパルスに同期して第２図Ｇ
1 に示すパルスｐ1 が発生する。このパルスは、ソース
ラインＳに映像信号が供給されているタイミングで発生
するため、画素Ｌ11，Ｌ12，Ｌ13…には映像信号が書き
込まれる。
以下、ゲートラインＧ2 ，Ｇ3 …Ｇ130 まではこれと同
様に、映像信号の発生に同期して第２図Ｇ2 ，Ｇ3 …の
パルスが発生してゲートラインＧ2 ，Ｇ3 …Ｇ130 の画
素に順次映像信号が書き込まれる。
様に、映像信号の発生に同期して第２図Ｇ2 ，Ｇ3 …の
パルスが発生してゲートラインＧ2 ，Ｇ3 …Ｇ130 の画
素に順次映像信号が書き込まれる。
一方、ゲートラインＧ131 …Ｇ240 には、第２図に示す
とおり、ゲートラインＧ1 …Ｇ130 に生じるパルスの直
前（ソースラインＳに直流電位ＶＨが供給されているタ
イミング）においてパルスが発生し、順次直流電位ＶＨ
が書き込まれる。
とおり、ゲートラインＧ1 …Ｇ130 に生じるパルスの直
前（ソースラインＳに直流電位ＶＨが供給されているタ
イミング）においてパルスが発生し、順次直流電位ＶＨ
が書き込まれる。
このように、１フィールド走査期間の前半においては、
ゲートラインＧ1 〜Ｇ130 の画素に映像信号が書き込ま
れ、ゲートラインＧ131 〜Ｇ240 の画素に直流電位ＶＨ
が書き込まれるものである。
ゲートラインＧ1 〜Ｇ130 の画素に映像信号が書き込ま
れ、ゲートラインＧ131 〜Ｇ240 の画素に直流電位ＶＨ
が書き込まれるものである。
上記書込みが終了すると、ゲートラインＧ1 からは、第
２図Ｄの直流電位の書込みスタートパルスの発生に同期
して、ソースラインＳに直流電位ＶＨが供給されている
タイミングにおいて第２図Ｇ1 のパルスｐ2 が発生す
る。このパルスによってゲートラインＧ1 の画素には直
流電位ＶＨが書き込まれる。以下、ゲートラインＧ2 ，
Ｇ3 …Ｇ130 の画素にも同様にして順次直流電位ＶＨが
書き込まれる。
２図Ｄの直流電位の書込みスタートパルスの発生に同期
して、ソースラインＳに直流電位ＶＨが供給されている
タイミングにおいて第２図Ｇ1 のパルスｐ2 が発生す
る。このパルスによってゲートラインＧ1 の画素には直
流電位ＶＨが書き込まれる。以下、ゲートラインＧ2 ，
Ｇ3 …Ｇ130 の画素にも同様にして順次直流電位ＶＨが
書き込まれる。
一方、ゲートラインＧ131 〜Ｇ240 の画素には順次映像
信号が書き込まれる。
信号が書き込まれる。
このように、１つの画素についてみれば、１フィールド
走査期間中に映像信号および直流電位が１回ずつ切り換
えられて書き込まれるものである。
走査期間中に映像信号および直流電位が１回ずつ切り換
えられて書き込まれるものである。
したがって実質的に６０Ｈｚ駆動となり、フリッカーを
なくすことができるのである。
なくすことができるのである。
第２図Ｅには、ゲートラインＧ1 の画素に書き込まれる
信号を示し、第２図ＦにはゲートラインＧ131 の画素に
書き込まれる信号を示してある。
信号を示し、第２図ＦにはゲートラインＧ131 の画素に
書き込まれる信号を示してある。
ソースラインＳは、第２図Ｂに示すように、１水平走査
期間中に映像信号と直流電位に切り換わり、画面の上方
および下方にある画素とも同じ条件になるため、シェー
ディングむらをなくすことができるのである。
期間中に映像信号と直流電位に切り換わり、画面の上方
および下方にある画素とも同じ条件になるため、シェー
ディングむらをなくすことができるのである。
ここでゲートドライバ３の詳細な構成について、第３図
に基いて説明する。同図において、５，６はそれぞれ４
８０ビットのシフトレジスタで、シフトレジスタ５から
は、奇数段の出力のみを導出してあり、シフトレジスタ
６からは偶数段の出力のみを導出してある。またシフト
レジスタ５，６には、それぞれ第４図Ｃ，Ｄ（第２図
Ｃ，Ｄと同じもの）の映像信号および直流電位の書込み
スタートパルスを供給してある。また各シフトレジスタ
５，６のクロック入力ＣＫには１フィールド走査中に５
２５パルスのクロックパルスを供給してある。したがっ
て、シフトレジスタ６の端子ｂ1 〜ｂ240 からは第４図
ｂ1 〜ｂ240 のパルスが発生し、シフトレジスタ５の端
子ａ1 〜ａ240 からは第４図ａ1 〜ａ240 のパルスが発
生する。これらのパルスを受けて、ゲート回路ｇ1 〜ｇ
240 およびインバータｔ1 〜ｔ240 からは第４図Ｇ1 〜
Ｇ240 のパルスが発生し、それぞれゲートラインＧ1 〜
Ｇ240 に供給され、第２図に示すパルスが得られるもの
である。
に基いて説明する。同図において、５，６はそれぞれ４
８０ビットのシフトレジスタで、シフトレジスタ５から
は、奇数段の出力のみを導出してあり、シフトレジスタ
６からは偶数段の出力のみを導出してある。またシフト
レジスタ５，６には、それぞれ第４図Ｃ，Ｄ（第２図
Ｃ，Ｄと同じもの）の映像信号および直流電位の書込み
スタートパルスを供給してある。また各シフトレジスタ
５，６のクロック入力ＣＫには１フィールド走査中に５
２５パルスのクロックパルスを供給してある。したがっ
て、シフトレジスタ６の端子ｂ1 〜ｂ240 からは第４図
ｂ1 〜ｂ240 のパルスが発生し、シフトレジスタ５の端
子ａ1 〜ａ240 からは第４図ａ1 〜ａ240 のパルスが発
生する。これらのパルスを受けて、ゲート回路ｇ1 〜ｇ
240 およびインバータｔ1 〜ｔ240 からは第４図Ｇ1 〜
Ｇ240 のパルスが発生し、それぞれゲートラインＧ1 〜
Ｇ240 に供給され、第２図に示すパルスが得られるもの
である。
なお上記の説明では、映像信号期間と直流電位期間を約
１：１にしたが、これに限るものではなく、例えば２：
１程度に設定するようにしてもよい。
１：１にしたが、これに限るものではなく、例えば２：
１程度に設定するようにしてもよい。
さらに、直流電位ＶＨを可変することにより、輝度調整
を行うことができる。
を行うことができる。
なお上記の例ではゲートラインが２４０本の例について
述べたが、４８０本のときにも映像信号を倍速にするこ
とにより本発明をそのまま適用できるものである。
述べたが、４８０本のときにも映像信号を倍速にするこ
とにより本発明をそのまま適用できるものである。
また上記の例では、白黒テレビについて説明したが、同
様にしてカラーテレビに応用することもできる。
様にしてカラーテレビに応用することもできる。
［発明の効果］ 本発明によれば、１フィールド走査期間中に映像信号お
よび所望の直流電位を選択的にかつ一定の順序で画素に
供給するようにしたので、ＮＴＳＣ方式の場合で実質的
に６０Ｈｚ駆動と従来の２倍の周波数で駆動できるため
フリッカーをなくすことができる。また１秒に５０フィ
ールドのＰＡＬ，ＳＥＣＡＭ方式では特に効果が大きい
ものである。フリッカーがなくなるため液晶の選定が自
由になり、高速，高抵抗，高信頼性のものを使用でき
る。
よび所望の直流電位を選択的にかつ一定の順序で画素に
供給するようにしたので、ＮＴＳＣ方式の場合で実質的
に６０Ｈｚ駆動と従来の２倍の周波数で駆動できるため
フリッカーをなくすことができる。また１秒に５０フィ
ールドのＰＡＬ，ＳＥＣＡＭ方式では特に効果が大きい
ものである。フリッカーがなくなるため液晶の選定が自
由になり、高速，高抵抗，高信頼性のものを使用でき
る。
さらに、画面上の画素は全て同じ条件で駆動されるた
め、シェーディングのない良質の画面を表示することが
できる。そのためスイッチング素子のリーク電流に対す
る要求が緩くなるものである。
め、シェーディングのない良質の画面を表示することが
できる。そのためスイッチング素子のリーク電流に対す
る要求が緩くなるものである。
しかも映像信号を反転しなくてよいし、倍速走査をする
ためのフレームメモリ等が不要になるので、回路構成が
簡単になるものである。
ためのフレームメモリ等が不要になるので、回路構成が
簡単になるものである。
第１図は本発明の一実施例を示した電気回路図、第２図
は動作説明のためのタイムチャート、第３図は第１図の
一部の構成を詳細に示した論理回路図、第４図は第３図
の動作説明のためのタイムチャートである。 １……シフトレジスタ ２……サンプルホールド回路 ３……ゲートドライバ ４……制御回路 Ｓ11，Ｓ12〜……スイッチング回路 Ｓ21，Ｓ22〜……スイッチング回路 Ｍ11，Ｍ12〜……スイッチング回路 Ｌ11，Ｌ12〜……画素
は動作説明のためのタイムチャート、第３図は第１図の
一部の構成を詳細に示した論理回路図、第４図は第３図
の動作説明のためのタイムチャートである。 １……シフトレジスタ ２……サンプルホールド回路 ３……ゲートドライバ ４……制御回路 Ｓ11，Ｓ12〜……スイッチング回路 Ｓ21，Ｓ22〜……スイッチング回路 Ｍ11，Ｍ12〜……スイッチング回路 Ｌ11，Ｌ12〜……画素
───────────────────────────────────────────────────── フロントページの続き (72)発明者 梅山 一也 東京都墨田区太平４丁目１番１号 株式会 社精工舎内 (56)参考文献 特開 昭59−153388（ＪＰ，Ａ) 特開 昭55−28649（ＪＰ，Ａ) 特開 昭53−68514（ＪＰ，Ａ)
Claims (1)
- 【請求項１】マトリクス配列された画素に映像信号を順
次供給して表示を行う液晶表示装置において、１フィー
ルド走査期間中に上記映像信号および所望の直流電位を
選択的に上記画素に供給し、かつ各フィールド走査期間
中における上記映像信号と上記直流電位の供給順序を同
じくする制御回路を設けたことを特徴とす液晶表示装
置。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61016520A JPH0652938B2 (ja) | 1986-01-28 | 1986-01-28 | 液晶表示装置 |
| US07/002,816 US4789899A (en) | 1986-01-28 | 1987-01-13 | Liquid crystal matrix display device |
| NL8700141A NL8700141A (nl) | 1986-01-28 | 1987-01-21 | Vloeibaar-kristalweergeefinrichting. |
| GB8701258A GB2187874B (en) | 1986-01-28 | 1987-01-21 | Liquid crystal display device |
| DE19873702335 DE3702335A1 (de) | 1986-01-28 | 1987-01-27 | Fluessigkristallanzeigevorrichtung |
| HK900/92A HK90092A (en) | 1986-01-28 | 1992-11-12 | Liquid crystal display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61016520A JPH0652938B2 (ja) | 1986-01-28 | 1986-01-28 | 液晶表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62175074A JPS62175074A (ja) | 1987-07-31 |
| JPH0652938B2 true JPH0652938B2 (ja) | 1994-07-06 |
Family
ID=11918548
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61016520A Expired - Lifetime JPH0652938B2 (ja) | 1986-01-28 | 1986-01-28 | 液晶表示装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4789899A (ja) |
| JP (1) | JPH0652938B2 (ja) |
| DE (1) | DE3702335A1 (ja) |
| GB (1) | GB2187874B (ja) |
| HK (1) | HK90092A (ja) |
| NL (1) | NL8700141A (ja) |
Families Citing this family (20)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0291252A3 (en) * | 1987-05-12 | 1989-08-02 | Seiko Epson Corporation | Method of video display and video display device therefor |
| US5057928A (en) * | 1987-12-29 | 1991-10-15 | Sharp Kabushiki Kaisha | Drive apparatus for liquid crystal display device utilizing a field discriminating apparatus |
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