JPH0642691B2 - 移動電話端末 - Google Patents

移動電話端末

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JPH0642691B2
JPH0642691B2 JP63123006A JP12300688A JPH0642691B2 JP H0642691 B2 JPH0642691 B2 JP H0642691B2 JP 63123006 A JP63123006 A JP 63123006A JP 12300688 A JP12300688 A JP 12300688A JP H0642691 B2 JPH0642691 B2 JP H0642691B2
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    • Y02D30/00—Reducing energy consumption in communication networks
    • Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks

Description

【発明の詳細な説明】 〔概要〕 バッテリィ給電式移動電話端末に関し、 バッテリィの消費電力を低減することを目的とし、 端末制御、データ受信処理、データ送信処理、タイマー
管理などを行うバッテリィ給電式移動電話端末におい
て、上記処理のうち複雑且つ処理ひん度の低いものをCP
Uで処理させ、定常的に処理すべきもの、および処理ひ
ん度の高いものをLSIで処理させ、CPUは処理終了後待機
状態に入り、LSIはCPUの待機状態に応答してCPUおよびC
PUと協働するメモリへのクロックの印加を停止しCPUお
よびメモリの動作を停止させ、LSIはCPU処理内容が発生
した場合、クロックがCPUおよびメモリに印加されるよ
うにし、CPUを駆動させるように構成する。
〔産業上の利用分野〕 本発明はバッテリィ給電式移動電話端末のバッテリィの
消費電力を低減させる移動電話端末の動作制御方式に関
する。
本発明の移動電話端末は、セルラー方式の移動電話端末
として自動車電話、可搬式電話、携帯電話を始めとす
る、種々の移動電話端末に用いられる。
〔従来の技術〕
バッテリィ給電式移動電話端末は、バッテリィの消費電
力（消費電流）を極力少なくすることが要望されてい
る。
一方、移動電話端末としては種々の複雑な処理が必要と
される上、システム構築の便宜、経済性、コンパクト化
などからマイクロコンピュータが用いられている。マイ
クロコンピュータとしては、８ビットのメインCPUを用
いて、端末制御、データ受信、データ送信、タイマー管
理等を行う一方、４ビットのサブCPUを用いて移動電話
端末にある表示器（ディスプレー）、押ボタン操作など
のマン・マシン・コミュニケーションを処理している。
移動電話端末としては、この他にベースバンド処理、送
受信処理などを行う。
移動電話端末は、前述の如く、バッテリィの消費電力を
少なくすることが要望されているから、上述の処理回路
は、電力消費の少ないCMOSデバイスにより実現されてい
る。
〔発明が解決しようとする課題〕
CMOSデバイスは電力低消費形デバイスであるが、オン・
オフ動作のときは電流が流れ、バッテリィからの電力供
給だ大きい。オン・オフ動作は、動作周波数で決まるか
ら、1MHz程度と高いクロックが印加されこのクロックに
より動作する、メインCPU、およびこのメモリCPUに接続
されるROM，RAMにおける電力消費が大きい。従って、メ
インCPUおよびRAM，ROMを高くクロックで常時動作させ
ている限り、バッテリィからの給電は相当な量になり、
バッテリィが比較的早く寿命がつきてしまうという問題
がある。
本発明は、更にバッテリィの消費電力を低減させること
を目的とする。
〔課題を解決するための手段〕
本発明は上記目的を達成するため、第１図にその原理ブ
ロック図を示すように、従来メインCPUおよびRAM，ROM
で行っていた処理のうち、複雑かつ処理ひん度の低い処
理を従来同様メインCPU１で処理させる一方、定常的に
処理すべきもの、且つ処理ひん度の高いものをLSI２で
処理させるように機能分担を図る。その上で、メインCP
U側を必要な都度間欠的に動作させる。
〔作用〕
第２図に、第１図の動作タイミングを示すように、メイ
ンCPU１は処理が終了すると一旦待機状態に設定する。L
SI２この待機状態を検出し、メインCPU１の動作が完了
したことを判断しメインCPU１およびそのメモリ系への
マスタクロックM-CLKの印加を停止する。これによりメ
インCPU１およびそのメモリ系は実質的に停止、電力消
費はCMOSにもとづく極めて僅かな値となる。
一方、LSI２はメインCPU１での動作処理が必要になった
場合、メインCPU１およびメモリ系へマスタクロックM-C
LKを印加させ、メインCPU１に割込をかけて駆動させ
る。これに伴ってメインCPU側は必要な処理を行ない、
処理終了後、再び待機状態に入る。
以上の如く、メインCPU１およびそのメモリ系といった
高速のクロックで動作し、しかも電力消費の割合の高い
ものが、比較的低ひん度で間欠的に動作するので、移動
電話端末全体としての消費電力が著しく低減される。
〔実施例〕
第３図に本発明の実施例の移動電話端末の回路構成図を
示す。
同図において、メインCPU１は８ビットマイコンのメイ
ンCPU1a、メモリ系はメインCPUlaの動作プログラムが内
蔵されたROM11およびデータ保存用のRAM12で実現されて
いる。これは4MHzのマスタクロックM-CLKを１／４分周
した1MHzのクロック動作する。LSI２は、メインLSI21、
サブLSI22、および、それぞれメインLSI21に接続された
システム情報格納ROM23、およびシリアル番号格納ROM24
で構成されている。メインLSI21およびサブLSI22は分割
しているのは、現実の設計上の要因にもとづくにすぎな
い。すなわちこれらLSIを１つのLSIで実現することも可
能であるが、LSIチップのピン数が非常に多くなるので
実現容易な汎用的なLSIを用いることによる。
移動電話端末としては、以上の他、送受信ユニット３１
およびアンテナ３２から成る送受信系３、データベース
バンドユニット４１およびアナログべースバンドユニッ
ト４２から成るベースバンド部４、４ビットマイコンの
サブCPU51、ディスプレー５２、キイスイッチ５３等か
ら成るマン・マシン・インターフェース系５、および、
バッテリィ６を有してイルベースバンド部４は、アナロ
グ処理を行うアナログべースバンドユニット４２とディ
ジタル処理を行うデータベースバンユニット４１とに分
けている。
バッテリィ６は、図示の諸回路に電力を供給する。
図示の諸回路は、極力電力消費の少ないもので構成され
ている。特に、メインCPUla、ROM11、RAM12、メインLSI
21、サブLSI22、ROM23，24、ベースバンドユニット41、
42、送受信ユニット３１、サブCPU51はCMOSで実現して
いる。ディスプレー３２はLCDを用いている。
メインCPU1a、ROM11、RAM12には１MHzのマスタクロック
MCLKが印加される。
次に、メインCPU1a、および、LSI21および２２の処理分
担を述べる。
ＬＳＩ (1)データ受信処理 (a)処理内容 イ．データ受信処理 AMPSの場合10Ｋボー、 TACSの場合８ボー、 ロ．同じデータが５回送られてくるものについて３／５
多数決処理、すなわち、３回正常なら正常とする。
ハ．ＢＣＨエラー訂正 ニ．ビジー／アイドル（Ｂ／Ｉ）ビット処理、すなわ
ち、送信可能か否かチェックする。
(b)動作タイミング 800μｓ毎の割込処理で動作 (2)高速タイマー管理 (a)処理内容 イ．１ms分解能のタイマー３種の管理 ロ．１０ms分解能のタイマー７種の管理 (b)動作タイミング １msごと、 以上のLSIの処理の分担は、メインLSI21データ受信処
理、高速タイマー管理をサブLSI22で行う。
メインＣＰＵ (1)データ送信処理 (a)処理内容 送信すべきデータの処理 (b)動作タイミング 必要時 (2)低速タイマー管理 (a)処理内容 イ．５０ms分解能のタイマー６種の管理 ロ．２秒分解能のタイマー３種の管理 (b)動作タイミング サブLSI22からの５０msごとの割込で動作する。
尚、サブCPU51は、１６桁ディスプレー５２の表示制
御、８種のインジケータの表示制御、キイスイッチの入
力制御等を５msの周期で常時行なう。このマン・マシン
・インターフェース処理は従来同様専用化している。
送受信ユニット３１およびアンテナ３２から成る送受信
系３も従来同様である。ベースバンドユニット４も従来
同様である。
第３図において、受信信号は、アンテナ３２および送受
信ユニット３１を介して入力され、アナログベースバン
ドユニット４２でベースバンド信号についてフィルタリ
ング処理され、バス２０を介してデータベースバンドユ
ニット４１でフィルタ後の処理が行なわれて、メインLS
I21に入力される。サブLSI22とメインLSI21とは協働す
る。
必要な場合、メインCPU1aが動作するが、このとき、ROM
11およびRAM12がメインCPU1aからのアクセスに応じて動
作する。メインCPU1aからのデータは、上とは逆の経
路、すなわち、メインLSI21、データベースバンドユニ
ット４１、アナログベースバンドユニット４２および送
受信ユニット３１を介してアンテナ３２から出力され
る。
メインCPU1aは処理が終了すると、“Wait for Interrup
t”命令を実行する。これにより、バスアベイラブル
（ＢＡ）信号ラインが「高」レベルとなる。
メインLSI21はＢＡ信号に応じて、メインCPU1a系へのマ
スタクロックM-CLKの印加又は停止、割込信号の発生を
行う。第４図にそのタイミング制御回路を示す。第５図
に第４図の動作タイミング図を示す。
ＢＡ信号が「低」レベルのとき、割込要求要因（IRQ-R)
が発生すると、NANDゲートNAND１の出力が「高」レベル
となり、ANDゲートAND１から４MHzのマスタクロックM-C
LKがメインCPU1a、ROM11、RAM12に出力される。また制
御回路101およびバッファゲートBG1を介して割込要求(I
RQ)信号がメインCPU1aに出力されてメインCPU1aが動作
する。メインCPU1aはこのマスタクロックM-CLKを１／４
分周した１MHzで動作する。
ＢＡ信号が「高」レベルになると、マスタクロックM-CL
Kが禁止される。これにより、メインCPU1a、ROM11、RAM
12は不動作となる。
ＢＡ信号が「高」レベル中に、IRQ-Rが発生すると、マ
スタクロックM-CLKが出力されて一定時間経過後にIRQ信
号が出力されてメインCPU1aが動作し、ＢＡ信号が
「低」レベルになる。このように、マスタクロックM-CL
K出力後一定時間経過後IRQ信号を出力しているのは、Ｂ
Ａ信号が「低」レベルのときはメインCPU1aが動作中で
あるから即メインCPU1aを動作させてもよいのに対し、
ＢＡ信号が「高」レベルの場合は、メインCPU1aは停止
しているから、マスタクロックM-CLK印加後１／４分周
されてメインCPU1a動作用クロックが発生するまでの起
動時間を考慮したためである。この制御を制御回路101
にて行う。本実施例では、マクタクロックM-CLK４個
分、すなわち１MHzに相当する時間だけ遅らせてIRQ信号
を出力する。
以上の如く、電力消費の多い、メインCPU1a、ROM11、RA
M12を必要に応じ間欠的に動作させることにより、バッ
テリィ６の電力消費が低減される。本実施例によれば、
移動電話端末全体の消費電流が、従来２３mAであったの
が１５mAに低減された。
〔発明の効果〕
以上に述べたように本発明によれば、メインCPUの処理
内容を電力消費という観点から一部LSIに機能分担を図
ると共に、メインCPU系を間欠的に動作させることによ
り、従来と同じ機能を発揮させながら、バッテリィの電
力消費の低減を図った移動電話端末が実現できた。
【図面の簡単な説明】
第１図は本発明の移動電話端末の原理ブロック図、 第２図は第１図の動作タイミング図、 第３図は本発明の実施例の移動電話端末の回路構成図、 第４図は本発明の実施例のタイミング制御回路、 第５図は第４図の動作タイミング図、である。 （符号の説明） １，１ａ…メインCPU、 ２…LSI処理系、 ３…送受信系、 ２０…バス、 ２１…メインLSI、 ２２…サブLSI、 ２３…システム情報格納ROM、 ２４…シリアル番号格納ROM、 ３１…送受信ユニット、 ３２…アンテナ、 ４１…データべースバンドユニット、 ４２…アナログベースバンドユニット、 ５１…サブCPU、 ５２…ディスプレー、 ５３…キーボード。

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】端末制御、データ受信処理、データ送信処
    理、タイマー管理などを行うバッテリィ給電式移動電話
    端末において、 上記処理のうち複雑且つ処理ひん度の低いものをCPU
    （１）で処理させ、定常的に処理すべきもの、および処
    理ひん度の高いものをLSI（２）で処理させ、 CPUは処理終了後待機状態に入り、LSIはCPUの待機状態
    に応答してCPUおよびCPUと協働するメモリへのクロック
    (M−CLK)の印加を停止しCPUおよびメモリの動作を停止
    させ、 LSIはCPU処理内容が発生した場合、クロックがCPUおよ
    びメモリに印加されるようにし、CPUを駆動させる ように構成し、バッテリィの消費電力を低減させるよう
    にしたことを特徴とする、移動電話端末。
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