JPH01293742A - 移動電話端末 - Google Patents

移動電話端末

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JPH01293742A
JPH01293742A JP63123006A JP12300688A JPH01293742A JP H01293742 A JPH01293742 A JP H01293742A JP 63123006 A JP63123006 A JP 63123006A JP 12300688 A JP12300688 A JP 12300688A JP H01293742 A JPH01293742 A JP H01293742A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔概　要〕 バッテリィ給電式移動電話端末に関し、バッテリィの消
費電力を低減することを目的とし、 端末制御、データ受信処理、データ送信処理、タイマー
管理などを行うバッテリィ給電式移動電話端末において
、上記処理のうち複雑且つ処理ひん度の低いものをｃｐ
ｕで処理させ、定常的に処理すべきもの、および処理ひ
ん度の高いものをＬＳＩで処理させ、ＣＰＵは処理終了
後待機状態に入り、ＬＳＩはＣＰＵの待機状態に応答し
てＣＰＵおよびＣＰＵと協働するメモリへのクロックの
印加を停止しＣＰＵおよびメモリの動作を停止させ、Ｌ
ＳＩはＣＰＵ処理内容が発生した場合、クロックがＣＰ
Ｕおよびメモリに印加されるようにし、ＣＰＵを駆動さ
せるように構成する。
（産業上の利用分野） 本発明はバッテリィ給電式移動電話端末のバッテリィの
消費電力を低減させる移動電話端末の動作制御方式に関
する。
本発明の移動電話端末は、セルラ一方式の移動電話端末
として自動車電話、可搬式電話、携帯電話を始めとする
、種々の移動電話端末に用いられる。
〔従来の技術〕
バ、テリイ給電式移動電話端末は、バッテリィの消費型
ツノ（消費電流）を極力少なくすることが要望されてい
る。
一方、移動電話端末としては種々の複雑な処理が必要と
される上、システム構築の便宜、経済性、コンパクト化
などからマイクロコンピュータが用いられている。マイ
クロコンピュータとしては、８ビツトのメインＣＰＵを
用いて、端末制御、データ受信、データ送信、タイマー
管理等を行う一方、４ビツトのサブＣＰＵを用いて移動
電話端末にある表示器（デイスプレー）、押ボタン操作
などのマン・マシン・コミュニケーションを処理してい
る。
移動電話端末としては、この他にベースバンド処理、送
受信処理などを行う。
移動電話端末は、前述の如く、バツテリイの消費電力を
少なくすることが要望されているから、上述の処理回路
は、電力消費の少ないＣＭＯＳデバイスにより実現され
ている。
〔発明が解決しようとする課題〕
ＣＭＯＳデバイスは電力低消費形デバイスであるが、オ
ン・オフ動作のとき電流が流れ、バツテリイからの電力
供給が大きい。オン・オフ動作は、動作周波数で決まる
から、Ｉ　ＭＨ２程度と高いクロックが印加されこのク
ロックにより動作する、メインｃｐｕ　、およびこのメ
インＣＰＵに接続されるＲＯＭ　。
ＲＡＭにおける電力消費が大きい。従って、メインＣＰ
ＵおよびＲＡＭ、　ＲＯＭを高いクロックで常時動作さ
せている限り、バッテリィからの給電は相当な量になり
、バッテリィが比較的早く寿命がつきてしまうという問
題がある。
本発明は、更にバッテリィの消費電力を低減させるごと
を目的とする。
〔課題を解決するための手段〕
本発明は上記目的を達成するため、第１図にその原理ブ
ロック図を示すように、従来メインＣＰＵおよびＲＡＭ
、ＲＯ？Ｉで行っていた処理のうち、複雑かつ処理ひん
度の低い処理を従来同様メインＣＰＵ　　１で処理させ
る一方、定常的に処理すべきもの、且つ処理ひん度の高
いものをＬＳＩ　２で処理させるように機能分担を図る
。その上で、メインＣＰＵ側を必要な都度間欠的に動作
させる。
〔作　用］ 第２図に、第１図の動作タイミングを示すように、メイ
ンＣＰｔ１１は処理が終了すると一旦待機状態に設定す
る。ＬＳＩ　２はこの待機状態を検出し、メインＣＰＩ
Ｉ　　１の動作が完了したことを判断しメインＣＰＵ　
１およびそのメモリ系へのマスタクロックＭ−ＣＬＫの
印加を停止する。これによりメインＣＰＵ１およびその
メモリ系は実質的に停止し、電力消費はＣＭＯＳにもと
づく極めて僅かな値となる。
一方、ＬＳＩ　２はメインＣＰＵ　　１での動作処理が
必要になった場合、メインＣＰＵ　１およびメモリ系へ
マスククロックＭ−ＣＬＫを印加させ、メインＣＰＵ　
　１に割込をかけて駆動させる。これに伴ってメインＣ
ＰＵ側は必要な処理を行ない、処理終了後、再び待機状
態に入る。
以上の如く、メインＣＰＵ　１およびそのメモリ系とい
った高速のクロックで動作し、しかも電力消費の割合の
高いものが、比較的低ひん度で間欠的に動作するので、
移動電話端末全体としての消費電力が著しく低減される
。
〔実施例］ 第３図に本発明の実施例の移動電話端末の回路構成図を
示す。
同図において、メインｃｐｕ　ｉは８ビツトマイコンの
メインＣＰＵ　ｌａ、メモリ系はメインＣＰＵ　ｌａの
動作プログラムが内蔵されたＲＯＭ　１１およびデータ
保存用のＲＡＭ　１２で実現されている。これらは４Ｍ
ＩＩｚのマスタクロックＭ−ＣＬＸを１／４分周したＩ
　ＭＨｚのクロックで動作する。　ＬＳＩ　　２は、メ
インＬＳＩ　２１、サブＬＳＩ　２２、および、それぞ
れメインＬＳＩ　２１に接続されたシステム情報格納Ｒ
ＯＭ　２３、およびシリアル番号格納ＲＯＭ　２４で構
成されている。メインＬＳＩ２１およびサブＬＳＩ　２
２は分割しているのは、現実の設計上の要因にもとづく
にすぎない。すなわちこれらＬＳＩを１つのＬＳＩで実
現することも可能であるが、ＬＳＩチップのビン数が非
常に多くなるので実現容易な汎用的なＬＳＩを用いるこ
とによる。
移動電話端末としては、以上の他、送受信ユニット３１
およびアンテナ３２から成る送受信系３、データベース
バンドユニット４１およびアナログベースバンドユニッ
ト４２から成るベースバンド部４．４ビツトマイコンの
サブＣＰＵ　５１、デイスプレー５２、キイスイッチ５
３等から成るマン・マシン・インターフェース系５、お
よび、バッテリィ６を有している。ベースバンド部４は
、アナログ処理を行うアナログベースバンドユニット４
２とディジタル処理を行うデータベースバンドユニット
４１とに分けている。
バッテリィ６は、図示の諸回路に電力を供給する。
図示の諸回路は、権力電力消費の少ないもので構成され
ている。特に、メインＣＰＵ　ｌａ、　ＲＯＭ　１１、
ＲＡＭ　１２、メインＬＳＩ　２１、サブＬＳＩ　２２
、ＲＯＭ　２３　、２４、ベースバンドユニット４１　
、４２、送受信ユニット３１、サブＣＰ［Ｉ　５１はＣ
ＭＯＳで実現している。デイスプレー３２はＬＣＤを用
いている。
メインＣＰｔ１　ｌａ、　ＲＯＭ　１１、ＲＡＭ　１２
にはｌ　ＭＨｚのマスタクロックＭＣＬＫが印加される
。
次に、メインＣＰＵ　ｌａ、および、ＬＳＩ　２１およ
び２２の処理分担を述べる。
５Ｉ （１）データ受信処理 （ａ）処理内容 イ、データ受信処理 ＡＭＰＳの場合１０にボー、 ＴＡＣ３の場合８にボー、 口、同じデータが５回送られてくるものについて３１５
多数決処理、すなわち、３回正常なら正常とする。
ハ、ＢＣＨエラー訂正 二、ビジー／アイドル（Ｂ／Ｉ）ビット処理、すなわち
、送信可能か否かチエ ツクする。
（ｂ）動作タイミング ８００μｓ毎の割込処理で動作 （２）高速タイマー管理 （ａ）処理内容 イ、１ａｓｓ分解能のタイマー３種の管理０．１０ｓ＋
ｓ分解能のタイマー７種の管理（ｂ）動作タイミング １ＩＩＩＳごと、 以上のＬＳＩの処理の分担は、メインＬＳＩ　２１がデ
ータ受信処理、高速タイマー管理をサブＬＳＩ　２２で
行う。
メインＣＰＵ （１）データ送信処理 （ａ）処理内容 送信すべきデータの処理 （ｂ）動作タイミング 必要時 （２）低速タイマー管理 （ａ）処理内容 イ、５０ｓｓ分解能のタイマー６種の管理０．２秒分解
能のタイマー３種の管理 （ｂ）動作タイミング サブＬＳＩ　２２からの５０−３ごとの割込で動作する
。
尚、サブＣＰＵ　５１は、１６桁デイスプレー５２の表
示制御、８種のインジケータの表示制御、キイスイッチ
の入力制御等を５Ｉｌｓの周期で常時行なう。
このマン・マシン・インターフェース処理は従来同様専
用化している。
送受信ユニット３１およびアンテナ３２から成る送受信
系３も従来同様である。ベースバンドユニット４も従来
同様である。
第３図において、受信信号は、アンテナ３２および送受
信ユニッ１−３１を介して人力され、アナログベースバ
ンドユニット４２でベースバンド信号についてフィルタ
リング処理され、バス２０を介してデータベースバンド
ユニット４１でフィルタ後の処理が行なわれて、メイン
ＬＳＩ　２１に入力される。サブＬＳＩ　２２とメイン
ＬＳＩ　２１とは協働する。
必要な場合、メインＣＰＩＪ　ｌａが動作するが、この
とき、ＲＯＭ　１１およびＲＡＭ　１２がメインＣＰＵ
　ｌａからのアクセスに応じて動作する。メインＣＰＵ
　ｌａからのデータは、上とは逆の経路、すなわち、メ
インＬＳＩ　２Ｌデータベースバンドユニツト４１、ア
ナログベースバンドユニット４２および送受信ユニット
３１を介してアンテナ３２から出力される。
メインＣＰＵ　ｌａは処理が終了すると、’Ｗａｉｔ　
ｆｏｒｌｒｌｔｅｒｒｕｐｔ”　命令を実行する。これ
により、バスアベイラブル（ＢＡ）信号ラインが「高」
レベルとなる。
メインＬＳＩ　２１はＢＡ倍信号応じて、メインＣＰＵ
１ａ系へのマスタクロックドＣＬにの印加又は停止、割
込信号の発生を行う。第４図にそのタイミング制御回路
を示す、第５図に第４図の動作タイミング図を示す、′ ＢＡ倍信号「低」レベルのとき、割込要求要因（ＩＲＱ
−Ｒ）が発生すると、ＮＡＮＤゲートＮＡＮＤ　１の出
力が「高Ｊレベルとなり、ＡＮＤゲートＡＮ口１から４
ＭＨｚのマスタクロックドＣＬにがメインＣＰＵ　ｌａ
、　ＲＯＭ１１、　ＲＡＭ　１２に出力される。また制
御回路１０１およびバッファゲートＢＧＩを介して割込
要求（ＩＲＱ）信号がメインＣＰＵ　ｌａに出力されて
メインＣＰＩＪ　ｌａが動作する。メインＣＰＵ　ｌａ
はこのマスタクロックドＣＬＫを１／４分周したＩ　Ｍ
Ｈｚで動作する。
ＢＡ倍信号「高」レベルになると、マスククロックドＣ
ＬＫが禁止される。これにより、メインＣＰＵ　ｌａ、
　ＲＯＭ　１１．　ＲＡＭ　１２は不動作となる。
ＢＡ倍信号「高」レベル中に、ＩＲＱ−Ｒが発生すると
、マスタクロックＭ−ＣＬＫが出力されて一定時間経過
後にＩＲＱ信号が出力されてメインＣＰＵ　ｌａが動作
し、ＢＡ倍信号「低」レベルになる。このように、マス
タクロックドＣＬＫ出力後一定時間経過後ＩＲＱ信号を
出力しているのは、ＢＡ倍信号「低」レベルのときはメ
インＣＰＬＩ　ｌａが動作中であるから即メインＣＰＵ
　ｌａを動作させてもよいのに対し、ＢＡ倍信号「高」
レベルの場合は、メインＣＰＵ　ｌａは停止しているか
ら、マスタクロックドＣＬＫ印加後１／４分周されてメ
インＣＰＵ　ｌａ動作用クロ・ンクが発生するまでの起
動時間を考慮したためである。
この制御を制御回路１０１にて行う０本実施例では、マ
スタクロックＭ−ＣＬｋ　４個分、すなわちＩ　ＭＨｚ
に相当する時間だけ遅らせてＩＲＱ信号を出力する。
以上の如く、電力消費の多い、メインＣＰＵ　ｌａ、Ｒ
ＯＭ　１１、［？ＡＭ　１２を必要に応じ間欠的に動作
させることにより、パッテリイ６の電力消費が低減され
る０本実施例によれば、移動電話端末全体の消費電流が
、従来２３−八であったのカ月５１ＩＡに低減された。
〔発明の効果〕
以上に述べたように本発明によれば、メインＣＰＵの処
理内容を電力消費という観点から一部ＬＳＩに機能分担
を図ると共に、メインｃｐｕ系を間欠的に動作させるこ
とにより、従来と同じ機能を発揮させながら、バッテリ
ィの電力消費の低減を図った移動電話端末が実現できた
。
【図面の簡単な説明】
第１図は本発明の移動電話端末の原理ブロック図、 第２図は第１図の動作タイミング図、 第３図は本発明の実施例の移動電話端末の回路構成図、 第４図は本発明の実施例のタイミング制御回路、第５図
は第４図の動作タイミング図、である。 （符号の説明） １、ｌａ−メインＣＰＵ　。 ２・・・ＬＳＩ処理系、 ３・・・送受信系、 ２０・・・バス、 ２１・・・メインＬＳＩ　、 ２２・・・サブＬＳＩ　。 ２３・・・システム情報格納ＲＯＭ、 ２４・・・シリアル番号格納ＲＯＭ、 ３１・・・送受信ユニット、 ３２・・・アンテナ、 ４１・・・データベースバンドユニット、４２・・・ア
ナログベースバンドユニット、５１・・・サブｃｐｕ、 ５２・・・デイスプレー、 ５３・・・キーボード。 特許比１幀人 富士通株式会社 特許出願代理人

Claims (1)

  1. 【特許請求の範囲】 １、端末制御、データ受信処理、データ送信処理、タイ
    マー管理などを行うバッテリィ給電式移動電話端末にお
    いて、 上記処理のうち複雑且つ処理ひん度の低いものをＣＰＵ
    （１）で処理させ、定常的に処理すべきもの、および処
    理ひん度の高いものをＬＳＩ（２）で処理させ、 ＣＰＵは処理終了後待機状態に入り、ＬＳＩはＣＰＵの
    待機状態に応答してＣＰＵおよびＣＰＵと協働するメモ
    リへのクロック（Ｍ−ＣＬＫ）の印加を停止しＣＰＵお
    よびメモリの動作を停止させ、 ＬＳＩはＣＰＵ処理内容が発生した場合、クロックがＣ
    ＰＵおよびメモリに印加されるようにし、ＣＰＵを駆動
    させる ように構成し、バッテリィの消費電力を低減させるよう
    にしたことを特徴とする、移動電話端末。
JP63123006A 1988-05-21 1988-05-21 移動電話端末 Expired - Lifetime JPH0642691B2 (ja)

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