JPH0625015Y2 - 半導体装置 - Google Patents

半導体装置

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JPH0625015Y2
JPH0625015Y2 JP1986090698U JP9069886U JPH0625015Y2 JP H0625015 Y2 JPH0625015 Y2 JP H0625015Y2 JP 1986090698 U JP1986090698 U JP 1986090698U JP 9069886 U JP9069886 U JP 9069886U JP H0625015 Y2 JPH0625015 Y2 JP H0625015Y2
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JP
Japan
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wiring
data line
adjacent
coupling capacitance
semiconductor device
Prior art date
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Expired - Lifetime
Application number
JP1986090698U
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English (en)
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JPS62201949U (ja
Inventor
佳似 太田
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Sharp Corp
Original Assignee
Sharp Corp
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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
    • G11C7/00Arrangements for writing information into, or reading information out from, a digital store
    • G11C7/18Bit line organisation; Bit line lay-out
    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
    • G11C5/00Details of stores covered by group G11C11/00
    • G11C5/06Arrangements for interconnecting storage elements electrically, e.g. by wiring
    • G11C5/063Voltage and signal distribution in integrated semi-conductor memory access lines, e.g. word-line, bit-line, cross-over resistance, propagation delay

Landscapes

  • Design And Manufacture Of Integrated Circuits (AREA)
  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
  • Dram (AREA)
  • Semiconductor Memories (AREA)
  • Static Random-Access Memory (AREA)

Description

【考案の詳細な説明】 <産業上の利用分野> 本考案は半導体装置に関し、特には半導体集積回路装置
における配線間のクロストーク低減に関するものであ
る。
<従来の技術> 近年の半導体製造技術の進歩は著しいものがあり、集積
回路を構成する各種要素の微細化が図られている。この
ような技術の進歩により、半導体集積回路は基板への構
成が高密度化すると共に高機能化され、それに伴って基
板上の信号配線間隔もまたますます狭くなりつつある。
<考案が解決しようとする問題点> 上記のように配線間隔が狭くなった回路においては、隣
接する配線とのカップリング容量が、配線自身の基板へ
の対地容量に比べて無視できなくなってきており、それ
ら隣接する配線間に生じるクロストークは信号の電位に
変動を引き起こし、動作マージンの悪化、ひいては誤動
作の原因となっている。
特にメモリ半導体装置の如く微弱な信号を書込み読取る
必要がある回路においては、信頼性が損なわれるという
大きな問題があった。
<問題点を解決するための手段> 本考案は上記従来装置の欠点を除去して、高集積化した
半導体回路における配線間のクロストークを低減し、半
導体回路の動作マージン拡大を図った半導体装置を提供
する。
本考案は、信号線対が複数組隣接して存在する集積回路
半導体装置において、特に能動期間に互いに逆相となる
信号線の配置を配線の途中で入れ換えて構成する。
<作用> 配線間でカップリング容量が生じたとしても、同一の配
線で観察した場合配線の入れ換えがある両側部分で逆相
の関係になるため、実質的に相殺されてクロストークの
影響がない回路動作を行わせることができる。
<実施例> 信号間のクロストークに最も影響され易い例として、微
小電位差を差動増幅しなければならない半導体メモリ装
置のデータI/O線を挙げて説明する。
図において、配線D0及びDは各々相補関
係にあるデータI/O線で、従来公知の回路によって非能
動期間は全てVCC/2にブリチャージされている。上記配
線組D0とDは、データ線DとDデー
タ線が近接して位置し、それらの間でカップ
リング容量を生じる惧れがあるため、例えばデータ線D
を、配線長のほぼ中央部Pで他のデータ線
と対向関係を入れ換えた配線パターンとし、
お互いの間で生じるカップリング容量C,C
,Cがほぼ同じ大きさになるように設計されてい
る。即ち図の中央部Pより左側ではデータ線Dはデー
タ線Dと近接しているのに対して、右側ではデータ線
はデータ線と近接する関係に配線され、カップ
リング容量CとCはほぼ等しく設計される。
上記配線構造において、書込みサイクルに入ってデータ
線Dが選択状態となり、例えばデータ線D
論理“1”(VCCレベル)、データ線が論理“0”
(接地レベル)に制御されたとする。一方外部からの書
込みについて非選択であったデータ線Dはメモ
リセルへの再書込みを行なうために、メモリセルからビ
ット線を介して得られる微小電位を差動増幅する必要が
あるとき、データ線Dは上記データ線D
の選択時の電位によって変動を受ける。しかし本実施
例の配線構造では、カップリング容量C(又はC2)か
ら受ける変動とカップリング容量C(又はC4)から受
ける変動が逆相で且つ同程度のレベルとなるため、デー
タ線D(又は)の全体としての電位は実質的に他
のデータ線Dから影響を受けない。従ってデー
タ線Dを介しての再書込みも誤動作を起こさな
い。
<考案の効果> 以上本考案によれば、簡単な構成によって集積回路内の
配線間のクロストークを低減することができ、より一層
の高集積化を可能ならしめ、半導体装置の高密度化を信
頼性を損うことなく達成できる。
【図面の簡単な説明】
図は本考案による一実施例を示す配線図である。 D,D……データ線、C,C,C
,C……カップリング容量、P……配線長中央部

Claims (1)

    【実用新案登録請求の範囲】
  1. 【請求項1】互いに平行に配置され、互いに逆相の信号
    が印加される、第1配線及び第2配線と、 上記第1配線及び第2配線間にツイスト状に配置され、
    互いに逆相の信号が印加される、第3配線及び第4配線
    とを有し、 且つ、上記第1配線と第3配線とが隣接する部分で形成
    されるカップリング容量と、上記第1配線と第4配線と
    が隣接する部分で形成されるカップリング容量と、上記
    第2配線と第3配線とが隣接する部分で形成されるカッ
    プリング容量と、上記第2配線と第4配線とが隣接する
    部分で形成されるカップリング容量とが略等しいことを
    特徴とする半導体装置。
JP1986090698U 1986-06-13 1986-06-13 半導体装置 Expired - Lifetime JPH0625015Y2 (ja)

Priority Applications (2)

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JP1986090698U JPH0625015Y2 (ja) 1986-06-13 1986-06-13 半導体装置
US07/627,617 US5060189A (en) 1986-06-13 1990-12-12 Semiconductor device with reduced crosstalk between lines

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JP1986090698U JPH0625015Y2 (ja) 1986-06-13 1986-06-13 半導体装置

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Publication Number Publication Date
JPS62201949U JPS62201949U (ja) 1987-12-23
JPH0625015Y2 true JPH0625015Y2 (ja) 1994-06-29

Family

ID=14005747

Family Applications (1)

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JP1986090698U Expired - Lifetime JPH0625015Y2 (ja) 1986-06-13 1986-06-13 半導体装置

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Publication number Publication date
US5060189A (en) 1991-10-22
JPS62201949U (ja) 1987-12-23

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