JPH0624042B2 - 波形等化回路 - Google Patents
波形等化回路Info
- Publication number
- JPH0624042B2 JPH0624042B2 JP58039236A JP3923683A JPH0624042B2 JP H0624042 B2 JPH0624042 B2 JP H0624042B2 JP 58039236 A JP58039236 A JP 58039236A JP 3923683 A JP3923683 A JP 3923683A JP H0624042 B2 JPH0624042 B2 JP H0624042B2
- Authority
- JP
- Japan
- Prior art keywords
- waveform
- input
- signal waveform
- delay line
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/02—Recording, reproducing, or erasing methods; Read, write or erase circuits therefor
- G11B5/027—Analogue recording
- G11B5/035—Equalising
Description
【発明の詳細な説明】 〔発明の利用分野〕 本発明は、磁気記録装置の読出し回路に係り、更らに詳
細には位相余裕の向上に好適な、波形等化回路に関する
ものである。
細には位相余裕の向上に好適な、波形等化回路に関する
ものである。
磁気記録装置において、近年、急速に高密度記録化が進
められており、記録再生特性がきびしくなっている。そ
こで読出回路系において記録再生特性改善のため波形等
化回路を用いるようになってきた。この実現方法の一つ
として第１図に示すような遅延線１とコレクタ接地回路
２と減衰器３と差動増幅器４とを用いた波形等化回路が
知られている。
められており、記録再生特性がきびしくなっている。そ
こで読出回路系において記録再生特性改善のため波形等
化回路を用いるようになってきた。この実現方法の一つ
として第１図に示すような遅延線１とコレクタ接地回路
２と減衰器３と差動増幅器４とを用いた波形等化回路が
知られている。
この回路は、第２図に示す信号波形５（弧立信号波形）
を入力したとき、遅延線１を通りコレクタ接地回路２の
入力で全反射され、遅延線１を入力側へ戻って、波形５
と合成され、コレクタ接地回路２のもう一方の入力に入
り、減衰器３で所定量減衰された波形６を得る。これら
差動増幅器４に入力された出力波形７は、波形５から波
形６を差引いたもので、波形５より細く、かつ鋭くなり
磁気ヘッドから読出された波形のビット間干渉によって
起こるパターンピークシフトを低減することができる。
を入力したとき、遅延線１を通りコレクタ接地回路２の
入力で全反射され、遅延線１を入力側へ戻って、波形５
と合成され、コレクタ接地回路２のもう一方の入力に入
り、減衰器３で所定量減衰された波形６を得る。これら
差動増幅器４に入力された出力波形７は、波形５から波
形６を差引いたもので、波形５より細く、かつ鋭くなり
磁気ヘッドから読出された波形のビット間干渉によって
起こるパターンピークシフトを低減することができる。
しかし、実際の磁気記録装置では、磁気ヘッドの特性例
えば、磁気ヘッドの形状ギャップ中心に対する非対称性
等により、弧立波形が第３図に示す波形８のように波形
ピークに対し左右非対称になり、ピークシフトの一要因
となっている。従って、この波形８を、第１図の波形等
化回路に入力しても、出力波形９は、波形ピークに対し
左右対称とならず、また、片側にアンダーシュートを生
ずることになり、弧立波形合成したときにピークシフト
を生じ、記録再生系の位相余裕を減少させることとな
る。
えば、磁気ヘッドの形状ギャップ中心に対する非対称性
等により、弧立波形が第３図に示す波形８のように波形
ピークに対し左右非対称になり、ピークシフトの一要因
となっている。従って、この波形８を、第１図の波形等
化回路に入力しても、出力波形９は、波形ピークに対し
左右対称とならず、また、片側にアンダーシュートを生
ずることになり、弧立波形合成したときにピークシフト
を生じ、記録再生系の位相余裕を減少させることとな
る。
本発明は、読出波形ピークに対する左右非対称を補正
し、かつ、波形を細く、鋭くした波形を得て、ピークシ
フトを低減させ、記録再生系の位相余裕の向上を目的と
した波形等化回路を提供することにある。
し、かつ、波形を細く、鋭くした波形を得て、ピークシ
フトを低減させ、記録再生系の位相余裕の向上を目的と
した波形等化回路を提供することにある。
前記目的を達成するために本発明による波形等価回路
は、遅延線を通過した波形を、終端抵抗を用いて電圧反
射係数を変えて遅延線を入力側へ戻る波形の大きさを選
び、入力波形の前後に異なった振幅の波形を作り、それ
を入力波形から差引くことにより、波形ピークに対し、
左右対称で、細く鋭い波形を得ることを特徴とする。
は、遅延線を通過した波形を、終端抵抗を用いて電圧反
射係数を変えて遅延線を入力側へ戻る波形の大きさを選
び、入力波形の前後に異なった振幅の波形を作り、それ
を入力波形から差引くことにより、波形ピークに対し、
左右対称で、細く鋭い波形を得ることを特徴とする。
以下本発明の一実施例を図面を用いて詳細に説明する。
第４図は、本実施例による波形等価回路を示す図であ
る。この波形等価回路は、遅延線11の特性インピーダン
スと等しい出力インピーダンスを持つと共に入力信号波
形を増幅する増幅器10と、入力信号波形を所定時間(t)
遅らせる遅延線11と、端子Ａに入力された信号を反射し
て入力信号と合成し、再び端子Ｂに入力するコレクタ接
地回路12と、入力信号波形の振幅を所定の減衰率(K)で
減衰させる減衰器13と＋（プラス）端子に入力した信号
波形ら−（マイナス）端子に入力した信号波形を除算し
た信号波形を出力する差動増幅器15とから構成されてい
る。
る。この波形等価回路は、遅延線11の特性インピーダン
スと等しい出力インピーダンスを持つと共に入力信号波
形を増幅する増幅器10と、入力信号波形を所定時間(t)
遅らせる遅延線11と、端子Ａに入力された信号を反射し
て入力信号と合成し、再び端子Ｂに入力するコレクタ接
地回路12と、入力信号波形の振幅を所定の減衰率(K)で
減衰させる減衰器13と＋（プラス）端子に入力した信号
波形ら−（マイナス）端子に入力した信号波形を除算し
た信号波形を出力する差動増幅器15とから構成されてい
る。
この様に構成された波形等価回路は、次の様に動作す
る。
る。
まず、本回路は、第５図に示した入力信号16を増幅器10
によって増幅後、遅延回路11及び終端抵抗14を介してコ
レクタ接地回路12の端子Ａに入力する。この端子Ａに入
力される信号波形は、遅延線11によって遅延されるた
め、第５図中に示した波形18の如く、波形16に比べて時
間ｔだけ遅れた波形となる。コレクタ接地回路12は、こ
の信号波形18を差動増幅器15の＋端子に入力すると共に
反射をする。反射された信号波形は、終端抵抗14の特性
インピーダンスによって決定される電圧反射係数（ρ）
をもって反射され、信号波形16と合成された合成波形17
となり、コレクタ接地回路12の端子Ｂに入力される。
尚、終端抵抗14の特性インピーダンスが増幅回路10及び
遅延回路11の特性インピーダンスより高いと共に、前記
回路10及び11の特性インピーダンスが同じのため、反射
波が再び反射されることはない。また、前記コレクタ接
地回路12の端子Ｂに入力された信号波形17は、信号波形
16に比べて遅延線11を２回通過するため２ｔ時間だけ遅
れる。
によって増幅後、遅延回路11及び終端抵抗14を介してコ
レクタ接地回路12の端子Ａに入力する。この端子Ａに入
力される信号波形は、遅延線11によって遅延されるた
め、第５図中に示した波形18の如く、波形16に比べて時
間ｔだけ遅れた波形となる。コレクタ接地回路12は、こ
の信号波形18を差動増幅器15の＋端子に入力すると共に
反射をする。反射された信号波形は、終端抵抗14の特性
インピーダンスによって決定される電圧反射係数（ρ）
をもって反射され、信号波形16と合成された合成波形17
となり、コレクタ接地回路12の端子Ｂに入力される。
尚、終端抵抗14の特性インピーダンスが増幅回路10及び
遅延回路11の特性インピーダンスより高いと共に、前記
回路10及び11の特性インピーダンスが同じのため、反射
波が再び反射されることはない。また、前記コレクタ接
地回路12の端子Ｂに入力された信号波形17は、信号波形
16に比べて遅延線11を２回通過するため２ｔ時間だけ遅
れる。
さて、コレクタ接地回路12は、端子Ａから入力された信
号波形18を差動増幅器15の＋端子に入力すると共に、端
子Ｂから入力された信号波形17を減衰器13によって減衰
した信号波形19を差動増幅器15の一端子に入力する。差
動増幅器15は、前記＋端子から入力した信号波形18から
一端子から入力した信号波形19を除算した信号波形20を
出力する。
号波形18を差動増幅器15の＋端子に入力すると共に、端
子Ｂから入力された信号波形17を減衰器13によって減衰
した信号波形19を差動増幅器15の一端子に入力する。差
動増幅器15は、前記＋端子から入力した信号波形18から
一端子から入力した信号波形19を除算した信号波形20を
出力する。
この信号波形20は、第５図に示す如く、信号波形19によ
って補正されるため、左右対象なアンダーシュートのな
い波形となる。この様に本実施例における波形等価回路
は、入力された波形にたとえアンダーシュートがあって
も、これを補正することができる。具体的には、入力し
た波形の弧立波形半値幅65nsの場合、ｔ＝35ns；Ｋ＝0.
3，ρ＝0.09の条件で、3ns向上可能である。
って補正されるため、左右対象なアンダーシュートのな
い波形となる。この様に本実施例における波形等価回路
は、入力された波形にたとえアンダーシュートがあって
も、これを補正することができる。具体的には、入力し
た波形の弧立波形半値幅65nsの場合、ｔ＝35ns；Ｋ＝0.
3，ρ＝0.09の条件で、3ns向上可能である。
以上述べた如く本発明によれば、入力した信号波形を減
衰及び遅延させた波形を用いて入力波形を補正するた
め、波形のピークを左右対称を補正すると共に波形を細
く鋭くすることができる。これにより記録再生系の位相
余裕を向上させることができる。
衰及び遅延させた波形を用いて入力波形を補正するた
め、波形のピークを左右対称を補正すると共に波形を細
く鋭くすることができる。これにより記録再生系の位相
余裕を向上させることができる。
第１図は従来技術による波形等価回路を示す図、第２図
及び第３図は第１図に示した従来の波形等価回路の各部
の波形を示す図である。第４図は本発明による波形等価
回路の一実施例を示す図であり、第５図は第４図の波形
等価回路による波形を示す図である。 符号の説明 10……増幅器、11……遅延線、 12……コレクタ接地回路、13……減衰器、 14……終端抵抗。
及び第３図は第１図に示した従来の波形等価回路の各部
の波形を示す図である。第４図は本発明による波形等価
回路の一実施例を示す図であり、第５図は第４図の波形
等価回路による波形を示す図である。 符号の説明 10……増幅器、11……遅延線、 12……コレクタ接地回路、13……減衰器、 14……終端抵抗。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 大内 康英 東京都国分寺市恋ケ窪一丁目280番地 株 式会社日立製作所中央研究所内 (72)発明者 青井 基 東京都国分寺市恋ケ窪一丁目280番地 株 式会社日立製作所中央研究所内 (56)参考文献 特開 昭58−79330（ＪＰ，Ａ)
Claims (1)
- 【請求項１】入力した孤立信号波形を波形ピークに対し
左右対称な信号波形に等化する波形等化回路であって、
入力した孤立信号波形を所定時間遅延させる遅延線と、
該遅延線より遅延された信号波形を一方の入力端子に入
力すると共に前記孤立信号波形を他方の入力端子に入力
してインピーダンスの変換を行なうインピーダンス変換
手段と、前記遅延線とインピーダンス変換手段の一方の
入力端子との間に設けられ、前記遅延線の特性インピー
ダンスよりも高い特性インピーダンスを有する終端抵抗
と、前記インピーダンス変換手段の２つの出力の差を増
幅する差動増幅器と、該差動増幅器の一方の入力端子に
設けられた減衰器とを備えることを特徴とする波形等化
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58039236A JPH0624042B2 (ja) | 1983-03-11 | 1983-03-11 | 波形等化回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58039236A JPH0624042B2 (ja) | 1983-03-11 | 1983-03-11 | 波形等化回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59165209A JPS59165209A (ja) | 1984-09-18 |
| JPH0624042B2 true JPH0624042B2 (ja) | 1994-03-30 |
Family
ID=12547490
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58039236A Expired - Lifetime JPH0624042B2 (ja) | 1983-03-11 | 1983-03-11 | 波形等化回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0624042B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60175257A (ja) * | 1984-02-21 | 1985-09-09 | Nec Corp | 読出し回路 |
| JP2511847B2 (ja) * | 1984-11-09 | 1996-07-03 | 株式会社日立製作所 | 波形等化回路 |
| JPH02152323A (ja) * | 1988-12-05 | 1990-06-12 | Hitachi Ltd | 位相同期回路 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0249571B2 (ja) * | 1981-11-05 | 1990-10-30 | Fujitsu Ltd | Hakeiseikeikairo |
-
1983
- 1983-03-11 JP JP58039236A patent/JPH0624042B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59165209A (ja) | 1984-09-18 |
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