JPH058950U - 半導体集積回路 - Google Patents
半導体集積回路Info
- Publication number
- JPH058950U JPH058950U JP5499291U JP5499291U JPH058950U JP H058950 U JPH058950 U JP H058950U JP 5499291 U JP5499291 U JP 5499291U JP 5499291 U JP5499291 U JP 5499291U JP H058950 U JPH058950 U JP H058950U
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- JP
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- semiconductor integrated
- integrated circuit
- circuit
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- Pending
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Abstract
(57)【要約】
【構成】 論理回路の遅延時間を測定するための同一の
遅延測定回路2を半導体集積回路チップ1上の四辺に配
置する。 【効果】 チップ内の遅延特性のばらつきを考慮でき
る。
遅延測定回路2を半導体集積回路チップ1上の四辺に配
置する。 【効果】 チップ内の遅延特性のばらつきを考慮でき
る。
Description
【0001】
本考案は半導体集積回路に関する。
【0002】
従来この種の半導体集積回路は、遅延性能の測定の為に遅延測定回路を有する ものもあったが、半導体集積回路チップ上にある特定の1ケ所に配置されていた 。
【0003】
上述した従来の半導体集積回路は、遅延性能の測定の為の遅延測定回路が半導 体集積回路チップ上のある特定の1ケ所にのみ配置されている為、半導体集積回 路の製造時に発生する半導体集積回路チップ内の遅延性能のばらつきを考慮する 事ができないという欠点がある。
【0004】
本考案の半導体集積回路は、遅延性能の測定の為の同一遅延時間測定回路を半 導体集積回路チップ上の複数ケ所に配置している。
【0005】
次に、本考案について図面を参照して説明する。図1は本考案の一実施例を示 す上面図である。半導体集積回路1の四隅に同一の遅延時刻測定回路2が配置さ れている。
【0006】 図2は遅延時間測定回路の一例であるリングオシレータの回路図である。偶数 個のインバータ回路10と発振を制御する1個の2入力NAND回路11が直列 に接続され発振ループを構成する。制御端子21にHレベル電位を与えるとこの 回路は発信し、Lレベル電位を与えると発信は止まる。発信信号は出力端子20 から観測される。発信周波数を測定する事によりインバータ回路の遅延性能を観 測する事ができる。
【0007】
以上説明したように本考案は、同一の遅延時間測定回路を半導体集積回路チッ プ上の複数ケ所に配置した事により、半導体集積回路の製造ばらつきにより発生 する遅延時間のばらつきを考慮した該半導体集積回路の真の遅延性能を測定でき る効果がある。
【図1】本考案の一実施例を示す上面図である。
【図2】本考案の一使用例を示す回路図である。
1 半導体集積回路チップ 2 遅延時間測定回路 10 インバータ回路 11 2入力NAND回路 20 出力端子 21 制御端子
Claims (1)
- 【実用新案登録請求の範囲】 【請求項1】 論理回路の遅延時間を測定する為の同一
の遅延測定回路を半導体集積回路チップ上の複数ケ所に
配置した事を特徴とする半導体集積回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5499291U JPH058950U (ja) | 1991-07-16 | 1991-07-16 | 半導体集積回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5499291U JPH058950U (ja) | 1991-07-16 | 1991-07-16 | 半導体集積回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH058950U true JPH058950U (ja) | 1993-02-05 |
Family
ID=12986152
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5499291U Pending JPH058950U (ja) | 1991-07-16 | 1991-07-16 | 半導体集積回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH058950U (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012516650A (ja) * | 2009-01-28 | 2012-07-19 | アップル インコーポレイテッド | 動的な電圧及び周波数管理 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6083344A (ja) * | 1983-10-13 | 1985-05-11 | Seiko Epson Corp | 半導体集積回路 |
JPS63133543A (ja) * | 1986-11-25 | 1988-06-06 | Nec Corp | Lsi動作速度制御方式 |
JPH02199851A (ja) * | 1989-01-30 | 1990-08-08 | Hitachi Ltd | 半導体装置 |
-
1991
- 1991-07-16 JP JP5499291U patent/JPH058950U/ja active Pending
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6083344A (ja) * | 1983-10-13 | 1985-05-11 | Seiko Epson Corp | 半導体集積回路 |
JPS63133543A (ja) * | 1986-11-25 | 1988-06-06 | Nec Corp | Lsi動作速度制御方式 |
JPH02199851A (ja) * | 1989-01-30 | 1990-08-08 | Hitachi Ltd | 半導体装置 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012516650A (ja) * | 2009-01-28 | 2012-07-19 | アップル インコーポレイテッド | 動的な電圧及び周波数管理 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19970805 |