JPH0584940B2 - - Google Patents

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Publication number
JPH0584940B2
JPH0584940B2 JP61116386A JP11638686A JPH0584940B2 JP H0584940 B2 JPH0584940 B2 JP H0584940B2 JP 61116386 A JP61116386 A JP 61116386A JP 11638686 A JP11638686 A JP 11638686A JP H0584940 B2 JPH0584940 B2 JP H0584940B2
Authority
JP
Japan
Prior art keywords
image
memory
frame memory
image information
buffer memory
Prior art date
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Expired - Lifetime
Application number
JP61116386A
Other languages
English (en)
Other versions
JPS62272370A (ja
Inventor
Mitsuo Kurakake
Shoichi Ootsuka
Yutaka Muraoka
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fanuc Corp
Original Assignee
Fanuc Corp
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Filing date
Publication date
Application filed by Fanuc Corp filed Critical Fanuc Corp
Priority to JP61116386A priority Critical patent/JPS62272370A/ja
Priority to PCT/JP1987/000308 priority patent/WO1987007411A1/ja
Priority to EP19870903405 priority patent/EP0268687A1/en
Publication of JPS62272370A publication Critical patent/JPS62272370A/ja
Publication of JPH0584940B2 publication Critical patent/JPH0584940B2/ja
Granted legal-status Critical Current

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Classifications

    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/36Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of a graphic pattern, e.g. using an all-points-addressable [APA] memory
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06TIMAGE DATA PROCESSING OR GENERATION, IN GENERAL
    • G06T1/00General purpose image data processing
    • G06T1/60Memory management
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2340/00Aspects of display data processing
    • G09G2340/12Overlay of images, i.e. displayed pixel being the result of switching between the corresponding input pixels

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Digital Computer Display Output (AREA)
  • Controls And Circuits For Display Device (AREA)
  • Processing Or Creating Images (AREA)
  • Image Input (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は第1の画像の上に第2の画像を表示す
るための画像情報の退避方法に関する。
〔従来の技術〕
表示されている画像の上にさらに他の画像を表
示したい場合、例えば、グラフイツク画像の一部
にデータを表示したい場合がある。従来、このた
めに、画像情報を記憶するフレームメモリの一部
をデータメモリに戻し、フレームメモリの空き部
分に表示したい画像情報を入力する方法が知られ
ている。
〔発明が解決しようとする問題点〕
しかし、従来の方法では画像情報をデータメモ
リに退避するためにメインCPUに負担が掛り、
且つ時間的にも低速度であるという問題点があつ
た。
本発明の目的は上記問題点を解決し、高速で、
メインCPUに負担の掛からない画像情報の退避
方法を提供することにある。
〔問題点を解決するための手段〕
本発明では上記の問題点を解決するために、 画像情報を記憶するフレームメモリと、画像演
算を行うための高速の画像演算用バツフアメモリ
を有し、第1の画像の上に第2の画像を表示する
ための画像情報の退避方法において、前記フレー
ムメモリの前記第1の画像の一部を前記画像演算
用バツフアメモリに一時退避し、前記フレームメ
モリの前記第1の画像の一部を取り除いた部分に
第2の画像情報を入力し、第2の画像を消去する
時に前記画像演算用バツフアメモリに退避した第
1の画像の一部を前記画像演算用バルフアメモリ
からもとの画像用メモリに戻すことを特徴とする
画像情報の退避方法が、提供される。
〔作用〕
フレームメモリと画像演算用バルフアメモリの
間の処理は画像演算処理のため、フレームメモリ
とデータメモリ間より高速に、かつメインCPU
を介すことなくデータ転送ができる。
〔実施列〕
以下本発明の一実施列を図面に基づいて説明す
る。
第1図に本発明の一実施列のブロツク図を示
す。図において、1はメインCPU、2は画像情
報及びプログラムを記憶しているデータメモリ、
3はバス調停回路であり、4は画像演算用の
CPUである。5は画像情報を記憶するフレーム
メモリであり、6はゲートであり、フレームメモ
リ5と画像演算用バツフアメモリ7とのデータの
転送を画像演算用CPU4の指令に基づいて制御
する。7は画像演算用バツフアメモリであり、画
像データの鮮説化、空間フイルタリング等の画像
処理演算をおこなうためのバツフアメモリであ
り、容量は一般にフレームメモリよりは小さい
が、演算内容に応じて容量が決められる。8はモ
ニタであり、フレームメモリの内容を表示するた
めの表示装置であり、一般的にCRT表示装置が
用いられる。9はカメラであり、必要な画像を写
し、その画像情報は画像演算用CPU4で画像処
理されてデータメモリに転送される。
次に動作について述べる。必要な画像情報は、
メインCPU1によりデータメモリ2から選択さ
れ、フレームメモリ5に記憶され、画像演算用
CPU4によつてモニタ8に表示される。ここで、
さらに他の画像の一部を先の画像の上に表示した
いときは、メインCPU1は先の画像の一部をフ
レームメモリ5から画像演算用バツフアメモリ7
に転送するように画像演算用CPU4に指令を出
す。画像演算用CPU4はこの指令を受け、ゲー
ト6を開き、フレームメモリのデータの一部を画
像演算用バツフアメモリ7に退避させる。次に、
メインCPU1は他の画像の一部をデータメモリ
からフレームメモリ5の空き部分に転送する。こ
の結果、フレームメモリ5の内容は先の画像情報
の一部に他の画像情報の一部が入り、モニタ8に
は、先の画像に他の画像が重ねて表示される。
他の画像を削除するときは、画像演算用CPU
4は画像演算用バツフアメモリ7に退避してあつ
た先の画像情報をフレームメモリ5に戻せば、フ
レームメモリ5のデータは先の画像情報のみとな
り、モニタ8には先の画像のみが表示される。こ
の場合フレームメモリ5と、画像演算用バツフア
メモリ7の間はデータメモリ2とフレームメモリ
5間に比べ画像処理演算のために高速に転送でき
るように構成されているので、高速に先の画像情
報を戻すことができる。
〔発明の効果〕
以上説明したように、本発明では他の画像を重
ねて表示する場合に先の画像情報を画像演算用バ
ツフアメモリに退避するように構成したので、デ
ータ転送を高速ででき、かつメインCPUの負担
を減らすことができる。
【図面の簡単な説明】
第1図は本発明の一実施例のブロツク図であ
る。 1……メインCPU、2……データメモリ、4
……画像処理用CPU、5……フレームメモリ、
7…画像演算用バツフアメモリ、8…モニタ。

Claims (1)

  1. 【特許請求の範囲】 1 画像情報を記憶するフレームメモリと、画像
    演算を行うための高速の画像演算用バツフアメモ
    リを有し、第1の画像の上に第2の画像を表示す
    るための画像情報の退避方法において、 前記フレームメモリの前記第1の画像の一部を
    前記画像演算用バツフアメモリに一時退避し、 前記フレームメモリの前記第1の画像の一部を
    取り除いた部分に第2の画像情報を入力し、 第2の画像を消去する時に前記画像演算用バツ
    フアメモリに退避した第1の画像の一部を前記画
    像演算用バツフアメモリからもとの画像用メモリ
    に戻すことを特徴とする画像情報の退避方法。
JP61116386A 1986-05-21 1986-05-21 画像情報の退避方法 Granted JPS62272370A (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP61116386A JPS62272370A (ja) 1986-05-21 1986-05-21 画像情報の退避方法
PCT/JP1987/000308 WO1987007411A1 (en) 1986-05-21 1987-05-16 System for saving image data
EP19870903405 EP0268687A1 (en) 1986-05-21 1987-05-16 System for saving image data

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP61116386A JPS62272370A (ja) 1986-05-21 1986-05-21 画像情報の退避方法

Publications (2)

Publication Number Publication Date
JPS62272370A JPS62272370A (ja) 1987-11-26
JPH0584940B2 true JPH0584940B2 (ja) 1993-12-03

Family

ID=14685735

Family Applications (1)

Application Number Title Priority Date Filing Date
JP61116386A Granted JPS62272370A (ja) 1986-05-21 1986-05-21 画像情報の退避方法

Country Status (3)

Country Link
EP (1) EP0268687A1 (ja)
JP (1) JPS62272370A (ja)
WO (1) WO1987007411A1 (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0312720A3 (en) * 1987-10-20 1990-06-13 Tektronix Inc. Double buffered graphics design system
EP0766201B1 (en) * 1995-09-28 2001-12-12 Agfa Corporation A method and apparatus for buffering data between a raster image processor and an output device

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5054647U (ja) * 1973-09-13 1975-05-24
JPS54108534A (en) * 1978-02-14 1979-08-25 Nec Corp Cathode-ray tube graphic display unit
JPS56104380A (en) * 1980-01-22 1981-08-20 Fujitsu Ltd Memory retrieval system in display unit

Also Published As

Publication number Publication date
EP0268687A1 (en) 1988-06-01
JPS62272370A (ja) 1987-11-26
WO1987007411A1 (en) 1987-12-03

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