JPH05342511A - 磁気記録制御装置 - Google Patents
磁気記録制御装置Info
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- JPH05342511A JPH05342511A JP4153601A JP15360192A JPH05342511A JP H05342511 A JPH05342511 A JP H05342511A JP 4153601 A JP4153601 A JP 4153601A JP 15360192 A JP15360192 A JP 15360192A JP H05342511 A JPH05342511 A JP H05342511A
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- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
Abstract
(57)【要約】
【構成】フィルタ回路１、増幅回路２およびレベル変換
回路３から成る読取信号生成回路を設け、読取時に、磁
気ヘッド６の再生信号をフィルタ回路１へ与えるように
し、読取矩形波信号Ｃの立ち上がりから一定時間を読取
期間、それ以外の期間を書込期間として読取書込制御信
号Ｒ／Ｗを発生させる。一方書込信号生成回路としての
パターンジェネレータ４は基準タイミングから、書き込
むべきデータに応じたタイミングで書込矩形波信号ＰＧ
＋，ＰＧ−を発生させる。そして書込時において書込信
号を磁気ヘッド６に与えるようにする。 【効果】磁気ヘッドからの再生信号の読取を行う読取用
回路と磁気ヘッドを用いて磁気記録媒体に対し書込を行
う書込用回路およびこれらの回路を制御するコントロー
ル回路を全て１チップの半導体集積回路に設けることが
できるため、単純なシステム構成で磁気記録制御装置を
構成することが可能となる。
回路３から成る読取信号生成回路を設け、読取時に、磁
気ヘッド６の再生信号をフィルタ回路１へ与えるように
し、読取矩形波信号Ｃの立ち上がりから一定時間を読取
期間、それ以外の期間を書込期間として読取書込制御信
号Ｒ／Ｗを発生させる。一方書込信号生成回路としての
パターンジェネレータ４は基準タイミングから、書き込
むべきデータに応じたタイミングで書込矩形波信号ＰＧ
＋，ＰＧ−を発生させる。そして書込時において書込信
号を磁気ヘッド６に与えるようにする。 【効果】磁気ヘッドからの再生信号の読取を行う読取用
回路と磁気ヘッドを用いて磁気記録媒体に対し書込を行
う書込用回路およびこれらの回路を制御するコントロー
ル回路を全て１チップの半導体集積回路に設けることが
できるため、単純なシステム構成で磁気記録制御装置を
構成することが可能となる。
Description
【０００１】
【産業上の利用分野】この発明は、磁気ヘッドを介し
て、磁気テープなどの記録媒体に記録されているデータ
の読み取りおよび書換えを行う磁気記録制御装置に関す
る。
て、磁気テープなどの記録媒体に記録されているデータ
の読み取りおよび書換えを行う磁気記録制御装置に関す
る。
【０００２】
【従来の技術】従来より、例えばＶＴＲなどの回転ヘッ
ドを用いたヘリカルスキャン方式の磁気記録再生装置に
おいては、記録時に磁気テープ上のコントロールトラッ
クに同期信号を記録しておき、再生時に同期信号を再生
してキャプスタンまたは回転ヘッドシリンダの回転位相
制御を行い、磁気テープの記録トラックを回転ヘッドが
正しくトレースするようサーボ回路でトラッキング制御
するようにしている。また、このような同期信号は矩形
波信号としての立ち上がりまたは立ち下がりのタイミン
グが検出できれば良いため、そのデューティ比によって
ビット情報を付与すれば、同期信号に新たな情報を重畳
することができる。
ドを用いたヘリカルスキャン方式の磁気記録再生装置に
おいては、記録時に磁気テープ上のコントロールトラッ
クに同期信号を記録しておき、再生時に同期信号を再生
してキャプスタンまたは回転ヘッドシリンダの回転位相
制御を行い、磁気テープの記録トラックを回転ヘッドが
正しくトレースするようサーボ回路でトラッキング制御
するようにしている。また、このような同期信号は矩形
波信号としての立ち上がりまたは立ち下がりのタイミン
グが検出できれば良いため、そのデューティ比によって
ビット情報を付与すれば、同期信号に新たな情報を重畳
することができる。
【０００３】ところで、一般に磁気ヘッドから出力され
る信号の電圧レベルは微弱であるため、従来の磁気記録
制御装置は読取用回路によって信号レベルの増幅および
ノイズ除去を行い、制御用回路にロジックレベルの信号
を与えるようにし、データの書換え時には、書込用回路
が制御用回路から受け取ったデータに応じて書き込み信
号を生成して磁気ヘッドに供給するようにしている。
る信号の電圧レベルは微弱であるため、従来の磁気記録
制御装置は読取用回路によって信号レベルの増幅および
ノイズ除去を行い、制御用回路にロジックレベルの信号
を与えるようにし、データの書換え時には、書込用回路
が制御用回路から受け取ったデータに応じて書き込み信
号を生成して磁気ヘッドに供給するようにしている。
【０００４】
【発明が解決しようとする課題】ところが、このような
従来の磁気記録制御装置においては、磁気ヘッドから出
力される信号の増幅、ノイズ除去およびロジックレベル
への変換を行う読取用回路は、微弱な信号を増幅する回
路が必要であるためバイポーラＩＣが用いられ、書込用
回路としては、その出力段を除き基本的に論理回路で構
成されるためＣ−ＭＯＳのＩＣが用いられていた。この
ように、磁気ヘッドを介しての信号の読み取りおよび書
き込みをそれぞれ異なるＩＣで行うため、読取用ＩＣと
書込用ＩＣ間で読み書きのタイミング制御を行う信号を
入出力しなければならないなど、システム構成が複雑と
なっていた。
従来の磁気記録制御装置においては、磁気ヘッドから出
力される信号の増幅、ノイズ除去およびロジックレベル
への変換を行う読取用回路は、微弱な信号を増幅する回
路が必要であるためバイポーラＩＣが用いられ、書込用
回路としては、その出力段を除き基本的に論理回路で構
成されるためＣ−ＭＯＳのＩＣが用いられていた。この
ように、磁気ヘッドを介しての信号の読み取りおよび書
き込みをそれぞれ異なるＩＣで行うため、読取用ＩＣと
書込用ＩＣ間で読み書きのタイミング制御を行う信号を
入出力しなければならないなど、システム構成が複雑と
なっていた。
【０００５】上述の問題はＶＴＲにおけるコントロール
トラックに対する磁気記録制御に限らず、矩形波信号の
デューティ比を変更することによってデータの書換えを
行う磁気記録制御装置に共通の問題である。
トラックに対する磁気記録制御に限らず、矩形波信号の
デューティ比を変更することによってデータの書換えを
行う磁気記録制御装置に共通の問題である。
【０００６】この発明の目的は、前述の問題を解消し
て、システム構成を単純化することのできる磁気記録制
御装置を提供することにある。
て、システム構成を単純化することのできる磁気記録制
御装置を提供することにある。
【０００７】
【課題を解決するための手段】この発明の磁気記録制御
装置は、磁気ヘッドの再生信号を増幅する増幅回路と、
前記増幅回路により増幅された正負両極性に変位する信
号を矩形波信号に変換して読取矩形波信号を生成する読
取信号生成回路と、読取時に、前記磁気ヘッドの再生信
号を前記増幅回路へ与える読取信号切替回路と、前記読
取矩形波信号の立ち上がりまたは立ち下がりのタイミン
グを基準として、この基準タイミングから一定時間を読
取期間、それ以外の期間を書込期間として読取書込制御
信号を発生する読取書込制御信号発生回路と、前記基準
タイミングから、書込データに応じて定まる所定時間の
後に立ち上がるまたは立ち下がる書込矩形波信号を発生
する書込信号生成回路と、前記書込期間に前記書込矩形
波信号を前記磁気ヘッドの両端に与える書込信号切替回
路、とを１チップの半導体集積回路に設けたことを特徴
とする。
装置は、磁気ヘッドの再生信号を増幅する増幅回路と、
前記増幅回路により増幅された正負両極性に変位する信
号を矩形波信号に変換して読取矩形波信号を生成する読
取信号生成回路と、読取時に、前記磁気ヘッドの再生信
号を前記増幅回路へ与える読取信号切替回路と、前記読
取矩形波信号の立ち上がりまたは立ち下がりのタイミン
グを基準として、この基準タイミングから一定時間を読
取期間、それ以外の期間を書込期間として読取書込制御
信号を発生する読取書込制御信号発生回路と、前記基準
タイミングから、書込データに応じて定まる所定時間の
後に立ち上がるまたは立ち下がる書込矩形波信号を発生
する書込信号生成回路と、前記書込期間に前記書込矩形
波信号を前記磁気ヘッドの両端に与える書込信号切替回
路、とを１チップの半導体集積回路に設けたことを特徴
とする。
【０００８】
【作用】この発明の磁気記録制御装置では、読取信号切
替回路は、読取時に磁気ヘッドの再生信号を増幅回路へ
与え、増幅回路は磁気ヘッドの再生信号を増幅し、読取
信号生成回路は、前記増幅回路により増幅された正負両
極性に変位する信号を矩形波信号に変換し、これを読取
矩形波信号として生成する。読取書込制御信号発生回路
は、読取矩形波信号の立ち上がりまたは立ち下がりのタ
イミングを基準として、その基準タイミングから一定時
間を読取期間、それ以外の期間を書込期間として読取書
込制御信号を発生する。書込信号生成回路は、書込デー
タに応じて定まる所定時間だけ前記基準タイミングから
経過した後に立ち上がるまたは立ち下がる書込矩形波信
号を発生し、書込信号切替え回路は、書込期間に書込矩
形波信号を磁気ヘッドの両端に与える。
替回路は、読取時に磁気ヘッドの再生信号を増幅回路へ
与え、増幅回路は磁気ヘッドの再生信号を増幅し、読取
信号生成回路は、前記増幅回路により増幅された正負両
極性に変位する信号を矩形波信号に変換し、これを読取
矩形波信号として生成する。読取書込制御信号発生回路
は、読取矩形波信号の立ち上がりまたは立ち下がりのタ
イミングを基準として、その基準タイミングから一定時
間を読取期間、それ以外の期間を書込期間として読取書
込制御信号を発生する。書込信号生成回路は、書込デー
タに応じて定まる所定時間だけ前記基準タイミングから
経過した後に立ち上がるまたは立ち下がる書込矩形波信
号を発生し、書込信号切替え回路は、書込期間に書込矩
形波信号を磁気ヘッドの両端に与える。
【０００９】以上のように、基準タイミングを定める磁
気記録媒体に記録されている矩形波信号の立ち上がりま
たは立ち下がりのタイミングは書換えられず、それに続
く立ち下がりまたは立ち上がりのタイミングが、与えら
れた書込データに応じて定まる位置に書換えられる。
気記録媒体に記録されている矩形波信号の立ち上がりま
たは立ち下がりのタイミングは書換えられず、それに続
く立ち下がりまたは立ち上がりのタイミングが、与えら
れた書込データに応じて定まる位置に書換えられる。
【００１０】我々の設計試作によれば、Ｃ−ＭＯＳ構成
であっても磁気ヘッドから出力される微弱な電圧信号を
増幅しノイズ除去を行うことが可能であることを見出し
た。
であっても磁気ヘッドから出力される微弱な電圧信号を
増幅しノイズ除去を行うことが可能であることを見出し
た。
【００１１】例えば前記全ての回路はＣ−ＭＯＳプロセ
スで構成することができ、１チップ化が容易となった。
このように前記各回路を１チップの半導体集積回路に設
けることにより二つのＩＣ間で、読み書きのタイミング
制御用信号の入出力を行う必要性もなくなり、また読取
と書込を兼ねる同一端子に磁気ヘッドを接続すれば良い
ため、全体のシステム構成が大幅に単純化される。
スで構成することができ、１チップ化が容易となった。
このように前記各回路を１チップの半導体集積回路に設
けることにより二つのＩＣ間で、読み書きのタイミング
制御用信号の入出力を行う必要性もなくなり、また読取
と書込を兼ねる同一端子に磁気ヘッドを接続すれば良い
ため、全体のシステム構成が大幅に単純化される。
【００１２】
【実施例】この発明の実施例である磁気記録制御装置の
構成を図１および図２に示す。
構成を図１および図２に示す。
【００１３】図１は全体の回路図である。図１において
フィルタ回路１は抵抗Ｒ１，Ｒ２，Ｒ３、コンデンサＣ
１，Ｃ２およびオペアンプＯＰ１から成る。オペアンプ
ＯＰ１の＋端子には１／２ＶDDの電圧を与えている。後
述するように、読取時にはアナログスイッチとしてのｐ
チャンネルＭＯＳトランジスタＰ４およびｎチャンネル
ＭＯＳトランジスタＮ３は共に導通状態であり、読取時
において磁気ヘッド６の出力信号がフィルタ回路１に与
えられる。前記ｐチャンネルＭＯＳトランジスタＰ４、
ｎチャンネルＭＯＳトランジスタＮ３およびｎチャンネ
ルＭＯＳトランジスタＮ３にゲート信号を与えるインバ
ータＩ７はこの発明に係る読取信号切替回路に相当す
る。増幅回路２は抵抗Ｒ４，Ｒ５およびオペアンプＯＰ
２から成り、フィルタ回路１の出力信号を一定増幅率で
増幅する。レベル変換回路３は抵抗Ｒ６，Ｒ７、コンパ
レータＣＭＰ１、インバータＩ２，Ｉ３から成り、増幅
回路２から出力される正負両極性に変位する信号を矩形
波信号に変換する。これらのフィルタ回路１、増幅回路
２およびレベル変換回路３はこの発明に係る読取信号生
成回路に相当する。パターンジェネレータ４はこの発明
に係る書込信号生成回路に相当し、レベル変換回路３か
ら出力される読取矩形波信号Ｃの立ち上がりでスタート
し、書き込むべきデータに応じて所定時間後にレベル反
転する書込矩形波信号ＰＧ＋，ＰＧ−を発生する。ま
た、図１においてタイマ５はレベル変換回路３より出力
される読取矩形波信号Ｃの立ち上がりからタイマをスタ
ートさせて、一定時間後にタイミング信号Ｔ１およびＴ
２を出力する。ＮＯＲゲートＮＯＲ１、ＮＯＲ２および
インバータＩ４はフリップフロップを構成し、タイマ５
の出力Ｔ１の立ち上がりによりＲ／Ｗ信号が立ち上が
り、タイマ５の出力Ｔ２の立ち上がりでＲ／Ｗ信号は立
ち下がる。これらのタイマ５、ＮＯＲゲートＮＯＲ１，
ＮＯＲ２およびインバータＩ４はこの発明に係る読取書
込制御信号発生回路に相当する。
フィルタ回路１は抵抗Ｒ１，Ｒ２，Ｒ３、コンデンサＣ
１，Ｃ２およびオペアンプＯＰ１から成る。オペアンプ
ＯＰ１の＋端子には１／２ＶDDの電圧を与えている。後
述するように、読取時にはアナログスイッチとしてのｐ
チャンネルＭＯＳトランジスタＰ４およびｎチャンネル
ＭＯＳトランジスタＮ３は共に導通状態であり、読取時
において磁気ヘッド６の出力信号がフィルタ回路１に与
えられる。前記ｐチャンネルＭＯＳトランジスタＰ４、
ｎチャンネルＭＯＳトランジスタＮ３およびｎチャンネ
ルＭＯＳトランジスタＮ３にゲート信号を与えるインバ
ータＩ７はこの発明に係る読取信号切替回路に相当す
る。増幅回路２は抵抗Ｒ４，Ｒ５およびオペアンプＯＰ
２から成り、フィルタ回路１の出力信号を一定増幅率で
増幅する。レベル変換回路３は抵抗Ｒ６，Ｒ７、コンパ
レータＣＭＰ１、インバータＩ２，Ｉ３から成り、増幅
回路２から出力される正負両極性に変位する信号を矩形
波信号に変換する。これらのフィルタ回路１、増幅回路
２およびレベル変換回路３はこの発明に係る読取信号生
成回路に相当する。パターンジェネレータ４はこの発明
に係る書込信号生成回路に相当し、レベル変換回路３か
ら出力される読取矩形波信号Ｃの立ち上がりでスタート
し、書き込むべきデータに応じて所定時間後にレベル反
転する書込矩形波信号ＰＧ＋，ＰＧ−を発生する。ま
た、図１においてタイマ５はレベル変換回路３より出力
される読取矩形波信号Ｃの立ち上がりからタイマをスタ
ートさせて、一定時間後にタイミング信号Ｔ１およびＴ
２を出力する。ＮＯＲゲートＮＯＲ１、ＮＯＲ２および
インバータＩ４はフリップフロップを構成し、タイマ５
の出力Ｔ１の立ち上がりによりＲ／Ｗ信号が立ち上が
り、タイマ５の出力Ｔ２の立ち上がりでＲ／Ｗ信号は立
ち下がる。これらのタイマ５、ＮＯＲゲートＮＯＲ１，
ＮＯＲ２およびインバータＩ４はこの発明に係る読取書
込制御信号発生回路に相当する。
【００１４】ＮＡＮＤゲートＮＡＮＤ１およびＮＯＲゲ
ートＮＯＲ３の一方の入力にはＰＧ＋を入力し、ＮＡＮ
Ｄ１の他方の入力にはＲ／Ｗ信号を入力し、ＮＯＲ３の
他方の入力にはインバータＩ５によるＲ／Ｗ信号の反転
信号を入力している。また、ＮＡＮＤ１の出力をｐチャ
ンネルＭＯＳトランジスタＰ１のゲートに接続し、ＮＯ
Ｒ３の出力をｎチャンネルＭＯＳトランジスタＮ１のゲ
ートに接続している。
ートＮＯＲ３の一方の入力にはＰＧ＋を入力し、ＮＡＮ
Ｄ１の他方の入力にはＲ／Ｗ信号を入力し、ＮＯＲ３の
他方の入力にはインバータＩ５によるＲ／Ｗ信号の反転
信号を入力している。また、ＮＡＮＤ１の出力をｐチャ
ンネルＭＯＳトランジスタＰ１のゲートに接続し、ＮＯ
Ｒ３の出力をｎチャンネルＭＯＳトランジスタＮ１のゲ
ートに接続している。
【００１５】従ってＲ／Ｗ信号が“Ｈ”の時で且つＰＧ
＋が“Ｈ”の時、ＮＡＮＤ１の出力Ｇ＋１とＮＯＲ３の
出力Ｇ＋２はともに“Ｌ”レベルとなって、ｐチャンネ
ルＭＯＳトランジスタＰ１がＯＮし、ｎチャンネルＭＯ
ＳトランジスタＮ１がＯＦＦする。これにより磁気ヘッ
ド６の端子＋にはＶDDが供給される。一方、ＮＡＮＤゲ
ートＮＡＮＤ２およびＮＯＲゲートＮＯＲ４の一方の入
力にはＰＧ−を入力し、ＮＡＮＤ２の他方の入力にはＲ
／Ｗ信号を与え、ＮＯＲ４の他方の入力にはインバータ
Ｉ６によるＲ／Ｗ信号の反転信号を与えている。また、
ＮＡＮＤ２の出力をｐチャンネルＭＯＳトランジスタＰ
２のゲートに接続し、ＮＯＲ４の出力をｎチャンネルＭ
ＯＳトランジスタＮ２のゲートに接続している。従って
Ｒ／Ｗ信号が“Ｈ”で且つＰＧ−が“Ｌ”の時ＮＡＮＤ
２の出力Ｇ−１と、ＮＯＲ４の出力Ｇ−２はともに
“Ｈ”レベルとなって、ｐチャンネルＭＯＳトランジス
タＰ２がＯＦＦし、ｎチャンネルＭＯＳトランジスタＮ
２がＯＮする。これにより磁気ヘッド６の端子−にはＧ
ＮＤ電位が与えられる。
＋が“Ｈ”の時、ＮＡＮＤ１の出力Ｇ＋１とＮＯＲ３の
出力Ｇ＋２はともに“Ｌ”レベルとなって、ｐチャンネ
ルＭＯＳトランジスタＰ１がＯＮし、ｎチャンネルＭＯ
ＳトランジスタＮ１がＯＦＦする。これにより磁気ヘッ
ド６の端子＋にはＶDDが供給される。一方、ＮＡＮＤゲ
ートＮＡＮＤ２およびＮＯＲゲートＮＯＲ４の一方の入
力にはＰＧ−を入力し、ＮＡＮＤ２の他方の入力にはＲ
／Ｗ信号を与え、ＮＯＲ４の他方の入力にはインバータ
Ｉ６によるＲ／Ｗ信号の反転信号を与えている。また、
ＮＡＮＤ２の出力をｐチャンネルＭＯＳトランジスタＰ
２のゲートに接続し、ＮＯＲ４の出力をｎチャンネルＭ
ＯＳトランジスタＮ２のゲートに接続している。従って
Ｒ／Ｗ信号が“Ｈ”で且つＰＧ−が“Ｌ”の時ＮＡＮＤ
２の出力Ｇ−１と、ＮＯＲ４の出力Ｇ−２はともに
“Ｈ”レベルとなって、ｐチャンネルＭＯＳトランジス
タＰ２がＯＦＦし、ｎチャンネルＭＯＳトランジスタＮ
２がＯＮする。これにより磁気ヘッド６の端子−にはＧ
ＮＤ電位が与えられる。
【００１６】ｎチャンネルＭＯＳトランジスタＮ３はイ
ンバータＩ７によるＲ／Ｗ信号の反転信号が“Ｈ”レベ
ルのとき（読取時）にＯＮして磁気ヘッド６の端子−を
ＧＮＤ電位とし、ｐチャンネルＭＯＳトランジスタＰ４
はＲ／Ｗ信号の反転信号が“Ｌ”レベルのとき（読取
時）にＯＮして、磁気ヘッド６の端子＋をフィルタ回路
に接続する。逆に、Ｒ／Ｗ信号の反転信号が“Ｈ”レベ
ルのとき（書込時）には、ｎチャンネルＭＯＳトランジ
スタＮ３をＯＦＦし、ｐチャンネルＭＯＳトランジスタ
Ｐ３はインバータＩ１によるＲ／Ｗ信号の反転信号が
“Ｌ”レベルのとき（書込時）にＯＮして、フィルタ回
路１の入力をＧＮＤに接続する。
ンバータＩ７によるＲ／Ｗ信号の反転信号が“Ｈ”レベ
ルのとき（読取時）にＯＮして磁気ヘッド６の端子−を
ＧＮＤ電位とし、ｐチャンネルＭＯＳトランジスタＰ４
はＲ／Ｗ信号の反転信号が“Ｌ”レベルのとき（読取
時）にＯＮして、磁気ヘッド６の端子＋をフィルタ回路
に接続する。逆に、Ｒ／Ｗ信号の反転信号が“Ｈ”レベ
ルのとき（書込時）には、ｎチャンネルＭＯＳトランジ
スタＮ３をＯＦＦし、ｐチャンネルＭＯＳトランジスタ
Ｐ３はインバータＩ１によるＲ／Ｗ信号の反転信号が
“Ｌ”レベルのとき（書込時）にＯＮして、フィルタ回
路１の入力をＧＮＤに接続する。
【００１７】図２は図１に示した回路の各部のタイミン
グを示す図である。図２において「書換え前のテープデ
ータ」は磁気ヘッド６による再生信号であり、ここでは
ビット列“０１”を再生している。図２に示すように、
書換え前のテープデータが正側に振れる時、レベル変換
回路の出力信号Ｃが立ち上がる。この例ではデータの書
換えを行っているので、一旦立ち上がった後再び立ち下
がっている。もし読取だけであれば、テープデータの負
側に振れるタイミングでレベル変換回路の出力Ｃは立ち
下がる。レベル変換回路の出力Ｃが立ち上がってからタ
イマ出力Ｔ１が立ち上がった時Ｒ／Ｗ信号は立ち上が
る。その後のタイマ出力Ｔ２の立ち上がりでＲ／Ｗ信号
が立ち下がる。このＲ／Ｗ信号の“Ｌ”期間が読取期
間、“Ｈ”期間が書込期間である。レベル変換回路の出
力Ｃが立ち上がってから一定時間（この一定時間は書き
換えるべきデータのビットが“０”であるか“１”であ
るかによって定まる）経過後、パターンジェネレータの
出力ＰＧ＋が立ち上がり、その後、レベル変換回路の出
力Ｃが立ち上がるまでに立ち下がる。パターンジェネレ
ータ４から出力されるもう一方の信号ＰＧ−はＰＧ＋の
反転信号である。図１に示したＮＡＮＤゲートＮＡＮＤ
１，ＮＡＮＤ２、ＮＯＲゲートＮＯＲ３，ＮＯＲ４およ
びインバータＩ５，Ｉ６から成る回路に対し図２に示す
読取書込制御信号Ｒ／Ｗおよび書込矩形波信号ＰＧ＋，
ＰＧ−を与えることによって、出力段のＭＯＳトランジ
スタに対するゲート信号Ｇ＋１，Ｇ＋２，Ｇ−１，Ｇ−
２はそれぞれ図２に示すようになる。その結果、磁気ヘ
ッドの端子＋には読取時において再生信号が発生し、書
込時においてＰＧ＋が“Ｌ”の期間ＧＮＤ電位が与えら
れ、ＰＧ＋が“Ｈ”レベルの期間ＶDDの電位が与えられ
る。一方、磁気ヘッドの端子−には書込期間においてＰ
Ｇ−が“Ｈ”レベルの期間ＶDDが印加される。このよう
に書込期間においてＰＧ＋が“Ｈ”レベル（ＰＧ−が
“Ｌ”レベル）となれば、磁気ヘッドの端子＋にはＶDD
が印加され、端子−にはＧＮＤ電位が接続される。ただ
し図１における抵抗Ｒ８，Ｒ９の存在により、磁気ヘッ
ドの端子＋および端子−に対する印加電圧は、図２にお
いて「端子＋」の波形中のＳ＋および「端子−」の波形
中のＳ−に示すように遅延する。このことにより磁気テ
ープには矩形波の立ち下がりタイミングが書換えられる
ことになる。図２における「書換え後のテープデータ」
は書換え後のテープを読み取った時に磁気ヘッドに再生
される信号を表している。
グを示す図である。図２において「書換え前のテープデ
ータ」は磁気ヘッド６による再生信号であり、ここでは
ビット列“０１”を再生している。図２に示すように、
書換え前のテープデータが正側に振れる時、レベル変換
回路の出力信号Ｃが立ち上がる。この例ではデータの書
換えを行っているので、一旦立ち上がった後再び立ち下
がっている。もし読取だけであれば、テープデータの負
側に振れるタイミングでレベル変換回路の出力Ｃは立ち
下がる。レベル変換回路の出力Ｃが立ち上がってからタ
イマ出力Ｔ１が立ち上がった時Ｒ／Ｗ信号は立ち上が
る。その後のタイマ出力Ｔ２の立ち上がりでＲ／Ｗ信号
が立ち下がる。このＲ／Ｗ信号の“Ｌ”期間が読取期
間、“Ｈ”期間が書込期間である。レベル変換回路の出
力Ｃが立ち上がってから一定時間（この一定時間は書き
換えるべきデータのビットが“０”であるか“１”であ
るかによって定まる）経過後、パターンジェネレータの
出力ＰＧ＋が立ち上がり、その後、レベル変換回路の出
力Ｃが立ち上がるまでに立ち下がる。パターンジェネレ
ータ４から出力されるもう一方の信号ＰＧ−はＰＧ＋の
反転信号である。図１に示したＮＡＮＤゲートＮＡＮＤ
１，ＮＡＮＤ２、ＮＯＲゲートＮＯＲ３，ＮＯＲ４およ
びインバータＩ５，Ｉ６から成る回路に対し図２に示す
読取書込制御信号Ｒ／Ｗおよび書込矩形波信号ＰＧ＋，
ＰＧ−を与えることによって、出力段のＭＯＳトランジ
スタに対するゲート信号Ｇ＋１，Ｇ＋２，Ｇ−１，Ｇ−
２はそれぞれ図２に示すようになる。その結果、磁気ヘ
ッドの端子＋には読取時において再生信号が発生し、書
込時においてＰＧ＋が“Ｌ”の期間ＧＮＤ電位が与えら
れ、ＰＧ＋が“Ｈ”レベルの期間ＶDDの電位が与えられ
る。一方、磁気ヘッドの端子−には書込期間においてＰ
Ｇ−が“Ｈ”レベルの期間ＶDDが印加される。このよう
に書込期間においてＰＧ＋が“Ｈ”レベル（ＰＧ−が
“Ｌ”レベル）となれば、磁気ヘッドの端子＋にはＶDD
が印加され、端子−にはＧＮＤ電位が接続される。ただ
し図１における抵抗Ｒ８，Ｒ９の存在により、磁気ヘッ
ドの端子＋および端子−に対する印加電圧は、図２にお
いて「端子＋」の波形中のＳ＋および「端子−」の波形
中のＳ−に示すように遅延する。このことにより磁気テ
ープには矩形波の立ち下がりタイミングが書換えられる
ことになる。図２における「書換え後のテープデータ」
は書換え後のテープを読み取った時に磁気ヘッドに再生
される信号を表している。
【００１８】以上のようにして磁気テープ上のデータで
あるビット列“０１”が“１０”に書換えられる。
あるビット列“０１”が“１０”に書換えられる。
【００１９】
【発明の効果】この発明によれば、磁気ヘッドからの信
号を読み取る読取用回路と、磁気ヘッドに対して書込信
号を与える書込用回路が１チップの半導体集積回路に設
けられ、ことにより二つのＩＣ間で、読み書きのタイミ
ング制御用信号の入出力を行う必要性もなくなり、また
読取と書込を兼ねる同一端子に磁気ヘッドを接続すれば
良いため、全体のシステム構成が大幅に単純化される。
号を読み取る読取用回路と、磁気ヘッドに対して書込信
号を与える書込用回路が１チップの半導体集積回路に設
けられ、ことにより二つのＩＣ間で、読み書きのタイミ
ング制御用信号の入出力を行う必要性もなくなり、また
読取と書込を兼ねる同一端子に磁気ヘッドを接続すれば
良いため、全体のシステム構成が大幅に単純化される。
【図１】この発明の実施例である磁気記録制御装置の回
路図である。
路図である。
【図２】図１各部の波形を示す図である。
Ｐ１，Ｐ２，Ｐ３，Ｐ４−ｐチャンネルＭＯＳトランジ
スタ Ｎ１，Ｎ２，Ｎ３−ｎチャンネルＭＯＳトランジスタ
スタ Ｎ１，Ｎ２，Ｎ３−ｎチャンネルＭＯＳトランジスタ
Claims (1)
- 【請求項１】磁気ヘッドの再生信号を増幅する増幅回路
と、 前記増幅回路により増幅された正負両極性に変位する信
号を矩形波信号に変換して読取矩形波信号を生成する読
取信号生成回路と、 読取時に、前記磁気ヘッドの再生信号を前記増幅回路へ
与える読取信号切替回路と、 前記読取矩形波信号の立ち上がりまたは立ち下がりのタ
イミングを基準として、この基準タイミングから一定時
間を読取期間、それ以外の期間を書込期間として読取書
込制御信号を発生する読取書込制御信号発生回路と、 前記基準タイミングから、書込データに応じて定まる所
定時間の後に立ち上がるまたは立ち下がる書込矩形波信
号を発生する書込信号生成回路と、 前記書込期間に前記書込矩形波信号を前記磁気ヘッドの
両端に与える書込信号切替回路、 とを１チップの半導体集積回路に設けたことを特徴とす
る磁気記録制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4153601A JPH05342511A (ja) | 1992-06-12 | 1992-06-12 | 磁気記録制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4153601A JPH05342511A (ja) | 1992-06-12 | 1992-06-12 | 磁気記録制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05342511A true JPH05342511A (ja) | 1993-12-24 |
Family
ID=15566054
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4153601A Pending JPH05342511A (ja) | 1992-06-12 | 1992-06-12 | 磁気記録制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05342511A (ja) |
-
1992
- 1992-06-12 JP JP4153601A patent/JPH05342511A/ja active Pending
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