JPH05224761A - 基準電流ループ - Google Patents
基準電流ループInfo
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- JPH05224761A JPH05224761A JP4313432A JP31343292A JPH05224761A JP H05224761 A JPH05224761 A JP H05224761A JP 4313432 A JP4313432 A JP 4313432A JP 31343292 A JP31343292 A JP 31343292A JP H05224761 A JPH05224761 A JP H05224761A
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- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/10—Regulating voltage or current
- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/56—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices
- G05F1/561—Voltage to current converters
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/10—Regulating voltage or current
- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/56—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices
- G05F1/577—Regulating voltage or current wherein the variable actually regulated by the final control device is dc using semiconductor devices in series with the load as final control devices for plural loads
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- Continuous-Control Power Sources That Use Transistors (AREA)
Abstract
(57)【要約】 （修正有）
【目的】 基準電流が流れる閉電流ループ内に含まれる
集積回路群の、各集積回路の最終段に流れるゼロ入力電
流を同じにすることができる基準電流ループを提供す
る。 【構成】 同じ集積回路ＩＣｓ（１、２、３）からなる
ＩＣ群を具え、各集積回路の第１インピーダンスがその
集積回路群の他のＩＣの第１インピーダンスに直列に接
続されている基準電流ループ。これらの第１インピーダ
ンスが構成する回路は基準電流源（４）に接続されてい
る。第１インピーダンス（７）にかかる電圧は電圧−電
流コンバータ（８）によって電流（Ｉ０）に変換され、
カレントミラー回路（２０、２３）によって基準電流源
（４）の基準電流（Ｉｒｅｆ）に比例する電流（Ｉ１，
Ｉ２）として使用される。電流Ｉ１及びＩ２と、基準電
流Ｉｒｅｆとの関係は、第１インピーダンス（７）のイ
ンピーダンス値と第２インピーダンス（１９）のインピ
ーダンス値との比によって決定する。
集積回路群の、各集積回路の最終段に流れるゼロ入力電
流を同じにすることができる基準電流ループを提供す
る。 【構成】 同じ集積回路ＩＣｓ（１、２、３）からなる
ＩＣ群を具え、各集積回路の第１インピーダンスがその
集積回路群の他のＩＣの第１インピーダンスに直列に接
続されている基準電流ループ。これらの第１インピーダ
ンスが構成する回路は基準電流源（４）に接続されてい
る。第１インピーダンス（７）にかかる電圧は電圧−電
流コンバータ（８）によって電流（Ｉ０）に変換され、
カレントミラー回路（２０、２３）によって基準電流源
（４）の基準電流（Ｉｒｅｆ）に比例する電流（Ｉ１，
Ｉ２）として使用される。電流Ｉ１及びＩ２と、基準電
流Ｉｒｅｆとの関係は、第１インピーダンス（７）のイ
ンピーダンス値と第２インピーダンス（１９）のインピ
ーダンス値との比によって決定する。
Description
【０００１】
【産業上の利用分野】本発明は、基準電流ループに関す
るものである。
るものである。
【０００２】
【従来の技術】電子工学の分野では、特別な電子的な機
能を実行するために、同じ集積回路（ＩＣｓ）を多数使
用することが通常行われている。例えば、複数の集積回
路群を配設した液晶ディスプレイ（ＬＣＤｓ）用の直列
及び並列駆動回路などがある。このような駆動回路を正
しく動作させるためには、これらの駆動回路のすべての
最終段にゼロ入力電流を流すことが必要である。各集積
回路には、一つあるいはそれ以上の最終段があり、カレ
ントミラー回路を用いて、同じゼロ入力電流がこの最終
段に供給される。カレントミラー回路の入力電流は既知
の正確な電圧を抵抗（あるいは他のインピーダンス）を
用いて電流に変換することによって決定される。既知の
正確な電圧は、すべてのＩＣｓに配分され、したがっ
て、すべての集積回路群に対して同じである。
能を実行するために、同じ集積回路（ＩＣｓ）を多数使
用することが通常行われている。例えば、複数の集積回
路群を配設した液晶ディスプレイ（ＬＣＤｓ）用の直列
及び並列駆動回路などがある。このような駆動回路を正
しく動作させるためには、これらの駆動回路のすべての
最終段にゼロ入力電流を流すことが必要である。各集積
回路には、一つあるいはそれ以上の最終段があり、カレ
ントミラー回路を用いて、同じゼロ入力電流がこの最終
段に供給される。カレントミラー回路の入力電流は既知
の正確な電圧を抵抗（あるいは他のインピーダンス）を
用いて電流に変換することによって決定される。既知の
正確な電圧は、すべてのＩＣｓに配分され、したがっ
て、すべての集積回路群に対して同じである。
【０００３】
【発明が解決しようとする課題】しかしながら、抵抗
（あるいは他のインピーダンス）の製造工程にバラツキ
があるため、個々の集積回路群に配設されたカレントミ
ラー回路に結果として流れる入力電流は同じではない。
この結果、最終段におけるゼロ入力電流は、一のＩＣと
次のＩＣでは異なるものとなり、入力電流を各ＩＣにお
いて調整する必要がある。
（あるいは他のインピーダンス）の製造工程にバラツキ
があるため、個々の集積回路群に配設されたカレントミ
ラー回路に結果として流れる入力電流は同じではない。
この結果、最終段におけるゼロ入力電流は、一のＩＣと
次のＩＣでは異なるものとなり、入力電流を各ＩＣにお
いて調整する必要がある。
【０００４】このバラツキの問題は、集積回路群中に一
般的に生じる問題であり、重要な実行パラメータは電流
値によって決定される。本発明の課題は、このようなバ
ラツキの問題を解決することである。
般的に生じる問題であり、重要な実行パラメータは電流
値によって決定される。本発明の課題は、このようなバ
ラツキの問題を解決することである。
【０００５】
【課題を解決するための手段】本発明にかかる基準電流
ループは、基準電流源（４）と、第１及び第２の基準電
流ターミナル（５、６）と、これらの第１及び第２の基
準電流ターミナル（５、６）に接続された第１のインピ
ーダンス（７）と、この第１のインピーダンス（７）と
同じ種類のインピーダンスであって、第１のインピーダ
ンスのインピーダンス値に対して所定の割合のインピー
ダンス値を持つの第２のインピーダンス（１９）と、前
記第１及び第２の基準電流ターミナル（５、６）間の電
圧差を受ける入力端子（１０、１４）、前記第２のイン
ピーダンス（１９）のインピーダンス値の関数である出
力電流（ＩＯ）を供給する出力端子（２４、２５）を具
える電圧ー電流コンバータ（８）と、入力枝路（２１）
及び少なくとも一つの出力枝路（２２）を具え、入力枝
路（２１）が前記電圧ー電流コンバータ（８）の出力端
子（２４）に接続されているカレントミラー回路（２
０）とを各々が具える少なくとも２つの集積回路（１、
２、３）からなると集積回路群と、これらの集積回路
（１、２、３）群の第１及び第２基準電流ターミナル
（５、６）、各集積回路の第１インピーダンス（７）を
相互に接続して直列回路を形成する手段と、前記基準電
流源（４）を前記直列回路に接続する手段とを具えるこ
とを特徴とするものである。
ループは、基準電流源（４）と、第１及び第２の基準電
流ターミナル（５、６）と、これらの第１及び第２の基
準電流ターミナル（５、６）に接続された第１のインピ
ーダンス（７）と、この第１のインピーダンス（７）と
同じ種類のインピーダンスであって、第１のインピーダ
ンスのインピーダンス値に対して所定の割合のインピー
ダンス値を持つの第２のインピーダンス（１９）と、前
記第１及び第２の基準電流ターミナル（５、６）間の電
圧差を受ける入力端子（１０、１４）、前記第２のイン
ピーダンス（１９）のインピーダンス値の関数である出
力電流（ＩＯ）を供給する出力端子（２４、２５）を具
える電圧ー電流コンバータ（８）と、入力枝路（２１）
及び少なくとも一つの出力枝路（２２）を具え、入力枝
路（２１）が前記電圧ー電流コンバータ（８）の出力端
子（２４）に接続されているカレントミラー回路（２
０）とを各々が具える少なくとも２つの集積回路（１、
２、３）からなると集積回路群と、これらの集積回路
（１、２、３）群の第１及び第２基準電流ターミナル
（５、６）、各集積回路の第１インピーダンス（７）を
相互に接続して直列回路を形成する手段と、前記基準電
流源（４）を前記直列回路に接続する手段とを具えるこ
とを特徴とするものである。
【０００６】本発明は、すべての集積回路が、基準電流
が流れる閉電流ループ内に含まれているという理解のも
とになされたものである。この電流はすべての集積回路
に対して同じであり、第１インピーダンスによって、各
集積回路において電圧に変換される。このインピーダン
スは好適な実施例では抵抗で構成されている。電圧−電
流コンバータでは、第１インピーダンスに印加された電
圧が出力電流に変換され、この出力電流の大きさは、や
はり抵抗で構成されることが好ましい第２インピーダン
スの値及び第１インピーダンスに印加される電圧によっ
て決まる。したがって、電圧−電流コンバータの出力電
流は、第２のインピーダンスの値と第１のインピーダン
スの値の比に比例する。集積回路技術においては、ＩＣ
を設計する際に、例えば抵抗、コンデンサ、トランジス
タ接合などの２つのインピーダンスの値の比を、非常に
正確に決定することができる。したがって、電圧−電流
コンバータの出力電流の大きさは基準電流ループ内を流
れる基準電流の大きさに対して前以て非常に正確に決定
できる関係にある。この出力電流は、カレントミラー回
路の入力枝路に流れ込む。公知のようにカレントミラー
回路のミラーファクタもＩＣを設計する際に大変正確に
決定することができる。したがって、カレントミラー回
路の出力枝路あるいは枝路を流れる電流も、基準電流に
対して前以て正確に決定することができる関係にある。
が流れる閉電流ループ内に含まれているという理解のも
とになされたものである。この電流はすべての集積回路
に対して同じであり、第１インピーダンスによって、各
集積回路において電圧に変換される。このインピーダン
スは好適な実施例では抵抗で構成されている。電圧−電
流コンバータでは、第１インピーダンスに印加された電
圧が出力電流に変換され、この出力電流の大きさは、や
はり抵抗で構成されることが好ましい第２インピーダン
スの値及び第１インピーダンスに印加される電圧によっ
て決まる。したがって、電圧−電流コンバータの出力電
流は、第２のインピーダンスの値と第１のインピーダン
スの値の比に比例する。集積回路技術においては、ＩＣ
を設計する際に、例えば抵抗、コンデンサ、トランジス
タ接合などの２つのインピーダンスの値の比を、非常に
正確に決定することができる。したがって、電圧−電流
コンバータの出力電流の大きさは基準電流ループ内を流
れる基準電流の大きさに対して前以て非常に正確に決定
できる関係にある。この出力電流は、カレントミラー回
路の入力枝路に流れ込む。公知のようにカレントミラー
回路のミラーファクタもＩＣを設計する際に大変正確に
決定することができる。したがって、カレントミラー回
路の出力枝路あるいは枝路を流れる電流も、基準電流に
対して前以て正確に決定することができる関係にある。
【０００７】このようにして、個々の集積回路の出力枝
路を流れる電流を、互いにほぼ同じにすることができ
る。これらの電流は上述の液晶ディスプレイ駆動回路の
最終段のゼロ入力電流として使用することができる。通
常は、これらの電流は、電流依存動作パラメータに関係
する他のものにも応用することができる。例えば、個々
の集積回路内に配置された複数のデジタルーアナログコ
ンバータを用いた多重チャネルデジタルーアナログ変換
に利用できる。この場合の動作は、基準電流に対して２
進の重み付けをされたものを形成する電流の加算に基づ
く。
路を流れる電流を、互いにほぼ同じにすることができ
る。これらの電流は上述の液晶ディスプレイ駆動回路の
最終段のゼロ入力電流として使用することができる。通
常は、これらの電流は、電流依存動作パラメータに関係
する他のものにも応用することができる。例えば、個々
の集積回路内に配置された複数のデジタルーアナログコ
ンバータを用いた多重チャネルデジタルーアナログ変換
に利用できる。この場合の動作は、基準電流に対して２
進の重み付けをされたものを形成する電流の加算に基づ
く。
【０００８】更に、本発明の基準電流ループは以下の点
で利益がある。つまり、本発明のループ中のすべての集
積回路の電流依存実行パラメータを、ひとつの電流、す
なわち基準電流を変化させることによって変化させるこ
とができるという点である。ＩＣ群の適正なトラッキン
グを行うために各ＩＣに個々に前以て調整を行う必要は
ない。
で利益がある。つまり、本発明のループ中のすべての集
積回路の電流依存実行パラメータを、ひとつの電流、す
なわち基準電流を変化させることによって変化させるこ
とができるという点である。ＩＣ群の適正なトラッキン
グを行うために各ＩＣに個々に前以て調整を行う必要は
ない。
【０００９】基準電流源は、第１インピーダンス間に電
圧降下を生じさせる。したがって、第１及び第２の基準
電流ターミナルの絶対電圧は、集積回路群の各ＩＣで異
なる。このことは、基準電流ループ内で直列に接続され
る集積回路の数を制限することになる。この欠点を取り
除くために、本発明の電圧−電流コンバータの実施例で
は、電圧−電流コンバータが、反転入力端子（１１、１
５）、非反転入力端子（１０、１４）及び出力端子（１
２、１６）をそれぞれが有し、非反転入力端子（１０、
１４）がそれぞれ第１及び第２の基準電圧ターミナル
（５、６）に接続された第１及び第２の演算増幅器
（９、１３）と；制御電極と、第１の主電極と、第２の
主電極とをそれぞれが具える第１及び第２のトランジス
タ（１７、１８）であって、この第１及び第２のトラン
ジスタ（１７、１８）の制御電極が前記第１及び第２の
演算増幅器（９、１３）にそれぞれ接続されており、第
１及び第２のトランジスタ（１７、１８）の第１主電極
が第１及び第２の演算増幅器（９、１３）の反転入力端
子（１１、１５）にそれぞれ接続されており、第１及び
第２のトランジスタの第１主電極が第２のインピーダン
ス（１９）によって相互に接続されている第１及び第２
のトランジスタ（１７、１８）とを具え、前記入力枝路
（２１）が、第１及び第２のトランジスタ（１７、１
８）と第２のインピーダンス（１９）とで形成される電
流路（ＩＯ）に直列に接続されていることを特徴とする
ものである。
圧降下を生じさせる。したがって、第１及び第２の基準
電流ターミナルの絶対電圧は、集積回路群の各ＩＣで異
なる。このことは、基準電流ループ内で直列に接続され
る集積回路の数を制限することになる。この欠点を取り
除くために、本発明の電圧−電流コンバータの実施例で
は、電圧−電流コンバータが、反転入力端子（１１、１
５）、非反転入力端子（１０、１４）及び出力端子（１
２、１６）をそれぞれが有し、非反転入力端子（１０、
１４）がそれぞれ第１及び第２の基準電圧ターミナル
（５、６）に接続された第１及び第２の演算増幅器
（９、１３）と；制御電極と、第１の主電極と、第２の
主電極とをそれぞれが具える第１及び第２のトランジス
タ（１７、１８）であって、この第１及び第２のトラン
ジスタ（１７、１８）の制御電極が前記第１及び第２の
演算増幅器（９、１３）にそれぞれ接続されており、第
１及び第２のトランジスタ（１７、１８）の第１主電極
が第１及び第２の演算増幅器（９、１３）の反転入力端
子（１１、１５）にそれぞれ接続されており、第１及び
第２のトランジスタの第１主電極が第２のインピーダン
ス（１９）によって相互に接続されている第１及び第２
のトランジスタ（１７、１８）とを具え、前記入力枝路
（２１）が、第１及び第２のトランジスタ（１７、１
８）と第２のインピーダンス（１９）とで形成される電
流路（ＩＯ）に直列に接続されていることを特徴とする
ものである。
【００１０】したがって、本発明の基準電流ループにお
ける電圧ー電流コンバータは、フローティングコンバー
タとして配置されている。結果的に、各ＩＣはループ中
の任意の位置におくことができる。この結果、電圧ー電
流コンバータの出力電流は絶対電圧からも供給され、こ
の絶対電圧は各ＩＣによって異なる。この出力電流をカ
レントミラー回路の入力枝路に流すことによって、出力
枝路あるいは枝路内で全ＩＣで同じ絶対電圧レベルで電
流が使用可能になる。演算増幅器の入力は無視できる程
度の電流をおこすだけであるので、第１及び第２のイン
ピーダンス間を流れる電流にほとんど負荷をかけない。
これによって、とりわけ、基準電流が全ＩＣに対して同
じになる。
ける電圧ー電流コンバータは、フローティングコンバー
タとして配置されている。結果的に、各ＩＣはループ中
の任意の位置におくことができる。この結果、電圧ー電
流コンバータの出力電流は絶対電圧からも供給され、こ
の絶対電圧は各ＩＣによって異なる。この出力電流をカ
レントミラー回路の入力枝路に流すことによって、出力
枝路あるいは枝路内で全ＩＣで同じ絶対電圧レベルで電
流が使用可能になる。演算増幅器の入力は無視できる程
度の電流をおこすだけであるので、第１及び第２のイン
ピーダンス間を流れる電流にほとんど負荷をかけない。
これによって、とりわけ、基準電流が全ＩＣに対して同
じになる。
【００１１】
【実施例】以下に図面に基づいて本発明を詳細に説明す
る。図中、同じ機能を有する構成要素については同じ符
号を付した。
る。図中、同じ機能を有する構成要素については同じ符
号を付した。
【００１２】図１は本発明にかかる基準電流ループの一
実施例を示す図である。ここに示されているトランジス
タはバイポーラトランジスタであり、ベースが制御電極
に、エミッタが第１主電極に、コレクタが第２主電極に
対応する。バイポーラトランジスタの代わりにユニポー
ラトランジスタを使用しても良く、この場合は、ゲート
が制御電極に、ソースが第１主電極に、ドレインが第２
主電極に対応する。このループは、集積回路群（ＩＣ
ｓ）を具え、そのうちの３つの集積回路（符号１、２、
３）と、基準電流Ｉｒｅｆを供給する基準電流源４とが
図１に示されている。説明に関係する構成要素が集積回
路１内に示されている。他の集積回路は集積回路１と構
成が同じであるため、記号のみを示す。集積回路１は第
１基準電流ターミナル５及び第２基準電流ターミナル６
を具える。第１インピーダンス７は、これらの第１及び
第２の基準電流ターミナル５、６にまたがって接続され
ている。インピーダンス７は抵抗であるのが好ましい
が、コンデンサ、複数のトランジスタ接合あるいは、こ
れらの要素の組み合わせでもよい。集積回路１は更に、
フローティング電圧ー電流コンバータ８を具えており、
このコンバータは非反転入力端子１０、反転入力端子１
１、出力端子１２を有する第１の演算増幅器９、非反転
入力端子１４、反転入力端子１５、出力端子１６を有す
る第２演算増幅器１３、第１のＮＰＮトランジスタ１
７、第２のＰＮＰトランジスタ１８及び第１インピーダ
ンスと同じ種類の第２インピーダンス１９とを具える。
非反転入力端子１０と１４とは、基準電流ターミナル５
及び６にそれぞれ接続されている。反転入力端子１１と
１５は、第１及び第２のトランジスタ１７、１８のエミ
ッタにそれぞれ接続されている。第２インピーダンス１
９は、第１及び第２のトランジスタ１７、１８のエミッ
タ間に配設されている。出力端子１２と１６とは、第１
及び第２のトランジスタ１７、１８のベースにそれぞれ
接続されており、これらのトランジスタのコレクタは電
圧ー電流コンバータ８の出力端子２４、２５を形成して
いる。
実施例を示す図である。ここに示されているトランジス
タはバイポーラトランジスタであり、ベースが制御電極
に、エミッタが第１主電極に、コレクタが第２主電極に
対応する。バイポーラトランジスタの代わりにユニポー
ラトランジスタを使用しても良く、この場合は、ゲート
が制御電極に、ソースが第１主電極に、ドレインが第２
主電極に対応する。このループは、集積回路群（ＩＣ
ｓ）を具え、そのうちの３つの集積回路（符号１、２、
３）と、基準電流Ｉｒｅｆを供給する基準電流源４とが
図１に示されている。説明に関係する構成要素が集積回
路１内に示されている。他の集積回路は集積回路１と構
成が同じであるため、記号のみを示す。集積回路１は第
１基準電流ターミナル５及び第２基準電流ターミナル６
を具える。第１インピーダンス７は、これらの第１及び
第２の基準電流ターミナル５、６にまたがって接続され
ている。インピーダンス７は抵抗であるのが好ましい
が、コンデンサ、複数のトランジスタ接合あるいは、こ
れらの要素の組み合わせでもよい。集積回路１は更に、
フローティング電圧ー電流コンバータ８を具えており、
このコンバータは非反転入力端子１０、反転入力端子１
１、出力端子１２を有する第１の演算増幅器９、非反転
入力端子１４、反転入力端子１５、出力端子１６を有す
る第２演算増幅器１３、第１のＮＰＮトランジスタ１
７、第２のＰＮＰトランジスタ１８及び第１インピーダ
ンスと同じ種類の第２インピーダンス１９とを具える。
非反転入力端子１０と１４とは、基準電流ターミナル５
及び６にそれぞれ接続されている。反転入力端子１１と
１５は、第１及び第２のトランジスタ１７、１８のエミ
ッタにそれぞれ接続されている。第２インピーダンス１
９は、第１及び第２のトランジスタ１７、１８のエミッ
タ間に配設されている。出力端子１２と１６とは、第１
及び第２のトランジスタ１７、１８のベースにそれぞれ
接続されており、これらのトランジスタのコレクタは電
圧ー電流コンバータ８の出力端子２４、２５を形成して
いる。
【００１３】集積回路１は更に、ＰＮＰカレントミラー
回路２０を具える。カレントミラー回路２０の入力枝路
は、ダイオード配置のＰＮＰトランジスタ２１で構成さ
れており、出力枝路はＰＮＰトランジスタ２２で構成さ
れている。トランジスタ２１と２２のエミッタは正電圧
ＶＰに接続されている。第１のトランジスタ１７のコレ
クタがトランジスタ２１のコレクタに接続されており、
したがって、電圧ー電流コンバータの出力電流ＩＯはカ
レントミラー回路２０の入力枝路に流れる。トランジス
タ２１と２２とのベース−エミッタ接合は並列に接続さ
れている。カレントミラー回路２０はトランジスタ２２
のコレクタから取り出された電流Ｉ１を作る。カレント
ミラー回路２０の単一の出力枝路以上のものは示されて
いない。同じように、トランジスタ２２に多くのトラン
ジスタを接続して出力枝路を加えるようにしても良い。
回路２０を具える。カレントミラー回路２０の入力枝路
は、ダイオード配置のＰＮＰトランジスタ２１で構成さ
れており、出力枝路はＰＮＰトランジスタ２２で構成さ
れている。トランジスタ２１と２２のエミッタは正電圧
ＶＰに接続されている。第１のトランジスタ１７のコレ
クタがトランジスタ２１のコレクタに接続されており、
したがって、電圧ー電流コンバータの出力電流ＩＯはカ
レントミラー回路２０の入力枝路に流れる。トランジス
タ２１と２２とのベース−エミッタ接合は並列に接続さ
れている。カレントミラー回路２０はトランジスタ２２
のコレクタから取り出された電流Ｉ１を作る。カレント
ミラー回路２０の単一の出力枝路以上のものは示されて
いない。同じように、トランジスタ２２に多くのトラン
ジスタを接続して出力枝路を加えるようにしても良い。
【００１４】第２のトランジスタ１８のコレクタはＮＰ
Ｎカレントミラー回路２３の入力枝路に接続されてい
る。カレントミラー回路２３はカレントミラー回路２２
と同様に配設されており、その出力枝路は電流Ｉ２を供
給する。必要に応じて、カレントミラー回路２０、２３
は削除しても良い。この場合、第１トランジスタ１７、
もしくは第２トランジスタ１８のコレクタを正電圧ＶＰ
あるいは負電圧ＶＮに接続する。
Ｎカレントミラー回路２３の入力枝路に接続されてい
る。カレントミラー回路２３はカレントミラー回路２２
と同様に配設されており、その出力枝路は電流Ｉ２を供
給する。必要に応じて、カレントミラー回路２０、２３
は削除しても良い。この場合、第１トランジスタ１７、
もしくは第２トランジスタ１８のコレクタを正電圧ＶＰ
あるいは負電圧ＶＮに接続する。
【００１５】基準電流Ｉｒｅｆが第１インピーダンス７
に電圧降下をおこし、この電圧降下が電圧ー電流コンバ
ータによって変換されて、第２インピーダンスに同じよ
うに大きな電圧降下を引き起こす。演算増幅器９及び１
３の入力端子間の電圧差は小さい。電圧ー電流コンバー
タの出力電流ＩＯは基準電流Ｉｒｅｆに比例する。この
比例の割合は第１インピーダンス７のインピーダンス値
と第２インピーダンス１９のインピーダンス値との比に
よって決定される。このインピーダンス値の比は集積回
路技術において正確に決定することができるので、電流
ＩＯの基準電流Ｉｒｅｆに対する比も正確に決定するこ
とができる。カレントミラー回路２０と２３のミラーフ
ァクタも、よく知られているとおり、正確に決定するこ
とができる。この結果、電流Ｉ１とＩｒｅｆ間、および
電流Ｉ２とＩｒｅｆ間には、大変正確な関係がある。も
し、集積回路群が同一のものであれば、これらの関係は
すべての集積回路群について同じであり、したがって、
電流Ｉ１とＩ２は全集積回路群中でほぼ同じ大きさであ
る。基準電流源４の電流Ｉｒｅｆを可変にすることによ
って、全集積回路群の電流Ｉ１とＩ２を一回の調整で変
化させることができる。
に電圧降下をおこし、この電圧降下が電圧ー電流コンバ
ータによって変換されて、第２インピーダンスに同じよ
うに大きな電圧降下を引き起こす。演算増幅器９及び１
３の入力端子間の電圧差は小さい。電圧ー電流コンバー
タの出力電流ＩＯは基準電流Ｉｒｅｆに比例する。この
比例の割合は第１インピーダンス７のインピーダンス値
と第２インピーダンス１９のインピーダンス値との比に
よって決定される。このインピーダンス値の比は集積回
路技術において正確に決定することができるので、電流
ＩＯの基準電流Ｉｒｅｆに対する比も正確に決定するこ
とができる。カレントミラー回路２０と２３のミラーフ
ァクタも、よく知られているとおり、正確に決定するこ
とができる。この結果、電流Ｉ１とＩｒｅｆ間、および
電流Ｉ２とＩｒｅｆ間には、大変正確な関係がある。も
し、集積回路群が同一のものであれば、これらの関係は
すべての集積回路群について同じであり、したがって、
電流Ｉ１とＩ２は全集積回路群中でほぼ同じ大きさであ
る。基準電流源４の電流Ｉｒｅｆを可変にすることによ
って、全集積回路群の電流Ｉ１とＩ２を一回の調整で変
化させることができる。
【００１６】ループ電流ＩｒｅｆはひとつのＩＣから次
のＩＣへ流れる。ＩＣはこのループ電流から電流を生じ
させるものではない。これは演算増幅器９、１３を用い
ることによって達成され、演算増幅器９、１３の非反転
入力端子は基準電流ターミナル５、６にほとんど負荷を
かけない。
のＩＣへ流れる。ＩＣはこのループ電流から電流を生じ
させるものではない。これは演算増幅器９、１３を用い
ることによって達成され、演算増幅器９、１３の非反転
入力端子は基準電流ターミナル５、６にほとんど負荷を
かけない。
【００１７】電流Ｉ１及び／又はＩ２は、例えば、液晶
ディスプレイの駆動回路の最終段用のゼロ入力電流、あ
るいは電流源を具えるディジタルーアナログコンバータ
用の基準電流として、多目的に使用することができる。
ディスプレイの駆動回路の最終段用のゼロ入力電流、あ
るいは電流源を具えるディジタルーアナログコンバータ
用の基準電流として、多目的に使用することができる。
【００１８】図２は他の電圧ー電流コンバータ８を示す
図である。演算増幅器３０の反転入力端子３１及び非反
転入力端子３２は抵抗３３、３４を介して基準電流ター
ミナル５、６にそれぞれ接続されており、このターミナ
ル間に第１インピーダンス７が接続されている。反転入
力端子３１は抵抗３５を介して演算増幅器３０の出力端
子３６に接続されている。出力端子３６は更に、第２イ
ンピーダンス１９を介して出力端子３７に接続されてお
り、この出力端子３７は抵抗３８を介して非反転入力端
子３２に接続されている。出力端子３７はカレントミラ
ー回路（図示せず）の入力枝路に電流ＩＯを与える。抵
抗３４、３８、３３及び３５はそれぞれＲ１，Ｒ２，Ｒ
３，Ｒ４の抵抗値をもつ。第１インピーダンス７に印加
される電圧はＵｉｎである。Ｒ２／Ｒ１＝Ｒ４／Ｒ３で
あれば、ＩＯ＝Ｕｉｎ／Ｚ・Ｒ２／Ｒ１となる。ここで
Ｚは第２インピーダンス１９の値である。したがって、
出力電流ＩＯが入力電圧Ｕｉｎの関数である。
図である。演算増幅器３０の反転入力端子３１及び非反
転入力端子３２は抵抗３３、３４を介して基準電流ター
ミナル５、６にそれぞれ接続されており、このターミナ
ル間に第１インピーダンス７が接続されている。反転入
力端子３１は抵抗３５を介して演算増幅器３０の出力端
子３６に接続されている。出力端子３６は更に、第２イ
ンピーダンス１９を介して出力端子３７に接続されてお
り、この出力端子３７は抵抗３８を介して非反転入力端
子３２に接続されている。出力端子３７はカレントミラ
ー回路（図示せず）の入力枝路に電流ＩＯを与える。抵
抗３４、３８、３３及び３５はそれぞれＲ１，Ｒ２，Ｒ
３，Ｒ４の抵抗値をもつ。第１インピーダンス７に印加
される電圧はＵｉｎである。Ｒ２／Ｒ１＝Ｒ４／Ｒ３で
あれば、ＩＯ＝Ｕｉｎ／Ｚ・Ｒ２／Ｒ１となる。ここで
Ｚは第２インピーダンス１９の値である。したがって、
出力電流ＩＯが入力電圧Ｕｉｎの関数である。
【００１９】本発明は、上述の実施例に限定されるもの
ではない。すべてのあるいは一部のバイポーラトランジ
スタに代えてユニポーラトランジスタを使用しても良
い。カレントミラー回路２０及び２３は、文献から知ら
れるより進歩した、より正確なカレントミラー回路で置
き換えても良い。
ではない。すべてのあるいは一部のバイポーラトランジ
スタに代えてユニポーラトランジスタを使用しても良
い。カレントミラー回路２０及び２３は、文献から知ら
れるより進歩した、より正確なカレントミラー回路で置
き換えても良い。
【図１】本発明にかかる基準電流ループの一実施例の構
成を示す図である。
成を示す図である。
【図２】 本発明にかかる基準電流ループに使用される
代替電圧ー電流コンバータの構成を示す図である。 １、２、３ 集積回路 ４ 基準電流源 ５、６ 基準電流ターミナル ７ 第１インピーダンス ８ 電圧ー電流コンバータ ９、１３ 演算増幅器 １０、１４ 非反転入力端子 １１、１５ 反転入力端子 １２、１６ 出力端子 １７ 第１トランジスタ（ＮＰＮ） １８ 第２トランジスタ（ＰＮＰ） １９ 第２インピーダンス ２０、２３ カレントミラー回路 ２１、２２トランジスタ ２４、２５ 出力端子 ３０ 演算増幅器 ３１ 反転入力端子 ３２ 非反転入力端子 ３３、３４、３５、３８ 抵抗 ３６ 出力端子 ３７ 出力端子
代替電圧ー電流コンバータの構成を示す図である。 １、２、３ 集積回路 ４ 基準電流源 ５、６ 基準電流ターミナル ７ 第１インピーダンス ８ 電圧ー電流コンバータ ９、１３ 演算増幅器 １０、１４ 非反転入力端子 １１、１５ 反転入力端子 １２、１６ 出力端子 １７ 第１トランジスタ（ＮＰＮ） １８ 第２トランジスタ（ＰＮＰ） １９ 第２インピーダンス ２０、２３ カレントミラー回路 ２１、２２トランジスタ ２４、２５ 出力端子 ３０ 演算増幅器 ３１ 反転入力端子 ３２ 非反転入力端子 ３３、３４、３５、３８ 抵抗 ３６ 出力端子 ３７ 出力端子
Claims (3)
- 【請求項１】 基準電流源（４）と、 第１及び第２の基準電流ターミナル（５、６）と、これ
らの第１及び第２の基準電流ターミナル（５、６）に接
続された第１のインピーダンス（７）と、この第１のイ
ンピーダンス（７）と同じ種類のインピーダンスであっ
て、第１のインピーダンスのインピーダンス値に対して
所定の割合のインピーダンス値を持つの第２のインピー
ダンス（１９）と、前記第１及び第２の基準電流ターミ
ナル（５、６）間の電圧差を受ける入力端子（１０、１
４）、前記第２のインピーダンス（１９）のインピーダ
ンス値の関数である出力電流（ＩＯ）を供給する出力端
子（２４、２５）を具える電圧ー電流コンバータ（８）
と、入力枝路（２１）及び少なくとも１つの出力枝路
（２２）を具え、入力枝路（２１）が前記電圧ー電流コ
ンバータ（８）の出力端子（２４）に接続されているカ
レントミラー回路（２０）とを各々が具える少なくとも
２つの集積回路（１、２、３）からなる集積回路群と、 これらの集積回路（１、２、３）の第１及び第２の基準
電流ターミナル（５、６）、各集積回路の第１インピー
ダンス（７）を相互に接続して直列回路を形成する手段
と、 前記基準電流源（４）を前記直列回路に接続する手段と
を具えることを特徴とする基準電流ループ。 - 【請求項２】 請求項１に記載の基準電流ループにおい
て、前記電圧ー電流コンバータ（８）が 反転入力端子
（１１、１５）、非反転入力端子（１０、１４）及び出
力端子（１２、１６）をそれぞれが有し、非反転入力端
子（１０、１４）がそれぞれ第１及び第２の基準電圧タ
ーミナル（５、６）に接続された第１及び第２の演算増
幅器（９、１３）と；制御電極と、第１の主電極と、第
２の主電極とをそれぞれが具える第１及び第２のトラン
ジスタ（１７、１８）であって、この第１及び第２のト
ランジスタ（１７、１８）の制御電極が前記第１及び第
２の演算増幅器（９、１３）にそれぞれ接続されてお
り、第１及び第２のトランジスタ（１７、１８）の第１
主電極が第１及び第２の演算増幅器（９、１３）の反転
入力端子（１１、１５）にそれぞれ接続されており、第
１及び第２のトランジスタの第１主電極が第２のインピ
ーダンス（１９）によって相互に接続されている第１及
び第２のトランジスタ（１７、１８）とを具え、 前記
入力枝路（２１）が、第１及び第２のトランジスタ（１
７、１８）と第２のインピーダンス（１９）とで形成さ
れる電流路（ＩＯ）に直列に接続されていることを特徴
とする基準電流ループ。 - 【請求項３】 請求項１若しくは２に記載の基準電流ル
ープにおいて、前記第１及び第２のインピーダンスが抵
抗であることを特徴とする基準電流ループ。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| NL91203074:9 | 1991-11-25 | ||
| EP91203074 | 1991-11-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05224761A true JPH05224761A (ja) | 1993-09-03 |
Family
ID=8208031
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4313432A Pending JPH05224761A (ja) | 1991-11-25 | 1992-11-24 | 基準電流ループ |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5341087A (ja) |
| EP (1) | EP0544360B1 (ja) |
| JP (1) | JPH05224761A (ja) |
| KR (1) | KR930010834A (ja) |
| DE (1) | DE69221999T2 (ja) |
| SG (1) | SG44015A1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7453780B2 (en) | 2004-07-30 | 2008-11-18 | Kabushiki Kaisha Toshiba | Information recording medium, information recording/reproducing apparatus and information management method |
Families Citing this family (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| BE1007007A3 (nl) * | 1993-04-16 | 1995-02-14 | Philips Electronics Nv | Gebalanceerde spanning-stroomomzetter met ruststroominstelling. |
| JP2638494B2 (ja) * | 1994-08-12 | 1997-08-06 | 日本電気株式会社 | 電圧／電流変換回路 |
| JPH0865074A (ja) * | 1994-08-24 | 1996-03-08 | Mitsubishi Denki Eng Kk | 電流電圧変換回路、電流圧縮伸張回路、自動露出制御システム及びセンサ内蔵自動露出制御システム |
| US5917368A (en) * | 1996-05-08 | 1999-06-29 | Telefonatiebolaget Lm Ericsson | Voltage-to-current converter |
| JP4138102B2 (ja) * | 1998-10-13 | 2008-08-20 | セイコーエプソン株式会社 | 表示装置及び電子機器 |
| US6304132B1 (en) * | 1998-10-30 | 2001-10-16 | Sony Corporation Of Japan | High side current source circuit having improved output impedance to reduce effects of leakage circuit |
| JP2001282374A (ja) * | 2000-03-30 | 2001-10-12 | Nec Corp | 半導体装置 |
| DE102004021232A1 (de) * | 2004-04-30 | 2005-11-17 | Austriamicrosystems Ag | Stromspiegelanordnung |
| DE102005021883A1 (de) * | 2005-05-04 | 2006-11-09 | Valeo Schalter Und Sensoren Gmbh | Schaltungsanordnung |
| US20070236275A1 (en) * | 2006-04-07 | 2007-10-11 | Mellanox Technologies Ltd. | Global Reference Voltage Distribution System With Local Reference Voltages Referred to Ground And Supply |
| CN102354241B (zh) * | 2011-07-29 | 2015-04-01 | 开曼群岛威睿电通股份有限公司 | 电压/电流转换电路 |
| TWI594656B (zh) * | 2012-06-27 | 2017-08-01 | 登豐微電子股份有限公司 | 線性電流調整器 |
| DE102014223152B4 (de) * | 2014-11-13 | 2021-10-07 | Rohde & Schwarz GmbH & Co. Kommanditgesellschaft | Stromquelle zum Bereitstellen eines ersten Stroms und eines zweiten Stroms |
| US10845832B2 (en) | 2018-09-10 | 2020-11-24 | Analog Devices International Unlimited Company | Voltage-to-current converter |
| CN109508064A (zh) * | 2018-12-30 | 2019-03-22 | 成都纵横自动化技术股份有限公司 | 一种液位测量电路与系统 |
Family Cites Families (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3731181A (en) * | 1972-04-12 | 1973-05-01 | Motorola Inc | Improved reference current source |
| NL8001115A (nl) * | 1980-02-25 | 1981-09-16 | Philips Nv | Geintegreerde schakeling omvattende een aantal spanningsstroomomzetters. |
| KR970000909B1 (en) * | 1985-09-02 | 1997-01-21 | Siemens Ag | Controlled current source apparatus |
| US4675594A (en) * | 1986-07-31 | 1987-06-23 | Honeywell Inc. | Voltage-to-current converter |
| US5266887A (en) * | 1988-05-24 | 1993-11-30 | Dallas Semiconductor Corp. | Bidirectional voltage to current converter |
| DE3924804A1 (de) * | 1989-07-27 | 1991-01-31 | Telefunken Electronic Gmbh | Elektrischer schaltkreis |
| EP0419255A3 (en) * | 1989-09-20 | 1993-02-17 | Hewlett-Packard Company | Method and apparatus for controlling apparent uniformity of led printheads |
-
1992
- 1992-11-16 KR KR1019920021465A patent/KR930010834A/ko active IP Right Grant
- 1992-11-17 US US07/977,331 patent/US5341087A/en not_active Expired - Fee Related
- 1992-11-18 EP EP92203550A patent/EP0544360B1/en not_active Expired - Lifetime
- 1992-11-18 DE DE69221999T patent/DE69221999T2/de not_active Expired - Fee Related
- 1992-11-18 SG SG1996009257A patent/SG44015A1/en unknown
- 1992-11-24 JP JP4313432A patent/JPH05224761A/ja active Pending
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|---|---|---|---|---|
| US7453780B2 (en) | 2004-07-30 | 2008-11-18 | Kabushiki Kaisha Toshiba | Information recording medium, information recording/reproducing apparatus and information management method |
Also Published As
| Publication number | Publication date |
|---|---|
| EP0544360A2 (en) | 1993-06-02 |
| US5341087A (en) | 1994-08-23 |
| EP0544360B1 (en) | 1997-09-03 |
| SG44015A1 (en) | 1997-11-14 |
| KR930010834A (ko) | 1993-06-23 |
| EP0544360A3 (en) | 1993-12-22 |
| DE69221999D1 (de) | 1997-10-09 |
| DE69221999T2 (de) | 1998-03-05 |
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