JPH0435111A - サンプリングレートコンバータ - Google Patents
サンプリングレートコンバータInfo
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- JPH0435111A JPH0435111A JP2134167A JP13416790A JPH0435111A JP H0435111 A JPH0435111 A JP H0435111A JP 2134167 A JP2134167 A JP 2134167A JP 13416790 A JP13416790 A JP 13416790A JP H0435111 A JPH0435111 A JP H0435111A
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- 238000010586 diagram Methods 0.000 description 10
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- 238000005259 measurement Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 238000007493 shaping process Methods 0.000 description 2
- 230000001934 delay Effects 0.000 description 1
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- 238000005516 engineering process Methods 0.000 description 1
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
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-
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- H03H17/0621—Non-recursive filters with input-sampling frequency and output-delivery frequency which differ, e.g. extrapolation; Anti-aliasing
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、回路構成の簡易化を計ったサンプリングレー
トコンバータに関し、特にデジタルオーディオ機器に用
いて好適なサンプリングレートコンバータに関する。
トコンバータに関し、特にデジタルオーディオ機器に用
いて好適なサンプリングレートコンバータに関する。
本発明のサンプリングレートコンバータは、第１のサン
プリング周波数でサンプリングされたＰＣＭ信号をＰＤ
Ｍ（パルス密度変調）信号に変換するＰＤＭ変調器と、
前記ＰＤＭ変調器の出力が供給されると共に第２のサン
プリング周波数で定まるサンプリング周期毎に計数値を
出力するカウンタとを有し、回路構成の簡易化を計るこ
とができる。 また、カウンタの出力に乗算器を接続す
ることにより、前記ＰＤＭ変調器のクロック周波数に応
じて出力信号のレベルを調整することができる。
プリング周波数でサンプリングされたＰＣＭ信号をＰＤ
Ｍ（パルス密度変調）信号に変換するＰＤＭ変調器と、
前記ＰＤＭ変調器の出力が供給されると共に第２のサン
プリング周波数で定まるサンプリング周期毎に計数値を
出力するカウンタとを有し、回路構成の簡易化を計るこ
とができる。 また、カウンタの出力に乗算器を接続す
ることにより、前記ＰＤＭ変調器のクロック周波数に応
じて出力信号のレベルを調整することができる。
従来、例えば特開昭５７−１１５０１５号公報に記載さ
れている通り、デジタルフィルタを用いたサンブリング
レートコンバータが知られている。
れている通り、デジタルフィルタを用いたサンブリング
レートコンバータが知られている。
ずなわら、第４図の従来のサンプリングレートコンハー
クの一例を示すブロック図において、１は入力標本化速
度と出力標本化速度との間の時間差（人力データのサン
プリングクロックと出力データのサンプリングクロック
の位相差）を測定する時間差測定回路である。時間差測
定回路ｌの時間差情報は、時間差−係数変換段２に供給
されてフィルタ係数に変換され、このフィルタ係数が標
本化フィルタ（ディジタルフィルタ）３に供給される。
クの一例を示すブロック図において、１は入力標本化速
度と出力標本化速度との間の時間差（人力データのサン
プリングクロックと出力データのサンプリングクロック
の位相差）を測定する時間差測定回路である。時間差測
定回路ｌの時間差情報は、時間差−係数変換段２に供給
されてフィルタ係数に変換され、このフィルタ係数が標
本化フィルタ（ディジタルフィルタ）３に供給される。
そして、時間差測定回路１は、第５回の時間差測定回路
の一例を示すブロック図に示すようにＰ Ｌ Ｌ （位
相ロンクループ）４と計数回路５とから構成され、入力
標本化速度信号により計数動作を開始すると共に出力標
本化速度信号により計数動作を停止し、その時点の計数
出力（並列データ）を変換段２に供給する。なお、Ｐ
Ｌ １．、４は入力標本化速度信号に位相同期した周波
数信号をクロックとして計数回路５に供給する。
の一例を示すブロック図に示すようにＰ Ｌ Ｌ （位
相ロンクループ）４と計数回路５とから構成され、入力
標本化速度信号により計数動作を開始すると共に出力標
本化速度信号により計数動作を停止し、その時点の計数
出力（並列データ）を変換段２に供給する。なお、Ｐ
Ｌ １．、４は入力標本化速度信号に位相同期した周波
数信号をクロックとして計数回路５に供給する。
〔発明が解決しようとする課題］
第４ＵＡにおいて、標本化フィルタ３を用いて標本化速
度を増大する場合、先ず元の標本比値間に零の標本化値
（または直線補間値）を挿入し、その結果得られた新し
い標本化シーケンスをより高い標本化速度で標本化フィ
ルタ３により処理することにより出力標本化速度を高く
することかできる。そして、標本化速度を多段階で増大
する場合、この処理を複数回繰り返す必要があり、処理
か複雑になると共に回路構成も複９１ｔになる欠点があ
った。
度を増大する場合、先ず元の標本比値間に零の標本化値
（または直線補間値）を挿入し、その結果得られた新し
い標本化シーケンスをより高い標本化速度で標本化フィ
ルタ３により処理することにより出力標本化速度を高く
することかできる。そして、標本化速度を多段階で増大
する場合、この処理を複数回繰り返す必要があり、処理
か複雑になると共に回路構成も複９１ｔになる欠点があ
った。
（課題を解決するだめの手段〕
本発明のサンプリングレートコンハークは、第１のサン
プリング周波数でサンプリングされたＰＣＭ信号をＰＤ
Ｍ（パルス密度変調）信号に変換するＰＤＭ変調器と、
前記ＰＤＭ変；１ｌｔｌｌ ４’Ｆ＋の出力が供給され
ると共に第２のサンプリング周波数で定まるサンプリン
グ周１…毎に計数値を出力するカウンタとから構成され
る。
プリング周波数でサンプリングされたＰＣＭ信号をＰＤ
Ｍ（パルス密度変調）信号に変換するＰＤＭ変調器と、
前記ＰＤＭ変；１ｌｔｌｌ ４’Ｆ＋の出力が供給され
ると共に第２のサンプリング周波数で定まるサンプリン
グ周１…毎に計数値を出力するカウンタとから構成され
る。
また、本発明のサンプリングレートコンバータは、前記
カウンタの出力に乗算器を接続して構成される ［作用〕 本発明のザンプリングレーＩ・コンバータによれば、Ｐ
ＤＭ変調器によりＰＣＭ信号のレベルが高い場合出力パ
ルスの密度が高くなるようなＰＤＭ信号を得て、このＰ
ＤＭ信号から所定のザンプリングレートで出力パルス信
号を得るよ・うにしたので、回路構成の簡易化を計るこ
とができる。
カウンタの出力に乗算器を接続して構成される ［作用〕 本発明のザンプリングレーＩ・コンバータによれば、Ｐ
ＤＭ変調器によりＰＣＭ信号のレベルが高い場合出力パ
ルスの密度が高くなるようなＰＤＭ信号を得て、このＰ
ＤＭ信号から所定のザンプリングレートで出力パルス信
号を得るよ・うにしたので、回路構成の簡易化を計るこ
とができる。
また、カウンタの出力に乗算器を設けた場合には、前記
ＰＤＭ変調器のクロンク周波数に応じて出力信号のレベ
ルを調整することができる。
ＰＤＭ変調器のクロンク周波数に応じて出力信号のレベ
ルを調整することができる。
［実施例〕
以下、本発明の実施例について図面を参照しながら説明
する。
する。
第１図は本発明のサンプリングレートコンバータの基本
構成を示すブロック図であり、第１図において６は第１
のサンプリング周波数ｆ１でサンプリングされたＰＣＭ
信号が供給される入力端子である。７は全体としてＰＤ
Ｍ変調器を示し、例として１次のノイズ補正を用いてＰ
ＤＭ変調器を構成した場合を示す。ＰＤＭ変調器７は、
加算器８、加算器９、一対の１サンプル遅延器１０．１
１及びコンパレータ１２とから成る。１３は第２のサン
プリング周波数ｆ２で定まるサンプリング周期（１／ｆ
２）毎に計数値を出力するカウンタであり、１４は第１
のサンプリング周波数ｆ、と第２のサンプリング周波数
ｆ２との比に応じて出力端子１５の出力信号のレベルを
調整する乗算器である。
構成を示すブロック図であり、第１図において６は第１
のサンプリング周波数ｆ１でサンプリングされたＰＣＭ
信号が供給される入力端子である。７は全体としてＰＤ
Ｍ変調器を示し、例として１次のノイズ補正を用いてＰ
ＤＭ変調器を構成した場合を示す。ＰＤＭ変調器７は、
加算器８、加算器９、一対の１サンプル遅延器１０．１
１及びコンパレータ１２とから成る。１３は第２のサン
プリング周波数ｆ２で定まるサンプリング周期（１／ｆ
２）毎に計数値を出力するカウンタであり、１４は第１
のサンプリング周波数ｆ、と第２のサンプリング周波数
ｆ２との比に応じて出力端子１５の出力信号のレベルを
調整する乗算器である。
以上の構成において、入力端子６に供給されたＰＣＭ信
号をＸ、加算器９の出力をＸｌ、コンパレータ１２の出
力をＹ、１サンプル遅延器１０．１１の１サンプルデイ
レイ量をＺ″１．１サンプル遅延器１０．１１に供給さ
れるクロック信号周波数をｆｃとすれば、その周期はＴ
＝１／ｆｃとなり、次式が成立する。
号をＸ、加算器９の出力をＸｌ、コンパレータ１２の出
力をＹ、１サンプル遅延器１０．１１の１サンプルデイ
レイ量をＺ″１．１サンプル遅延器１０．１１に供給さ
れるクロック信号周波数をｆｃとすれば、その周期はＴ
＝１／ｆｃとなり、次式が成立する。
ＸＩ ＝Ｘ−Ｙ−Ｚ−’＋Ｘ、 ・ Ｚ−■
（１）Ｘ、＝Ｙ＋ＱＮ （３）弐において、ωＴが小、すなわちクロ・ンク信号
の周期Ｔ （１／ｆＣ）が短い場合、Ｚ−１は１に近い
値となり、Ｙ−Ｘとなる。Ｘは例えば１６ビツトのＰＣ
Ｍ信号、Ｙはノイズ補正（Ｎｏｉｓｅ Ｓｈａｐｉｎｇ
）がされた１ピントのＰＤＭ信号を示す。
（１）Ｘ、＝Ｙ＋ＱＮ （３）弐において、ωＴが小、すなわちクロ・ンク信号
の周期Ｔ （１／ｆＣ）が短い場合、Ｚ−１は１に近い
値となり、Ｙ−Ｘとなる。Ｘは例えば１６ビツトのＰＣ
Ｍ信号、Ｙはノイズ補正（Ｎｏｉｓｅ Ｓｈａｐｉｎｇ
）がされた１ピントのＰＤＭ信号を示す。
そして、第２図Ａの本発明に用いるＰＤＭ変調器の説明
図のＰＤＭ信号Ｙに示されるように、第２図Ｂの本発明
に用いるＰＤＭ変調器の説明図のアナログ信号Ｓのレベ
ルが高いほど出力パルスの密度が高くなる。
図のＰＤＭ信号Ｙに示されるように、第２図Ｂの本発明
に用いるＰＤＭ変調器の説明図のアナログ信号Ｓのレベ
ルが高いほど出力パルスの密度が高くなる。
換言すれば、１６ビツトのＰＣＭ信号Ｘを１ビ・ント化
する場合、ｆ、を例えば４４．１ ｋＨｚとすると、フ
ルビット（オフセット・バイナリの全桁が１）時に、４
４．１ ｋＨｚＸ （２” −１） ＃ ３ Ｃ；Ｈｚ
のクロック信号周波数ｆｃが必要となるので、ノイズ補
正（Ｎｏｉｓｅ Ｓｈａｐｉｎｇ ）を用いてｆ ＋
＝４４．１ ｋｌ（ｚの例えば１２８倍のオーバーサン
プリング（クロック信号の周波数ｆｃが約６ＭＨｚ）で
１８ビツト相当の分解能を得ることができる。
する場合、ｆ、を例えば４４．１ ｋＨｚとすると、フ
ルビット（オフセット・バイナリの全桁が１）時に、４
４．１ ｋＨｚＸ （２” −１） ＃ ３ Ｃ；Ｈｚ
のクロック信号周波数ｆｃが必要となるので、ノイズ補
正（Ｎｏｉｓｅ Ｓｈａｐｉｎｇ ）を用いてｆ ＋
＝４４．１ ｋｌ（ｚの例えば１２８倍のオーバーサン
プリング（クロック信号の周波数ｆｃが約６ＭＨｚ）で
１８ビツト相当の分解能を得ることができる。
そして、第３図の本発明のカウンタの動作説明図に簡易
化して示す通り、カウンタの計数時間Ｔｇ内のパルス数
をカウントすることにより第２のサンプリング周波数ｆ
２で定まるサンプリング周期（ｔ／ｒ２）毎に計数値を
取り出し、乗算器１４に供給する。
化して示す通り、カウンタの計数時間Ｔｇ内のパルス数
をカウントすることにより第２のサンプリング周波数ｆ
２で定まるサンプリング周期（ｔ／ｒ２）毎に計数値を
取り出し、乗算器１４に供給する。
この場合、ＰＣＭ信号のピーク時、または第１のサンプ
リング周波数が高くクロック信号の周波数ｆｃが高い時
ＰＤＭ信号のパルス密度は高くなるため、乗算器１４は
出力端子の出力信号がフルビット（アナログ信号Ｓが正
のピークに例えばオフセット・バイナリの全桁が１）に
なるように係数を調整する。その結果、乗算器１４の出
力信号は第１のサンプリング周波数ｆｌ （例えば４
４．１ ｋＨｚ）でサンプリングされたＰＣＭ信号Ｘを
第２のサンプリング周波数ｆ２ （例えば４８ｋＨｚ
）に変換されたものとなる。
リング周波数が高くクロック信号の周波数ｆｃが高い時
ＰＤＭ信号のパルス密度は高くなるため、乗算器１４は
出力端子の出力信号がフルビット（アナログ信号Ｓが正
のピークに例えばオフセット・バイナリの全桁が１）に
なるように係数を調整する。その結果、乗算器１４の出
力信号は第１のサンプリング周波数ｆｌ （例えば４
４．１ ｋＨｚ）でサンプリングされたＰＣＭ信号Ｘを
第２のサンプリング周波数ｆ２ （例えば４８ｋＨｚ
）に変換されたものとなる。
〔発明の効果）
以上の説明から明らかな通り、本発明のサンプリングレ
ートコンバータによれば、ＰＤＭ変調器によりＰＣＭ信
号のレベルが高い場合出力パルスの密度が高くなるよう
なＰＤＭ信号を得て、このＰＤＭ信号から所定のサンプ
リングレートで出力パルス信号を得るようにしたので、
回路構成の簡易化を計ることができると共に、カウンタ
の出力に乗算器を設けた場合には、前記ＰＤＭ変調器の
クロック周波数に応じて出力信号のレベルを調整するこ
とができる。
ートコンバータによれば、ＰＤＭ変調器によりＰＣＭ信
号のレベルが高い場合出力パルスの密度が高くなるよう
なＰＤＭ信号を得て、このＰＤＭ信号から所定のサンプ
リングレートで出力パルス信号を得るようにしたので、
回路構成の簡易化を計ることができると共に、カウンタ
の出力に乗算器を設けた場合には、前記ＰＤＭ変調器の
クロック周波数に応じて出力信号のレベルを調整するこ
とができる。
第１図は本発明のサンプリングレートコンバータの基本
構成を示すブロック図、第２図Ａ乃至第２図Ｂはそれぞ
れ本発明に用いるＰＤＭ変調器の説明図、第３図は本発
明のカウンタの動作説明図、第４図は従来のサンプリン
グレートコンバークの一例を示すブロック図、第５図は
時間差測定回路の一例を示すブロック図である。 ６−一−−−−−−−−−−−−−−入力端子７、−−
−−− ＰＤ Ｍ変調器８．９−一−−−−−
−−−−−−−加算器１０．１１ １サンプル遅延
器 １２−− −−−−−−−−−コンパレータ１３−−
−−−−−−−−−−−−−−−−一カウンタ１４−−
−−−−−−−−−−−−−−−一乗算器１５−−−−
− 出力端子
構成を示すブロック図、第２図Ａ乃至第２図Ｂはそれぞ
れ本発明に用いるＰＤＭ変調器の説明図、第３図は本発
明のカウンタの動作説明図、第４図は従来のサンプリン
グレートコンバークの一例を示すブロック図、第５図は
時間差測定回路の一例を示すブロック図である。 ６−一−−−−−−−−−−−−−−入力端子７、−−
−−− ＰＤ Ｍ変調器８．９−一−−−−−
−−−−−−−加算器１０．１１ １サンプル遅延
器 １２−− −−−−−−−−−コンパレータ１３−−
−−−−−−−−−−−−−−−−一カウンタ１４−−
−−−−−−−−−−−−−−−一乗算器１５−−−−
− 出力端子
Claims (1)
- 【特許請求の範囲】 １、第１のサンプリング周波数でサンプリングされたＰ
ＣＭ信号をＰＤＭ（パルス密度変調）信号に変換するＰ
ＤＭ変調器と、前記ＰＤＭ変調器の出力が供給されると
共に第２のサンプリング周波数で定まるサンプリング周
期毎に計数値を出力するカウンタとを具備したことを特
徴とするサンプリングレートコンバータ。 ２、前記カウンタの出力に乗算器を接続したことを特徴
とする請求項１記載のサンプリングレートコンバータ。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2134167A JPH0435111A (ja) | 1990-05-25 | 1990-05-25 | サンプリングレートコンバータ |
| KR1019910008291A KR910020689A (ko) | 1990-05-25 | 1991-05-23 | 샘플링비 변환기 |
| US08/039,528 US5357248A (en) | 1990-05-25 | 1993-03-29 | Sampling rate converter |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2134167A JPH0435111A (ja) | 1990-05-25 | 1990-05-25 | サンプリングレートコンバータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0435111A true JPH0435111A (ja) | 1992-02-05 |
Family
ID=15122017
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2134167A Pending JPH0435111A (ja) | 1990-05-25 | 1990-05-25 | サンプリングレートコンバータ |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5357248A (ja) |
| JP (1) | JPH0435111A (ja) |
| KR (1) | KR910020689A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2003069783A1 (fr) * | 2002-02-14 | 2003-08-21 | Sharp Kabushiki Kaisha | Appareil de reception, systeme de communication utilisant ledit appareil de reception et systeme de conversion de vitesse d'echantillonnage |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5497152A (en) * | 1993-09-13 | 1996-03-05 | Analog Devices, Inc. | Digital-to-digital conversion using non-uniform sample rates |
| US5732002A (en) * | 1995-05-23 | 1998-03-24 | Analog Devices, Inc. | Multi-rate IIR decimation and interpolation filters |
| US5661479A (en) * | 1995-09-22 | 1997-08-26 | United Microelectronic Corporation | Oversampling modulation in a D/A converter using a combination of feedforward/feedback coefficients and shift registers |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB1436878A (en) * | 1973-08-23 | 1976-05-26 | Standard Telephones Cables Ltd | Pulse density modulation to pcm modulation translation |
| US4109110A (en) * | 1975-02-20 | 1978-08-22 | International Standard Electric Corporation | Digital-to-analog converter |
| JPS5892160A (ja) * | 1981-11-27 | 1983-06-01 | Nec Corp | サンプリング周波数変換装置 |
| JP2731151B2 (ja) * | 1987-09-18 | 1998-03-25 | 株式会社東芝 | 位相情報検出回路 |
-
1990
- 1990-05-25 JP JP2134167A patent/JPH0435111A/ja active Pending
-
1991
- 1991-05-23 KR KR1019910008291A patent/KR910020689A/ko not_active Application Discontinuation
-
1993
- 1993-03-29 US US08/039,528 patent/US5357248A/en not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2003069783A1 (fr) * | 2002-02-14 | 2003-08-21 | Sharp Kabushiki Kaisha | Appareil de reception, systeme de communication utilisant ledit appareil de reception et systeme de conversion de vitesse d'echantillonnage |
Also Published As
| Publication number | Publication date |
|---|---|
| KR910020689A (ko) | 1991-12-20 |
| US5357248A (en) | 1994-10-18 |
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