JPH0422130A - 半導体装置 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 30
- 238000002844 melting Methods 0.000 claims abstract description 10
- 230000008018 melting Effects 0.000 claims abstract description 10
- 239000000463 material Substances 0.000 claims abstract description 8
- 239000002184 metal Substances 0.000 abstract description 6
- 229910052751 metal Inorganic materials 0.000 abstract description 6
- 229910052802 copper Inorganic materials 0.000 abstract description 4
- 229910000679 solder Inorganic materials 0.000 description 10
- 230000004888 barrier function Effects 0.000 description 4
- 238000004519 manufacturing process Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 3
- 229920002120 photoresistant polymer Polymers 0.000 description 3
- 230000004907 flux Effects 0.000 description 2
- 238000010438 heat treatment Methods 0.000 description 2
- 239000002904 solvent Substances 0.000 description 2
- 241000587161 Gomphocarpus Species 0.000 description 1
- 101100450138 Neurospora crassa (strain ATCC 24698 / 74-OR23-1A / CBS 708.71 / DSM 1257 / FGSC 987) hat-2 gene Proteins 0.000 description 1
- 239000000853 adhesive Substances 0.000 description 1
- 230000001070 adhesive effect Effects 0.000 description 1
- 238000001816 cooling Methods 0.000 description 1
- 238000009826 distribution Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 239000000155 melt Substances 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 238000007747 plating Methods 0.000 description 1
- 238000005057 refrigeration Methods 0.000 description 1
- 238000003892 spreading Methods 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 239000010902 straw Substances 0.000 description 1
- 239000012780 transparent material Substances 0.000 description 1
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
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- H01L2224/113—Manufacturing methods by local deposition of the material of the bump connector
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
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- H01L2224/11—Manufacturing methods
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- H01L2224/1183—Reworking, e.g. shaping
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- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
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- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
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- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〆、産業上の利用分野)
本発明はバンプ電極を有する半導体装置を回路基板に正
確に接続させる構造に関するものである。
確に接続させる構造に関するものである。
(従来の技術)
半導体装置の電極を回路基板の電極に一括して接続する
ため、半導体装置にAu、Cu、 はんだ等によるバ
ンプ電極(以下バンプという)を設け、例えばフヱイス
ダウンにより回路基板に接続することが行われているう 第4図(a) + (b) 、(c) 、(d)はこの
はんだによるバンプを形成する各工程の一例を示す略断
面図であるっ第4図(a)において、半導体装置10表
面には回路素子が形成され、Atによって配線され、所
要の個所に?Ij、数の電極バッド2が設けられている
。
ため、半導体装置にAu、Cu、 はんだ等によるバ
ンプ電極(以下バンプという)を設け、例えばフヱイス
ダウンにより回路基板に接続することが行われているう 第4図(a) + (b) 、(c) 、(d)はこの
はんだによるバンプを形成する各工程の一例を示す略断
面図であるっ第4図(a)において、半導体装置10表
面には回路素子が形成され、Atによって配線され、所
要の個所に?Ij、数の電極バッド2が設けられている
。
電極バッド2の表面以外は絶縁喚3によって糧わnてい
る。この表面l′こCr、Cu占のバリアメタル4をス
パッタリングでより形成するっこの表j(て)tトレン
スト5を塗布し、フォトリソグラフィーにより、電極ハ
ツト2の上方のパリアメ4・し4の表面に、フォトレジ
スト除去部5−1を形成する。
る。この表面l′こCr、Cu占のバリアメタル4をス
パッタリングでより形成するっこの表j(て)tトレン
スト5を塗布し、フォトリソグラフィーにより、電極ハ
ツト2の上方のパリアメ4・し4の表面に、フォトレジ
スト除去部5−1を形成する。
次に第4図ib)に示すように、フォトレジスト除去部
5− I VCパップ6を形成するっこれは、例えば、
バリアメタル4を陰極として、電気r−iんだメツキを
行うことにより形成される。
5− I VCパップ6を形成するっこれは、例えば、
バリアメタル4を陰極として、電気r−iんだメツキを
行うことにより形成される。
次に第4図fc)に示すように、7オトレジスト5を溶
剤を用いて除去し、不要のバリアメタル4をエツチング
により除去すると、面状の略々同じ高さのバンプ6が形
成する。
剤を用いて除去し、不要のバリアメタル4をエツチング
により除去すると、面状の略々同じ高さのバンプ6が形
成する。
次に、このバンプ6のはんだを・溶融し再度固1らせて
、第4図fd)に示されるような略々球形のバンプ6が
得られる。
、第4図fd)に示されるような略々球形のバンプ6が
得られる。
第5図1al 、 (b)はfMJ述のようをバンプ6
を有する半導体製型1ヶ回路基板7に接続する工程の略
断面図である。
を有する半導体製型1ヶ回路基板7に接続する工程の略
断面図である。
第5図(a)に示されるよって、半導体装置Iはノくノ
ブ6側を下面てし、ボンディングツールI2により真空
吸着さn、回路基板7の表面の接続ノくノド13に位置
合わせされるっ回路基板7の表面に汀、あらかじめワラ
1.クス14が塗布さ扛ている。
ブ6側を下面てし、ボンディングツールI2により真空
吸着さn、回路基板7の表面の接続ノくノド13に位置
合わせされるっ回路基板7の表面に汀、あらかじめワラ
1.クス14が塗布さ扛ている。
ぞし7て半導体装置Iを回路基板7に押さえつけると、
この両者に7ラノクス14の粘着力により仮止めされる
。
この両者に7ラノクス14の粘着力により仮止めされる
。
第51″A(b)はこの仮止めされた状態であって、こ
レヲヘルト炉モジくはペーパーフェイズリフ0−炉tた
hホットプレート等の適当な加熱手段により加熱すると
、バンプ6のはんだが浴融し、はんだが回路基板7上の
接続パッド!3に濡れひろがった後冷却することにより
、両者は電気的かつ機械的に接続される。その後、適当
i溶剤によりフラックス14を洗浄除去して、フェイス
ダウン接続が完了する。
レヲヘルト炉モジくはペーパーフェイズリフ0−炉tた
hホットプレート等の適当な加熱手段により加熱すると
、バンプ6のはんだが浴融し、はんだが回路基板7上の
接続パッド!3に濡れひろがった後冷却することにより
、両者は電気的かつ機械的に接続される。その後、適当
i溶剤によりフラックス14を洗浄除去して、フェイス
ダウン接続が完了する。
(発明か解決しょうとする課題)
前述のよう、を従来の技術〉でおいてに、バンプのはん
だが熔融された状態では、半導体装置lは、熔融された
はんだの表面張力て工り支えられた不安定な状態である
ため、第6図に3いて、半導体装置1と回路基板7との
間のギャップd(・=、半導体装illの自重とはんだ
の表面張力との釣り合いKより決まり、温度プロファイ
ルやフラックスの量などの誤差により、ギャップdは簡
単に変化してしまい、任意にコントロールすることは難
しい。
だが熔融された状態では、半導体装置lは、熔融された
はんだの表面張力て工り支えられた不安定な状態である
ため、第6図に3いて、半導体装置1と回路基板7との
間のギャップd(・=、半導体装illの自重とはんだ
の表面張力との釣り合いKより決まり、温度プロファイ
ルやフラックスの量などの誤差により、ギャップdは簡
単に変化してしまい、任意にコントロールすることは難
しい。
また、半導体装置1のバンプの配置が不均一な場合、そ
の他重量の配分が不均一な場合などに、第7図に示され
るよって、ギャップdが不均一になり、バンプの数が少
ない方が低くなって傾斜する現象があり、信頼性の低下
を招くことがあった。
の他重量の配分が不均一な場合などに、第7図に示され
るよって、ギャップdが不均一になり、バンプの数が少
ない方が低くなって傾斜する現象があり、信頼性の低下
を招くことがあった。
(課題を解決するための手段)
前述の課題を解決するため、本発明においては、半導体
装置の表面に設けた電極パッドVC複数のバンプを設け
、さらに前記のバンプよりは高さが低くかつ融点の昼い
材料よりなる複数の突起を設けた。
装置の表面に設けた電極パッドVC複数のバンプを設け
、さらに前記のバンプよりは高さが低くかつ融点の昼い
材料よりなる複数の突起を設けた。
(作 用)
m1述の:うiバンプと突起を備えた半導体装置を、−
1路基板ンで妥絖するとき、バンプつ;熔融し、両者i
ijに〇ギャップは半導体装置の自重により若干侠<で
るが、高融点の突起〆′!−より支えられるから、両者
1じレヤップは濱て一定ンで保持される。
1路基板ンで妥絖するとき、バンプつ;熔融し、両者i
ijに〇ギャップは半導体装置の自重により若干侠<で
るが、高融点の突起〆′!−より支えられるから、両者
1じレヤップは濱て一定ンで保持される。
(了九例ニア
第1図(a)(口本発明による半導体装置1の略断面図
である。半導体装置10表面の周辺の上部には、Auk
でよるスタッドバンプ る。その製造方法は、後で第2図(a) 、 fb)
、 (e)に従って説明される。内側の表面には、電極
パッド2。
である。半導体装置10表面の周辺の上部には、Auk
でよるスタッドバンプ る。その製造方法は、後で第2図(a) 、 fb)
、 (e)に従って説明される。内側の表面には、電極
パッド2。
2の上ンζはんだによるバンプ6、6が設けられている
。スタッドバンプ8,8の高さは均一でバンプ6、6の
高さより低く、かつm1者の融点は後者の1点より高い
。
。スタッドバンプ8,8の高さは均一でバンプ6、6の
高さより低く、かつm1者の融点は後者の1点より高い
。
第1図+bjは、嘉1図fa)に示される半導体装置1
?、回路基板7に接続した状態の断面図である。
?、回路基板7に接続した状態の断面図である。
この接続は壕ず、第3図fa)て示すように、ボンディ
ングツール12により半導体装g1と真空吸着し、回路
基板7上の接続バ2,ド13とバンプ6、必要てよりス
タフ・ドバンプ8とを位置合わせするっ回路基板7の表
面に汀、あらかじめフラー・クス14を塗布しておき、
ボンディングツール・12/でより回路基板7上に押さ
え付けた半導体装置lが仮り止めされる。その後回路基
ff17’e、ベルト炉あるいにペーパ−7エイズ炉寸
たにホットプレートなどの加熱手段により加熱し、パッ
プ6のはんだを溶融させ、回路基板7上の接続パッド1
3への接続を完了する。この工程は、第5図fa) 、
(b)の従来例と同様である。その結果は、第1図t
b’+に示されるように、バンプ6、6が押しつぶされ
初期の高きより低くなるが、両側のスタッドバンプ8,
8は熔融しないから、半導体装置1と回路基板7とのギ
ャップは、スタッドバンプ8,8の高さで保持される。
ングツール12により半導体装g1と真空吸着し、回路
基板7上の接続バ2,ド13とバンプ6、必要てよりス
タフ・ドバンプ8とを位置合わせするっ回路基板7の表
面に汀、あらかじめフラー・クス14を塗布しておき、
ボンディングツール・12/でより回路基板7上に押さ
え付けた半導体装置lが仮り止めされる。その後回路基
ff17’e、ベルト炉あるいにペーパ−7エイズ炉寸
たにホットプレートなどの加熱手段により加熱し、パッ
プ6のはんだを溶融させ、回路基板7上の接続パッド1
3への接続を完了する。この工程は、第5図fa) 、
(b)の従来例と同様である。その結果は、第1図t
b’+に示されるように、バンプ6、6が押しつぶされ
初期の高きより低くなるが、両側のスタッドバンプ8,
8は熔融しないから、半導体装置1と回路基板7とのギ
ャップは、スタッドバンプ8,8の高さで保持される。
以上のようなギャップを規定するための突起となるスタ
ッドバンプ8.8は、以下のようシでしてg造される。
ッドバンプ8.8は、以下のようシでしてg造される。
その個数は、少々くとも3個以上あることが望ましい。
この実施例では、材料としてAuを用いた場合について
説明するが、通常使用さnる電極パッド2の材料、例え
ばAtにワイヤボンディング可能な金属であればよく、
AtやCuを使用することもできる。バンプ6の材料よ
りも融点が高いことが必要である。
説明するが、通常使用さnる電極パッド2の材料、例え
ばAtにワイヤボンディング可能な金属であればよく、
AtやCuを使用することもできる。バンプ6の材料よ
りも融点が高いことが必要である。
第2図fa) K示されるよって、通常のネイルヘッド
ボンディングと同様に、キャピラリ9の孔に通したAu
ワイヤ10の先端に電気放電などによってAuボール1
1を形成する。
ボンディングと同様に、キャピラリ9の孔に通したAu
ワイヤ10の先端に電気放電などによってAuボール1
1を形成する。
次に第2図(b”lに示されるように、とのAuポル1
1を、チャピラリ9全圧下して半導体装置Iの例えばk
tのパッド20に、超音波併用の熱圧Nにより固定させ
る。
1を、チャピラリ9全圧下して半導体装置Iの例えばk
tのパッド20に、超音波併用の熱圧Nにより固定させ
る。
その後、キャピラリ9を移動させ、AuワイヤlOを切
断すると、パッド20の上にスタッドバンプ8が形成さ
れる。
断すると、パッド20の上にスタッドバンプ8が形成さ
れる。
Auボール+1の大きさは、Auワイヤ10の太さによ
りコントロールすることができ、従って、スタッドバン
プ8の大きさも、Auワイヤ10の太さ又はボール形成
条件をコントロールすることにより、任意に選択できる
。−例として、バンプ6の高さより、スタンドバンプ8
の高さは、十数μm低くされる。バンプ6及びスタッド
バンプ8の形成は、ウェーハの段階で形成され、形成後
タイタングにより個別の半導体装置に分割さnる。
りコントロールすることができ、従って、スタッドバン
プ8の大きさも、Auワイヤ10の太さ又はボール形成
条件をコントロールすることにより、任意に選択できる
。−例として、バンプ6の高さより、スタンドバンプ8
の高さは、十数μm低くされる。バンプ6及びスタッド
バンプ8の形成は、ウェーハの段階で形成され、形成後
タイタングにより個別の半導体装置に分割さnる。
(発明の効果〕
以上のように本発明によれば、フェイスダウン接続時の
半導体装置と回路基板とのキャップを、バンプより融点
の高い突起により機械的にコントロールでさると共に、
半導体装置の回路基板に対する傾斜を防止することがで
きるので、信頼性の高い接続を行うことができる。
半導体装置と回路基板とのキャップを、バンプより融点
の高い突起により機械的にコントロールでさると共に、
半導体装置の回路基板に対する傾斜を防止することがで
きるので、信頼性の高い接続を行うことができる。
%1図(alは本発明の一実施例の略断面図、第1図t
b)は第1図(a)の装置を回路基板に接続した略断面
図、第2図(a)〜(c)はスタッドバンプの製造工程
の略断面図、第3図fa) 、 (b)は接続の工程の
略断面図、第4図(at〜(d)はバンプの製造工程の
略断面図、第5図(at 、 (b)は従来の接続の工
程の略断面図、第6図及び第7図に従来の接続状、轢の
略断面図である。 !・半導体装置、 2・・・電極パッド、 6・・
バンプ、 7・・・回路基板、 8・・スタッドバ
ンプ、・接続パッド
b)は第1図(a)の装置を回路基板に接続した略断面
図、第2図(a)〜(c)はスタッドバンプの製造工程
の略断面図、第3図fa) 、 (b)は接続の工程の
略断面図、第4図(at〜(d)はバンプの製造工程の
略断面図、第5図(at 、 (b)は従来の接続の工
程の略断面図、第6図及び第7図に従来の接続状、轢の
略断面図である。 !・半導体装置、 2・・・電極パッド、 6・・
バンプ、 7・・・回路基板、 8・・スタッドバ
ンプ、・接続パッド
Claims (1)
- 1 複数の電極パッドの表面に設けた複数のバンプと、
前記のバンプよりは高さが低くかつ融点の高い材料より
なる複数の突起を設けたことを特徴とする半導体装置
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2128170A JPH0422130A (ja) | 1990-05-17 | 1990-05-17 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2128170A JPH0422130A (ja) | 1990-05-17 | 1990-05-17 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0422130A true JPH0422130A (ja) | 1992-01-27 |
Family
ID=14978137
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2128170A Pending JPH0422130A (ja) | 1990-05-17 | 1990-05-17 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0422130A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0532297A1 (en) * | 1991-09-10 | 1993-03-17 | Fujitsu Limited | Process for flip-chip connection of a semiconductor chip |
JPH0623247U (ja) * | 1992-08-28 | 1994-03-25 | 京セラ株式会社 | 表面実装型電子部品 |
US5700715A (en) * | 1994-06-14 | 1997-12-23 | Lsi Logic Corporation | Process for mounting a semiconductor device to a circuit substrate |
-
1990
- 1990-05-17 JP JP2128170A patent/JPH0422130A/ja active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0532297A1 (en) * | 1991-09-10 | 1993-03-17 | Fujitsu Limited | Process for flip-chip connection of a semiconductor chip |
US5284796A (en) * | 1991-09-10 | 1994-02-08 | Fujitsu Limited | Process for flip chip connecting a semiconductor chip |
JPH0623247U (ja) * | 1992-08-28 | 1994-03-25 | 京セラ株式会社 | 表面実装型電子部品 |
US5700715A (en) * | 1994-06-14 | 1997-12-23 | Lsi Logic Corporation | Process for mounting a semiconductor device to a circuit substrate |
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