JPH04207024A - 成膜方法 - Google Patents

成膜方法

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JPH04207024A
JPH04207024A JP2340199A JP34019990A JPH04207024A JP H04207024 A JPH04207024 A JP H04207024A JP 2340199 A JP2340199 A JP 2340199A JP 34019990 A JP34019990 A JP 34019990A JP H04207024 A JPH04207024 A JP H04207024A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は成膜方法に関する。
(従来の技術) リンがドープされたポリシリコン膜は、例えば半導体デ
バイスの配線材料として広く用いられている。
このポリシリコン膜を半導体ウェハに成膜する方法の一
つとして、低濃度リンドープポリシリコン膜の製法につ
いて記述された特開平2−34917号公報の技術、有
機系原料の使用について記述された特開平2−8143
2号公報等に開示された技術等があり、いずれも減圧C
VD法が用いられている。
減圧CVD法は、反応管内を排気して減圧しながら当該
反応管内に反応ガスを供給して成膜する方法であり、ド
ープ用ガスの流量を調整することにより膜の不純物濃度
、この場合リン濃度をコントロールできる点で上記のポ
リシリコン膜の製法に対して有効な方法である。
第4図は減圧CVD装置において、反応管内の圧力及び
成膜用ガスの流量を固定した場合におけるドープ用ガス
の流量と成膜速度との関係を示すグラフであり、横軸に
ヘリウム(He)ガスでフォスフイン(PH3)カスを
1%に希釈した混合ガスの流量、縦軸に成膜速度を夫々
とったものである。また第5図は同様の場合におけるド
ープ用ガスの流量と、薄膜中のリン(P)濃度との関係
を示すグラフであり、横軸には同様にドープ用ガスの流
量をとり、縦軸にはリン濃度をとったものである。なお
各図の数値は半導体ウェハ面内25点の平均値である。
これらグラフかられかるように減圧CVD法ではドープ
用ガスの流量を調整することにより成膜速度を変えずに
不純物濃度をコントロールできる。
(発明が解決しようとする課題) ところで半導体デバイスの高集積化、高信頼性の要求に
伴い、ポリシリコン膜に対してリン濃度のウェハ面内均
一性、膜厚均一性及びウェハ間均−性を高くすることが
要請されている。減圧CVD法において、リン濃度の均
一性を改善するためには成膜時の反応管内圧力を0.1
〜0.2T。
rrにする必要がある。
一方すンドープボリシリコン膜を成膜する場合、例えば
成膜用ガス及びドープ用ガスとして夫々ジシラン(Si
2H6)カス及びフォスフイン(PH3)ガスが用いら
れるか、PH,カス濃度は安全性の面から1%程度が望
ましいとされている。
このため確保しようとするリン濃度の値によっては多量
にガスを流さなければならないが、リン濃度に見合う大
きな流量でガスを供給しなから反応管内圧力を0.1〜
0.2Torrとするためには、排気性能を大幅に向上
させなければならない。
しかしながら排気性能を大きくすることについては次の
理由により限界がある6例えは縦型CVD装置の場合、
反応管やウェハのロード、アンロードのための機構等を
収容した筐体は、ウェハカセット等が配置されたクリー
ンルームと電力制御部や真空ポンプ等が配置されたメン
テナンスルームとの境界に設置されている。ここで真空
ポンプを前記筐体に近接して設けると、CVD装置のメ
ンテナンスが困難になる上、真空ポンプの振動が反応管
内のウェハに伝播し、この振動により塵が発生し、半導
体ウェハに付着すると半導体素子の歩留が低下してしま
うので、真空ポンプは前記筐体から可成り離した位置に
設置せざるを得ない。
従って真空ポンプと反応管との間の排気管路のコンダク
タンスは小さくなり、このため排気性能を大幅に向上さ
せるためには可成り大きな容量の真空ポンプが必要にな
り、また排気管路の直径を大きくすることが必要になり
、コストアップ、装置の大型化を招いてしまう。
本発明はこのような事情に基づいてなされたものであり
、その目的は、不純物をドープした薄膜を減圧雰囲気下
で成膜するにあたって、不純物の必要な濃度均一性を確
保しながら任意の高濃度不純物濃度の薄膜を得ることが
でき、しがも大きな排気性能を必要としない成膜方法を
提供することにある。
(課題を解決するための手段) 本発明は、薄膜の主成分を含む成膜用ガスと薄膜の不純
物を含むドープ用ガスとを、被処理雰囲気に供給すると
共に当該被処理雰囲気を減圧状態としながら成膜を行う
方法において、 前記成膜用ガス及びドープ用ガスを被処理雰囲気に供給
して不純物濃度の低い低濃度層を形成する工程と成膜用
ガスの流量を前記工程における成膜用ガスの流量よりも
小さくして不純物濃度の高い高濃度層を形成する工程と
を交互に行い、これにより得られた薄膜を熱処理して高
濃度層の不純物を低濃度層に拡散させることを特徴とす
る。
(作用) 例えば成膜用ガスとドープ用カスとを被処理雰囲気に供
給して低濃度層を基板上に形成し、次いで例えば成膜用
ガスの供給を停止して高濃度層である不純物層を形成し
、その後成膜用ガスの供給を再開して低濃度層を形成す
ると低濃度層、高濃度層、低濃度層の順に積層された薄
膜が得られる。
そしてこの薄膜を熱処理例えばアニール処理すると高濃
度層内の不純物が両側の低濃度層に拡散して例えば不純
物高濃度薄膜が得られる。
(実施例) 本発明方法を実施するための成膜装置の一例を第1図及
び第2図を参照しながら説明する。
同図に示す成膜装置は縦型の減圧CVD装置であり、ク
リーンルームとメンテナンスルームとの境界に設置され
た外筐1(第2図参照)の中に収容されている。
前記外筐1内の上部においては、外筐1に支承されたベ
ースプレート1aの上に円筒状の加熱炉2が長手方向垂
直に配置されており、この加熱炉2は、金属板2aと、
この金属板2aの内面全体に積層された断熱層2bと、
この断熱層2bの内周面に後述する反応管を囲続するよ
うに設けられた例えば抵抗発熱体からなる円筒状の加熱
用ヒータ2Cとから構成されている。
前記加熱炉2内には、円筒状の反応管3が略垂立して配
設されており、この反応管3は、一端が開口していてそ
の開口面を下向きにして配置された有底筒状の耐熱性材
料例えば石英からなる外筒3aと、この外筒3a内に間
隙を介して同心状に配置され、両端が開口している例え
ば石英からなる内筒3bとを備えた2重管構造として構
成されている。
前記外Fili 3 a及び内筒3bは各々その下端に
てステンレス等からなる筒状のマニホールド4に保持さ
れており、このマニホールド4は、前記ベースプレート
1aに当該プレート1aの開口部に挿入された状態で固
定されている。前記マニホールド4の下端部の開口部に
は、ステンレス等からなる円盤状のキャップ部5が開閉
自在に設けられており、このキャップ部5は閉じた状態
のときに図示しない弾性材料のOリングを介して当該開
口部を気密封止する役割を有するものである。
前記キャップ部5の略中心部には、例えは磁気シールに
より気密な状態で回転可能な回転軸6が挿通されている
。この回転軸6の下端は昇降台7aに組み込まれた図示
しない回転機構に接続されていると共に、上端は例えば
ステンレススチールからなるターンテーブル6aに固定
されている。
前記ターンテーブル6aの上面には、反応管3の内1!
j3bと所定の間隙を保持して石英からなる保温1”1
j6bが設置されており、この保温筒6b上には、多数
枚の例えば50枚の半導体ウェハをが各々略水平な状態
でかつ互いに所定の間隔例えば13mm間隔で積重して
収容する例えば石英からなるウェハボート6cが搭載さ
れている。
前記昇降台7aは、これを昇降させるように当該昇降台
7aの基端部に挿通された昇降軸7b等と共に搬送機構
7を構成するものであり、この搬送機構7は、ウェハボ
ート6cをキャップ部5、ターンテーブル6a及び保温
Fj6b等と一体となって反応管1内にロード、アンロ
ードを行う役割を有する。
前記ベースグレート1aの下方側に位置するマニホール
ド4の下部側面には、例えば石英からなる第1のガス導
入管8がシール部材8aにより気密に水平に挿設されて
おり、この第1のガス導入管8のマニホールド4内の内
端側は、そのガス流出口8bがウェハボート6cの下端
付近に位置するように上方に向けてL字状に曲折される
と共に、マニホールド4の外に位置する外端は例えばス
テンレススチールからなるガス配管8cを介して図示し
ないガス供給源、例えば成膜用ガスであるジシラン(S
i2H6)ガスとキャリアガスである窒素ガス(N2)
ガスとを供給するためのガス供給源に接続されている。
更に前記第1のガス導入管8の上方側には、例えば石英
からなる第2のガス導入管9が同様にマニホールド4の
側面にシール部材9aにより挿設され、その内端部側は
上端かウェハボー)6cの上端付近に位置するようにL
字状に曲折されている。この第2のガス導入管9aは、
例えばリンCP>やボロン(B)やヒ素(As)等のド
ープ元素を含む有機化合物を含有するドープ用ガス、例
えばフォスフイン(PH1)ガスを反応管1内に導入す
るためのものであり、垂立した管路部分には、各半導体
ウェハWに対して均一にPH3ガスを供給することがで
きるように、ウェハボート6cに対向した位置にて複数
のガス流出孔9bが上下方向に所定の間隔で形成されて
いる。更に必要に応じてウェハボートを回転させ、以て
ウェハを回転させ、面内均一性を向上させることができ
る。
前記第2のガス導入管9の外端部には、例えばステンレ
ススチールの配管9Cの一端が接続され、この配管9C
の他端には、カス加熱部9d及びガス流量調整器9eを
介して、P H3ガスが充填されたガス供給源9fか接
続されている。前記ガス加熱部9dは、P Hsガスを
所定の温度に加熱し、この熱によりガスを成膜前に予め
励起状態にして反応管3内へ供給するためのいわば予備
励起機構としての役割を果たすものである。
一方前記ベースプレート1aの上方側に位置するマニホ
ールド4の上部側面には、外筒3aと内m3bとの間隙
から処理ガスを排出して反応管3内を所定の減圧雰囲気
に設定するための例えばステンレススチールよりなる管
経2インチの排気管10の一端が接続されており、この
排気管10の他端は、メンテナンスルームにて前記外筐
1から離れて設!された別の外筐11(第2図参照)内
の真空ポンプ等例えばドライポンプの排気部12に、メ
ンテナンスルームの上部側を通って接続されている。そ
して前記排気管10の管路長は、外筐1.11が互に離
れており、しかもメンテナンスの点から排気管10をメ
ンテナンスルームの上部側に配置しなければならない等
の理由から例えば3mもの長さに達つする。
以上のように成膜装置は構成されている。
次に上記の成膜装置を用いた本発明方法の実施例につい
て説明する。先ずヒータ2Cにより反応管3内の被処理
領域を500℃の均熱加熱状態とし、次いで反応管3内
に下方開口部から搬送m梢7により、例えば各々13m
mの間隔で50枚の半導体ウェハWを収容したウェハボ
ート6Cをロートする。
次に反応管1内を所定の真空状態例えば1×10づTo
rrまで排気した後に第1のガス導入管9から、薄膜の
主成分を含む成膜用ガスとして例えば5iiH*ガスと
N2ガスとを夫々流量を例えば100SCCM及び10
0SCCMの流量で内筒3b内に導入すると共に、P 
H3がヘリウム(He)で1%に希釈されたビー1用カ
スである混合ガスをガス加熱部9dで400℃に加熱し
、この加熱された混合ガスを1008CCMの流量で第
2のガス導入管9に設けられた複数のガス流出孔9bか
ら各半導体ウェハWに均等に供給する。
そして反応管3内を0.2Torrになるように圧力を
制御しながら排気を行い、100分開成膜を行った。続
いてP Hsガスを含む混合ガスはそのまま供給状態で
成膜ガスであるSi2H6ガス及びN2ガスの供給を止
めてこの状態を15分間維持し、然る後に再び5i2H
aガス及びN2ガスを同様に夫々流量を例えば100S
CCM及び100SCCMの流量で供給し、20分間成
膜を行った。なお各プロセスにおける反応管3内の圧力
は例えば0.2Torrとなるよう制御されている。
このように成膜ガスを供給する工程とその供給を停止す
る工程とを交互に行ったところ、第3図に示すように被
処理体である半導体ウェハWのSi Ox Ill 1
3の表面に、リンが低濃度でドーグされた膜厚2500
オングストロームのリン低濃度層としてのポリシリコン
!114この例ではリンのみからなる膜厚例えば数オン
グストロームの薄い厚さのリン高濃度層15、及び前記
ポリシリコンII(リン低濃度層)14と、同様の膜厚
500オングストロームの低濃度層としてのポリシリコ
ン!116がこの順に積層された。
こうして得られた積層体をアニール炉にて900℃で2
0分間熱処理を行ったところ、リン高濃度層15内のリ
ンが両面側のリン低濃度層14.16に拡散し、この結
果膜厚3000オングストロームの高濃度リンドープポ
リシリコン膜が得られた。
本実施例の効果を確認するために、この高濃度リンドー
プポリシリコン膜についてリン濃度及びシート抵抗を調
べたところ、夫々2.4X10”個/ c m ’及び
1シート当り20Ωであった。
これに対し上述の減圧CVD装置を用いて従来方法によ
り5iiH6ガス、N2ガス及び1%PH3ガスの流量
を夫々1003CCM、100SCCM及び300SC
CMに設定し、かつ反応管3内の圧力を0.2Torr
に制御して膜厚3000オングストロームの高濃度リン
ドープポリシリコン膜を成膜し、リン濃度を調べたとこ
ろ2゜0XIO”個/ c m ’であった。なおこの
場合加熱温度等地の条件は実施例と同じである。
この結果かられかるように本実施例によれば従来よりも
リン濃度の高い高濃度リンドープポリシリコン膜が得ら
れた。ここで従来方法の場合1%PH3ガスの流量を3
003CCM程度にすれば望ましいリン濃度が得られる
が、反応管3内の圧力が0.4〜0.5Torrになっ
てしまい、先述したようにリン濃度の面方向の均−性等
が悪かった。
更に本発明では、リン低濃度層の間にリン高濃度層を1
層のみ形成する方法に限定されるものではなく、2層以
上形成するようにしてもよい。実際にリン高濃度層を2
層及び3層を形成した場合について最終的に得られたポ
リシリコン膜のリン濃度を夫々調べたところ、2.8X
10”個/Cm3及び3.2X10”個Cm’であった
。この結果から本発明では層構成を選択することによっ
て所望のリン濃度が得られることが理解される。
また熱処理前の層構成については、リン低濃度層の間に
リン高濃度層を挟んだ構成に限らず、リン低濃度層とリ
ン高濃度層の2層のみからなる構成としてもよい。
ここで反応管3内の減圧雰囲気については、0゜ITo
rr程度がより好ましく、この場合にはなお一層均質な
薄膜が得られる。
更にリン高濃度層を形成する工程においては、ドープ用
ガスの流量を増加してもよいし、Si2H6ガス、N2
ガスの供給を完全に止めることなく、少量流すようにし
てもよい、またアニール処理を行わなくとも、その後に
CVD、酸化、拡散等の熱処理が行われる場合は、この
熱処理で代用することができる。
以上において本発明では、不純物としてリンに限定され
るものではないし、薄膜の主成分についてもシリコンに
限定されるものではない。
なお薄膜が表面に成膜される被処理体は、半導体ウェハ
に限らずガラス基板等地の材料であってもよいし、その
処理については多数枚同時に行うのではなく一枚づつ処
理してもよい。
(発明の効果) 本発明によれば、薄膜の主成分を含む成膜用ガスの流量
を調整することによって不純物濃度の低い低濃度層と不
純物濃度の高い高濃度層とを交互に積層し、続く熱処理
により高濃度層内の不純物を低濃度層内に拡散して不純
物をドープした薄膜を得るようにしているため、大きな
排気性能を必要とすることなく、不純物成分の必要な濃
度均一性を確保しながら任意の不純物濃度の薄膜を得る
ことができ、例えば高濃度不純物ドープ膜を成膜する場
合、排気性能を改良することなく、より高濃度で均質性
の高い薄膜を得ることができる。
【図面の簡単な説明】
第1図は本発明方法の実施例を説明するための成膜装置
の一部を示す説明図、第2図は第1図装置の一部を排気
部と共に示す斜視図、第3図は第1図装置を用いて本発
明方法にて成膜された薄膜の説明図、第4図はPH,ガ
スの流量と成膜速度との関係を示す特性曲線図、第5図
はPH,ガスの流量とリン濃度との関係を示す特性曲線
図である。 2・・・加熱炉     3・・・反応管4・・・マニ
ホールド  8・・・第1のガス導入管9・・・第2の
導入管  1o・・・排気管W・・・半導体ウェハ  
14.16・リン低濃度層15・・・リン高濃度層

Claims (1)

  1. 【特許請求の範囲】 薄膜の主成分を含む成膜用ガスと薄膜の不純物を含むド
    ープ用ガスとを被処理雰囲気に供給すると共に当該被処
    理雰囲気を減圧状態としながら成膜を行う方法において
    、 前記成膜用ガス及びドープ用ガスを被処理雰囲気に供給
    して不純物濃度の低い低濃度層を形成する工程と成膜用
    ガスの流量を前記工程における成膜用ガスの流量よりも
    小さくして不純物濃度の高い高濃度層を形成する工程と
    を交互に行い、これにより得られた薄膜を熱処理して高
    濃度層の不純物を低濃度層に拡散させることを特徴とす
    る成膜方法。
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5817368A (en) * 1994-08-08 1998-10-06 Fuji Electric Co., Ltd. Method for forming a thin film

Families Citing this family (25)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR940006667B1 (ko) * 1991-02-18 1994-07-25 삼성전자 주식회사 미 반응가스의 제거 및 반응 억제장치
JP2819073B2 (ja) * 1991-04-25 1998-10-30 東京エレクトロン株式会社 ドープド薄膜の成膜方法
US5536918A (en) * 1991-08-16 1996-07-16 Tokyo Electron Sagami Kabushiki Kaisha Heat treatment apparatus utilizing flat heating elements for treating semiconductor wafers
US5387557A (en) * 1991-10-23 1995-02-07 F. T. L. Co., Ltd. Method for manufacturing semiconductor devices using heat-treatment vertical reactor with temperature zones
US5407350A (en) * 1992-02-13 1995-04-18 Tokyo Electron Limited Heat-treatment apparatus
JP3121122B2 (ja) * 1992-06-26 2000-12-25 東京エレクトロン株式会社 熱処理方法
US5332689A (en) * 1993-02-17 1994-07-26 Micron Technology, Inc. Method for depositing low bulk resistivity doped films
US5380370A (en) * 1993-04-30 1995-01-10 Tokyo Electron Limited Method of cleaning reaction tube
US5441570A (en) * 1993-06-22 1995-08-15 Jein Technics Co., Ltd. Apparatus for low pressure chemical vapor deposition
US5484484A (en) * 1993-07-03 1996-01-16 Tokyo Electron Kabushiki Thermal processing method and apparatus therefor
JPH0786173A (ja) * 1993-09-16 1995-03-31 Tokyo Electron Ltd 成膜方法
WO1995020823A1 (en) * 1994-01-27 1995-08-03 Insync Systems, Inc. Methods for improving semiconductor processing
US5948300A (en) * 1997-09-12 1999-09-07 Kokusai Bti Corporation Process tube with in-situ gas preheating
US6204194B1 (en) * 1998-01-16 2001-03-20 F.T.L. Co., Ltd. Method and apparatus for producing a semiconductor device
JP3468347B2 (ja) * 1998-06-22 2003-11-17 日本エー・エス・エム株式会社 半導体素子の製造方法
US7250196B1 (en) 1999-10-26 2007-07-31 Basic Resources, Inc. System and method for plasma plating
US6503379B1 (en) * 2000-05-22 2003-01-07 Basic Research, Inc. Mobile plating system and method
AU2006200125B2 (en) * 2000-05-22 2007-11-29 Nova Machine Products, Inc. Mobile plating system and method
US6451692B1 (en) * 2000-08-18 2002-09-17 Micron Technology, Inc. Preheating of chemical vapor deposition precursors
US20030180450A1 (en) * 2002-03-22 2003-09-25 Kidd Jerry D. System and method for preventing breaker failure
US20050126497A1 (en) * 2003-09-30 2005-06-16 Kidd Jerry D. Platform assembly and method
JP4728748B2 (ja) * 2005-09-05 2011-07-20 株式会社東芝 半導体製造装置の清浄化方法
JP5060324B2 (ja) * 2008-01-31 2012-10-31 株式会社日立国際電気 基板処理装置、半導体装置の製造方法及び処理容器
JP6121993B2 (ja) 2011-06-10 2017-04-26 マサチューセッツ インスティテュート オブ テクノロジー 半導体への高濃度活性ドーピングおよびこのようなドーピングにより生成される半導体装置
JP5921168B2 (ja) * 2011-11-29 2016-05-24 株式会社日立国際電気 基板処理装置

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2133498B1 (ja) * 1971-04-15 1977-06-03 Labo Electronique Physique
US3949119A (en) * 1972-05-04 1976-04-06 Atomic Energy Of Canada Limited Method of gas doping of vacuum evaporated epitaxial silicon films
JPS5322029B2 (ja) * 1973-12-26 1978-07-06
US4217375A (en) * 1977-08-30 1980-08-12 Bell Telephone Laboratories, Incorporated Deposition of doped silicon oxide films
US4190470A (en) * 1978-11-06 1980-02-26 M/A Com, Inc. Production of epitaxial layers by vapor deposition utilizing dynamically adjusted flow rates and gas phase concentrations
JPS5575219A (en) * 1978-12-02 1980-06-06 Toshiba Corp Manufacturing semiconductor
JPS5696834A (en) * 1979-12-28 1981-08-05 Mitsubishi Monsanto Chem Co Compound semiconductor epitaxial wafer and manufacture thereof
JPS57132331A (en) * 1981-02-06 1982-08-16 Ricoh Co Ltd Chemical vapor deposition and device therefor
US4698104A (en) * 1984-12-06 1987-10-06 Xerox Corporation Controlled isotropic doping of semiconductor materials
US4659401A (en) * 1985-06-10 1987-04-21 Massachusetts Institute Of Technology Growth of epitaxial films by plasma enchanced chemical vapor deposition (PE-CVD)
US4773355A (en) * 1985-06-10 1988-09-27 Massachusetts Institute Of Technology Growth of epitaxial films by chemical vapor deposition
JPH06101434B2 (ja) * 1985-09-30 1994-12-12 住友化学工業株式会社 気相成長法
US4968644A (en) * 1986-06-16 1990-11-06 At&T Bell Laboratories Method for fabricating devices and devices formed thereby
US4699805A (en) * 1986-07-03 1987-10-13 Motorola Inc. Process and apparatus for the low pressure chemical vapor deposition of thin films

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5817368A (en) * 1994-08-08 1998-10-06 Fuji Electric Co., Ltd. Method for forming a thin film

Also Published As

Publication number Publication date
JP3023982B2 (ja) 2000-03-21
US5116784A (en) 1992-05-26

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