JPH04170657A - 伝送路制御装置 - Google Patents

伝送路制御装置

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Publication number
JPH04170657A
JPH04170657A JP2299365A JP29936590A JPH04170657A JP H04170657 A JPH04170657 A JP H04170657A JP 2299365 A JP2299365 A JP 2299365A JP 29936590 A JP29936590 A JP 29936590A JP H04170657 A JPH04170657 A JP H04170657A
Authority
JP
Japan
Prior art keywords
data
transmission line
fault
bit
bus
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2299365A
Other languages
English (en)
Inventor
Kazuyuki Funada
一幸 船田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Software Shikoku Ltd
Original Assignee
NEC Software Shikoku Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Software Shikoku Ltd filed Critical NEC Software Shikoku Ltd
Priority to JP2299365A priority Critical patent/JPH04170657A/ja
Publication of JPH04170657A publication Critical patent/JPH04170657A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は伝送路制御装置、特に、伝送路に障害が発生し
た場合に、自動的に障害から復旧する伝送路制御装置に
関する。
〔従来の技術〕
従来、この種の伝送路制御装置は、伝送路において転送
される並列データにパリティビットあるいはハミング符
合を付加して、それを検査することにより、伝送路の障
害を検出し、可能な場合はデータを訂正することにより
障害時のシステムダウンを回避していた。
〔発明が解決しようとする課題〕
上述した従来の伝送路制御装置は、伝送路の障害を検出
するだけか、多数の訂正符合を付加してデータを訂正す
るものであるので、伝送路の信頼性が低いという欠点が
ある。
〔課題を解決するための手段〕
本発明の伝送路制御装置は、並列データのデータ誤りを
検出する障害検出回路と、前記障害検出回路からの障害
情報に従って伝送路の診断を行う診断回路と、前記診断
回路からの選択信号によって前記並列データの中の1ビ
ットを選択する第1のデータセレクタと、前記第1のデ
ータセレクタの出力と前記並列データの中の対応するビ
ットを比較する比較回路と、前記第1のデータセレクタ
の出力と前記並列データの中の対応するビットを切り替
える第2のデータセレクタを有している。
〔実施例〕
次に、本発明について図面を参照して説明する。
第1図は本発明の一実施例を示すブロック図である。
並列データバス1はあらかじめパリティビットが付加さ
れている通常の伝送路である。障害検出回路5は、並列
データバス1に障害が発生すると、その障害情報を通知
線7を介して診断回路6に通知する。診断回路6は、障
害情報を解析し、選択信号9を操作する。データセレク
タ2は、選択信号9によって並列データバス1の中の選
択されたビットをデータ線10に出力する。
比較回路4は、データ線10と並列データバス1の中の
対応するビットを比較し、その結果を通知線8を介して
診断回路6に通知する。比較結果が一致であれば、診断
回路6は選択信号9の値を更新する。データセレクタ2
は、選択信号9によって示される別のデータビットをデ
ータ線10に出力する。
不一致が検出されると、診断回路は、選択信号9の状態
をその時点の状態に固定し処理を終了する。データセレ
クタ3は、選択信号9によって示される並列データバス
1の中のビットを切り替えて、並列データバス10に出
力する。
以後は、正しいデータがデータ線10を通して供給され
、伝送路は障害状態から復旧する。
〔発明の効果〕
以上説明したように本発明は、障害が発生したビットを
別のデータバスを使用して転送することにより、伝送路
の障害によるシステムダウンを回避し、かつ伝送路の信
頼性を向上させることができる効果がある。
【図面の簡単な説明】
第1図は本発明の一実施例を示すブロック図である。 1・・・並列データバス、2・・・データセレクタ、3
・・・データセレクタ、4・・・比較回路、5・・・障
害検出回路、6・・・診断回路、7・・・通知線、8・
・・通知線、9・・・選択信号、10・・・並列データ
バス。

Claims (1)

    【特許請求の範囲】
  1. 複数のデータビットによって構成される並列データの転
    送を行う伝送路の伝送路制御装置において、前記並列デ
    ータのデータ誤りを検出する障害検出回路と、前記障害
    検出回路からの障害情報および不一致信号に従って伝送
    路の診断を行う診断回路と、前記診断回路からの選択信
    号によって前記並列データの中の1ビットを選択する第
    1のデータセレクタと、前記第1のデータセレクタの出
    力と前記平列データの中の対応するビットを比較し不一
    致信号を出力する比較回路と、前記第1のデータセレク
    タの出力と前記平列データの中の対応するビットを前記
    選択信号によって切り替える第2のデータセレクタとを
    含むことを特徴とする伝送路制御装置。
JP2299365A 1990-11-05 1990-11-05 伝送路制御装置 Pending JPH04170657A (ja)

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JP2299365A JPH04170657A (ja) 1990-11-05 1990-11-05 伝送路制御装置

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JPH04170657A true JPH04170657A (ja) 1992-06-18

Family

ID=17871616

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JP2299365A Pending JPH04170657A (ja) 1990-11-05 1990-11-05 伝送路制御装置

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100483423B1 (ko) * 1997-11-18 2005-09-14 매그나칩 반도체 유한회사 버스테스트장치

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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