JPH04139666A - 追記型光デイスクの信号処理用半導体集積回路および半導体装置 - Google Patents

追記型光デイスクの信号処理用半導体集積回路および半導体装置

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JPH04139666A
JPH04139666A JP2262009A JP26200990A JPH04139666A JP H04139666 A JPH04139666 A JP H04139666A JP 2262009 A JP2262009 A JP 2262009A JP 26200990 A JP26200990 A JP 26200990A JP H04139666 A JPH04139666 A JP H04139666A
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JP
Japan
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circuit
signal
efm
data
optical disk
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JP2262009A
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Yasushi Yoshiyama
吉山　恭嗣
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Ricoh Co Ltd
Original Assignee
Ricoh Co Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ［産業上の利用分野］ この発明は追記型光ディスク、すなわち追記型のコンパ
クトディスクのディジタル信号処理４行う信号処理用半
導体集積回路及びその集積回路を備えた半導体装置に関
する。
［従来の技術］ 最近、レーザによる光記憶メディアとして、オーディオ
用コンパクトディスクが多く用いられており、アナログ
レコードからコンパクトディスクへと置き換えが進んで
いる。
一方、ディジタルデータの記憶メディアとして従来、大
容量メモリとして使用されていた磁気メモリの領域にコ
ンパクトディスクを利用して、コンピュータのデータ等
を記録／再生するいわゆるＣＤ−ＲＯＭが用いらるよう
になってきた。このＣＤ−ＲＯＭは、オーディオ用コン
パクトディスクとシステムのコンパチビリティを保ちな
がら、オーディオ信号領域に、コンピュータのデータ、
静止画、グラフィックス等を記録でき、記録可能容量が
５４０Ｍバイトでオーディオ用コンパクトディスクと同
様に大量複製、配布の用途に使用される。
これらの従来のコンパトディスクとしては、上述したよ
うにオーディオ用コンパクトディスクや電子出版等に用
いられるＣＤ−ＲＯＭが存在するが、これらはいずれも
読出し等用のＲＯＭ　（リード・オン・メモリ）タイプ
であり、コンパクトディスクを製造するメーカが予じめ
情報をディスク上に記録している。このコンパクトディ
スクを再生するために、デコーダ再生機器が各種メーカ
から多く出されているが、これらの機器は再生専用器で
あり、書き込み用回路については、何ら対応がなされて
いない。
ところで、最近コンパクトディスク規格を満足する追記
型光ディスクが提案され、この追記型ディスクに記録、
再生を行なうフォーマットを制定したいわゆるオレンジ
ブック標準も提案されている。
〔発明が解決しようとする課題］ 上述したように、従来はコンパクトディスクへの記録は
コンパクトディスク製造メーカ側が行なっていたため、
その記録用装置は記録等用の大型のものであった。
また、従来のコンパクトディスクのデコーダ、再生機器
は上述したように、再生等用であり、再生等用器にコン
パクトディスク製造用メーカが使用する記録装置を組み
込むには無理がある。
この発明は追記型コンパクトディスクに対して記録し再
生するためのいわゆるオレンジブック準拠した半導体集
積回路を提供し、追記型コンパクトディスクの記録再生
装置が容易に製造できるようにすることをその課題とす
る。
［課題を解決するための手段］ この発明の第１の発明は、光ディスクから読み出された
ＥＦＭ変調されたＥＦＭ信号を復調するＥＦＭ復調回路
と、光ディスクへ書き込むデータをＥＦＭ変調するＥＦ
Ｍ変調回路と、光ディスクから読み出されたＡＴＩＰ信
号を復調するＡＴＩＰ復調回路と、上記ＥＦＭ信号また
はＡＴＩＰ信号に基づき光ディスクの回転制御用信号を
出力するＣＬＶ制御回路と、上記ＥＦＭ信号よりサブコ
ードを抽出しサブコードのＣＲＣ演算を施しまた光ディ
スクへ書き込むデータにＣＲＣ演算を施しサブコードを
生成するサブコード生成並びに演算回路と、上記ＥＦＭ
復調された信号からＣＩＲＣ信号の誤りを検出し訂正す
るとともに光ディスクに書き込むデータにＣＩＲＣ誤り
訂正符号を付加するＣＩＲＣ変調並びに復調回路と、オ
ーディオまたはデータを出力するとともにオーディオま
たデータが入力されるインターフェース回路と、システ
ムコントローラ用プロセッサのデータバスとのインター
フェースを行なうシステムコントローラ用インターフェ
ース回路と、を備えてなる追記型光ディスクの信号処理
用半導体集積回路である。
又、この発明の第２の発明は、光ディスクから読み出さ
れたＥＦＭ変調されたＥＦＭ信号を復調するＥＦＭ復調
回路と、光ディスクへ書き込むデータをＥＦＭ変調する
ＥＦＭ変調回路と、光ディスクから読み出されたＡＴＩ
Ｐ信号を復調するＡＴＩＰ復調回路と、上記ＥＦＭ信号
またはＡＴＩＰ信号に基づき光ディスクの回転制御用信
号を出力するＣＬＶ制御回路と、上記ＥＦＭ信号よりサ
ブコードを抽出しサブコードのＣＲＣ演算を施しまた光
ディスクへ書き込むデータにＣＲＣ演算を施しサブコー
ドを生成するサブコード生成並びに演算回路と、上記Ｅ
ＦＭ復調された信号からＣＩＲＣ信号の誤りを検出し訂
正するとともに光ディスクに書き込むデータにＣＩＲＣ
誤り訂正符号を付加するＣＩＲＣ変調並びに復調回路と
、オーディオまたはデータを出力するとともにオーディ
オまたデータが入力されるインターフェース回路と、シ
ステムコントローラ用プロセッサのデータバスとのイン
ターフェースを行なうシステムコントロラ用インターフ
ェース回路とを、同一半導体基板上に形成してなる半導
体装置である。
〔作用〕
上述したように、各回路が読出しと畜き込みに対応でき
る機能を備えているので、読出し、書き込みに対応可能
な半導体集積回路が得られる。また、各回路は読出し及
び書き込みに共通使用するため、回路の共用部分が多く
なり、回路規模が小さくなる。従って、１チツプへの集
積が容易に行なえる。
Ｆ実施例コ 以下、この発明の実施例を図面を参照して説明する。
第１図はこの発明による信号処理用半導体集積回路の全
体構成を示すブロック図である。
第１図において、ｌはこの発明による信号処理用半導体
集積回路である。そして、この集積回路１に追記型光デ
ィスク２からピックアップ３にて読み出したデータがＲ
Ｆ回路４から入力される。
また、集積回路ｌからは、外部の容量６４にビットのス
タティック型のランダムアクセスメモリ（以下、ＲＡＭ
と略記する。）８に格納された書き込みデータを光ディ
スク２に書き込むためＲＦ回路４へ出力する。
２０はＥＦＭ復調回路であり、光ディスク２から読み出
された１４ビツトのＥＦＭ変調されたＥＦＭ信号を変換
テーブルに従って８ビツトのデータに復調し、データバ
ス１０に送出する。データバス１０に送出されたデータ
は、基準クロック回路９０に基づいてアドレス発生回路
９５から発生されるアドレスにてアドレス指定されたＲ
ＡＭ８に書き込まれる。
２５はＥＦＭ変調回路であり、ＲＡＭ８から読み出され
た８ビツトのデータに直流成分を少なくするために１４
ビツトのＥＦＭデータに変調するとともに、更にマージ
ンビットを付加し１７ビツトのデータにし、ＲＦ回路４
ヘデータを送出する。
ＲＡＭ８から読み出されたデータはデータバス１０から
ＥＦＭ変調回路２５へ送出される。このデータバス１０
へは、アドレス発生回路９５から発生されるアドレスに
てアドレス指定されたＲＡＭ８からのデータが送出され
る。
３０はＡＴＩＰ復調回路であり、ＡＴＩＰデコシュレー
タ５にて光ディスク２に作成されているブリブルーフか
ら読み出されたＡＴＩＰ信号を復調する。
４０はＣＬＶ制御回路であり、ＥＦＭ復調回路２ｏから
のＥＦＭ信号及びまたはＡＴＩＰデコシュレータ５から
のＡＴＩＰ信号に基づき光ディスクの回転制御用信号を
サーボ回路７に出力する。
またこの実施例のＣＬＶ制御回路はモータ６からのＦＧ
小出力入力され、この出力に基づいて更に回転制御用の
信号を出力する。
５０はサブコード生成並びに演算回路であり、Ｅ　Ｆ　
Ｍ信号よりサブコードを抽出しサブコードのＣＲＣ演算
を施しまた光ディスクへ書き込むデータにＣＲＣ演算を
施しサブコードを生成する。このサブコード生成並びに
演算回路５０は、ＥＦＭ復調回路２０からのＥＦＭ信号
が入力されＣＲＣ信号を抽出するレジスタ５１．ＣＲＣ
演算回路Ｓ２、読み出し用レジスタ５３、書き込み用レ
ジスタ５４、自動加減算回路５５、ＥＦＭ変調回路２５
ヘデータを送出するためのレジスタ５６及び内部バヌ５
７を備える。
７０はＣＩＲＣ変調並びに復調回路であり、ＲＡＭ８よ
りデータバス１０を介して読み出されたＥ　Ｆ’　Ｍ復
調された信号からＣＩＲＣ（クロス・インターリ−ブト
・リード・ソロモン）信号の誤りを検出し訂正し、その
データを再度ＲＡ　Ｍ　８に書き込む。更にＣＩＲＣ変
調並びに復調回路７０はＲＡ　Ｍ　８よりデータバス１
０を介して読み出された光ディスク２に書き込むデータ
にＣＩＲＣ誤り訂正符号を付加し、そのデータを再度Ｒ
ＡＭ８に書き込む。
８０はインターフェース回路であり、ＲＡ　Ｍ　８よ番
ノデータバス１０を介して読み出されたオーディオまた
はデータを出力するのとともにオーディオまたはデータ
が入力されたデータをＲＡ入１８に書き込む。
８５はシステムコントローラ用インターフェース回路で
あり、システムコントローラ用プロセッサのデータバス
とのインターフェースを行なう。
次に上述した各回路につき更に説明する。
（１）ＥＦＭ復調回路２０（第２図参照）ＥＦＭ復調回
路２０はＥＦＭ信号入力部とＥＦＭデータ抽出部とを備
える。第２図（Ａ）は、ＥＦ　ｈ、＋信号入力部を、第
２図（Ｂ）は、ＥＦＭデータ抽出部を示す。
光ディスク２から読み出された１４ビツトのＥＦＭ変調
されたＥＦＭ信号が５ＹＮＣパタ一ン抽出回路２２に入
力される。そして、外部のＰＬＬ回路１５とビットクロ
ック再生回路２１と位相比較回路２１１でＰＬＬが構成
されており、８　Ｍ　Ｈ２のＶ　ＣＯ信号がビットクロ
ック再生回路２１で４、　Ｍ　ｉ（ｚのビットグロック
信号（ＰＬ、ＣＫ）として出力される。このＰＬＣＫを
５ＹＮＣ抽出回路２２にタイミング信号として与え、こ
の回路２１からＥＦＭ信号のＨｊｌ、Ｌｌｌ、■（２が
抽出される。又この回路には保護内挿回路２３を備えて
おり、この回路２３からのクロッグ信号と５ＹＮＣ抽出
回路２２かもの信号がオア回路２４に入力され、このオ
ア回路２４からジンクロン同期信号（ＶＳＹＮＣ）が出
力される。Ｅ　Ｆ　Ｍ変換テーブル回路２１２にはＥＦ
Ｍ信号データが入力されるとともに、ＶＳＹＮＣが基準
タイミング信号、ＰＬＣＫがタイミング信号として夫々
与えられる。
この変換テーブル回路２１２ではマージンビットを除去
し、そして変換テーブルに従って１４ビツトから８ビツ
トのデータに復調する。このデータがデータバス１０に
送出され、基準クロック回路９０に基づいてアビレス発
生回路９５から発生されるアドレスにてアドレス指定さ
れたＲＡＭ８に書き込まれる。
（２）ＥＦＭ変調回路２５（第３図参照）ＥＦｌｖづ変
調回路２５はＥＦＭ出力部とＥＦＭ変換部を備え、第３
図（Ａ）はＥＦＭ出力部を第３図ＣＢ）はＥＦＭ変換部
を示す。
ＲＡＭ８から読み出された８ビツトのデータトサブコー
ド生成並びに演算回路５０からの８ビツトのデータがセ
レクタ２６１に入力される。サブコード直流成分を少な
くするために１４ビツトのＥＦＭデータに変調するとと
もに、更にマージンビットを付加し１７ビツトのデータ
にし、ＲＦＩｉｌｉｌ路４ヘデータを送出する。ＲＡＭ
８から読み出されたデータはデータバス１０からＥＦＭ
変調回路２５へ送出される。セレクタ２６１はＲＡＭ８
からのデータ又はサブコードデータを選択しＥＦＭ変換
回路２６２に出力する。ＥＦＭ変換回路２６２は変換テ
ーブルに従って８ビツトのデータを１４ビツトのＥＦＭ
信号に変換し、セレクタ２６３に出力する。セレクタ２
６３にはＳｏ、Ｓｌ付加用の１４ビツトのデータが入力
されている。セレクタ２６３はシスコンからの制御信号
に基づき、ＥＦＭ信号又はＳＬ、Ｓ○倍信号何れかをマ
ージン付加回路２６４に送出する。マージン付加回路２
６４は１４ビツトのデータにマージンビットを付加し、
１７ビツトの信号を出力する。このマージンビット作成
回路２６４は各データに対応したＪ、に、Ｖ値を格納し
たＲＯＭ又はロジックアレイで構成されている。更に、
この回路２６４はＪ。
Ｋ値に基づき使用可能なパターンを示すＲＯＭ又はロジ
ックアレイを構成する。この回路２６４にはＤＳＶを計
算する回路、Ｖ値とＤＳＶに基づきパターンの優先順位
を示し、更に唯一の出力すべきパターンを選択する回路
を備える。
このようにマージンビット作成回路２６４を構成するこ
とにより、マージンビット付加に際して、予めルールに
基づいて全ての場合について計算しておき、その結果を
ＲＯＭ又はロジックアレイ等の回路でチップ内に持つこ
とで、演算が高速に行なえる。このことにより、追記型
光ディスクの書き込みを高速で行なうことができる。
マージンビット付加回路２６４にてマージンビットが付
加されたデータは５ＹＮＣ付加回路２６５に出力される
この回路ではＳＹＮＣ信号の場合だけ更に７ビツトのデ
ータを付加して出力する。
１７ビツト又は２３ビツト（ＳＹＮＣのみ）のＥＦＭデ
ータがセレクタ回路２５１とパルスストラテジー回路２
５２と（ｎ−１）ストラテジー回路２５４に夫々送出さ
れる。パルスストラテジー回路２５２ではブルーブック
に準拠してＡ、Ｂ。
Ｃ化を施し、セレクタ２５１に出力する。　（ｎｌ）ス
トラテジー回路２５４ではｎ−１の処理を行ないその結
果をセレクタ２５１に送出する。セレクタ２５１には、
更に規格のテストを行なうためのテストパターン回路２
５３及び１度書いたデータに２度書きしてデータを破壊
するための同期パルス発生回路２５５からの出力が入力
される。
そして、このセレクタ２５１はシスコンからの制御信号
に基づき上述の各信号の中から１つの信号を選択して出
力する。このデータがＲＦ回路４へ出力され、ビッグア
ップ３から光ディスクにデータが書き込まれる。
（３）ＡＴＩ　Ｐ復調回路３０（第４図参照）ＡＴＩＰ
復調回路３０はＡＴＩＰ入力部とＡＴＩＰ信号処理部を
備える。第４図（Ａ）はＡＴＩＰ入力部を第４図（Ｂ）
はＡＴＩＰ信号処理部を示す。
ＡＴＩＰデコシュレータ５にて光ディスク２に作成され
ているブリブルーフから読み出されたＡＴＩＰ信号がＣ
３１５０，Ｃ６３００抽出回路３１に入力され、この回
路３１により、基本タイミングとしてＣ３１５０がオア
回路３３に出力される。オア回路３３には保護内挿回路
３２からの出力が入力され、このオア回路３３からＣ３
１５０が出力される。このＣ３１５０は５ＹＮＣパタ一
ン抽出回路３４に取り込みタイミング信号として与えら
れる。５ＹＮＣ抽出パタ一ン回路３４にはＡＴＩＰデー
タが入力され、この回路３４からをビットクロックがオ
ア回路３６へ出力される。オア回路３６には保護内挿回
路３５からの出力が入力され、このオア回路３６からタ
イミング信号（ＡＳＹＮＣ）出力される。
又、ＡＴＩＰデータはＡＴＩＰデータ抽出回路３７へ入
力される。この回路３７にはＡＳＹＮＣが基本タイミン
グとして与えられる。そして、ＡＴＩＰ抽出回路３７か
らの出力は８ビツトのデータとしてレジスタ３８並びに
ＣＲＣ演算回路３９に与えられる。レジスタ３８からは
ＣＰＵへ８ビツトのデータが、同じ＜ＣＲＣ演算回路３
９からは誤り検出をした結果がＣＰＵへ送出される。
（４）ＣＬＶ制御回路４０　（第５図参照）であり、Ｅ
ＦＭ復調回路２０からのＥＦＭフレームタイミング及び
ＡＴＩＰタイミング信号がパラレル−シリアル変換回路
４１を介してカウンタ４２に入力される。ＥＦＭフレー
ムタイミング及びＡＴＩＰタイミング信号はセレクタ４
８にも出力される。カウンタ４２にて速度差分制御され
た信号はセレクタ４３に出力される。モータ６からのＦ
Ｇ高出力ＦＧカウンタ４６に与えられ、このカウンタ４
６の出力がセレクタ４３に与えられる。
そして基準数設定回路４７にＥＦＭ基準値固定出力、Ａ
ＴＩＰ基準値固定出力、ＦＧ基準値が夫々与えられてお
り、この回路４７の出力が減算器４４に与えられる。減
算器４４にはセレクタ４３の出力が与えられる。この減
算器４４からレジスタ４５を介して光ディスクの回転制
御用信号（ＭＤＳ）をサーボ回路７に出力する。またセ
レクタ４８からアップ団カウンタ４９に位相差分制御用
の信号が出力されこのカウンタ４９から位相制御信号（
ＭＤＰ）が出力される。
このＣＬＶ回路３０によれば、読み出し時はディスク上
のＥＦＭビットに応じてサーボをかけ、書き込み時には
ディスク上のプリグループに応じてサーボをかける回路
が同一回路で行なわれる。
（５）サブコード生成並びに演算回路５０（第６図参照
） このサブコード生成並びに演算回路５０は、ＥＦＭ復調
回路２０からのＥＦＭ信号が入力されＣＲＣ信号を抽出
するレジスタ５に入力され、このレジスタ５１からオア
回路６３に抽出信号が出力される。オア回路６３には保
護内挿回路６２からの出力が与えられ、このオア回路６
３からｖＳＳＹＮＣ信号がレジスタ６４の取り込みタイ
ミング信号として与えられる。レジスタ６４にはＥＦＮ
１データが入力され、このレジスタからＱ出力がシリア
ル−パラレル変換回路６５に与えられる。
この回路６５はＣＲＣ演算回路５２及び読み出し用レジ
スタ５３に夫々８ビツトのデータを送出する。ＣＲＣ演
算回路５２はＣＲＣ結果をＣＰＵへ出力する。又レジス
タ５３からも読み出しデータがＣＰＵへ出力する。
書き込み用レジスタ５４へはＣＰＵよりＱサブデータが
与えられ、このレジスタ５４から自動加減算回路５５と
レジスタ６０．６１にデータが送出される。自動加減算
回路５５とレジスタ６０において、Ｑサブコードの時間
情報の自動加減算を行ないその値をセレクタ５９に与え
る。セレクタ５９にはレジスタ６１のデータも与えられ
、このセレクタ５９により前記信号が選択されて、ＣＲ
Ｃ演算回路５２及びセレクタ５８へ出力される。
ＣＲＣ演算回路５２にでは入力された買い込み用データ
にＣＲＣ演算を施しセレクタ５８二そのデータを出力す
る。そして、セレクタ５８よりパラレル−シリアル変換
回路５７ヘデータが送られ、シリアル変換されたＱデー
タがレジスタ５６に送られ、このレジスタ５６からサブ
コードデータが出力される。
（６）ＣＩＲＣ変調並びに復調回路７０（第７図参照） ＣＩＲＣ辺復調回路７ｏより、ＲＡＭ８より、ｌデータ
バス１０を介して読み出されたＥＦＭ復調された信号か
らＣＩＲＣ信号の誤りを検出し訂正し、そのデータを再
度ＲＡＭ８に書き込む。更にＣＩＲＣ変調並びに復ＷＲ
互路７０はＲＡＭ８よりデータバスｌＯを介して読み出
された光ディスク２に書き込むデータにＣＩＲＣ誤り訂
正符号を付加し、そのデータを再度ＲＡＭ８に書き込む
。
（７）インターフェース回路８０（第８図参照）ＲＡＭ
８よりデータはレジスタ８１及び補間回路８２へ与えら
れ、レジスタ８１は１６ビツトのデータを補間回路８２
へ与える。補間回路８２歯前値をホールドし、平均値補
間し、補間済データをセレクタ８３に与えられる。セレ
クタ８３にはレジスタ８１からの出力があてられ、この
セレクタ８３からＣＤ−ＤＡ用データが出力される。又
レジスタ８１からはＣＤ−ＲＯＭ用データが出力される
。
更に、ＣＤ−ＲＯＭ、ＣＩ）−ＤＡのデータは夫々アン
に回路８６．８７に供給され、このアシド回路８６．８
７にはプレエンコードデータがノット回路８８を介して
供給される。このアンド回路８６．８７から夫々セレク
タ８５ヘデータを送り、このセレクタ８５からレジスタ
８４を介してそのデータをＲＡＭ８に書き込む。
〔発明の効果〕
以上説明したように、この発明によれば、各回路が読出
しと書き込みに対応できる機能を備えているので、読出
し、書き込みに対応可能な半導体集積回路が得られる。
また、各回路は読出し及び書き込みに共通使用するため
、回路の共用部分が多くなり、回路規模が小さくなる。
従って、ｌチップへの集積が容易に行なえる。
【図面の簡単な説明】
第１図は二の発明の全体構成を示すブロック図、第２Ｕ
ｇＪはこの発明のＥＦＭ復調回路を示すブロック図、第
３図はこの発明のＥＦＭ変調回路を示すブロック図、第
４図はこの発明のＡＴＴＰ復調回路を示すブロック図、
第５図はこの発明のＣＬＶ制御回路を示すブロック図、
第６図はこの発明のサブコード生成並びに演算回路を示
すブロック図、第７図はこの発明のＣＩＲＣ変調並びに
復調回路を示すブロック図、第８図はこの発明のインタ
ーフェース回路を示すブロック図である。 ２０・・ＥＦＭ復調回路、 ２５　・ＥＦＭ変調回路、 ３０・・ＡＴＩＰ復調回路、 ４０・・ＣＬＶ制御回路、 ５０　サブコード生成並びに演算回路、７０・・ＣＩＲ
Ｃ変調並びに復調回路、８０　インターフェース回路。

Claims (2)

    【特許請求の範囲】
  1. （１）光ディスクから読み出されたＥＦＭ変調されたＥ
    ＦＭ信号を復調するＥＦＭ復調回路、光ディスクへ書き
    込むデータをＥＦＭ変調するＥＦＭ変調回路、 光ディスクから読み出されたＡＴＩＰ信号を復調するＡ
    ＴＩＰ復調回路、 上記ＥＦＭ信号またはＡＴＩＰ信号に基づき光ディスク
    の回転制御用信号を出力するＣＬＶ制御回路、 上記ＥＦＭ信号よりサブコードを抽出しサブコードのＣ
    ＲＣ演算を施しまた光ディスクへ書き込むデータにＣＲ
    Ｃ演算を施しサブコードを生成するサブコード生成並び
    に演算回路、 上記ＥＦＭ復調された信号からＣＩＲＣ信号の誤りを検
    出し訂正するとともに光ディスクに書き込むデータにＣ
    ＩＲＣ誤り訂正符号を付加するＣＩＲＣ変調並びに復調
    回路、 オーディオまたはデータを出力するとともにオーディオ
    またデータが入力されるインターフェース回路、 システムコントローラ用プロセッサのデータバスとのイ
    ンターフェースを行なうシステムコントローラ用インタ
    ーフェース回路、 とを備えてなる追記型光ディスクの信号処理用半導体集
    積回路。
  2. （２）光ディスクから読み出されたＥＦＭ変調されたＥ
    ＦＭ信号を復調するＥＦＭ復調回路、光ディスクへ書き
    込むデータをＥＦＭ変調するＥＦＭ変調回路、 光ディスクから読み出されたＡＴＩＰ信号を復調するＡ
    ＴＩＰ復調回路、 上記ＥＦＭ信号またはＡＴＩＰ信号に基づき光ディスク
    の回転制御用信号を出力するＣＬＶ制御回路、 上記ＥＦＭ信号よりサブコードを抽出しサブコードのＣ
    ＲＣ演算を施しまた光ディスクへ書き込むデータにＣＲ
    Ｃ演算を施しサブコードを生成するサブコード生成並び
    に演算回路、 上記ＥＦＭ復調された信号からＣＩＲＣ信号の誤りを検
    出し訂正するとともに光ディスクに書き込むデータにＣ
    ＩＲＣ誤り訂正符号を付加するＣＩＲＣ変調並びに復調
    回路、 オーディオまたはデータを出力するとともにオーディオ
    またデータが入力されるインターフェース回路、 システムコントローラ用プロセッサのデータバスとのイ
    ンターフェースを行なうシステムコントローラ用インタ
    ーフェース回路、 とを、同一半導体基板上に形成してなる半導体装置。
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