JPH0379046A - セラミツクパツケージ - Google Patents

セラミツクパツケージ

Info

Publication number
JPH0379046A
JPH0379046A JP1216214A JP21621489A JPH0379046A JP H0379046 A JPH0379046 A JP H0379046A JP 1216214 A JP1216214 A JP 1216214A JP 21621489 A JP21621489 A JP 21621489A JP H0379046 A JPH0379046 A JP H0379046A
Authority
JP
Japan
Prior art keywords
die
chip
wiring
wire
die pad
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1216214A
Other languages
English (en)
Inventor
Yukihiro Araya
荒谷 幸博
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP1216214A priority Critical patent/JPH0379046A/ja
Publication of JPH0379046A publication Critical patent/JPH0379046A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/484Connecting portions
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/4912Layout
    • H01L2224/49171Fan-out arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/85Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
    • H01L2224/8538Bonding interfaces outside the semiconductor or solid-state body
    • H01L2224/85385Shape, e.g. interlocking features
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01082Lead [Pb]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/14Integrated circuits
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1515Shape
    • H01L2924/15153Shape the die mounting substrate comprising a recess for hosting the device
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1515Shape
    • H01L2924/15153Shape the die mounting substrate comprising a recess for hosting the device
    • H01L2924/15155Shape the die mounting substrate comprising a recess for hosting the device the shape of the recess being other than a cuboid
    • H01L2924/15157Top view
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1515Shape
    • H01L2924/15158Shape the die mounting substrate being other than a cuboid
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/15165Monolayer substrate

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Wire Bonding (AREA)
  • Die Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野J この発明は、セフミックパッケージの構造に関するもの
である。
【従来の技術] 第6図は従来の一般的なセフミックパッケージの構造を
示す上面図、第7図は第6図に示すA・Aにおける断面
斜視図、第8図は第6図のパッケージにICチップをダ
イボンドする状況を示す第6図のム・AKおける断面図
、第9図は第6図のパッケージにICチップを装着した
状況を示す第6図OA・ムにおける断面斜視図、第1θ
図は第9図と同じ状況を示す断面図である。図において
(2)はダイパッド、(4)はICチップ、(5)はワ
イヤ、(6)はダイボンド用のピンセット、(7)はセ
ラミックパッケージ本体、(8)はワイヤリングリード
部である。グイパッド伐)周辺のワイヤリングリード部
(8)が、ダイパッド(2)と平行となった構造となっ
ている。
次に動作について説明する。ダイパッド(2)とワイヤ
リングリード部(8)が平行と汝っており、第8図に示
した様にダイボンドにおいては、ビンセット(6)がセ
ラミックパッケージ本体(7)とICチップ(4)との
間にはいるため、ダイパッド(2)の大きさに対しであ
る寸法分だけ小さいICチップ(4)tでしかダイボン
ドが出来ない。また、第9図、第10図で示したワイヤ
(5)の様にワイヤリングされるが、このワイヤの弧が
大きくなる場合がある。
〔発明が解決しようとする課題J 従来のセラミックバッグ−νは以上のように構成されているので、ダイパッドに対しである寸法の/卜さいXCチップまでしかダイボンドできず、t+、ワイヤリングの際、ワイヤの弧が大きくなる場合があるなどの問題点があった・ この発明は上記のような問題点を解消するためになされたもので、ダイパッドの大きさに対して、相当する大きさのICチップまでグイボンドが可能で、ワイヤリングの際、ワイヤの弧が必要以上大きくならないセラミックパッケージを得ることを目的とする、 〔課題を解決するための手段〕
この発明に係るセラミックパッケージはダイパッド周辺
のワイヤリングのためのワイヤリングリード部を斜面と
したものである。
〔代用〕
この発明におけるセラミックパッケージは、ワイヤリン
グリード部を斜面とすることにより、ダイパッド相当の
大きさのICチップまでダイボンドが可能となし、また
、ワイヤリングのワイヤの弧を必要以上の大きさになら
ないようにすることが出来る。
〔実施例〕
以下、この発明の一実施例を図について説明する。第1
図はセフミックパッケージの上面図、第2図は第1図に
示すB−Bにおける断面斜視図、第3図は第1図のパッ
ケージICチップをダイボンドする状況を示す第1図の
B−Bにおける断面図、第4図は第1図のパッケージI
Cチップを装着した状況を示す第1図のB−Bにおける
断面斜視図、第5図は第4図と同じ状況を示す断面図で
ある。図において、(2)、(4)〜(6)は第6図な
いし第10図の従来例に示したものと同等であるので説
明を省略する。(1)はセフミックパッケージ本体、(
3)は斜面構造とし九ワイヤリングリード部である。
次に動作について説明する。
上記の様な構造のセラミックパッケージにおいて、アセ
ンブリを行うとする。グイボンド工程においては、グイ
ボンド用のビンセラ) (6) KてICチップ(4)
をはさんで行うが、第3図に示した様にワイヤリングリ
ード部(3)が斜面構造となっているため、ダイパッド
(2)相当の大きさのICチップ(4)のダイボンドが
可能である。さらに、第4図、第5図に示す様にワイヤ
リングリード部(3)が斜面構造となっており、ワイヤ
リングリード部(3)のワイヤリングされる位置が一般
的な構造のワイヤリングリード部(3)より低い位置に
あり、ワイヤリングの際、ワイヤ(5)の弧を小さく出
来る。
なお、上記実施例において、ワイヤリングリード部(3
)を斜面構造としているが、その斜面は出来るだけゆる
い方が効果は大きい。
また、ワイヤリングリード部(3)を凹斜面としても同
様の効果を奏する。
〔発明の効果〕
以上のように、この発明によればセラミックパッケージ
本体のワイヤリングリード部を斜面構造としたので、ダ
イパッド相当の大きさまでのICチップのダイボンドが
でき、また、ワイヤリングの際、ワイヤの弧を小さく出
来る。これKより、ICチップの大きさに対してのセフ
ミックパッケージのダイパッドの制約が少なくなる。ま
た、ワイヤリングのワイヤの弧を小さく出来るため、振
動によるワイヤの変形や、高周波での使用におけるワイ
ヤの影響を軽減出来る。
【図面の簡単な説明】
第1図はこの発明の一実施例によるセラミックパッケー
ジの上面図、第2図は第1図に示すB・Bにおける断面
斜視図、第3図は第1図のパッケージにICチップをダ
イボンドする状況を示す第1図のl3−BKおける断面
図、第4図は第1図のパッケージKICチップを装着し
た状況を示す第1図のB−Bにおける断面斜視図、第5
図は第4図と同じ状況を示す断面図、第6図は従来のセ
フミックパッケージの上面図、第7図は第6図に示すA
−Aにおける断面斜視図、第8図は第6図のパッケージ
にICチップをダイボンドする状況を示す第6図0A−
AKおける断面図、第9図は第6図のパッケージKIC
チップを装着した状況を示す第6図0A−AKおける断
面斜視図、第10図は第9図と同じ状況を示す断面図で
ある。 図において、(1)はセラミックパッケージ本体、(2
)はダイパッド、(3)はワイヤリングリード部、(4
)はICチップ、(5)はワイヤ、(6)はビンセット
を示す。 なお、図中、同一符号は同一、又は相当部分を示す。 代 理 人 大 岩 増 雄 手 工Cう′ヅフ゛ t ビンセット 第4図 ワイヤ 第1図 第2図。 第5図 第6図 S、ワイヤリシグソードIP −24′/ 第9図 第10図

Claims (1)

    【特許請求の範囲】
  1.  ワイヤリングリード部を斜面構造としたことを特徴と
    するセラミツクパツケージ。
JP1216214A 1989-08-22 1989-08-22 セラミツクパツケージ Pending JPH0379046A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP1216214A JPH0379046A (ja) 1989-08-22 1989-08-22 セラミツクパツケージ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1216214A JPH0379046A (ja) 1989-08-22 1989-08-22 セラミツクパツケージ

Publications (1)

Publication Number Publication Date
JPH0379046A true JPH0379046A (ja) 1991-04-04

Family

ID=16685065

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1216214A Pending JPH0379046A (ja) 1989-08-22 1989-08-22 セラミツクパツケージ

Country Status (1)

Country Link
JP (1) JPH0379046A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012253197A (ja) * 2011-06-02 2012-12-20 Fuji Mach Mfg Co Ltd 半導体装置及びその製造方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012253197A (ja) * 2011-06-02 2012-12-20 Fuji Mach Mfg Co Ltd 半導体装置及びその製造方法

Similar Documents

Publication Publication Date Title
JPH0379046A (ja) セラミツクパツケージ
JPH0685151A (ja) 半導体装置とその製造方法
JPH0399459A (ja) 樹脂封止型半導体装置
JPH01171047U (ja)
JPH02246126A (ja) 半導体装置
JPH02216839A (ja) 半導体装置
JP2703999B2 (ja) 半導体製造装置
JPS5831733B2 (ja) 集積回路装置
JPS63283053A (ja) 半導体装置のリ−ドフレ−ム
JPS5795642A (en) Semiconductor integrated circuit
JPH02246257A (ja) 半導体装置
JPH04320361A (ja) リードフレーム及び半導体装置
JP2002016210A (ja) 半導体装置
JPH01136357A (ja) 集積回路用パツケージ
JPH05121645A (ja) 半導体装置
JPS6476732A (en) Semiconductor device
JPS61152031A (ja) 半導体装置
JPS62190858A (ja) 半導体装置
JPH05243317A (ja) 半導体装置
JPH08264673A (ja) 集積回路装置
JPH04372161A (ja) 半導体装置
JPS6180846A (ja) 半導体装置
JPH02166743A (ja) 半導体集積回路装置
JPH01243457A (ja) 半導体装置用リードフレーム
JPH03225858A (ja) Icパッケージ