JPH0358233B2 - - Google Patents
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- JPH0358233B2 JPH0358233B2 JP59145691A JP14569184A JPH0358233B2 JP H0358233 B2 JPH0358233 B2 JP H0358233B2 JP 59145691 A JP59145691 A JP 59145691A JP 14569184 A JP14569184 A JP 14569184A JP H0358233 B2 JPH0358233 B2 JP H0358233B2
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- JP
- Japan
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- noise reduction
- circuit
- limiter
- reduction circuit
- correlation
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- 230000001934 delay Effects 0.000 claims 1
- 238000001514 detection method Methods 0.000 description 21
- 238000010586 diagram Methods 0.000 description 9
- 230000000694 effects Effects 0.000 description 6
- 230000002411 adverse Effects 0.000 description 3
- 230000002238 attenuated effect Effects 0.000 description 2
- 239000000284 extract Substances 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/14—Picture signal circuitry for video frequency region
- H04N5/21—Circuitry for suppressing or minimising disturbance, e.g. moiré or halo
- H04N5/213—Circuitry for suppressing or minimising impulsive noise
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/14—Picture signal circuitry for video frequency region
- H04N5/21—Circuitry for suppressing or minimising disturbance, e.g. moiré or halo
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Picture Signal Circuits (AREA)
Description
産業上の利用分野
本発明はノイズリダクシヨン回路に係り、ライ
ン内相関、ライン間相関、フイールド間相関等対
象とする相関が異なるノイズリダクシヨン回路部
を複数縦続接続したノイズリダクシヨン回路に関
する。 従来の技術 第５図は従来提案されている種々のノイズリダ
クシヨン回路の基本となるブロツク系統図を示
す。同図において、端子１1に入来した映像信号
ａ及び端子１2に入来した映像信号（例えば映
像信号ａを1H遅延した信号）は減算器２に供給
され、ここで信号ａは信号を減算される。この
減算によりノイズ成分が取出され、リミツタ３に
て振幅制限された後アツテネータ（ゲインｋ）４
にてレベル減衰されて減算器５に供給され、ここ
で信号ａからノイズ成分を減算され、ノイズ成分
を軽減された映像信号ｂが得られて端子６より取
出される。ここで、映像信号の相関性の方法につ
いて考えてみる。第６図に示す如く、水平走査線
ｌに対し、はライン内におけるフオワードの相
関性、はそのバツクワードの相関性、はライ
ン間（又はフイールド内）におけるフオワードの
相関性、はそのバツクワードの相関性、はフ
イールド間（又はフレーム間）におけるフオード
の相関性、はそのバツクワードの相関性の夫々
の方向を示す。 即ち、相関性はどの方向から見るかによつて、
ライン内、ライン間（フイールド内）、フイール
ド間（フレーム間に）に分けられ、更に夫々に対
してフオワード（時間の流れに沿つて予測）、バ
ツクワード（時間の流れの逆方向に予測）の別が
ある。これらをまとめると、表に示す如く６通り
になる。
ン内相関、ライン間相関、フイールド間相関等対
象とする相関が異なるノイズリダクシヨン回路部
を複数縦続接続したノイズリダクシヨン回路に関
する。 従来の技術 第５図は従来提案されている種々のノイズリダ
クシヨン回路の基本となるブロツク系統図を示
す。同図において、端子１1に入来した映像信号
ａ及び端子１2に入来した映像信号（例えば映
像信号ａを1H遅延した信号）は減算器２に供給
され、ここで信号ａは信号を減算される。この
減算によりノイズ成分が取出され、リミツタ３に
て振幅制限された後アツテネータ（ゲインｋ）４
にてレベル減衰されて減算器５に供給され、ここ
で信号ａからノイズ成分を減算され、ノイズ成分
を軽減された映像信号ｂが得られて端子６より取
出される。ここで、映像信号の相関性の方法につ
いて考えてみる。第６図に示す如く、水平走査線
ｌに対し、はライン内におけるフオワードの相
関性、はそのバツクワードの相関性、はライ
ン間（又はフイールド内）におけるフオワードの
相関性、はそのバツクワードの相関性、はフ
イールド間（又はフレーム間）におけるフオード
の相関性、はそのバツクワードの相関性の夫々
の方向を示す。 即ち、相関性はどの方向から見るかによつて、
ライン内、ライン間（フイールド内）、フイール
ド間（フレーム間に）に分けられ、更に夫々に対
してフオワード（時間の流れに沿つて予測）、バ
ツクワード（時間の流れの逆方向に予測）の別が
ある。これらをまとめると、表に示す如く６通り
になる。
【表】
そこで、上記相関性に対して用いられるノイズ
リダクシヨン回路と信号との関係は第７図に示
す如くとなり、例えばVTR等の機器ではこれら
の回路を適宜縦続接続してノイズ軽減を図つてい
る。 発明が解決しようとする問題点 ところが、従来の縦続接続されたノイズリダク
シヨン回路の各リミツタにおける夫々のリミツタ
レベルは、夫々他のノイズリダクシヨン回路に悪
影響を及ぼさない程度に狭く設定されていた。こ
のため、SN比の改善効果が低く、画面のあらゆ
る部分において最適のノイズ軽減効果を得ること
はできない等の問題点があつた。 本発明は、ある相関に対してノイズ軽減を行な
う際、他の相関に対するノイズリダクシヨン回路
部に悪影響を及ぼすことがなく、SN比を良好に
し得、画面のあらゆる部分において最適のノイズ
軽減効果を得ることができるノイズリダクシヨン
回路を提供することを目的とする。 問題点を解決するための手段 第１図中、１０1，１０2，１０3は各ノイズリ
ダクシヨン回路部Ａ，Ｂ，Ｃにおいて相関が無い
期間を検出する無相関部分検出回路、３1，３2，
３3は上記期間通過レベルを広くされるリミツタ
である。 作 用 ノイズリダクシヨン回路部Ａ，Ｂ，Ｃのうちの
一のノイズリダクシヨン回路部における減算器出
力をスライスした期間を検出し、この期間他のノ
イズリダクシヨン回路部におけるリミツタの通過
レベルを広くする。 実施例 第１図は本発明回路の一実施例のブロツク系統
図を示す。同図中、Ａはライン内相関に対するノ
イズリダクシヨン回路部、Ｂはライン間相関に対
するノイズリダクシヨン回路部、Ｃはフイールド
間相関に対するノイズリダクシヨン回路部であ
り、これらは縦続接続されている。信号を作る
回路として上記各回路部には低域フイルタ７、
1H遅延回路８、１フイールド遅延回路９が設け
られている。 １０1，１０2，１０3は無相関部分検出回路
（以下、検出回路という）で、第２図に示す構成
とされている。端子１０ａに入来した減算器（例
えば２1）の出力信号ｃ（第３図Ａ）は、上側スラ
イス回路１１ａ、下側スライス回路１１ｂにて
夫々上側スライスレベル、下側スライスレベルを
以てスライスされる。ここで、映像信号に相関
（例えばイラン内相関）が無い場合、第３図Ａに
示す如く1H期間内において大振幅部分P1，P2を
生じ、上側スライス回路１１ａ、下側スライス回
路１１ｂで大振幅部分Ｐをスライスされて信号
ｄ，ｅ（同図Ｂ，Ｃ）とされる。次いで信号ｅは
反転回路１２で反転され、加算器１３で信号ｄと
加算されて信号ｆ（同図Ｄ）とされ、出力端子１
０ｂより取出される。 信号ｆは無相関部分検出信号（以下、検出信号
という）として次の各回路に供給される。検出回
路１０1，１０2から取出された検出信号はアツテ
ネータ１４1，１４4を介して加算器１５1にて加
算された後リミツタ回路３3に供給され、検出回
路１０1，１０3から取出された検出信号はアツテ
ネータ１４2，１４6を介して加算器１５3にて加
算された後リミツタ回路３2に供給され、検出回
路１０2，１０3から取出された検出信号はアツテ
ネータ１４3，１４5を介して加算器１５2にて加
算された後リミツタ回路３1に供給される。 リミツタ回路３1，３2，３3は第４図に示す如
く、大略、リミツタ３ａと反転回路３ｂとにて構
成されている。同図示の回路は、第１図中、ある
一のノイズリダクシヨン回路部におけるリミツタ
回路３0及びそのノイズリダクシヨン回路部と別
の他の２つのノイズリダクシヨン回路部における
検出回路１０ａ，１０ｂを示したものである。 検出回路１０ａ，１０ｂから取出された検出信
号は減衰器１４ａ，１４ｂにてレベル調節され、
加算器１５にて加算された後可変抵抗VR2に供給
される一方、反転回路３ｂにて反転されて可変抵
抗VR1に供給される。ここで、加算器１５からの
信号により可変抵抗VR2の中点電位が電源Vc側
に上昇することにより、又、反転回路３ｂからの
信号により可変抵抗VR1の中点電位がアース側に
下降することによりリミツタ３ａの通過レベルが
広くなるように設定されている。 例えば、端子１に入来した映像信号にライン内
相関が無い場合、検出回路１０1から検出信号f1
が取出され、減衰器１４2、加算器１５3を介して
リミツタ回路３2に供給される一方、減衰器１４
１、加算器１５1を介してリミツタ回路３3に供給
され、その夫々の通過レベルを広くする。この場
合、リミツタ回路３1にて大振幅部分P1，P2の期
間スライスされるので、加算器５1からはその期
間にノイズ成分を含む大振幅信号成分が取出され
る。 この大振幅信号成分は減算器２2、通過レベル
を広くされたリミツタ回路３2をそのまま通過し、
減衰器４2にてレベル減衰されて減算器５2に供給
される。減算器５2において、減算器５1から出力
された上記ノイズ成分を含む大振幅信号成分から
減衰器４2の出力が減算され、これにより、大振
幅部分P1，P2の期間大振幅信号成分に含まれる
ノイズ成分が軽減されて取出される。 このとき、リミツタ回路３3の通過レベルも広
くされているので、減算器５2からの信号は減算
器２3、リミツタ回路３3をそのまま通過して減算
器５3で大振幅部分P1，P2の期間のノイズ成分を
軽減されて端子６より取出される。 このように、ライン内相関が無い場合、ノイズ
リダクシヨン回路部Ａで軽減しきれなかつた大振
幅部分P1，P2におけるノイズ成分はノイズリダ
クシヨン回路部Ｂ，Ｃにて軽減され、より大振幅
の部分におけるノイズ成分を有効に軽減し得る。 逆に、ライン内相関がある場合、リミツタ回路
３2，３3の通過レベルは元のまま狭くされている
ため、ノイズリダクシヨン回路Ｂ，Ｃによつてノ
イズリダクシヨン回路部Ａの出力を減算してしま
うことはなく、ノイズリダクシヨン回路部Ｂ，Ｃ
の映像信号への悪影響を少なくし得る。 一方、ライン間相関が無い場合、検出回路１０
２から検出された検出信号f2によりリミツタ回路
３1，３3の通過レベルが広くされ、ノイズリダク
シヨン回路部Ｂで軽減しきれない大振幅部分期間
におけるノイズ成分はノイズリダクシヨン回路部
Ａ，Ｃで軽減される。これと同様にして、フイー
ルド間相関が無い場合、検出回路１０3から取出
された検出信号f3によりリミツタ回路３1，３2の
通過レベルが広くされ、ノイズリダクシヨン回路
部Ｃで軽減しきれない大振幅部分期間におけるノ
イズ成分はノイズリダクシヨン回路部Ａ，Ｂで軽
減される。 なお、ノイズリダクシヨン回路部Ａ，Ｂ，Ｃの
縦続接続順序は第１図示のものに限定されるもの
ではなく、適宜入替えてもよい。又、ノイズリダ
クシヨン回路部の数は必ずしも３つ必要ではな
く、例えば２つでもよい。 又、リミツタ回路３1，３2，３3のリミツタレ
ベルを可変するに際し、デジタル的にリミツタレ
ベルを切換えると、画面の相関性が切換えの閾値
レベル近傍に一致した時にノイズ等によつて画面
にちらつきを生じるが、本実施例ではアナログ的
にリミツタレベルを切換えているので、上記のよ
うな画面のちらつきを生じるおそれはない。 発明の効果 本発明回路は、複数のノイズリダクシヨン回路
部のうちの一のノイズリダクシヨン回路部におけ
る第１の減算器の出力を所定レベルでスライスし
てこのスライスした期間を検出し、この期間他の
ノイズリダクシヨン回路部におけるリミツタの通
過レベルを広くするように構成したため、相関が
ない映像信号が入来した場合、無相関を検出する
一のノイズリダクシヨン回路部において軽減しき
れないノイズ成分を他のノイズリダクシヨン回路
部において軽減し得、又、相関がある場合、他の
ノイズリダクシヨン回路部におけるリミツタの通
過レベルは狭いままであるので、他のノイズリダ
クシヨン回路部による悪影響を少なくし得、又、
SN比を良好にし得、画面のあらゆる部分におい
て最適のノイズ軽減効果を得ることができる等の
特長を有する。
リダクシヨン回路と信号との関係は第７図に示
す如くとなり、例えばVTR等の機器ではこれら
の回路を適宜縦続接続してノイズ軽減を図つてい
る。 発明が解決しようとする問題点 ところが、従来の縦続接続されたノイズリダク
シヨン回路の各リミツタにおける夫々のリミツタ
レベルは、夫々他のノイズリダクシヨン回路に悪
影響を及ぼさない程度に狭く設定されていた。こ
のため、SN比の改善効果が低く、画面のあらゆ
る部分において最適のノイズ軽減効果を得ること
はできない等の問題点があつた。 本発明は、ある相関に対してノイズ軽減を行な
う際、他の相関に対するノイズリダクシヨン回路
部に悪影響を及ぼすことがなく、SN比を良好に
し得、画面のあらゆる部分において最適のノイズ
軽減効果を得ることができるノイズリダクシヨン
回路を提供することを目的とする。 問題点を解決するための手段 第１図中、１０1，１０2，１０3は各ノイズリ
ダクシヨン回路部Ａ，Ｂ，Ｃにおいて相関が無い
期間を検出する無相関部分検出回路、３1，３2，
３3は上記期間通過レベルを広くされるリミツタ
である。 作 用 ノイズリダクシヨン回路部Ａ，Ｂ，Ｃのうちの
一のノイズリダクシヨン回路部における減算器出
力をスライスした期間を検出し、この期間他のノ
イズリダクシヨン回路部におけるリミツタの通過
レベルを広くする。 実施例 第１図は本発明回路の一実施例のブロツク系統
図を示す。同図中、Ａはライン内相関に対するノ
イズリダクシヨン回路部、Ｂはライン間相関に対
するノイズリダクシヨン回路部、Ｃはフイールド
間相関に対するノイズリダクシヨン回路部であ
り、これらは縦続接続されている。信号を作る
回路として上記各回路部には低域フイルタ７、
1H遅延回路８、１フイールド遅延回路９が設け
られている。 １０1，１０2，１０3は無相関部分検出回路
（以下、検出回路という）で、第２図に示す構成
とされている。端子１０ａに入来した減算器（例
えば２1）の出力信号ｃ（第３図Ａ）は、上側スラ
イス回路１１ａ、下側スライス回路１１ｂにて
夫々上側スライスレベル、下側スライスレベルを
以てスライスされる。ここで、映像信号に相関
（例えばイラン内相関）が無い場合、第３図Ａに
示す如く1H期間内において大振幅部分P1，P2を
生じ、上側スライス回路１１ａ、下側スライス回
路１１ｂで大振幅部分Ｐをスライスされて信号
ｄ，ｅ（同図Ｂ，Ｃ）とされる。次いで信号ｅは
反転回路１２で反転され、加算器１３で信号ｄと
加算されて信号ｆ（同図Ｄ）とされ、出力端子１
０ｂより取出される。 信号ｆは無相関部分検出信号（以下、検出信号
という）として次の各回路に供給される。検出回
路１０1，１０2から取出された検出信号はアツテ
ネータ１４1，１４4を介して加算器１５1にて加
算された後リミツタ回路３3に供給され、検出回
路１０1，１０3から取出された検出信号はアツテ
ネータ１４2，１４6を介して加算器１５3にて加
算された後リミツタ回路３2に供給され、検出回
路１０2，１０3から取出された検出信号はアツテ
ネータ１４3，１４5を介して加算器１５2にて加
算された後リミツタ回路３1に供給される。 リミツタ回路３1，３2，３3は第４図に示す如
く、大略、リミツタ３ａと反転回路３ｂとにて構
成されている。同図示の回路は、第１図中、ある
一のノイズリダクシヨン回路部におけるリミツタ
回路３0及びそのノイズリダクシヨン回路部と別
の他の２つのノイズリダクシヨン回路部における
検出回路１０ａ，１０ｂを示したものである。 検出回路１０ａ，１０ｂから取出された検出信
号は減衰器１４ａ，１４ｂにてレベル調節され、
加算器１５にて加算された後可変抵抗VR2に供給
される一方、反転回路３ｂにて反転されて可変抵
抗VR1に供給される。ここで、加算器１５からの
信号により可変抵抗VR2の中点電位が電源Vc側
に上昇することにより、又、反転回路３ｂからの
信号により可変抵抗VR1の中点電位がアース側に
下降することによりリミツタ３ａの通過レベルが
広くなるように設定されている。 例えば、端子１に入来した映像信号にライン内
相関が無い場合、検出回路１０1から検出信号f1
が取出され、減衰器１４2、加算器１５3を介して
リミツタ回路３2に供給される一方、減衰器１４
１、加算器１５1を介してリミツタ回路３3に供給
され、その夫々の通過レベルを広くする。この場
合、リミツタ回路３1にて大振幅部分P1，P2の期
間スライスされるので、加算器５1からはその期
間にノイズ成分を含む大振幅信号成分が取出され
る。 この大振幅信号成分は減算器２2、通過レベル
を広くされたリミツタ回路３2をそのまま通過し、
減衰器４2にてレベル減衰されて減算器５2に供給
される。減算器５2において、減算器５1から出力
された上記ノイズ成分を含む大振幅信号成分から
減衰器４2の出力が減算され、これにより、大振
幅部分P1，P2の期間大振幅信号成分に含まれる
ノイズ成分が軽減されて取出される。 このとき、リミツタ回路３3の通過レベルも広
くされているので、減算器５2からの信号は減算
器２3、リミツタ回路３3をそのまま通過して減算
器５3で大振幅部分P1，P2の期間のノイズ成分を
軽減されて端子６より取出される。 このように、ライン内相関が無い場合、ノイズ
リダクシヨン回路部Ａで軽減しきれなかつた大振
幅部分P1，P2におけるノイズ成分はノイズリダ
クシヨン回路部Ｂ，Ｃにて軽減され、より大振幅
の部分におけるノイズ成分を有効に軽減し得る。 逆に、ライン内相関がある場合、リミツタ回路
３2，３3の通過レベルは元のまま狭くされている
ため、ノイズリダクシヨン回路Ｂ，Ｃによつてノ
イズリダクシヨン回路部Ａの出力を減算してしま
うことはなく、ノイズリダクシヨン回路部Ｂ，Ｃ
の映像信号への悪影響を少なくし得る。 一方、ライン間相関が無い場合、検出回路１０
２から検出された検出信号f2によりリミツタ回路
３1，３3の通過レベルが広くされ、ノイズリダク
シヨン回路部Ｂで軽減しきれない大振幅部分期間
におけるノイズ成分はノイズリダクシヨン回路部
Ａ，Ｃで軽減される。これと同様にして、フイー
ルド間相関が無い場合、検出回路１０3から取出
された検出信号f3によりリミツタ回路３1，３2の
通過レベルが広くされ、ノイズリダクシヨン回路
部Ｃで軽減しきれない大振幅部分期間におけるノ
イズ成分はノイズリダクシヨン回路部Ａ，Ｂで軽
減される。 なお、ノイズリダクシヨン回路部Ａ，Ｂ，Ｃの
縦続接続順序は第１図示のものに限定されるもの
ではなく、適宜入替えてもよい。又、ノイズリダ
クシヨン回路部の数は必ずしも３つ必要ではな
く、例えば２つでもよい。 又、リミツタ回路３1，３2，３3のリミツタレ
ベルを可変するに際し、デジタル的にリミツタレ
ベルを切換えると、画面の相関性が切換えの閾値
レベル近傍に一致した時にノイズ等によつて画面
にちらつきを生じるが、本実施例ではアナログ的
にリミツタレベルを切換えているので、上記のよ
うな画面のちらつきを生じるおそれはない。 発明の効果 本発明回路は、複数のノイズリダクシヨン回路
部のうちの一のノイズリダクシヨン回路部におけ
る第１の減算器の出力を所定レベルでスライスし
てこのスライスした期間を検出し、この期間他の
ノイズリダクシヨン回路部におけるリミツタの通
過レベルを広くするように構成したため、相関が
ない映像信号が入来した場合、無相関を検出する
一のノイズリダクシヨン回路部において軽減しき
れないノイズ成分を他のノイズリダクシヨン回路
部において軽減し得、又、相関がある場合、他の
ノイズリダクシヨン回路部におけるリミツタの通
過レベルは狭いままであるので、他のノイズリダ
クシヨン回路部による悪影響を少なくし得、又、
SN比を良好にし得、画面のあらゆる部分におい
て最適のノイズ軽減効果を得ることができる等の
特長を有する。
第１図は本発明回路の一実施例のブロツク系統
図、第２図及び第３図は夫々無相関部分検出回路
のブロツク系統図及びその動作説明用信号波形
図、第４図はリミツタの通過レベルを可変する動
作を説明するための回路図、第５図は一般のノイ
ズリダクシヨン回路のブロツク系統図、第６図は
ライン内、ライン間、フイールド間の各相関の方
向を説明するための図、第７図は各種ノイズリダ
クシヨン回路と遅延回路の出力信号との関係を
説明するための図である。 １……映像信号入力端子、２1〜２3，５1〜５3
……減算器、３1〜３3……リミツタ回路、４1〜
４3，１４1〜１４6……減衰器、６……出力端子、
７……低減フイルタ、８……1H遅延回路、９…
…１フイールド遅延回路、１０1〜１０3……無相
関部分検出回路、１５1〜１５3……加算器、Ａ，
Ｂ，Ｃ……ノイズリダクシヨン回路部。
図、第２図及び第３図は夫々無相関部分検出回路
のブロツク系統図及びその動作説明用信号波形
図、第４図はリミツタの通過レベルを可変する動
作を説明するための回路図、第５図は一般のノイ
ズリダクシヨン回路のブロツク系統図、第６図は
ライン内、ライン間、フイールド間の各相関の方
向を説明するための図、第７図は各種ノイズリダ
クシヨン回路と遅延回路の出力信号との関係を
説明するための図である。 １……映像信号入力端子、２1〜２3，５1〜５3
……減算器、３1〜３3……リミツタ回路、４1〜
４3，１４1〜１４6……減衰器、６……出力端子、
７……低減フイルタ、８……1H遅延回路、９…
…１フイールド遅延回路、１０1〜１０3……無相
関部分検出回路、１５1〜１５3……加算器、Ａ，
Ｂ，Ｃ……ノイズリダクシヨン回路部。
Claims (1)
- 【特許請求の範囲】 １ 入力映像信号を遅延する遅延回路、該入力映
像信号と該遅延回路の出力とを減算する第１の減
算器、該第１の減算器の出力を振幅制限するリミ
ツタ、該入力映像信号から該リミツタの出力を減
算する第２の減算器とからなるノイズリダクシヨ
ン回路部を複数縦続接続し、該複数のノイズリダ
クシヨン部の夫々の遅延回路を、低域フイルタ、
1H遅延回路、１フイールド遅延回路等夫々異な
るいずれかの遅延回路にて構成したノイズリダク
シヨン回路において、上記複数のノイズリダクシ
ヨン回路部のうちの一のノイズリダクシヨン回路
部における上記第１の減算器の出力を所定レベル
でスライスして該スライスした期間を検出し、該
期間他ノイズリダクシヨン回路部における上記リ
ミツタの通過レベルを広くするように構成してな
ることを特徴とするノイズリダクシヨン回路。 ２ 該リミツタは、該通過レベルをアナログ的に
可変されることを特徴とする特許請求の範囲第１
項記載のノイズリダクシヨン回路。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14569184A JPS6125377A (ja) | 1984-07-13 | 1984-07-13 | ノイズリダクシヨン回路 |
| KR1019850004112A KR900002384B1 (ko) | 1984-07-13 | 1985-06-12 | 잡음 저감 회로 |
| US06/754,628 US4635120A (en) | 1984-07-13 | 1985-07-12 | Noise reduction circuit for video signal |
| EP85305053A EP0169052B1 (en) | 1984-07-13 | 1985-07-15 | Noise reduction circuit for video signal |
| DE8585305053T DE3585339D1 (de) | 1984-07-13 | 1985-07-15 | Schaltung zur verminderung des rauschens fuer ein videosignal. |
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