JPH05276531A - ロジカル・コム・フィルタ - Google Patents
ロジカル・コム・フィルタInfo
- Publication number
- JPH05276531A JPH05276531A JP6784192A JP6784192A JPH05276531A JP H05276531 A JPH05276531 A JP H05276531A JP 6784192 A JP6784192 A JP 6784192A JP 6784192 A JP6784192 A JP 6784192A JP H05276531 A JPH05276531 A JP H05276531A
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- signal
- comb filter
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Abstract
(57)【要約】
【目的】クロマレベル検出用出力を有するロジカル・コ
ム・フィルタを少ない素子数で実現することにある。 【構成】２つの１ライン遅延回路１２，１３と、加算器
１５，１６を備えたコムフィルタ群１と、比較器１７，
１８，１９を備えた絵柄検出回路２と、セレクタ２２，
２３を備えたセレクタ群３とを有する。このコムフィル
タ群１を形成する加算器１５，１６の出力をクロマレベ
ル検出回路への出力とするとともに、セレクタ群３の入
力とする。これにより、少ない素子数でロジカル・コム
・フィルタを実現する。
ム・フィルタを少ない素子数で実現することにある。 【構成】２つの１ライン遅延回路１２，１３と、加算器
１５，１６を備えたコムフィルタ群１と、比較器１７，
１８，１９を備えた絵柄検出回路２と、セレクタ２２，
２３を備えたセレクタ群３とを有する。このコムフィル
タ群１を形成する加算器１５，１６の出力をクロマレベ
ル検出回路への出力とするとともに、セレクタ群３の入
力とする。これにより、少ない素子数でロジカル・コム
・フィルタを実現する。
Description
【０００１】
【産業上の利用分野】本発明はＶＴＲやＴＶなどの映像
機器において主としてＹ／Ｃ分離に用いられるロジカル
・コム・フィルタに関し、特にディジタルで信号処理を
行うロジカル・コム・フィルタに関する。
機器において主としてＹ／Ｃ分離に用いられるロジカル
・コム・フィルタに関し、特にディジタルで信号処理を
行うロジカル・コム・フィルタに関する。
【０００２】
【従来の技術】従来のロジカル・コム・フィルタは、遅
延回路や絵柄検出回路等を用いて構成されている。
延回路や絵柄検出回路等を用いて構成されている。
【０００３】図３は従来の一例を示すロジカル・コム・
フィルタの回路図である。図３に示すように、従来のロ
ジカル・コム・フィルタはコンポジットビデオ信号ａを
入力とし、ＢＰＦ（バンドパスフィルタ）１１を通して
後信号ｃを生成し、さらに１ライン遅延回路１２の出力
を１ライン遅延回路１３を通して前信号ｅとしている。
ここで、後信号ｃ，主信号ｄ，前信号ｅはそれぞれ主信
号ｄを基準として、前信号ｅは１ライン手前（画面上で
は上側）、後信号ｃは１ライン後（画面上では下側）の
各画素に対応した輝度信号の高域成分とクロマ信号の和
の信号である。また、ＢＰＦ１１はコンポジットビデオ
信号入力ａからクロマ帯域の信号を抜き出すために用い
られ、反転アンプ１４はクロマ信号の位相をそろえるた
めに用いている。これらＢＰＦ１１および反転アンプ１
４は同機能が得られれば、１ライン遅延回路１２，１３
の前後のどちらに入れても構わない。
フィルタの回路図である。図３に示すように、従来のロ
ジカル・コム・フィルタはコンポジットビデオ信号ａを
入力とし、ＢＰＦ（バンドパスフィルタ）１１を通して
後信号ｃを生成し、さらに１ライン遅延回路１２の出力
を１ライン遅延回路１３を通して前信号ｅとしている。
ここで、後信号ｃ，主信号ｄ，前信号ｅはそれぞれ主信
号ｄを基準として、前信号ｅは１ライン手前（画面上で
は上側）、後信号ｃは１ライン後（画面上では下側）の
各画素に対応した輝度信号の高域成分とクロマ信号の和
の信号である。また、ＢＰＦ１１はコンポジットビデオ
信号入力ａからクロマ帯域の信号を抜き出すために用い
られ、反転アンプ１４はクロマ信号の位相をそろえるた
めに用いている。これらＢＰＦ１１および反転アンプ１
４は同機能が得られれば、１ライン遅延回路１２，１３
の前後のどちらに入れても構わない。
【０００４】また、後信号ｃ，主信号ｄ，前信号ｅは比
較器１７，１８，１９に入力され、絵柄の検出を行う。
較器１７，１８，１９に入力され、絵柄の検出を行う。
【０００５】図４は図３における絵柄とクロマ出力の関
係を表わす対応図である。図４に示すように、これら比
較器１７，１８，１９の出力と絵柄の関係はこのように
表わされ、そのときのクロマ出力ｂも後信号ｃ，主信号
ｄおよび前信号ｅで表わされる。
係を表わす対応図である。図４に示すように、これら比
較器１７，１８，１９の出力と絵柄の関係はこのように
表わされ、そのときのクロマ出力ｂも後信号ｃ，主信号
ｄおよび前信号ｅで表わされる。
【０００６】次に、比較器１７，１８，１９の出力をＥ
ＸＯＲ（排他的論理和）ゲート２０，２１の入力とし、
ＥＸＯＲゲート２０，２１の出力をセレクタ２６，２７
の制御信号とする。すなわち、比較器１７，１８，１９
とＥＸＯＲゲート２０，２１で絵柄検出回路を構成して
いる。また、セレクタ２６は後信号ｃと前信号ｅを入力
し、セルクタ２７は主信号ｄとセレクタ２６の出力を入
力している。このセレクタ２７の出力は絵柄に応じて図
４に示すように制御される。更に、主信号ｄとセレクタ
２７の出力を加算器２８と反転アンプ２９に通すことに
より、クロマ信号出力ｂとしている。尚、この反転アン
プ２９はクロマ信号ｂの利得と位相を合わせるために用
いているので、この反転アンプ２９は同機能が得られる
ならば、セレクタ２７や加算器２８の前後のどちらに入
れても良い。
ＸＯＲ（排他的論理和）ゲート２０，２１の入力とし、
ＥＸＯＲゲート２０，２１の出力をセレクタ２６，２７
の制御信号とする。すなわち、比較器１７，１８，１９
とＥＸＯＲゲート２０，２１で絵柄検出回路を構成して
いる。また、セレクタ２６は後信号ｃと前信号ｅを入力
し、セルクタ２７は主信号ｄとセレクタ２６の出力を入
力している。このセレクタ２７の出力は絵柄に応じて図
４に示すように制御される。更に、主信号ｄとセレクタ
２７の出力を加算器２８と反転アンプ２９に通すことに
より、クロマ信号出力ｂとしている。尚、この反転アン
プ２９はクロマ信号ｂの利得と位相を合わせるために用
いているので、この反転アンプ２９は同機能が得られる
ならば、セレクタ２７や加算器２８の前後のどちらに入
れても良い。
【０００７】以上、ロジカル・コム・フィルタについて
述べたが、Ｙ／Ｃ分離には他に動き検出回路が必要であ
る。この動き検出回路では、クロマ信号のレベルが大き
いときに輝度信号の動き検出回路にトラップフィルタを
入れ、クロマ成分を減衰させると、動きの検出精度が良
くなることが知られている。
述べたが、Ｙ／Ｃ分離には他に動き検出回路が必要であ
る。この動き検出回路では、クロマ信号のレベルが大き
いときに輝度信号の動き検出回路にトラップフィルタを
入れ、クロマ成分を減衰させると、動きの検出精度が良
くなることが知られている。
【０００８】図５は図３の回路にクロマレベル検出用出
力を追加した一例を示すロジカル・コム・フィルタの回
路図である。図５に示すように、かかるフィルタ回路は
レベル検出用クロマ信号に輝度信号の混ざらない信号を
用いるため、後信号ｃおよび主信号ｄを加算する加算器
１５と、主信号ｄおよび前信号ｅを加算する加算器１６
とを付加している。すなわち、加算器１５，１６の出力
をクロマレベル検出回路への入力としている。
力を追加した一例を示すロジカル・コム・フィルタの回
路図である。図５に示すように、かかるフィルタ回路は
レベル検出用クロマ信号に輝度信号の混ざらない信号を
用いるため、後信号ｃおよび主信号ｄを加算する加算器
１５と、主信号ｄおよび前信号ｅを加算する加算器１６
とを付加している。すなわち、加算器１５，１６の出力
をクロマレベル検出回路への入力としている。
【０００９】図６は図３の回路にクロマレベル検出用出
力を追加した他の例を示すロジカル・コム・フィルタの
回路図である。図６に示すように、かかる回路は前述し
た図３の回路に対し、後信号ｃおよび前信号ｅを入力と
する加算器３３と、この加算器３３の出力を１／２にす
る系数器３４とを追加している。これら加算器３３およ
び系数器３４とを通して出力をセレクタ２７の一方の入
力としている。従って、かかるフィルタ回路において、
絵柄の変化が３ラインコム・フィルタにすることができ
る。
力を追加した他の例を示すロジカル・コム・フィルタの
回路図である。図６に示すように、かかる回路は前述し
た図３の回路に対し、後信号ｃおよび前信号ｅを入力と
する加算器３３と、この加算器３３の出力を１／２にす
る系数器３４とを追加している。これら加算器３３およ
び系数器３４とを通して出力をセレクタ２７の一方の入
力としている。従って、かかるフィルタ回路において、
絵柄の変化が３ラインコム・フィルタにすることができ
る。
【００１０】
【発明が解決しようとする課題】上述した従来のロジカ
ル・コム・フィルタは、クロマレベル検出用出力のため
に加算器を２個追加する必要があるという欠点がある。
ル・コム・フィルタは、クロマレベル検出用出力のため
に加算器を２個追加する必要があるという欠点がある。
【００１１】本発明の目的は、かかる加算器を少なくす
ることのできるロジカル・コム・フィルタを提供するこ
とにある。
ることのできるロジカル・コム・フィルタを提供するこ
とにある。
【００１２】
【課題を解決するための手段】本発明のロジカル・コム
・フィルタは、入力信号を１水平走査期間遅延させる第
１の遅延回路と、前記第１の遅延回路の出力を更に遅延
させる第２の遅延回路と、前記入力信号と前記第１及び
第２の遅延回路の出力を入力とし複数の出力を有するコ
ムフィルタ群と、前記入力信号および前記第１及び第２
の遅延回路の出力を入力とする絵柄検出回路と、前記コ
ムフィルタ群の出力を入力とし前記絵柄検出回路の出力
を制御入力とするセレクタ群とを有し、前記セレクタ群
の出力をクロマ出力として構成される。
・フィルタは、入力信号を１水平走査期間遅延させる第
１の遅延回路と、前記第１の遅延回路の出力を更に遅延
させる第２の遅延回路と、前記入力信号と前記第１及び
第２の遅延回路の出力を入力とし複数の出力を有するコ
ムフィルタ群と、前記入力信号および前記第１及び第２
の遅延回路の出力を入力とする絵柄検出回路と、前記コ
ムフィルタ群の出力を入力とし前記絵柄検出回路の出力
を制御入力とするセレクタ群とを有し、前記セレクタ群
の出力をクロマ出力として構成される。
【００１３】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。図１は本発明の一実施例を示すロジカル・
コム・フィルタの回路図である。図１に示すように、本
実施例はコンポジットビデオ信号ａを入力とし、バンド
・パス・フィルタ（ＢＰＦ）１１，１ライン遅延回路１
２および１３，反転アンプ１４によって、後信号ｃ，前
信号ｅを生成するが、この過程については、前述した図
３に示す従来のロジカル・コム・フィルタと同様であ
る。また、後信号ｃと主信号ｄを入力とする加算器１５
と、主信号ｄと前信号ｃを入力とする加算器１６とを用
い、加算器１５，１６の出力をクロマレベル検出回路へ
の入力とすることも前述した図５に示す従来のロジカル
・コム・フィルタと同様である。本実施例がこれらと比
較して異なる点は加算器１５，１６をコムフィルタ群１
としても用いていることにある。なお、後信号ｃ，主信
号ｄ，前信号ｅを入力とする比較器１７，１８，１９
と、これらの比較器１７，１８，１９の出力を入力とす
るＥＸＯＲゲート２０，２１とによって絵柄検出回路２
を構成することは、前述した図３に示す従来のロジカル
・コム・フィルタと同様である。従って、本実施例にお
いては、セレクタ群３として、加算器１５の出力と加算
器１６の出力を入力とするセレクタ２２と、反転アンプ
２４の出力と反転アンプ２５の出力を入力とするセレク
タ２３とを用い、ＥＸＯＲゲート２０，２１の出力によ
って制御することで、前述した図４と同じクロマ出力を
選択することができる。ここで、反転アンプ２４は主信
号ｄを−１倍し、反転アンプ２５はセレクタ２２の出力
を−（１／２）倍して、利得と位相を合わせている。こ
れらの反転アンプ２４，２５は同機能が得られるなら
ば、セレクタ２２，２３の前後のどちらに入れてもかま
わない。なお、加算器１５の出力と加算器１６の出力を
比較器１９の入力としても同様の機能が実現できる。要
するに、かかる本実施例の回路は前述した図５に示す従
来例の回路と比較すると、同等機能のロジカル・コム・
フィルタを従来の回路では加算器３個を用いて構成して
いたが、本実施例では加算器２個で実現できる。
て説明する。図１は本発明の一実施例を示すロジカル・
コム・フィルタの回路図である。図１に示すように、本
実施例はコンポジットビデオ信号ａを入力とし、バンド
・パス・フィルタ（ＢＰＦ）１１，１ライン遅延回路１
２および１３，反転アンプ１４によって、後信号ｃ，前
信号ｅを生成するが、この過程については、前述した図
３に示す従来のロジカル・コム・フィルタと同様であ
る。また、後信号ｃと主信号ｄを入力とする加算器１５
と、主信号ｄと前信号ｃを入力とする加算器１６とを用
い、加算器１５，１６の出力をクロマレベル検出回路へ
の入力とすることも前述した図５に示す従来のロジカル
・コム・フィルタと同様である。本実施例がこれらと比
較して異なる点は加算器１５，１６をコムフィルタ群１
としても用いていることにある。なお、後信号ｃ，主信
号ｄ，前信号ｅを入力とする比較器１７，１８，１９
と、これらの比較器１７，１８，１９の出力を入力とす
るＥＸＯＲゲート２０，２１とによって絵柄検出回路２
を構成することは、前述した図３に示す従来のロジカル
・コム・フィルタと同様である。従って、本実施例にお
いては、セレクタ群３として、加算器１５の出力と加算
器１６の出力を入力とするセレクタ２２と、反転アンプ
２４の出力と反転アンプ２５の出力を入力とするセレク
タ２３とを用い、ＥＸＯＲゲート２０，２１の出力によ
って制御することで、前述した図４と同じクロマ出力を
選択することができる。ここで、反転アンプ２４は主信
号ｄを−１倍し、反転アンプ２５はセレクタ２２の出力
を−（１／２）倍して、利得と位相を合わせている。こ
れらの反転アンプ２４，２５は同機能が得られるなら
ば、セレクタ２２，２３の前後のどちらに入れてもかま
わない。なお、加算器１５の出力と加算器１６の出力を
比較器１９の入力としても同様の機能が実現できる。要
するに、かかる本実施例の回路は前述した図５に示す従
来例の回路と比較すると、同等機能のロジカル・コム・
フィルタを従来の回路では加算器３個を用いて構成して
いたが、本実施例では加算器２個で実現できる。
【００１４】図２は本発明の他の実施例を示すロジカル
・コム・フィルタの回路図である。図２に示すように、
本実施例は前述した図１の一実施例に対して、加算器１
５の出力と加算器１６の出力を入力とする加算器３０
と、この加算器３０の出力を入力とする反転アンプ３１
と、この反転アンプ３１の出力および反転アンプ２５の
出力を入力とするセレクタ３２とを用いることが異って
いる。本実施例では比較器１７，１８，１９の出力が
Ｌ，Ｌ，ＬまたはＨ，Ｈ，Ｈのときにクロマ出力として
−ｄの代りに、−（ｃ＋２ｄ＋ｅ）／４を出力する。こ
れにより、絵柄の変化が少ないときは、ロジカル・コム
・フィルタの特性を周波数分離ではなく、３ラインコム
フィルタにすることができる。従って、本実施例も前述
した図６に示す従来例と同等の機能を有するが、従来例
における加算器は４個用いて構成していたのに対し、本
実施例では３個で実現できる。
・コム・フィルタの回路図である。図２に示すように、
本実施例は前述した図１の一実施例に対して、加算器１
５の出力と加算器１６の出力を入力とする加算器３０
と、この加算器３０の出力を入力とする反転アンプ３１
と、この反転アンプ３１の出力および反転アンプ２５の
出力を入力とするセレクタ３２とを用いることが異って
いる。本実施例では比較器１７，１８，１９の出力が
Ｌ，Ｌ，ＬまたはＨ，Ｈ，Ｈのときにクロマ出力として
−ｄの代りに、−（ｃ＋２ｄ＋ｅ）／４を出力する。こ
れにより、絵柄の変化が少ないときは、ロジカル・コム
・フィルタの特性を周波数分離ではなく、３ラインコム
フィルタにすることができる。従って、本実施例も前述
した図６に示す従来例と同等の機能を有するが、従来例
における加算器は４個用いて構成していたのに対し、本
実施例では３個で実現できる。
【００１５】
【発明の効果】以上説明したように、本発明のロジカル
・コム・フィルタは、従来よりも加算器１個分少なくで
き、経済化できるという効果がある。
・コム・フィルタは、従来よりも加算器１個分少なくで
き、経済化できるという効果がある。
【図１】本発明の一実施例を示すロジカル・コム・フィ
ルタの回路図である。
ルタの回路図である。
【図２】本発明の他の実施例を示すロジカル・コム・フ
ィルタの回路図である。
ィルタの回路図である。
【図３】従来の一例を示すロジカル・コム・フィルタの
回路図である。
回路図である。
【図４】図３における絵柄とクロマ出力の関係を表わす
対応図である。
対応図である。
【図５】図３の回路にクロマレベル検出用出力を追加し
た一例を示すロジカル・コム・フィルタの回路図であ
る。
た一例を示すロジカル・コム・フィルタの回路図であ
る。
【図６】図３の回路にクロマレベル検出用出力を追加し
た他の例を示すロジカル・コム・フィルタの回路図であ
る。
た他の例を示すロジカル・コム・フィルタの回路図であ
る。
１ コムフィルタ群 ２ 絵柄検出回路 ３ セレクタ群 １１ ＢＰＦ １２，１３ １ライン遅延回路 １４，２４，２５，２９，３１ 反転アンプ １５，１６，２８，３０ 加算器 １７，１８，１９，３３ 比較器 ２０，２１ ＥＸＯＲゲート ２２，２３，２６，２７，３２ セレクタ
Claims (3)
- 【請求項１】 入力信号を１水平走査期間遅延させる第
１の遅延回路と、前記第１の遅延回路の出力を更に遅延
させる第２の遅延回路と、前記入力信号と前記第１及び
第２の遅延回路の出力を入力とし複数の出力を有するコ
ムフィルタ群と、前記入力信号および前記第１及び第２
の遅延回路の出力を入力とする絵柄検出回路と、前記コ
ムフィルタ群の出力を入力とし前記絵柄検出回路の出力
を制御入力とするセレクタ群とを有し、前記セレクタ群
の出力をクロマ出力とすることを特徴とするロジカル・
コム・フィルタ。 - 【請求項２】 前記コムフィルタ群は、前記入力信号お
よび前記第１の遅延回路の出力を入力とする第１の加算
器と、前記第１の遅延回路の出力および前記第２の遅延
回路の出力を入力とする第２の加算器とを備えた請求項
１記載のロジカル・コム・フィルタ。 - 【請求項３】 前記コムフィルタ群は、前記入力信号お
よび前記第１の遅延回路の出力を入力とする第１の加算
器と、前記第１の遅延回路出力および前記第２の遅延回
路の出力を入力とする第２の加算器と、前記第１および
第２の加算器の出力を入力とする第３の加算器とを備え
た請求項１記載のロジカル・コム・フィルタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6784192A JPH05276531A (ja) | 1992-03-26 | 1992-03-26 | ロジカル・コム・フィルタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6784192A JPH05276531A (ja) | 1992-03-26 | 1992-03-26 | ロジカル・コム・フィルタ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05276531A true JPH05276531A (ja) | 1993-10-22 |
Family
ID=13356584
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6784192A Pending JPH05276531A (ja) | 1992-03-26 | 1992-03-26 | ロジカル・コム・フィルタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05276531A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0840526A1 (en) * | 1996-10-29 | 1998-05-06 | Daewoo Electronics Co., Ltd | Motion adaptive luminance and chrominance signal separating circuit |
-
1992
- 1992-03-26 JP JP6784192A patent/JPH05276531A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0840526A1 (en) * | 1996-10-29 | 1998-05-06 | Daewoo Electronics Co., Ltd | Motion adaptive luminance and chrominance signal separating circuit |
| US5929938A (en) * | 1996-10-29 | 1999-07-27 | Daewoo Electronics Co., Ltd. | Motion adaptive luminance and chrominance signal separating circuit |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19990323 |