JPH0345854B2 - - Google Patents
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- Publication number
- JPH0345854B2 JPH0345854B2 JP58018311A JP1831183A JPH0345854B2 JP H0345854 B2 JPH0345854 B2 JP H0345854B2 JP 58018311 A JP58018311 A JP 58018311A JP 1831183 A JP1831183 A JP 1831183A JP H0345854 B2 JPH0345854 B2 JP H0345854B2
- Authority
- JP
- Japan
- Prior art keywords
- relay
- circuit
- power supply
- relay coil
- voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000012544 monitoring process Methods 0.000 claims description 5
- 238000010586 diagram Methods 0.000 description 11
- 230000007257 malfunction Effects 0.000 description 6
- 230000000694 effects Effects 0.000 description 1
- 238000004886 process control Methods 0.000 description 1
- 230000002123 temporal effect Effects 0.000 description 1
- 230000001052 transient effect Effects 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
Landscapes
- Relay Circuits (AREA)
Description
【発明の詳細な説明】
この発明はプラントのプロセス制御を行う計算
機やシーケンサからプラント側へ接点信号を出力
するためのリレーを駆動するリレー駆動装置に関
するものである。
機やシーケンサからプラント側へ接点信号を出力
するためのリレーを駆動するリレー駆動装置に関
するものである。
従来この種の装置として第１図に示すものがあ
つた。図においてＫ１はリレーコイル、ｋ１はそ
のリレー接点、IC１はドライバ、Ｄ１はダイオ
ード、Vccは電源、CUTは接点出力である。ダイ
オードＤ１はリレーコイルＫ１内における電流の
時間的変化により発生する逆起電力を吸収するた
めに設けられている。
つた。図においてＫ１はリレーコイル、ｋ１はそ
のリレー接点、IC１はドライバ、Ｄ１はダイオ
ード、Vccは電源、CUTは接点出力である。ダイ
オードＤ１はリレーコイルＫ１内における電流の
時間的変化により発生する逆起電力を吸収するた
めに設けられている。
ドライバIC１の出力の電位レベルは、第１図
にＳで示す入力の論理によつて定まり“Ｌ”レベ
ルになつた時はVccからリレーコイルＫ１を経て
電流が流れ、接点のNC−Ｃ間が開きNO−Ｃ間
が閉じる。一方、ドライバIC１の出力が“Ｈ”
レベルになるとリレーコイルＫ１には電流が流れ
ず、接点NC−Ｃ間が閉じ、NO−Ｃ間が開く。
にＳで示す入力の論理によつて定まり“Ｌ”レベ
ルになつた時はVccからリレーコイルＫ１を経て
電流が流れ、接点のNC−Ｃ間が開きNO−Ｃ間
が閉じる。一方、ドライバIC１の出力が“Ｈ”
レベルになるとリレーコイルＫ１には電流が流れ
ず、接点NC−Ｃ間が閉じ、NO−Ｃ間が開く。
しかし、Vccが正規の電圧でない場合はリレー
の開閉に誤動作が発生する。第２図は第１図の装
置における誤動作の発生を示す波形図であり、横
軸は時間を示し、第２図ａはVccの、同図ｂはド
ライバIC１の出力電圧の、同図ｃは接点出力
OUTの、それぞれ時間的経過を示す。
の開閉に誤動作が発生する。第２図は第１図の装
置における誤動作の発生を示す波形図であり、横
軸は時間を示し、第２図ａはVccの、同図ｂはド
ライバIC１の出力電圧の、同図ｃは接点出力
OUTの、それぞれ時間的経過を示す。
電源が投入されてVccが０から立上つて正規の
電圧に達し、次に電源がしや断されてVccが正規
の電圧から０に戻る状態を第２図ａに示してい
る。第２図ａにおいてVKはリレーが動作するこ
とのできる閾値電圧、VEは電子回路が正常に動
作する閾値電圧を示す。普通の場合VE＞VKであ
つて、VK〜VEの領域では第１図の信号Ｓの論理
が誤りその結果IC１の出力の電位レベルが誤り、
又は信号Ｓの論理が正規であつてもIC１の出力
の電位レベルが正規でなく、しかもリレーが動作
し得る電圧値VKを越しているので、誤つた接点
出力OUTが出力されることがある。
電圧に達し、次に電源がしや断されてVccが正規
の電圧から０に戻る状態を第２図ａに示してい
る。第２図ａにおいてVKはリレーが動作するこ
とのできる閾値電圧、VEは電子回路が正常に動
作する閾値電圧を示す。普通の場合VE＞VKであ
つて、VK〜VEの領域では第１図の信号Ｓの論理
が誤りその結果IC１の出力の電位レベルが誤り、
又は信号Ｓの論理が正規であつてもIC１の出力
の電位レベルが正規でなく、しかもリレーが動作
し得る電圧値VKを越しているので、誤つた接点
出力OUTが出力されることがある。
第２図に示す例では、信号Ｓの制御によつて接
点出力OUTを“OFF”状態に保つよう制御して
いる場合、電源Vccの変化の過渡状態において接
点出力OUTが“ON”状態になることがあるこ
とを第２図ｃで示している。
点出力OUTを“OFF”状態に保つよう制御して
いる場合、電源Vccの変化の過渡状態において接
点出力OUTが“ON”状態になることがあるこ
とを第２図ｃで示している。
従来のリレー駆動装置は以上のように構成され
ており、電源投入およびしや断時の誤動作を完全
に防止することはできず、接点出力OUTが誤つ
ても重大な事故が発生することがないようにする
ためには、接点出力OUT以後にフエイルセーフ
（fail−safe）回路を設ける等の対策を講じなけれ
ばならぬという欠点があつた。
ており、電源投入およびしや断時の誤動作を完全
に防止することはできず、接点出力OUTが誤つ
ても重大な事故が発生することがないようにする
ためには、接点出力OUT以後にフエイルセーフ
（fail−safe）回路を設ける等の対策を講じなけれ
ばならぬという欠点があつた。
この発明は上記のような従来のものの欠点を除
去するためになされたもので、電子回路が誤動作
する電源電圧領域ではリレーコイルへの電源の供
給をカツトオフ状態に保つトランジスタスイツチ
回路を設けることによつて、電源投入およびしや
断の過渡期においてもリレーの接点が誤出力され
ることのないようにしたリレー駆動装置を提供す
ることを目的としている。
去するためになされたもので、電子回路が誤動作
する電源電圧領域ではリレーコイルへの電源の供
給をカツトオフ状態に保つトランジスタスイツチ
回路を設けることによつて、電源投入およびしや
断の過渡期においてもリレーの接点が誤出力され
ることのないようにしたリレー駆動装置を提供す
ることを目的としている。
以下、図面についてこの発明の実施例を説明す
る。第３図はこの発明の一実施例を示すブロツク
図で、第１図と同一符号は同一又は相当部分を示
し、１０は電圧低下時カツトオフ回路である。ま
た、第４図は第３図の電圧低下時カツトオフ回路
１０の設計例を示す接続図で、第３図と同一符号
は同一部分を示し、Ｄ２はカツトオフする電圧を
設定するためのツエナーダイオード、Ｒ１はツエ
ナーダイオードＤ２の電流制限抵抗、TR１はス
イツチ回路として動作するトランジスタ、Ｒ２は
トランジスタTR１のベース抵抗である。
る。第３図はこの発明の一実施例を示すブロツク
図で、第１図と同一符号は同一又は相当部分を示
し、１０は電圧低下時カツトオフ回路である。ま
た、第４図は第３図の電圧低下時カツトオフ回路
１０の設計例を示す接続図で、第３図と同一符号
は同一部分を示し、Ｄ２はカツトオフする電圧を
設定するためのツエナーダイオード、Ｒ１はツエ
ナーダイオードＤ２の電流制限抵抗、TR１はス
イツチ回路として動作するトランジスタ、Ｒ２は
トランジスタTR１のベース抵抗である。
Vccの電圧値が第２図に示すVEよりも少し高い
VDにおいてツエナダイオードＤ２に電流が流れ
るように設定しておくと、VccがVD以下ではツエ
ナダイオードＤ２に電流が流れず、したがつてト
ランジスタTR１のベース電流が流れず、トラン
ジスタTR１はカツトオフ状態になつており、リ
レーコイルＫ１には電圧が供給されない。
VDにおいてツエナダイオードＤ２に電流が流れ
るように設定しておくと、VccがVD以下ではツエ
ナダイオードＤ２に電流が流れず、したがつてト
ランジスタTR１のベース電流が流れず、トラン
ジスタTR１はカツトオフ状態になつており、リ
レーコイルＫ１には電圧が供給されない。
第５図は第４図におけるリレーコイルＫ１に加
えられる電圧を示す波形図で、第５図ａはVccを、
同図ｂはリレーコイルＫ１に印加される電圧を示
す。第５図のVDは第２図のVEに対しVDVEに設
定してあるのでVcc＜VEの領域で電子回路が誤動
作しても誤つた接点出力OUTが出力されること
はない。
えられる電圧を示す波形図で、第５図ａはVccを、
同図ｂはリレーコイルＫ１に印加される電圧を示
す。第５図のVDは第２図のVEに対しVDVEに設
定してあるのでVcc＜VEの領域で電子回路が誤動
作しても誤つた接点出力OUTが出力されること
はない。
第６図はこの発明の他の実施例を示すブロツク
図で、第３図と同一符号は同一又は相当部分を示
し、Vcc1はリレー駆動装置、Vcc2は電子回路駆動
電源、１１はリレー電源のカツトオフ回路、１２
は電子回路電源の監視回路である。
図で、第３図と同一符号は同一又は相当部分を示
し、Vcc1はリレー駆動装置、Vcc2は電子回路駆動
電源、１１はリレー電源のカツトオフ回路、１２
は電子回路電源の監視回路である。
第６図のようにリレー駆動電源Vcc1と電子回路
駆動電源Vcc2とが別のものである場合にはVcc2を
監視して、Vcc2が所定値より低くなつた場合Vcc1
をしや断すればよい。第４図においてＲ１とＤ２
の直列回路が監視回路１２を構成し、TR１と
TR１のベース抵抗Ｒ２とがカツトオフ回路１１
を構成し、Ｒ１とＤ２の接続点からＲ２への接続
線が監視回路１２からカツトオフ回路１１の制御
線となる。
駆動電源Vcc2とが別のものである場合にはVcc2を
監視して、Vcc2が所定値より低くなつた場合Vcc1
をしや断すればよい。第４図においてＲ１とＤ２
の直列回路が監視回路１２を構成し、TR１と
TR１のベース抵抗Ｒ２とがカツトオフ回路１１
を構成し、Ｒ１とＤ２の接続点からＲ２への接続
線が監視回路１２からカツトオフ回路１１の制御
線となる。
また、この発明はラツチングリレーを駆動する
リレー駆動装置に応用できることは申すまでもな
く、ホトカツプラの出力回路に利用しても同様の
効果を得ることができる。
リレー駆動装置に応用できることは申すまでもな
く、ホトカツプラの出力回路に利用しても同様の
効果を得ることができる。
以上のようにこの発明によれば、電子回路が誤
動作することのある電圧領域では、リレーコイル
への電源をカツトオフするように制御するので、
リレー駆動装置の電源投入およびしや断時の誤出
力を防止することができ、総合的に見て装置全体
の簡単化と低価格化を実現することができる。
動作することのある電圧領域では、リレーコイル
への電源をカツトオフするように制御するので、
リレー駆動装置の電源投入およびしや断時の誤出
力を防止することができ、総合的に見て装置全体
の簡単化と低価格化を実現することができる。
第１図は従来の装置を示す接続図、第２図は第
１図の装置における各部の動作を示す波形図、第
３図はこの発明の一実施例を示すブロツク図、第
４図は第３図の電圧低下時カツトオフ回路の設計
例を示す接続図、第５図は第３図の装置における
各部の動作を示す波形図、第６図はこの発明の他
の実施例を示すブロツク図である。 Ｋ１……リレーコイル、IC１……ドライバ、
TR１……トランジスタ、Ｄ２……ツエナダイオ
ード、ｋ１……リレー接点。なお、図中同一符号
は同一又は相当部分を示す。
１図の装置における各部の動作を示す波形図、第
３図はこの発明の一実施例を示すブロツク図、第
４図は第３図の電圧低下時カツトオフ回路の設計
例を示す接続図、第５図は第３図の装置における
各部の動作を示す波形図、第６図はこの発明の他
の実施例を示すブロツク図である。 Ｋ１……リレーコイル、IC１……ドライバ、
TR１……トランジスタ、Ｄ２……ツエナダイオ
ード、ｋ１……リレー接点。なお、図中同一符号
は同一又は相当部分を示す。
Claims (1)
- １ 電子回路によりリレーコイルを駆動するリレ
ー駆動装置において、上記電子回路に供給される
電源の電圧があらかじめ定めた電圧値以上である
か否かを検出する監視回路と、上記リレーコイル
に直列に接続され制御信号により上記リレーコイ
ルの電流をオンオフ制御するトランジスタと、上
記監視回路において上記電子回路に供給される電
源の電圧が上記あらかじめ定めた電圧値以上でな
いことを検出したときは制御信号を出力して上記
トランジスタをオフ状態に制御する手段とを備え
たことを特徴とするリレー駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58018311A JPS59143231A (ja) | 1983-02-07 | 1983-02-07 | リレ−駆動装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58018311A JPS59143231A (ja) | 1983-02-07 | 1983-02-07 | リレ−駆動装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59143231A JPS59143231A (ja) | 1984-08-16 |
| JPH0345854B2 true JPH0345854B2 (ja) | 1991-07-12 |
Family
ID=11968061
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58018311A Granted JPS59143231A (ja) | 1983-02-07 | 1983-02-07 | リレ−駆動装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59143231A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3908192A1 (de) * | 1989-03-14 | 1990-09-20 | Licentia Gmbh | Elektronische schuetzansteuerung |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5553026A (en) * | 1978-10-16 | 1980-04-18 | Hitachi Ltd | Output relay switching circuit |
-
1983
- 1983-02-07 JP JP58018311A patent/JPS59143231A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5553026A (en) * | 1978-10-16 | 1980-04-18 | Hitachi Ltd | Output relay switching circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59143231A (ja) | 1984-08-16 |
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