JPH034127Y2 - - Google Patents
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- Publication number
- JPH034127Y2 JPH034127Y2 JP1984036378U JP3637884U JPH034127Y2 JP H034127 Y2 JPH034127 Y2 JP H034127Y2 JP 1984036378 U JP1984036378 U JP 1984036378U JP 3637884 U JP3637884 U JP 3637884U JP H034127 Y2 JPH034127 Y2 JP H034127Y2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- capacitor
- current limiting
- rectifier circuit
- limiting resistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000003990 capacitor Substances 0.000 claims description 22
- 238000010586 diagram Methods 0.000 description 4
- 238000005516 engineering process Methods 0.000 description 2
- 230000000903 blocking effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000005611 electricity Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
Landscapes
- Emergency Protection Circuit Devices (AREA)
- Supply And Distribution Of Alternating Current (AREA)
Description
【考案の詳細な説明】
〔産業上の利用分野〕
本考案は、インラツシユ（初期突入）電流制限
回路の改良に関するものである。
回路の改良に関するものである。
従来、交流電源を使用する電子機器において、
電源投入時に発生するインラツシユ電流は機器の
定格入力電流の数倍にも達し、電源スイツチの寿
命を縮めたり、普通のヒユーズではすぐに溶断し
てしまうことがあるため、スローブロー・ヒユー
ズを用いなければならない場合があつた。即ち、
整流回路で使用される大容量のフイルタ用コンデ
ンサに、内部抵抗の小さい半導体ダイオードをと
おして大きな初期充電電流が流れるので、電流制
限抵抗を前記整流回路と直列に接続することによ
り、回路等を保護していた。
電源投入時に発生するインラツシユ電流は機器の
定格入力電流の数倍にも達し、電源スイツチの寿
命を縮めたり、普通のヒユーズではすぐに溶断し
てしまうことがあるため、スローブロー・ヒユー
ズを用いなければならない場合があつた。即ち、
整流回路で使用される大容量のフイルタ用コンデ
ンサに、内部抵抗の小さい半導体ダイオードをと
おして大きな初期充電電流が流れるので、電流制
限抵抗を前記整流回路と直列に接続することによ
り、回路等を保護していた。
しかし、上述のような従来技術において、電源
の負荷による電圧変動を重視する電子機器では、
できるだけ電源回路のインピーダンスを低くして
おかなければならないので、抵抗等の直列接続は
避けるべき手段である。そこでインラツシユ電流
を制限する手段として、例えば第２図に示すよう
に、電源スイツチSWと整流回路２との間に電流
制限抵抗R0を設け、同時に−間の電圧を抵
抗R1及びR2により分割した後、ダイオードD2で
整流し、更に抵抗R3とコンデンサC2によるフイ
ルタ回路を介してリレーRLを動作させ、かつ、
このリレーRLの接点Ｓにより、前記電流制限抵
抗R0が短絡するものである。他方、抵抗R3とコ
ンデンサC2はフイルタ回路であると共に、積分
形遅延回路でもあるから、前記コンデンサC2の
端子電圧がリレーRLの動作電圧となるまでには
若干の時間を要することになり、その間、抵抗
R0が電流制限を行うものである。しかし、前記
リレーRLが一旦動作すると、これを保持するた
めに抵抗R1，R2及びR3に電流が流れ、無駄な電
力を消費していた。
の負荷による電圧変動を重視する電子機器では、
できるだけ電源回路のインピーダンスを低くして
おかなければならないので、抵抗等の直列接続は
避けるべき手段である。そこでインラツシユ電流
を制限する手段として、例えば第２図に示すよう
に、電源スイツチSWと整流回路２との間に電流
制限抵抗R0を設け、同時に−間の電圧を抵
抗R1及びR2により分割した後、ダイオードD2で
整流し、更に抵抗R3とコンデンサC2によるフイ
ルタ回路を介してリレーRLを動作させ、かつ、
このリレーRLの接点Ｓにより、前記電流制限抵
抗R0が短絡するものである。他方、抵抗R3とコ
ンデンサC2はフイルタ回路であると共に、積分
形遅延回路でもあるから、前記コンデンサC2の
端子電圧がリレーRLの動作電圧となるまでには
若干の時間を要することになり、その間、抵抗
R0が電流制限を行うものである。しかし、前記
リレーRLが一旦動作すると、これを保持するた
めに抵抗R1，R2及びR3に電流が流れ、無駄な電
力を消費していた。
本考案は、従来知られている電流制限回路の、
このような欠点を改良する目的でなされたもので
ある。
このような欠点を改良する目的でなされたもので
ある。
本考案は、交流入力（例えば、AC100Vの商用
電源）側と整流回路との間に、インラツシユ電流
阻止用の電流制限抵抗を設け、かつ、インラツシ
ユ電流が流れなくなると半波倍電圧整流回路の出
力を電源とするリレー回路により、前記電流制限
抵抗を短絡して、通常の電流が流れるようにした
インラツシユ電流制限回路であつて、上述の従来
技術の課題を解決するものである。
電源）側と整流回路との間に、インラツシユ電流
阻止用の電流制限抵抗を設け、かつ、インラツシ
ユ電流が流れなくなると半波倍電圧整流回路の出
力を電源とするリレー回路により、前記電流制限
抵抗を短絡して、通常の電流が流れるようにした
インラツシユ電流制限回路であつて、上述の従来
技術の課題を解決するものである。
次に本考案の実施例を図面に基づいて説明する
と、第１図において、電源スイツチSWと整流回
路２との間に電流制限抵抗R0を設け、かつ、交
流入力側のコンデンサC1の容量を直流出力側の
コンデンサC2の容量より小さく設定した半波倍
電圧回路１を前記電源スイツチSWと電流制限抵
抗R0との間に接続し、更に、前記半波倍電圧整
流回路１の出力によりリレーRLの接点Ｓを動作
させることによつて、電流制限抵抗R0が短絡す
るようになつている。
と、第１図において、電源スイツチSWと整流回
路２との間に電流制限抵抗R0を設け、かつ、交
流入力側のコンデンサC1の容量を直流出力側の
コンデンサC2の容量より小さく設定した半波倍
電圧回路１を前記電源スイツチSWと電流制限抵
抗R0との間に接続し、更に、前記半波倍電圧整
流回路１の出力によりリレーRLの接点Ｓを動作
させることによつて、電流制限抵抗R0が短絡す
るようになつている。
一方、前記半波倍電圧整流回路１の動作と、リ
レーRLの動作との関係を第３図及び第４図に示
し、側が＋のサイクルでは、電流i1がダイオー
ドD1とコンデンサC1をとおつて流れ、かつ、こ
のコンデンサC1を図示の方向に充電する。次に、
側が＋のサイクルでは、コンデンサC1の両端
電圧が入力電圧と直列に加わり、電流i2がダイオ
ードD2とコンデンサC2をとおつて流れ、かつ、
このコンデンサC2を充電することによつて両端
に入力電圧の２倍の出力電圧が得られるものであ
る。更に本考案の回路では、コンデンサC1の容
量をコンデンサC2より小さく設定してあるので、
上述したように、最初のサイクルにおけるコンデ
ンサC1の充電電圧は同じであるが、このコンデ
ンサC1に充電される電気量は容量に比例するた
め、容量が小さいと放電サイクルにおいてはただ
ちに電荷を失い、以後は電流i2により充電される
形となり、直列リアクタンスとして前記電流i2の
流通を妨げる作用をすることになる。したがつ
て、コンデンサC2の充電には時間がかかるため、
負荷であるリレーRLが動作する電圧になるには、
若干の遅れを生ずる。すなわち、コンデンサC2
に比べてコンデンサC1の容量を小さくするほど、
リレーRLの動作時間を遅延させることができる
ものである。
レーRLの動作との関係を第３図及び第４図に示
し、側が＋のサイクルでは、電流i1がダイオー
ドD1とコンデンサC1をとおつて流れ、かつ、こ
のコンデンサC1を図示の方向に充電する。次に、
側が＋のサイクルでは、コンデンサC1の両端
電圧が入力電圧と直列に加わり、電流i2がダイオ
ードD2とコンデンサC2をとおつて流れ、かつ、
このコンデンサC2を充電することによつて両端
に入力電圧の２倍の出力電圧が得られるものであ
る。更に本考案の回路では、コンデンサC1の容
量をコンデンサC2より小さく設定してあるので、
上述したように、最初のサイクルにおけるコンデ
ンサC1の充電電圧は同じであるが、このコンデ
ンサC1に充電される電気量は容量に比例するた
め、容量が小さいと放電サイクルにおいてはただ
ちに電荷を失い、以後は電流i2により充電される
形となり、直列リアクタンスとして前記電流i2の
流通を妨げる作用をすることになる。したがつ
て、コンデンサC2の充電には時間がかかるため、
負荷であるリレーRLが動作する電圧になるには、
若干の遅れを生ずる。すなわち、コンデンサC2
に比べてコンデンサC1の容量を小さくするほど、
リレーRLの動作時間を遅延させることができる
ものである。
なお、第１図及び第２図に示したＦは、回路保
護用ヒユーズである。
護用ヒユーズである。
本考案は以上説明したように、半波倍電圧整流
回路のコンデンサと、電流制限抵抗の値をそれぞ
れ適当に調整し、かつ、リレー回路と組合わせる
ことによつて、インラツシユ電流による損傷を防
止する効果がある。
回路のコンデンサと、電流制限抵抗の値をそれぞ
れ適当に調整し、かつ、リレー回路と組合わせる
ことによつて、インラツシユ電流による損傷を防
止する効果がある。
更に、前記半波倍電圧整流回路に流れる電流
は、リレー回路により消費されるだけであるか
ら、従来回路のような抵抗による電力消費がな
い。したがつて、発熱することもないので信頼性
が向上し、かつ経済的である。
は、リレー回路により消費されるだけであるか
ら、従来回路のような抵抗による電力消費がな
い。したがつて、発熱することもないので信頼性
が向上し、かつ経済的である。
第１図は本考案の一実施回路構成図、第２図は
抵抗を用いた従来の回路構成図、第３図は第１図
における半波倍電圧整流回路の動作説明図、第４
図は第１図における制御部分の動作説明図であ
る。 １……半波倍電圧整流回路、２……整流回路、
C1・C2……コンデンサ、D1・D2……ダイオード、
Ｆ……ヒユーズ、R0……電流制限抵抗、R1〜R3
……抵抗、RL……リレー、Ｓ……接点、SW…
…電源スイツチ。
抵抗を用いた従来の回路構成図、第３図は第１図
における半波倍電圧整流回路の動作説明図、第４
図は第１図における制御部分の動作説明図であ
る。 １……半波倍電圧整流回路、２……整流回路、
C1・C2……コンデンサ、D1・D2……ダイオード、
Ｆ……ヒユーズ、R0……電流制限抵抗、R1〜R3
……抵抗、RL……リレー、Ｓ……接点、SW…
…電源スイツチ。
Claims (1)
- 電源スイツチSWと整流回路２との間に電流制
限抵抗R0を設けた電源回路において、コンデン
サC1の容量をコンデンサC2の容量より小さく設
定した半波倍電圧整流回路１を、前記電源スイツ
チSW及び電流制限抵抗R0の間に接続し、かつ、
前記半波倍電圧整流回路１の整流出力によりリレ
ーRLの接点Ｓを動作して、前記電流制限抵抗R0
を短絡するよう構成したことを特徴とするインラ
ツシユ電流制限回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3637884U JPS60147951U (ja) | 1984-03-14 | 1984-03-14 | インラツシユ電流制限回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3637884U JPS60147951U (ja) | 1984-03-14 | 1984-03-14 | インラツシユ電流制限回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60147951U JPS60147951U (ja) | 1985-10-01 |
| JPH034127Y2 true JPH034127Y2 (ja) | 1991-02-01 |
Family
ID=30541500
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3637884U Granted JPS60147951U (ja) | 1984-03-14 | 1984-03-14 | インラツシユ電流制限回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60147951U (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5836200U (ja) * | 1981-09-01 | 1983-03-09 | 有限会社千佳 | 観音霊場集印掛軸地 |
-
1984
- 1984-03-14 JP JP3637884U patent/JPS60147951U/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5836200U (ja) * | 1981-09-01 | 1983-03-09 | 有限会社千佳 | 観音霊場集印掛軸地 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60147951U (ja) | 1985-10-01 |
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