JPH0278392A - 複合映像信号生成方法 - Google Patents
複合映像信号生成方法Info
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- JPH0278392A JPH0278392A JP1026851A JP2685189A JPH0278392A JP H0278392 A JPH0278392 A JP H0278392A JP 1026851 A JP1026851 A JP 1026851A JP 2685189 A JP2685189 A JP 2685189A JP H0278392 A JPH0278392 A JP H0278392A
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- 238000000034 method Methods 0.000 title claims description 20
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 9
- 238000006243 chemical reaction Methods 0.000 claims description 7
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- 239000011159 matrix material Substances 0.000 abstract description 5
- 238000010586 diagram Methods 0.000 description 6
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- 230000010355 oscillation Effects 0.000 description 2
- 241001522296 Erithacus rubecula Species 0.000 description 1
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N11/00—Colour television systems
- H04N11/06—Transmission systems characterised by the manner in which the individual colour picture signal components are combined
- H04N11/12—Transmission systems characterised by the manner in which the individual colour picture signal components are combined using simultaneous signals only
- H04N11/14—Transmission systems characterised by the manner in which the individual colour picture signal components are combined using simultaneous signals only in which one signal, modulated in phase and amplitude, conveys colour information and a second signal conveys brightness information, e.g. NTSC-system
- H04N11/143—Encoding means therefor
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N9/00—Details of colour television systems
- H04N9/64—Circuits for processing colour signals
- H04N9/65—Circuits for processing colour signals for synchronous modulators
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Processing Of Color Television Signals (AREA)
- Color Television Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
複合映像信号生成方法に関し、
集積化に適した回路構成を実現して製造コストおよび設
計コストの削減を計ることを目的とし、周波数ｆｓｃの
サブキャリアを用いて２つの色度信号を平衡変調した後
、輝度信号とともに合成し、複合映像信号を生成する複
合映像信号生成方法において、前記サブキャリアは、原
色信号のサンプリング周＃、＋１１ ／ ｆａとサブキ
ャリアの周期１／ｆｓｃの比（ｆｓｃ ／ｆａ）を順次
整数倍にして時間軸上に配列し、該配列の各々について
、ＳＩＮ 、 ＣＯＳ変換処理を行ってデジタル量で表
すように構成している。
計コストの削減を計ることを目的とし、周波数ｆｓｃの
サブキャリアを用いて２つの色度信号を平衡変調した後
、輝度信号とともに合成し、複合映像信号を生成する複
合映像信号生成方法において、前記サブキャリアは、原
色信号のサンプリング周＃、＋１１ ／ ｆａとサブキ
ャリアの周期１／ｆｓｃの比（ｆｓｃ ／ｆａ）を順次
整数倍にして時間軸上に配列し、該配列の各々について
、ＳＩＮ 、 ＣＯＳ変換処理を行ってデジタル量で表
すように構成している。
（産業上の利用分野〕
本発明は、複合映像信号生成方法に関し、特に、ＮＩＶ
ｓｃ方式のカラー複合映像信号生成方法に係り、デジタ
ル化に適した構成にして、集積化を容易にした複合映像
信号生成方法に関する。
ｓｃ方式のカラー複合映像信号生成方法に係り、デジタ
ル化に適した構成にして、集積化を容易にした複合映像
信号生成方法に関する。
−Ｃに、パーソナルコンビュークやワークステーション
で作成されたデジタルカラー画情報をＣＲＴに表示する
場合には、デジタル信号のまま表示する方法の他に、−
旦、アナログ信号に変換した後、表示する方法があるが
、特に、ＮＴＳＣ（Ｎａｔｉｏｎａｌ Ｔｅ１ｅｖｉｓ
ｉｏｎ Ｓｙｓｔｅｍ Ｃｏｍｍ１ｔｔｅｅ）方式に従
って複合映像信号に変換するような方法は、通常のテレ
ビ受像機への表示が行え、また、テレビ放送網への対応
も可能となるので、例えば、パーソナルコンピュータや
ワークステーション等をアニメーション作成に用いるな
どして活用範囲の拡大が期待できる。
で作成されたデジタルカラー画情報をＣＲＴに表示する
場合には、デジタル信号のまま表示する方法の他に、−
旦、アナログ信号に変換した後、表示する方法があるが
、特に、ＮＴＳＣ（Ｎａｔｉｏｎａｌ Ｔｅ１ｅｖｉｓ
ｉｏｎ Ｓｙｓｔｅｍ Ｃｏｍｍ１ｔｔｅｅ）方式に従
って複合映像信号に変換するような方法は、通常のテレ
ビ受像機への表示が行え、また、テレビ放送網への対応
も可能となるので、例えば、パーソナルコンピュータや
ワークステーション等をアニメーション作成に用いるな
どして活用範囲の拡大が期待できる。
（従来の技術］
ＮＴＳＣ方弐に従ってデジタルＲＧＢ信号からアナログ
のカラー複合映像信号を作る装置（以下、カラーエンコ
ーダ装置）としては、従来例えば、第４図のようなもの
がある。第４図において、パーソナルコンピュータやワ
ークステーション等（以下、ＣＰＵという）で作成され
たカラー画情報のデジタルＲ，Ｇ、Ｂ各信号は、３つの
Ｄ／Ａ変換器１〜３に入力され、このＤ／Ａ変換器１〜
３によりＣＰＵからの基本クロックＣｅＫのタイミング
でアナログ値に変換される。アナログ変換されたＲ、Ｇ
、Ｂ信号は、マトリクス回路４に入力され、２つの色差
信号Ｒ−Ｙ、Ｂ−Ｙおよび１つの輝度信号Ｙが作られる
。
のカラー複合映像信号を作る装置（以下、カラーエンコ
ーダ装置）としては、従来例えば、第４図のようなもの
がある。第４図において、パーソナルコンピュータやワ
ークステーション等（以下、ＣＰＵという）で作成され
たカラー画情報のデジタルＲ，Ｇ、Ｂ各信号は、３つの
Ｄ／Ａ変換器１〜３に入力され、このＤ／Ａ変換器１〜
３によりＣＰＵからの基本クロックＣｅＫのタイミング
でアナログ値に変換される。アナログ変換されたＲ、Ｇ
、Ｂ信号は、マトリクス回路４に入力され、２つの色差
信号Ｒ−Ｙ、Ｂ−Ｙおよび１つの輝度信号Ｙが作られる
。
Ｒ−Ｙはローパスフィルタ５を通過して変調回路６に加
えられ、また、Ｂ−Ｙはローパスフィルタ７を通過して
変調回路８に加えられる。変調回路６および変調回路８
には、ＰＬＬ等を用いた発振回路Ｏ３Ｃからのカラーサ
ブキャリア（各々０°。
えられ、また、Ｂ−Ｙはローパスフィルタ７を通過して
変調回路８に加えられる。変調回路６および変調回路８
には、ＰＬＬ等を用いた発振回路Ｏ３Ｃからのカラーサ
ブキャリア（各々０°。
９０°）が加えられており、変調回路６および変調回路
８は、それぞれカラーサブキャリアをＲ−Ｙ（Ｂ−Ｙ）
で平衡変調する。変調されたＲ−ＹおよびＢ−Ｙの信号
は、加算回路９ａで合成され、次いで、加算回路９ｂで
時間調整用の遅延線Ｄ／Ｌを通過してきた輝度信号Ｙと
も合成された後、ＮＴＳＣ方式の複合映像信号として出
力される。
８は、それぞれカラーサブキャリアをＲ−Ｙ（Ｂ−Ｙ）
で平衡変調する。変調されたＲ−ＹおよびＢ−Ｙの信号
は、加算回路９ａで合成され、次いで、加算回路９ｂで
時間調整用の遅延線Ｄ／Ｌを通過してきた輝度信号Ｙと
も合成された後、ＮＴＳＣ方式の複合映像信号として出
力される。
しかしながら、このような従来のエンコーダ装置にあっ
ては、デジタルＲ，Ｇ、Ｂ信号を、−旦、アナログ信号
に変換した後、平衡変調等の必要な処理をアナログ的に
行う構成となっていたため、集積化に適した回路構成と
することができなかった。
ては、デジタルＲ，Ｇ、Ｂ信号を、−旦、アナログ信号
に変換した後、平衡変調等の必要な処理をアナログ的に
行う構成となっていたため、集積化に適した回路構成と
することができなかった。
特に、アナログ構成のローパスフィルタ５．７や遅延線
Ｄ／Ｌおよび発振回路ＯＳＣなどは大規模な回路構成と
ならざるを得す、仮に、図中−点鎖線で囲んだ範囲を１
つのチップ内に収めたとしても、上述の大規模各部は、
チップ外に別設しなければならず、製造コストの面で問
題があった。
Ｄ／Ｌおよび発振回路ＯＳＣなどは大規模な回路構成と
ならざるを得す、仮に、図中−点鎖線で囲んだ範囲を１
つのチップ内に収めたとしても、上述の大規模各部は、
チップ外に別設しなければならず、製造コストの面で問
題があった。
また、一般にアナログ回路の場合、部品特性の個体差に
起因する製品価々のバラツキが避けられないから、製品
毎の調整作業は必須であり、これにより更に製造コスト
が悪化する。しかも、長期に亘って安定動作を得るため
には、温度補償や経時変化補償等に対しても配慮しなけ
ればならず、設計コストの面でも問題がある。
起因する製品価々のバラツキが避けられないから、製品
毎の調整作業は必須であり、これにより更に製造コスト
が悪化する。しかも、長期に亘って安定動作を得るため
には、温度補償や経時変化補償等に対しても配慮しなけ
ればならず、設計コストの面でも問題がある。
そこで、本発明は、変更変調を含む各処理をデジタル量
で行えるようにすることにより、集積化に適した回路構
成を実現して製造コストおよび設計コストの削減を図る
ことを目的としている。
で行えるようにすることにより、集積化に適した回路構
成を実現して製造コストおよび設計コストの削減を図る
ことを目的としている。
〔課題を解決するための手段］
本発明では、上記目的を達成するために、周波数ｆｓｃ
のサブキャリアを用いて２つの色度信号を平衡変調した
後、輝度信号とともに合成し、複合映像信号を生成する
複合映像信号生成方法において、前記サブキャリアは、
原色信号のサンプリング周期１／ｆａとサブキャリアの
周期１／ｆｓｃの比（ｆｓｃ ／ｆａ）を順次整数倍し
て時間軸上に配列し、該配列の各々について、ＳＩＮ、
ＣＯＳ変換処理を行ってデジタル量で表すように構成し
ている。
のサブキャリアを用いて２つの色度信号を平衡変調した
後、輝度信号とともに合成し、複合映像信号を生成する
複合映像信号生成方法において、前記サブキャリアは、
原色信号のサンプリング周期１／ｆａとサブキャリアの
周期１／ｆｓｃの比（ｆｓｃ ／ｆａ）を順次整数倍し
て時間軸上に配列し、該配列の各々について、ＳＩＮ、
ＣＯＳ変換処理を行ってデジタル量で表すように構成し
ている。
本発明では、平衡変調に用いられるサブキャリアがデジ
タル量で表される。したがって、エンコーダ装置の各部
、例えば、ローパスフィルタ、遅延線、平衡変調回路お
よび加算回路などをデジタル構成とすることができ、サ
ブキャリア生成回路を含む上記各部を１つのチップ内に
集積化することが可能になる。しかも、デジタルからア
ナログへの変換は、複合映像信号を生成後に行えばよい
ので、Ｄ／Ａ変換器が１つで済み、より望ましい回路構
成となる。また、各処理がデジタル処理によって行える
ことで、調整作業も簡素化され、長期に亘って安定した
動作も得られる。
タル量で表される。したがって、エンコーダ装置の各部
、例えば、ローパスフィルタ、遅延線、平衡変調回路お
よび加算回路などをデジタル構成とすることができ、サ
ブキャリア生成回路を含む上記各部を１つのチップ内に
集積化することが可能になる。しかも、デジタルからア
ナログへの変換は、複合映像信号を生成後に行えばよい
ので、Ｄ／Ａ変換器が１つで済み、より望ましい回路構
成となる。また、各処理がデジタル処理によって行える
ことで、調整作業も簡素化され、長期に亘って安定した
動作も得られる。
［実施例〕
以下、本発明を図面に基づいて説明する。
第１．２図は本発明の複合映像信号生成方法を適用した
エンコーダ装置の一実施例を示す図である。
エンコーダ装置の一実施例を示す図である。
まず、構成を説明する。第１図において、１０はマトリ
クス回路であり、マトリクス１０は、ＣＰＵからのデジ
タルＲ，Ｇ、Ｂ各信号を受け、次式■〜■の演算処理を
デジタル的に実行して２つの色度信号、例えば色差信号
Ｒ−Ｙ、Ｂ−Ｙおよび１つの輝度信号Ｙを生成する。
クス回路であり、マトリクス１０は、ＣＰＵからのデジ
タルＲ，Ｇ、Ｂ各信号を受け、次式■〜■の演算処理を
デジタル的に実行して２つの色度信号、例えば色差信号
Ｒ−Ｙ、Ｂ−Ｙおよび１つの輝度信号Ｙを生成する。
０．３ＯＲ＋ ０．５９Ｇ ＋ ０．１１Ｂ ＝ Ｙ・
・・・・・・・・・・・■（０，７ＯＲ−０，５９Ｇ
−０，１１Ｂ ） ／ １．１４＝ Ｒ−Ｙ・・・・・
・・・・・・・■ （−０，３ＯＲ−０，５９Ｇ ＋ ０．８９Ｂ ） ／
２．０３＝ Ｂ −Ｙ・・・・・・・・・・・・■ 但し、Ｒ；赤のデジタル原色信号を表すＧ：緑のデジタ
ル原色信号を表す Ｂ：青のデジタル原色信号を表す Ｒ−Ｙ、Ｂ−Ｙはそれぞれデジタルローパスフィルタ１
１．１２によって、後述の平衡変調に適した帯域（例え
ば、０．５ＭＨｚ）となるように帯域制限を受けた後、
デジタル乗算器１３．１４に人力される。
・・・・・・・・・・・■（０，７ＯＲ−０，５９Ｇ
−０，１１Ｂ ） ／ １．１４＝ Ｒ−Ｙ・・・・・
・・・・・・・■ （−０，３ＯＲ−０，５９Ｇ ＋ ０．８９Ｂ ） ／
２．０３＝ Ｂ −Ｙ・・・・・・・・・・・・■ 但し、Ｒ；赤のデジタル原色信号を表すＧ：緑のデジタ
ル原色信号を表す Ｂ：青のデジタル原色信号を表す Ｒ−Ｙ、Ｂ−Ｙはそれぞれデジタルローパスフィルタ１
１．１２によって、後述の平衡変調に適した帯域（例え
ば、０．５ＭＨｚ）となるように帯域制限を受けた後、
デジタル乗算器１３．１４に人力される。
一方、１５はサブキャリア生成回路であり、サブキャリ
ア生成回路１５は、デジタル加算回路１６、レジスタ１
７、ＣＯＳ （θ］発生器１８、ＳＩＮ （θ〕発
生器１９を含んで構成され、デジタル加算回路１６は、
外部からの動作設定定数ＶＡＬと後述の位相情報θとを
加算して出力する。ここで、動作設定定数ＶＡＬは、外
部のデイツプスイッチやＣＰｕから入力されるもので、
次のように説明される。
ア生成回路１５は、デジタル加算回路１６、レジスタ１
７、ＣＯＳ （θ］発生器１８、ＳＩＮ （θ〕発
生器１９を含んで構成され、デジタル加算回路１６は、
外部からの動作設定定数ＶＡＬと後述の位相情報θとを
加算して出力する。ここで、動作設定定数ＶＡＬは、外
部のデイツプスイッチやＣＰｕから入力されるもので、
次のように説明される。
今、ＮＴＳＣ方式のサブキャリア周波数をｆｓｃ （ｆ
ｓｃ＝３．５８Ｍ）Ｉｚ ）とした場合に、ＣＰＵで作
られるＲ、Ｇ。
ｓｃ＝３．５８Ｍ）Ｉｚ ）とした場合に、ＣＰＵで作
られるＲ、Ｇ。
Ｂ信号の周波数（すなわち、基本クロ・ンクＣｃｋの周
波数）が、例えば、Ｎｆｓｃ （ＮＸｆｓｃ ）であれ
ば、ＶＡＬは１／Ｈに設定される。あるいは、基本クロ
ックＣｃｋの周波数がＭｆｓｃ （ＭＸｆｓｃ ）であ
れば、ＶＡＬは１／Ｍに設定される。すなわち、ＶＡＬ
は原色信号であるＲ、Ｇ、Ｂ信号のサンプリング周期１
／ｆａ （ｆａ＝ＮｆｓｃあるいはＭｆｓｃ・・・・・
・）とサブキャリアの周期１／ｆｓｃの比ｆｓｃ ／ｆ
ａ （１／ Ｎ、 １ ／ Ｍ・−・・・・）に設定す
ればよい。
波数）が、例えば、Ｎｆｓｃ （ＮＸｆｓｃ ）であれ
ば、ＶＡＬは１／Ｈに設定される。あるいは、基本クロ
ックＣｃｋの周波数がＭｆｓｃ （ＭＸｆｓｃ ）であ
れば、ＶＡＬは１／Ｍに設定される。すなわち、ＶＡＬ
は原色信号であるＲ、Ｇ、Ｂ信号のサンプリング周期１
／ｆａ （ｆａ＝ＮｆｓｃあるいはＭｆｓｃ・・・・・
・）とサブキャリアの周期１／ｆｓｃの比ｆｓｃ ／ｆ
ａ （１／ Ｎ、 １ ／ Ｍ・−・・・・）に設定す
ればよい。
レジスタ１７は基本クロックＣｃｋのタイミングで、デ
ジタル加算回路１６の出力信号（すなわち、ＶＡＬとθ
を加算したもの）を端子ＤＩに取り込み、端子ＤＯから
θとして出力する。また、レジスタ１７は端子Ｒ５Ｔに
ＣＰＵからの水平同期信号ＣＭＯＲが人力されると内容
をリセットする。００からのθはデジタル加算回路１６
の端子ＡＤＤに帰還され、ＶＡＬを加算してＤＩに加え
られ、そして、ＤＯから再びデジタル加算回路１６に戻
される。したがって、レジスタ１７のＤＯでは、はじめ
θ＝ Ｉ ＸＶＡＬ 、次いで、θ＝２ＸＶＡＬ 、さ
らに、θ−３ＸＶＡＬといったように、ＶＡＬを順次整
数倍したものが時間軸上に配列されることとなる。以下
、この配列されたθをθ１〜θｎで表す。なお、添字１
〜ｎはＶＡＬの倍数を表す。ＣＯＳ （θ〕発生器１
８およびＳＩＮ （θ）発生器１９は、θ、〜θｎの
各値に対して、ＳＩＮ変換およびＣＯＳ変換処理を行う
。例えば、ＣＯＳ （θ〕発生器１８では、ＣＯＳ
θ、 、ＣＯＳθ２・・・・・・ＣＯ３θｎなるデジタ
ル量を演算し、デジタル乗算器１３に出力する。また、
ＳＩＮ （θ）発生器１９では、ＳＩＮ θ８、ＳＩ
Ｎ θ２・・・・・・ＳＩＮ θｎなるデジタル量を演
算し、デジタル乗算器１４に出力する。デジタル乗算器
１３では、Ｒ−ＹとＣＯＳ θ、 、ＣＯＳ θｚ −
−ＣＯ３θｎとを各々乗算し、また、デジタル乗算器１
４では、Ｂ−ＹとＳＩＮ θ、 、ＳＩＮ θｔ −−
ＳＩＮ θｎとを各々乗算し、これらの乗算によりＲ−
ＹおよびＢ−Ｙの平衡変調波形Ｒ−Ｙ’、Ｂ−Ｙ’が得
られる。
ジタル加算回路１６の出力信号（すなわち、ＶＡＬとθ
を加算したもの）を端子ＤＩに取り込み、端子ＤＯから
θとして出力する。また、レジスタ１７は端子Ｒ５Ｔに
ＣＰＵからの水平同期信号ＣＭＯＲが人力されると内容
をリセットする。００からのθはデジタル加算回路１６
の端子ＡＤＤに帰還され、ＶＡＬを加算してＤＩに加え
られ、そして、ＤＯから再びデジタル加算回路１６に戻
される。したがって、レジスタ１７のＤＯでは、はじめ
θ＝ Ｉ ＸＶＡＬ 、次いで、θ＝２ＸＶＡＬ 、さ
らに、θ−３ＸＶＡＬといったように、ＶＡＬを順次整
数倍したものが時間軸上に配列されることとなる。以下
、この配列されたθをθ１〜θｎで表す。なお、添字１
〜ｎはＶＡＬの倍数を表す。ＣＯＳ （θ〕発生器１
８およびＳＩＮ （θ）発生器１９は、θ、〜θｎの
各値に対して、ＳＩＮ変換およびＣＯＳ変換処理を行う
。例えば、ＣＯＳ （θ〕発生器１８では、ＣＯＳ
θ、 、ＣＯＳθ２・・・・・・ＣＯ３θｎなるデジタ
ル量を演算し、デジタル乗算器１３に出力する。また、
ＳＩＮ （θ）発生器１９では、ＳＩＮ θ８、ＳＩ
Ｎ θ２・・・・・・ＳＩＮ θｎなるデジタル量を演
算し、デジタル乗算器１４に出力する。デジタル乗算器
１３では、Ｒ−ＹとＣＯＳ θ、 、ＣＯＳ θｚ −
−ＣＯ３θｎとを各々乗算し、また、デジタル乗算器１
４では、Ｂ−ＹとＳＩＮ θ、 、ＳＩＮ θｔ −−
ＳＩＮ θｎとを各々乗算し、これらの乗算によりＲ−
ＹおよびＢ−Ｙの平衡変調波形Ｒ−Ｙ’、Ｂ−Ｙ’が得
られる。
Ｒ−Ｙ’、Ｂ−Ｙ”はデジタル加算回路２０に加えられ
、デジタル加算回路２０はＲ−Ｙ’、Ｂ−Ｙ’を時間調
整のためのデジタルプレイライン２１を通過してきた輝
度信号Ｙと加算合成し、複合映像信号を生成する。この
複合映像信号はＤ／Ａ変換器２２でアナログ変換され、
アナログ値のＮＴＳＣ方式複合映像信号として、例えば
、テレビ受像器や、テレビ放送網に送られる。
、デジタル加算回路２０はＲ−Ｙ’、Ｂ−Ｙ’を時間調
整のためのデジタルプレイライン２１を通過してきた輝
度信号Ｙと加算合成し、複合映像信号を生成する。この
複合映像信号はＤ／Ａ変換器２２でアナログ変換され、
アナログ値のＮＴＳＣ方式複合映像信号として、例えば
、テレビ受像器や、テレビ放送網に送られる。
次に、作用を説明する。
−ｇに、ＮＴＳＣ方式では、白黒とカラーの両立性を保
つため、色情報（すなわち、色差信号Ｒ−Ｙ。
つため、色情報（すなわち、色差信号Ｒ−Ｙ。
Ｂ−Ｙ）を輝度信号Ｙの帯域内に押し込むことが行われ
、この目的で平衡変調が行われる。平衡変調は、第２図
に示すように、副搬送波信号（すなわち、カラーサブキ
ャリア）をＲ−Ｙ、Ｂ−Ｙで変調するもので、Ｒ−Ｙ、
Ｂ−Ｙの極性が変化する際に、副搬送波信号の極性も変
化する点を除けば、通常の振幅変調とほぼ同様な変調波
形が得られる。カラーエンコーダ装置をデジダル化しよ
うとする場合、この平衡変調をまずデジタルで行う必要
がある。アナログのままではカラーサブキャリアを作る
ための回路が大規模にならざるを得ないからである。そ
こで、本実施例では、カラーサブキャリアの周波数ｆｓ
ｃがＮＴＳＣではｆ ｓｃ＝ ３．５８ＭＨｚに規定さ
れていることに着目し、このｆｓｃと、デジタルＲ，Ｇ
、Ｂ信号のサンプリンタ周波数との比に基づいて、位相
情報θを作り、アナログカラーサブキャリアの角周波数
ωｔに相当するデジタル量ＳＩＮ θ＋ 、ＳＩＮ θ
２・・・・・・ＳＩＮ θｎおよびＣＯＳ θ２、ＣＯ
３θ２・・・・・・ＣＯ３θｎを作り出している。この
こＳＩＮ θ、 〜ＳＩＮ θｎおよびＣＯＳ θ＋
〜ＣＯ３θｎのデジタル量の大きさを表している。すな
わち、各矢印の長さは、仮想線で示すアナログカラーサ
ブキャリアの時間毎の振幅値に対応しているから、第２
図で示した変調波形をデジタル処理によって得ることが
できる。
、この目的で平衡変調が行われる。平衡変調は、第２図
に示すように、副搬送波信号（すなわち、カラーサブキ
ャリア）をＲ−Ｙ、Ｂ−Ｙで変調するもので、Ｒ−Ｙ、
Ｂ−Ｙの極性が変化する際に、副搬送波信号の極性も変
化する点を除けば、通常の振幅変調とほぼ同様な変調波
形が得られる。カラーエンコーダ装置をデジダル化しよ
うとする場合、この平衡変調をまずデジタルで行う必要
がある。アナログのままではカラーサブキャリアを作る
ための回路が大規模にならざるを得ないからである。そ
こで、本実施例では、カラーサブキャリアの周波数ｆｓ
ｃがＮＴＳＣではｆ ｓｃ＝ ３．５８ＭＨｚに規定さ
れていることに着目し、このｆｓｃと、デジタルＲ，Ｇ
、Ｂ信号のサンプリンタ周波数との比に基づいて、位相
情報θを作り、アナログカラーサブキャリアの角周波数
ωｔに相当するデジタル量ＳＩＮ θ＋ 、ＳＩＮ θ
２・・・・・・ＳＩＮ θｎおよびＣＯＳ θ２、ＣＯ
３θ２・・・・・・ＣＯ３θｎを作り出している。この
こＳＩＮ θ、 〜ＳＩＮ θｎおよびＣＯＳ θ＋
〜ＣＯ３θｎのデジタル量の大きさを表している。すな
わち、各矢印の長さは、仮想線で示すアナログカラーサ
ブキャリアの時間毎の振幅値に対応しているから、第２
図で示した変調波形をデジタル処理によって得ることが
できる。
このように本実施例ではカラーサブキャリアをデジタル
量で表しているので、平衡変調処理を含む回路各部を、
デジタル処理とすることができる。
量で表しているので、平衡変調処理を含む回路各部を、
デジタル処理とすることができる。
したがって、集積化に適した回路構成とすることができ
、例えば、第１図に仮想線で囲んだ範囲を１つのチップ
に収めることができる。その結果、調整作業の簡素化と
相まって製造コストの削減を図ることができる。また、
各種補償回路等を特別に組込まなくてもよいので、設計
コストの削減も図れる。さらに、複合映像信号を生成し
た後にアナログ変換をすればよいので、Ｄ／Ａ変換器が
１つで済み、システム構成上好ましいものとなる。
、例えば、第１図に仮想線で囲んだ範囲を１つのチップ
に収めることができる。その結果、調整作業の簡素化と
相まって製造コストの削減を図ることができる。また、
各種補償回路等を特別に組込まなくてもよいので、設計
コストの削減も図れる。さらに、複合映像信号を生成し
た後にアナログ変換をすればよいので、Ｄ／Ａ変換器が
１つで済み、システム構成上好ましいものとなる。
また、上記実施例では基本クロックＣｃｋの周波数が異
なる別のＣＰＩＩを用いる際には、ｆｓｃ （ｆｓｃ
＝３．５８ＭＨｚ ）と当＝亥Ｃｃｋとの比に従って
ＶＡＬを適当に変更すればよく、システム構成の変更に
柔軟性良く対応できる。
なる別のＣＰＩＩを用いる際には、ｆｓｃ （ｆｓｃ
＝３．５８ＭＨｚ ）と当＝亥Ｃｃｋとの比に従って
ＶＡＬを適当に変更すればよく、システム構成の変更に
柔軟性良く対応できる。
なお、上記実施例では、２つの色度信号を２つの色差信
号Ｒ−Ｙ、Ｂ−Ｙとし、これらの信号を用いて平衡変調
を行ったが、色度信号をＩ−Ｑ信号としてもよい。この
場合、前式■、■は次式■′、■′に変更される。
号Ｒ−Ｙ、Ｂ−Ｙとし、これらの信号を用いて平衡変調
を行ったが、色度信号をＩ−Ｑ信号としてもよい。この
場合、前式■、■は次式■′、■′に変更される。
０．６ Ｒ−０，２８Ｃ，−０，３２Ｂ ＝ Ｉ・・・
・・・■′０．２１Ｒ−０，５２Ｇ＋０．３１Ｂ＝Ｑ・
・・・・・■′また、Ｉ−Ｑの場合には、■側のローパ
スフィルタに０〜１．５ＭＨｚの通常帯域を持たせ、さ
らに、ＳＴＮ θとＣＯＳ θとを各々、ＳＩＮ （
θ＋３３°）、ＣＯＳ （θ＋３３°）とすればよい
。
・・・■′０．２１Ｒ−０，５２Ｇ＋０．３１Ｂ＝Ｑ・
・・・・・■′また、Ｉ−Ｑの場合には、■側のローパ
スフィルタに０〜１．５ＭＨｚの通常帯域を持たせ、さ
らに、ＳＴＮ θとＣＯＳ θとを各々、ＳＩＮ （
θ＋３３°）、ＣＯＳ （θ＋３３°）とすればよい
。
本発明によれば、平衡変調を含む各処理をデジタル量で
行うことができるので、回路各部をデジタル構成にして
集積化に適したものとすることができ、製造コストおよ
び設計コストの削減を図ることができる。
行うことができるので、回路各部をデジタル構成にして
集積化に適したものとすることができ、製造コストおよ
び設計コストの削減を図ることができる。
第１〜３図は本発明に係る複合映像信号生成方法の一実
施例を示す図であり、 第１図はその複合映像信号生成方法を適用したカラーエ
ンコーダ装置の構成図、 第２図はその平衡変調動作を示す波形図、第３図はその
デジタル量で表したカラーサブキャリアを示す概念図、 第４図は従来のカラーエンコーダ装置の構成図である。 ＩＯ・・・・・・マトリクス回路、 １１．１２・・・・・・デジタルローパスフィルタ、１
３．１４・・・・・・デジタル乗算器、１５・・・・・
・サブキャリア生成回路、１６．２０・・・・・・デジ
タル加算回路、１７・・・・・・レジスタ、 １８・・・・・・ＣＯＳ （θ〕発生器、１９・・・
・・・ＳＩＮ （θ〕発生器、２１・・・・・・デジ
タルデイレイライン、２２・・・・・・Ｄ／Ａ変換器、 ＶＡＬ・・・・・・動作設定定数（ｆｓｃ／ｆａ）、Ｃ
ｃｋ・・・・・・基本クロック（サンプリング周波数ｆ
ａ）。 ５ト鍾ｔ１タ淀ピを巧弓動イ下乏仁テｒ、Ｔ洩４ｉ蔦
２目 アナロブ゛饗泗カラーサフキＹリアｌζギ目当／
施例を示す図であり、 第１図はその複合映像信号生成方法を適用したカラーエ
ンコーダ装置の構成図、 第２図はその平衡変調動作を示す波形図、第３図はその
デジタル量で表したカラーサブキャリアを示す概念図、 第４図は従来のカラーエンコーダ装置の構成図である。 ＩＯ・・・・・・マトリクス回路、 １１．１２・・・・・・デジタルローパスフィルタ、１
３．１４・・・・・・デジタル乗算器、１５・・・・・
・サブキャリア生成回路、１６．２０・・・・・・デジ
タル加算回路、１７・・・・・・レジスタ、 １８・・・・・・ＣＯＳ （θ〕発生器、１９・・・
・・・ＳＩＮ （θ〕発生器、２１・・・・・・デジ
タルデイレイライン、２２・・・・・・Ｄ／Ａ変換器、 ＶＡＬ・・・・・・動作設定定数（ｆｓｃ／ｆａ）、Ｃ
ｃｋ・・・・・・基本クロック（サンプリング周波数ｆ
ａ）。 ５ト鍾ｔ１タ淀ピを巧弓動イ下乏仁テｒ、Ｔ洩４ｉ蔦
２目 アナロブ゛饗泗カラーサフキＹリアｌζギ目当／
Claims (1)
- 【特許請求の範囲】 周波数ｆｓｃのサブキャリアを用いて２つの色度信号を
平衡変調した後、輝度信号とともに合成し、複合映像信
号を生成する複合映像信号生成方法において、 前記サブキャリアは、原色信号のサンプリング周期１／
ｆａとサブキャリアの周期１／ｆｓｃの比（ｆｓｃ／ｆ
ａ）を順次整数倍して時間軸上に配列し、該配列の各々
について、ＳＩＮ、ＣＯＳ変換処理を行ってデジタル量
で表したことを特徴とする複合映像信号生成方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1026851A JP2539024B2 (ja) | 1988-06-30 | 1989-02-06 | 複合映像信号生成方法 |
| US07/369,075 US4982179A (en) | 1988-06-30 | 1989-06-20 | Composite video signal generation method and device |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63-163608 | 1988-06-30 | ||
| JP16360888 | 1988-06-30 | ||
| JP1026851A JP2539024B2 (ja) | 1988-06-30 | 1989-02-06 | 複合映像信号生成方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0278392A true JPH0278392A (ja) | 1990-03-19 |
| JP2539024B2 JP2539024B2 (ja) | 1996-10-02 |
Family
ID=26364699
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1026851A Expired - Fee Related JP2539024B2 (ja) | 1988-06-30 | 1989-02-06 | 複合映像信号生成方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4982179A (ja) |
| JP (1) | JP2539024B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0462712A2 (en) * | 1990-05-31 | 1991-12-27 | Mitsubishi Denki Kabushiki Kaisha | Signal processor for video printer |
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| JP2563692B2 (ja) * | 1991-06-28 | 1996-12-11 | 松下電器産業株式会社 | ディジタル処理によるｐａｌ方式映像信号発生装置 |
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| KR100246911B1 (ko) * | 1996-01-11 | 2000-03-15 | 윤종용 | 휘도신호와 색호간의 지연차 자동 보상 장치 및 방법 |
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| GB2059711B (en) * | 1979-09-12 | 1983-07-20 | British Broadcasting Corp | Digital demodulation or modulation of television chrominance signals |
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| US4694326A (en) * | 1986-03-28 | 1987-09-15 | Rca Corporation | Digital phase locked loop stabilization circuitry including a secondary digital phase locked loop which may be locked at an indeterminate frequency |
| JPH07112287B2 (ja) * | 1986-10-20 | 1995-11-29 | 松下電器産業株式会社 | デイジタルカラ−エンコ−ダ |
-
1989
- 1989-02-06 JP JP1026851A patent/JP2539024B2/ja not_active Expired - Fee Related
- 1989-06-20 US US07/369,075 patent/US4982179A/en not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
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Also Published As
| Publication number | Publication date |
|---|---|
| US4982179A (en) | 1991-01-01 |
| JP2539024B2 (ja) | 1996-10-02 |
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