JPH0232154U - - Google Patents

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JPH0232154U
JPH0232154U JP10845288U JP10845288U JPH0232154U JP H0232154 U JPH0232154 U JP H0232154U JP 10845288 U JP10845288 U JP 10845288U JP 10845288 U JP10845288 U JP 10845288U JP H0232154 U JPH0232154 U JP H0232154U
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arithmetic
next instruction
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Description

【図面の簡単な説明】
第１図はこの考案の一実施例による情報処理制
御装置を説明するための図、第２図は従来の情報
処理制御装置を説明するための図である。 １は命令先取りキユーレジスタ、２は次命令レ
ジスタ、３は命令レジスタ、４は演算制御部、２
は演算処理部、６は入力データレジスタ、７は比
較器、８は論理和回路である。図中、同一あるい
は相当部分には同一符号を付してある。

Claims (1)

    【実用新案登録請求の範囲】
  1. 順次実行すべき命令を予め取り込み、待行列に
    格納する命令先取りキユーレジスタと、この命令
    先取りキユーレジスタから出力されたデータを次
    に実行すべき命令として保持する次命令レジスタ
    と、次の命令サイクルでこの出力を格納し、現在
    実行中の命令として保持する命令レジスタと、命
    令先取りキユーレジスタと次命令レジスタの出力
    から演算制御信号を生成する演算制御部と、この
    演算制御信号に従つて演算処理を行い、また、命
    令ブレーク等の割り込み処理をも行う演算処理部
    とからなる情報処理装置において、外部より入力
    したデータと制御コマンドを保持する入力データ
    レジスタと、この入力データレジスタの内容と次
    命令レジスタ及び命令レジスタの内容を比較する
    比較器と、比較した結果を基にブレーク信号を発
    生制御するブレーク制御器と、ブレーク制御器よ
    り出力されるブレーク信号と外部から入力するブ
    レーク信号の論理和を取つて演算処理部に伝える
    回路部分からなる機器構成をとることによつて、
    入力データレジスタに外部から設定した制御コマ
    ンドとデータをもとに条件を設定し、内部の命令
    実行動作がこの条件を満たした場合にブレーク割
    り込みを発生し、命令の実行を停止することを特
    徴とした情報処理制御装置。
JP10845288U 1988-08-18 1988-08-18 Pending JPH0232154U (ja)

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JP10845288U JPH0232154U (ja) 1988-08-18 1988-08-18

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JPH0232154U true JPH0232154U (ja) 1990-02-28

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