JPH01302940A - 動作モード設定可能なｌａｎ間結合装置 - Google Patents
動作モード設定可能なｌａｎ間結合装置Info
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- JPH01302940A JPH01302940A JP63131561A JP13156188A JPH01302940A JP H01302940 A JPH01302940 A JP H01302940A JP 63131561 A JP63131561 A JP 63131561A JP 13156188 A JP13156188 A JP 13156188A JP H01302940 A JPH01302940 A JP H01302940A
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/46—Interconnection of networks
- H04L12/4604—LAN interconnection over a backbone network, e.g. Internet, Frame Relay
- H04L12/462—LAN interconnection over a bridge based backbone
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ＬＡＮ間で情報フレームを転送するための、
ＬＡＮ間結合装置（しばしばブリッジと呼ばれる）に関
する。
ＬＡＮ間結合装置（しばしばブリッジと呼ばれる）に関
する。
従来のＬＡＮ間結合装置、例えば、１−一クンリング用
のブリッジは、一方のＬＡＮから他方への転送とその逆
の転送を、双方向（全二重）様式で行なうものであり、
かつ、そのような動作しかできない。従来のＬＡＮ間結
合装置の例は、特開昭６０−２６４１．４２号公報、同
６０−１５２５４５号公報等に記載されている。
のブリッジは、一方のＬＡＮから他方への転送とその逆
の転送を、双方向（全二重）様式で行なうものであり、
かつ、そのような動作しかできない。従来のＬＡＮ間結
合装置の例は、特開昭６０−２６４１．４２号公報、同
６０−１５２５４５号公報等に記載されている。
ＬＡＮ間転送のトラヒックが大きくなると、ＬＡＮ間結
合装置内で、オーバランによるフレームの消失が生じ、
その結果、再送が多発して、事態はますます悪化する。
合装置内で、オーバランによるフレームの消失が生じ、
その結果、再送が多発して、事態はますます悪化する。
このような事態を改善しようとして、従来の双方向結合
装置を単に追加しても、効果的な解決にはならない。２
台の結合装置の間で負荷を効率良く分配するための機構
がないからである。双方向結合装置間で負荷を分配する
ための機構として各種のものが考えられるが、それらは
、ハードウェア量及び／又はソフトウェア量の著しい増
大を招くか、システムを複雑化するか、融通性を欠くか
、負荷分散の効率が良くないか、いずれにせよ、不満を
残すものである。
装置を単に追加しても、効果的な解決にはならない。２
台の結合装置の間で負荷を効率良く分配するための機構
がないからである。双方向結合装置間で負荷を分配する
ための機構として各種のものが考えられるが、それらは
、ハードウェア量及び／又はソフトウェア量の著しい増
大を招くか、システムを複雑化するか、融通性を欠くか
、負荷分散の効率が良くないか、いずれにせよ、不満を
残すものである。
本発明の課題は、双方向結合装置又は単向結合装置のい
ずれとしても簡単に切替えて使用しうるＬＡＮ間結合装
置を、ハードウェア及びソフトウェアのさしたる増大も
変更もなしに提供し、それにより、ＬＡＮ間フレーム転
送トラヒックの変化に、容易に、かつ効率良く、対処し
うるようにすることにある。
ずれとしても簡単に切替えて使用しうるＬＡＮ間結合装
置を、ハードウェア及びソフトウェアのさしたる増大も
変更もなしに提供し、それにより、ＬＡＮ間フレーム転
送トラヒックの変化に、容易に、かつ効率良く、対処し
うるようにすることにある。
本発明のＬＡＮ間結合装置は、第１のＬＡＮに接続され
た送受信部と第２のＬＡＮに接続された送受信部のそれ
ぞれを、第１及び第２の動作モードの任意の一方に設定
するための手段と、第１の動作モードに設定された送受
信部から他方の送受信部への中継フレーム（ＬＡＮ間で
転送されるべきフレーム）の転送は許すが、第２の動作
モードに設定された送受信部から他方の送受信部への中
継フレームの転送は禁止するモード制御部とを備える。
た送受信部と第２のＬＡＮに接続された送受信部のそれ
ぞれを、第１及び第２の動作モードの任意の一方に設定
するための手段と、第１の動作モードに設定された送受
信部から他方の送受信部への中継フレーム（ＬＡＮ間で
転送されるべきフレーム）の転送は許すが、第２の動作
モードに設定された送受信部から他方の送受信部への中
継フレームの転送は禁止するモード制御部とを備える。
好ましい実施態様として、各送受信部が、信号処理を行
なうフィジカル制御ステージと、他方のＬＡＮへの中継
フレームのコピーその他のフレーム処理を行なうＭＡＣ
層制御ステージとを含む場合に、前記のモード制御手段
は、ＭＡ（Ｊ制御部における中継フレームのコピーを、
動作モードに従って許可又は禁止する。
なうフィジカル制御ステージと、他方のＬＡＮへの中継
フレームのコピーその他のフレーム処理を行なうＭＡＣ
層制御ステージとを含む場合に、前記のモード制御手段
は、ＭＡ（Ｊ制御部における中継フレームのコピーを、
動作モードに従って許可又は禁止する。
本発明によるＬＡＮ間結合装置は、双方の送受信部が第
一の動作モードに設定されれば、双方向結合装置として
機能し、一方の送受信部が第１の動作モードに設定され
るとともに他方の送受信部が第２の動作モードに設定さ
れれば、第１の動作モードの送受信部に接続されたＬＡ
Ｎから他方のＬＡＮへの単向結合装置として機能する。
一の動作モードに設定されれば、双方向結合装置として
機能し、一方の送受信部が第１の動作モードに設定され
るとともに他方の送受信部が第２の動作モードに設定さ
れれば、第１の動作モードの送受信部に接続されたＬＡ
Ｎから他方のＬＡＮへの単向結合装置として機能する。
しかも、それらの間の切替えの手続きは、極めて簡単で
ある。
ある。
送受信部間の転送の許否を、ＭＡＣ層制御ステージにお
ける中継フレームのコピーの許否として行なえば、無益
な処理が最少限に抑えられる。
ける中継フレームのコピーの許否として行なえば、無益
な処理が最少限に抑えられる。
以下において、トークンリングＬＡＮ用のリング間結合
装置に適用された本発明を説明する。第１図は、本発明
の一実施例であるリング間結合装置の概要を示す。この
リング間結合装置１０は、トークリング１ａと１ｂに接
続されて、それらの間の通信を、ＩＥＥＥ８０２ 、５
規格のプロトコルに従って遂行する。リング間結合装置
１ｏは、りング１ａ及び１ｂにそれぞれ接続されるフィ
ジカル制御部（ＰＲＹ）ｌｌａ及びｌｌｂと、これらに
それぞれ接続されるＭＡＣ層（Ｍｅｄｉａ Ａｃｃｅｓ
ｓＣｏｎｔｒｏｌ Ｌａｙｅｒ）制御部（ＭＡＣ）１２
ａ及び１２ｂと、マイクロプロセッサ（ＭＰＵ）１４と
、メモリ（ＭＥＭ）１５と、ダイレクトメモリアクセス
コントローラ（ＤＭＡＣ１以ｌＤＭＡコントローラと略
記）１６を含み、バス１３が、ＭＡＣ層制御部１２ａ、
１２ｂと、マイクロプロセッサ１４と、メモリ１５と、
ＤＭＡコントローラ１６を相互接続する。
装置に適用された本発明を説明する。第１図は、本発明
の一実施例であるリング間結合装置の概要を示す。この
リング間結合装置１０は、トークリング１ａと１ｂに接
続されて、それらの間の通信を、ＩＥＥＥ８０２ 、５
規格のプロトコルに従って遂行する。リング間結合装置
１ｏは、りング１ａ及び１ｂにそれぞれ接続されるフィ
ジカル制御部（ＰＲＹ）ｌｌａ及びｌｌｂと、これらに
それぞれ接続されるＭＡＣ層（Ｍｅｄｉａ Ａｃｃｅｓ
ｓＣｏｎｔｒｏｌ Ｌａｙｅｒ）制御部（ＭＡＣ）１２
ａ及び１２ｂと、マイクロプロセッサ（ＭＰＵ）１４と
、メモリ（ＭＥＭ）１５と、ダイレクトメモリアクセス
コントローラ（ＤＭＡＣ１以ｌＤＭＡコントローラと略
記）１６を含み、バス１３が、ＭＡＣ層制御部１２ａ、
１２ｂと、マイクロプロセッサ１４と、メモリ１５と、
ＤＭＡコントローラ１６を相互接続する。
フィジカル制御部１１ａ、ｌｌｂは、このリング間結合
装置１０とリング１ａ及び１ｂの間で授受される信号の
符号化と復号、リング上の信号の異常の検出、ジッタの
吸収などを行なう。ＭＡＣ層制御部１２ａと１２ｂは、
それぞれリング１ａを１ｂの状態を監視して、トークン
の生成、管理用に送出するＭＡＣフレームの生成、リン
グ上を到来する処理対象フレームのコピー（受領）など
を行なう。マイクロプロセッサ１４は、メモリ１５に格
納されているフレーム中継制御プログラムに従って、Ｍ
ＡＣ層制御部１２ａ、１２ｂにコマンドを送り、かつ、
それらからのレスポンスを受け、更に、ＭＡＣ層制御部
１２ａ、１２ｂとメモリ１５の間のダイレクトメモリア
クセスによるデータ転送のために、ＤＭＡコントローラ
１６へのパラメータ設定と、それの起動を行なう。
装置１０とリング１ａ及び１ｂの間で授受される信号の
符号化と復号、リング上の信号の異常の検出、ジッタの
吸収などを行なう。ＭＡＣ層制御部１２ａと１２ｂは、
それぞれリング１ａを１ｂの状態を監視して、トークン
の生成、管理用に送出するＭＡＣフレームの生成、リン
グ上を到来する処理対象フレームのコピー（受領）など
を行なう。マイクロプロセッサ１４は、メモリ１５に格
納されているフレーム中継制御プログラムに従って、Ｍ
ＡＣ層制御部１２ａ、１２ｂにコマンドを送り、かつ、
それらからのレスポンスを受け、更に、ＭＡＣ層制御部
１２ａ、１２ｂとメモリ１５の間のダイレクトメモリア
クセスによるデータ転送のために、ＤＭＡコントローラ
１６へのパラメータ設定と、それの起動を行なう。
ＭＡＣ層制御部１２ａ、１２ｂのそれぞれは、従来のも
のと同様に、それに接続されたフィジカル制御部から受
取ったリング上の到来フレームを、応答の表示のために
必要に応じて一部を変更する以外はそのまま、フィジカ
ル制御部を経てリングの下流に送出、すなわちリピート
する機能と、そのフレームが中継フレーム（他方のリン
グに転送すべきフレーム、ブリッジフレームとも呼ばれ
る）であれば、それ髪コピーし、メモリ１５を介して他
方のＭＡＣ層制御部に渡す機能と、メモリ１５を介して
他方のＭＡＣ層制御部から渡された中継フレームを、そ
れに接続されたフィジカル制御部を経てリングに送出す
る機能とを持つ。本発明により、動作モードレジスタ１
２１ａ及び１２１ｂがＭＡＣ層制御部１２ａ及び１２ｂ
にそれぞれ設けられる。後で詳述するように、それぞれ
の動作モードレジスタに設定される動作モードが第１の
モードを示すか第２のモードを示すかに従って、各ＭＡ
Ｃ層制御部は、前述した中継フレームをコピーして転送
する機能が能動化又は抑止される。
のと同様に、それに接続されたフィジカル制御部から受
取ったリング上の到来フレームを、応答の表示のために
必要に応じて一部を変更する以外はそのまま、フィジカ
ル制御部を経てリングの下流に送出、すなわちリピート
する機能と、そのフレームが中継フレーム（他方のリン
グに転送すべきフレーム、ブリッジフレームとも呼ばれ
る）であれば、それ髪コピーし、メモリ１５を介して他
方のＭＡＣ層制御部に渡す機能と、メモリ１５を介して
他方のＭＡＣ層制御部から渡された中継フレームを、そ
れに接続されたフィジカル制御部を経てリングに送出す
る機能とを持つ。本発明により、動作モードレジスタ１
２１ａ及び１２１ｂがＭＡＣ層制御部１２ａ及び１２ｂ
にそれぞれ設けられる。後で詳述するように、それぞれ
の動作モードレジスタに設定される動作モードが第１の
モードを示すか第２のモードを示すかに従って、各ＭＡ
Ｃ層制御部は、前述した中継フレームをコピーして転送
する機能が能動化又は抑止される。
したがって、両ＭＡＣ層制御部の動作モードが第１モー
ドに設定されれば、リング間結合装置１０は双方向（全
二重）結合装置として機能し、一方が第１モードで他方
が第２モードに設定されれば、リング間結合装置１０は
単向結合装置として機能する。
ドに設定されれば、リング間結合装置１０は双方向（全
二重）結合装置として機能し、一方が第１モードで他方
が第２モードに設定されれば、リング間結合装置１０は
単向結合装置として機能する。
第２図は、ＭＡＣ層制御部１２（以下において、参照符
号の添字ａ、ｂを省くことにより、同一構造の一対の要
素を代表する）の本発明に関連する部分の詳細を示す。
号の添字ａ、ｂを省くことにより、同一構造の一対の要
素を代表する）の本発明に関連する部分の詳細を示す。
直並列変換回路２６は、フィジカル制御部（ＰＨＹ）１
１からのビット直列信号３４をキャラクタ列に組立てて
、このキャラクタ列を受信シブタ２３に送り、その間に
、フレー−７＝ ムの先頭にあるデリミタの検出を示すデリミタ検出信号
３１と、各キャラクタの受信シフタ２３への送出と同期
するキャラクタバウンダリ信号３２を発生する。受信フ
レームバイトカウンタ２７は、デリミタ検出信号３１と
キャラクタバウンダリ信号３２を受けて、受信フレーム
のバイト数を積算し、フレームのヘッダ部分が受信シフ
タ２３に入り終った時に、ヘッダ取込み指示信号３３と
割込起動信号３６を発生する。ヘッダレジスタ２５は、
ヘッダ取込み指示信号３３が発生された時に、受信フレ
ームのヘッダ部分を受信シフタ２３から取込む。ヘッダ
は、ＡＣ（Ａｃｃｅｓｓ Ｃｏｎｔｒｏｌ）とＦＣ（Ｆ
ｒａｍｅ Ｃｏｎｔｒｏｌ）とＤ Ａ （Ｄｅｓｔｉｎ
ａｔｉｏｎＡｄｄｒｅｓｓ）とＳ Ａ （Ｓｏｕｒｃｅ
Ａｄｄｒｅｓｓ）を含み、ＳＡの先頭ビットはそのフ
レームが中継フレームであるか否かを示す。書込ポイン
タ制御回路２４は、マイクロプロセッサ２０からの受信
指令３７と受信シフタ２３からの書込指示信号３８を受
けて、受信バッファ２１の書込ポインタの更新と書込動
作の制御を行なう。書込指示信号３８は、受信シフタ２
３から受信バッファ２１へのデータ転送が行なわれる時
に、１バイトごとに発生される。
１からのビット直列信号３４をキャラクタ列に組立てて
、このキャラクタ列を受信シブタ２３に送り、その間に
、フレー−７＝ ムの先頭にあるデリミタの検出を示すデリミタ検出信号
３１と、各キャラクタの受信シフタ２３への送出と同期
するキャラクタバウンダリ信号３２を発生する。受信フ
レームバイトカウンタ２７は、デリミタ検出信号３１と
キャラクタバウンダリ信号３２を受けて、受信フレーム
のバイト数を積算し、フレームのヘッダ部分が受信シフ
タ２３に入り終った時に、ヘッダ取込み指示信号３３と
割込起動信号３６を発生する。ヘッダレジスタ２５は、
ヘッダ取込み指示信号３３が発生された時に、受信フレ
ームのヘッダ部分を受信シフタ２３から取込む。ヘッダ
は、ＡＣ（Ａｃｃｅｓｓ Ｃｏｎｔｒｏｌ）とＦＣ（Ｆ
ｒａｍｅ Ｃｏｎｔｒｏｌ）とＤ Ａ （Ｄｅｓｔｉｎ
ａｔｉｏｎＡｄｄｒｅｓｓ）とＳ Ａ （Ｓｏｕｒｃｅ
Ａｄｄｒｅｓｓ）を含み、ＳＡの先頭ビットはそのフ
レームが中継フレームであるか否かを示す。書込ポイン
タ制御回路２４は、マイクロプロセッサ２０からの受信
指令３７と受信シフタ２３からの書込指示信号３８を受
けて、受信バッファ２１の書込ポインタの更新と書込動
作の制御を行なう。書込指示信号３８は、受信シフタ２
３から受信バッファ２１へのデータ転送が行なわれる時
に、１バイトごとに発生される。
マイクロプロセッサ２０は１割込発生回路３０が割込起
動信号３６を受けて発生する割込要求に応答して、ヘッ
ダレジスタ２５からヘッダ情報を読込み、解析する。特
に本発明に関しては、ＳＡの先頭ビットが中継フレーム
を示すか否かが調べられる。動作モードレジスタ１２１
の内容は、セットアツプ処理により設定され、中継フレ
ーム受信指示ビットを含む。この中継フレーム受信指示
ビットが“１”の場合、マイクロプロセッサ２０は、ヘ
ッダ解析の結果が中継フレームを示すと、受信指令３７
を発生して、受信バッファ２１への受信フレームの書込
み、すなわちコピーを行ない、次いで、受信バッファ２
１の内容をメモリ１５に転送すべく、ＤＭＡコントロー
ラ１６の起動を要求する。他方、中継フレーム受信指示
ビットが“０”ならば、マイクロプロセッサ２０は、ヘ
ッダ解析の結果が中継フレームを示しても、受信指令３
７を発生せず、その結果、受信フレームの受信バッファ
２１への書込み、したがって他方のリングへの転送は、
実行されず、リピートのみが行なわれる。
動信号３６を受けて発生する割込要求に応答して、ヘッ
ダレジスタ２５からヘッダ情報を読込み、解析する。特
に本発明に関しては、ＳＡの先頭ビットが中継フレーム
を示すか否かが調べられる。動作モードレジスタ１２１
の内容は、セットアツプ処理により設定され、中継フレ
ーム受信指示ビットを含む。この中継フレーム受信指示
ビットが“１”の場合、マイクロプロセッサ２０は、ヘ
ッダ解析の結果が中継フレームを示すと、受信指令３７
を発生して、受信バッファ２１への受信フレームの書込
み、すなわちコピーを行ない、次いで、受信バッファ２
１の内容をメモリ１５に転送すべく、ＤＭＡコントロー
ラ１６の起動を要求する。他方、中継フレーム受信指示
ビットが“０”ならば、マイクロプロセッサ２０は、ヘ
ッダ解析の結果が中継フレームを示しても、受信指令３
７を発生せず、その結果、受信フレームの受信バッファ
２１への書込み、したがって他方のリングへの転送は、
実行されず、リピートのみが行なわれる。
リピートは、直並列変換回路３４から、ビット書替回路
２９と並直列変換回路２８を経て行なわれる。ビット書
替え回路２９は、リピートされるフレームがこの装置の
処理対象である場合に、応答表示用のビット（Ａビット
、Ｃビット）の書替えを行なう。なお、メモリ１５から
転送される他方のＭＡＣ層制御部からの中継フレームは
、送信バッファ２２に受取られ、そこから並直列変換回
路２８を経て、フィジカル制御部（ＰＨＹ）１１へ送ら
れる。
２９と並直列変換回路２８を経て行なわれる。ビット書
替え回路２９は、リピートされるフレームがこの装置の
処理対象である場合に、応答表示用のビット（Ａビット
、Ｃビット）の書替えを行なう。なお、メモリ１５から
転送される他方のＭＡＣ層制御部からの中継フレームは
、送信バッファ２２に受取られ、そこから並直列変換回
路２８を経て、フィジカル制御部（ＰＨＹ）１１へ送ら
れる。
第２図に示されたＭＡＣ層制御部の総合的動作を、次に
簡潔に述べる。
簡潔に述べる。
リング１からの受信データの中にフレーム開始のデリミ
タを検出すると、受信フレームバイトカウンタ２７は、
バイトのカウントを開始し、ヘッダ部分が受信シフタ２
３に入った時に、ヘッダ取込み指示信号８３を出す。こ
の信号３３により、受信シフタ２３内のヘッダ情報はヘ
ッダレジスタ２５に格納される。
タを検出すると、受信フレームバイトカウンタ２７は、
バイトのカウントを開始し、ヘッダ部分が受信シフタ２
３に入った時に、ヘッダ取込み指示信号８３を出す。こ
の信号３３により、受信シフタ２３内のヘッダ情報はヘ
ッダレジスタ２５に格納される。
マイクロプロセッサ２０は、割込発生回路３０からの割
込要求を契機に、ヘッダレジスタ２５の内容を読出して
、ヘッダ情報を解析する。その結果、このフレームは他
のリングへの中継フレームであることがわかると、中継
フレーム受信指示ビットがＬＬ Ｉ ＩＩならば、受信
バッファ２１を経由して、メモリ１５への転送が行なわ
れ、中継フレーム受信指示ビットがＩＩ ＯＩＩならば
、受信バッファ２１への書込みは行なわれず、したがっ
て、他リングへの中継フレームではあるが、他方のＭＡ
Ｃ層制御部への転送１４行なわれない。
込要求を契機に、ヘッダレジスタ２５の内容を読出して
、ヘッダ情報を解析する。その結果、このフレームは他
のリングへの中継フレームであることがわかると、中継
フレーム受信指示ビットがＬＬ Ｉ ＩＩならば、受信
バッファ２１を経由して、メモリ１５への転送が行なわ
れ、中継フレーム受信指示ビットがＩＩ ＯＩＩならば
、受信バッファ２１への書込みは行なわれず、したがっ
て、他リングへの中継フレームではあるが、他方のＭＡ
Ｃ層制御部への転送１４行なわれない。
次に、第３図を参照して、動作モードの設定によるリン
グ間結合装置の使い分けの例を説明する。
グ間結合装置の使い分けの例を説明する。
第３図（ａ）に示すように、リング」ａと１ｂが始めて
接続された時点で、ステーション２８〜２ｍ及び３８〜
３ｎの数が未だ少なく、リング１ａと１ｂの間のフレー
ム転送の１−ラヒツクがさほど大きくなければ、１台の
リング間結合装置１０を設け、それの両ＭＡ（Ｊ制御部
１２ａと１２ｂにおける中継フレーム受信指示ビットを
、共にｒｒ １ ＋１に設定する。この状態では、リン
グ間結合装置１ｏは双方向結合装置として機能し、リン
グ１ａから１ｂ及びその逆への中継フレームの双方を、
従来装置と同様に、全二重様式で処理する。
接続された時点で、ステーション２８〜２ｍ及び３８〜
３ｎの数が未だ少なく、リング１ａと１ｂの間のフレー
ム転送の１−ラヒツクがさほど大きくなければ、１台の
リング間結合装置１０を設け、それの両ＭＡ（Ｊ制御部
１２ａと１２ｂにおける中継フレーム受信指示ビットを
、共にｒｒ １ ＋１に設定する。この状態では、リン
グ間結合装置１ｏは双方向結合装置として機能し、リン
グ１ａから１ｂ及びその逆への中継フレームの双方を、
従来装置と同様に、全二重様式で処理する。
その後、第３図（ｂ）に示すように、ステーション２ａ
〜２ｐと３ａ〜３ｑの数が増し、リング間のフレーム転
送のトラヒックが増すと、１台のリング間結合装置によ
る双方向転送では対処し切れなくなる。そこで、もう１
台のリング間結合装置１０’ を追加し、それのリング
１ａ側のＭＡＣ。
〜２ｐと３ａ〜３ｑの数が増し、リング間のフレーム転
送のトラヒックが増すと、１台のリング間結合装置によ
る双方向転送では対処し切れなくなる。そこで、もう１
台のリング間結合装置１０’ を追加し、それのリング
１ａ側のＭＡＣ。
層制御部１２′ ａにおける中継フレーム受信指示ビッ
トをＩＩ ＯＩＩに設定するとともに、リング１ｂ側の
ＭＡＣ層制御部１２′ｂにおける中継フレーム受信指示
ビットをＬＬ Ｉ ＩＩに設定し、同時に、旧来のリン
グ間結合装置１ｏのリング１ｂ側のＭＡＣ層制御部１２
ｂにおける中継フレーム受信指示ビットを、ｒｒ ＯＩ
Ｉに変更する。
トをＩＩ ＯＩＩに設定するとともに、リング１ｂ側の
ＭＡＣ層制御部１２′ｂにおける中継フレーム受信指示
ビットをＬＬ Ｉ ＩＩに設定し、同時に、旧来のリン
グ間結合装置１ｏのリング１ｂ側のＭＡＣ層制御部１２
ｂにおける中継フレーム受信指示ビットを、ｒｒ ＯＩ
Ｉに変更する。
この状態において、リング１ａを流れるフレーム中、他
リングへ転送すべき中継フレームは、リング間結合装置
１０内のＭＡＣ層制御部１２ａでコピー（受領）されて
、共通制御部（第１図１４〜１６）を介して他方のＭＡ
Ｃ層制御部１２ｂへ渡され、リング１ｂへ転送される。
リングへ転送すべき中継フレームは、リング間結合装置
１０内のＭＡＣ層制御部１２ａでコピー（受領）されて
、共通制御部（第１図１４〜１６）を介して他方のＭＡ
Ｃ層制御部１２ｂへ渡され、リング１ｂへ転送される。
一方、リング１ｂを流れる他リングへの中継フレームは
、リング間結合装置１０内のＭＡＣ層制御部１２ｂでは
コピー（受領）されない。したがって、リング間結合装
置１０では、リング１ａからリング１ｂへの転送のみが
可能となる。これに対して、リング間結合装置１０′に
おいては、同様にして、リング１ｂからリング１ａへの
転送のみが可能となる。
、リング間結合装置１０内のＭＡＣ層制御部１２ｂでは
コピー（受領）されない。したがって、リング間結合装
置１０では、リング１ａからリング１ｂへの転送のみが
可能となる。これに対して、リング間結合装置１０′に
おいては、同様にして、リング１ｂからリング１ａへの
転送のみが可能となる。
したがって、リング間結合装置１０と１０′のそれぞれ
は、一方向のリング間転送処理にのみ専念することがで
き、それにより、倍加したリング間転送１−ラヒツクを
混乱なくさばくことができる。
は、一方向のリング間転送処理にのみ専念することがで
き、それにより、倍加したリング間転送１−ラヒツクを
混乱なくさばくことができる。
あるいは、これと逆に、リング間転送トラヒックの減少
に応じて、第３図（ｂ）の構成を同（ａ）のように変更
することもできる。
に応じて、第３図（ｂ）の構成を同（ａ）のように変更
することもできる。
前述の実施例では、中継フレームの転送の可否が、ＭＡ
Ｃ層制御部内の受信バッファへの書込み（コピー）の段
階において、その可否として実現された。この方法が、
装置の負荷を最小にする点で、最も好ましいと考えられ
る。しかしながら、それは、他の段階における処理の可
否として実現されても、本質的な支障はない。例えば、
受信バッファから共用メモリ（第１図１５）への転送の
段階でもよいし、共用メモリから他方のＭＡＣ層制御部
内の送信バッファへの転送の段階でもよい。
Ｃ層制御部内の受信バッファへの書込み（コピー）の段
階において、その可否として実現された。この方法が、
装置の負荷を最小にする点で、最も好ましいと考えられ
る。しかしながら、それは、他の段階における処理の可
否として実現されても、本質的な支障はない。例えば、
受信バッファから共用メモリ（第１図１５）への転送の
段階でもよいし、共用メモリから他方のＭＡＣ層制御部
内の送信バッファへの転送の段階でもよい。
また、本発明は、トークンリング以外の型式のＬＡＮの
ための結合装置にも適用できる。
ための結合装置にも適用できる。
本発明によれば、１台のＬＡＮ間結合装置を、双方向結
合装置として使用することも、あるいは任意の向きの単
向結合装置として使用することも自由であり、しかも、
それらの間の切替えの手続きは極めて簡単である。した
がって、ＬＡＮ間転送トラヒックの量に応じた結合機構
を容易に実現することができ、２台を併設した場合には
負荷を効率良く分散することができ、更に、転送トラヒ
ックの増減にも容易に対処できる。しかも、本発明は、
従来装置に極めて僅少な修正を加えるだけで実現できる
。
合装置として使用することも、あるいは任意の向きの単
向結合装置として使用することも自由であり、しかも、
それらの間の切替えの手続きは極めて簡単である。した
がって、ＬＡＮ間転送トラヒックの量に応じた結合機構
を容易に実現することができ、２台を併設した場合には
負荷を効率良く分散することができ、更に、転送トラヒ
ックの増減にも容易に対処できる。しかも、本発明は、
従来装置に極めて僅少な修正を加えるだけで実現できる
。
第１図は本発明の一実施例の概要を示すブロックダイヤ
グラム、第２図は第１図に示された装置内のＭＡＣ層制
御部の詳細を示すブロックダイヤグラム、第３図は第１
図に示された装置の使用態様の例を示すブロックダイヤ
グラムである。 ｌａ、ｌｂ・・・ＬＡＮの一例としてのトークンリング
、１０ ・Ｌ Ａ Ｎ間結合装置、ｌｌａ、１ｌｂ−フ
ィジカル制御部、１２ａ、１２ｂ・・ＭＡＣ層制御部、
１２１ａ、１２１ｂ・・・動作モー１くレジスタ、１４
〜１６・・ＭＡＣ層制御部間のフレーム転送を仲介する
処理システム、２０・・・動作モードに従って中継フレ
ームのコピーの許否を行なうマイクロプロセッサ、２１
・・・コピーされた中継フレームを受ける受信バッファ
。
グラム、第２図は第１図に示された装置内のＭＡＣ層制
御部の詳細を示すブロックダイヤグラム、第３図は第１
図に示された装置の使用態様の例を示すブロックダイヤ
グラムである。 ｌａ、ｌｂ・・・ＬＡＮの一例としてのトークンリング
、１０ ・Ｌ Ａ Ｎ間結合装置、ｌｌａ、１ｌｂ−フ
ィジカル制御部、１２ａ、１２ｂ・・ＭＡＣ層制御部、
１２１ａ、１２１ｂ・・・動作モー１くレジスタ、１４
〜１６・・ＭＡＣ層制御部間のフレーム転送を仲介する
処理システム、２０・・・動作モードに従って中継フレ
ームのコピーの許否を行なうマイクロプロセッサ、２１
・・・コピーされた中継フレームを受ける受信バッファ
。
Claims (1)
- 【特許請求の範囲】 １、それぞれ第１及び第２のＬＡＮに接続されて接続さ
れたＬＡＮに対する情報フレームの送信と受信を行なう
第１及び第２の送受信部と、前記第１及び第２のＬＡＮ
の間で転送されるべき情報フレームである中継フレーム
の転送のために前記第１及び第２の送受信部を相互接続
する手段と、前記第１及び第２の送受信部のそれぞれを
第１及び第２の動作モードの任意の一方に設定するため
の手段と、前記第１の動作モードに設定された送受信部
から他方の送受信部への中継フレームの転送は許すが前
記第２の動作モードに設定された送受信部から他方の送
受信部への中継フレームの転送は禁止するモード制御手
段とを備えたＬＡＮ間結合装置。 ２、請求項１において、前記第１及び第２の送受信部の
それぞれは、それとそれに接続されたＬＡＮの間で授受
される信号の処理を行なうフィジカル制御ステージと、
他方のＬＡＮへの中継フレームのコピーを含むフレーム
の処理を行なうＭＡＣ層制御ステージを含み、前記モー
ド制御手段は、前記ＭＡＣ層制御ステージにおける中継
フレームの前記コピーを前記動作モードに従つて許可又
は禁止するＬＡＮ間結合装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63131561A JP2660422B2 (ja) | 1988-05-31 | 1988-05-31 | 動作モード設定可能なｌａｎ間結合装置 |
| KR1019890006297A KR920004147B1 (ko) | 1988-05-31 | 1989-05-11 | 동작모드설정 가능한 lan간 결합장치 |
| US07/359,047 US5079764A (en) | 1988-05-31 | 1989-05-30 | Operation mode settable lan interconnecting apparatus |
| EP89109754A EP0344722B1 (en) | 1988-05-31 | 1989-05-30 | Operation mode settable lan interconnecting apparatus |
| DE68913230T DE68913230T2 (de) | 1988-05-31 | 1989-05-30 | Lokale Netzwerkverbindungsvorrichtung mit einstellbarer Betriebsart. |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63131561A JP2660422B2 (ja) | 1988-05-31 | 1988-05-31 | 動作モード設定可能なｌａｎ間結合装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01302940A true JPH01302940A (ja) | 1989-12-06 |
| JP2660422B2 JP2660422B2 (ja) | 1997-10-08 |
Family
ID=15060944
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63131561A Expired - Lifetime JP2660422B2 (ja) | 1988-05-31 | 1988-05-31 | 動作モード設定可能なｌａｎ間結合装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5079764A (ja) |
| EP (1) | EP0344722B1 (ja) |
| JP (1) | JP2660422B2 (ja) |
| KR (1) | KR920004147B1 (ja) |
| DE (1) | DE68913230T2 (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5267238A (en) * | 1989-12-29 | 1993-11-30 | Ricoh Company, Ltd. | Network interface units and communication system using network interface unit |
| GB9003880D0 (en) * | 1990-02-21 | 1990-04-18 | Univ Strathclyde | Network interconnection apparatus |
| US6847611B1 (en) * | 1990-12-10 | 2005-01-25 | At&T Corp. | Traffic management for frame relay switched data service |
| JP3281043B2 (ja) * | 1992-08-06 | 2002-05-13 | マツダ株式会社 | 多重伝送装置 |
| US5630061A (en) * | 1993-04-19 | 1997-05-13 | International Business Machines Corporation | System for enabling first computer to communicate over switched network with second computer located within LAN by using media access control driver in different modes |
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| US5802287A (en) * | 1993-10-20 | 1998-09-01 | Lsi Logic Corporation | Single chip universal protocol multi-function ATM network interface |
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| WO2008056686A1 (en) | 2006-11-07 | 2008-05-15 | Sony Corporation | Communication system, transmitting device, receiving device, communication method, program and communication cable |
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Citations (3)
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-
1988
- 1988-05-31 JP JP63131561A patent/JP2660422B2/ja not_active Expired - Lifetime
-
1989
- 1989-05-11 KR KR1019890006297A patent/KR920004147B1/ko not_active IP Right Cessation
- 1989-05-30 DE DE68913230T patent/DE68913230T2/de not_active Expired - Fee Related
- 1989-05-30 EP EP89109754A patent/EP0344722B1/en not_active Expired - Lifetime
- 1989-05-30 US US07/359,047 patent/US5079764A/en not_active Expired - Lifetime
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59126348A (ja) * | 1983-01-06 | 1984-07-20 | Hitachi Ltd | 中継制御装置 |
| JPS59126347A (ja) * | 1983-01-06 | 1984-07-20 | Hitachi Ltd | 中継制御方式 |
| JPS61212940A (ja) * | 1985-03-18 | 1986-09-20 | Hitachi Ltd | マルチネツトワ−クシステムのデ−タ伝送方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| DE68913230T2 (de) | 1994-06-16 |
| KR920004147B1 (ko) | 1992-05-25 |
| US5079764A (en) | 1992-01-07 |
| EP0344722A2 (en) | 1989-12-06 |
| JP2660422B2 (ja) | 1997-10-08 |
| DE68913230D1 (de) | 1994-03-31 |
| EP0344722B1 (en) | 1994-02-23 |
| KR900019419A (ko) | 1990-12-24 |
| EP0344722A3 (en) | 1991-05-29 |
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