JPH01124031A - マイクロ・コンピュータ - Google Patents

マイクロ・コンピュータ

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Publication number
JPH01124031A
JPH01124031A JP62283403A JP28340387A JPH01124031A JP H01124031 A JPH01124031 A JP H01124031A JP 62283403 A JP62283403 A JP 62283403A JP 28340387 A JP28340387 A JP 28340387A JP H01124031 A JPH01124031 A JP H01124031A
Authority
JP
Japan
Prior art keywords
register
interrupt
signal
writing
registers
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP62283403A
Other languages
English (en)
Inventor
Masayuki Endo
正之 遠藤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPH01124031A publication Critical patent/JPH01124031A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はマイクロ・コンピュータ、特に割り込み回路を
有するマイクロ・コンピュータに関スる。
〔従来の技術〕
従来のこの種のマイクロ・コンピュータは第２図に示す
様な回路構成となっている。ＣＰＵＩはレジスタ５及び
メモリー６に対して演算等の処理を行う。割り込み両回
路２，３．４はそれぞれＣＰＵの処理が必要になった時
点でＣＰＵ１に対して割り込み要求信号１１，１２．１
３を出力する。
するとＣＰＵ１は割り込み許可信号８または９または１
０を出力し、割り込み処理に入る。この割り込み処理プ
ログラムの中でレジスタ５を書き替える命令が含まれて
いると割り込み処理から復帰した時に、レジスタ５の内
容は書き変ってしまうので割り込み処理前の処理をその
まま実行することはできない。このため割り込み処理の
最初のルーチンでレジスタ５の内容をブツシュ命令マた
はストア命令によりメモリー６に退避して、割り込み処
理の終了する前にメモリー６からポツプ命令、またはロ
ード命令によりレジスタ５へ以前の内容を復帰させるこ
とが行われる。
〔発明が解決しようとする問題点〕
しかし、従来のこの割り込み処理の前後でレジスタの内
容をメモリーに退避させ、復帰させることは処理の時間
がかかり、高速処理には適さず、また、割り込み処理プ
ログラムも処理が複雑になるのでソフトウェアの生産性
がよくないという欠点を有する。
〔問題点を解決するための手段〕
本発明は、ＣＰＵ及び周辺回路を制御するためのレジス
タ及び複数の割り込み回路を有するマイクロ・コンピュ
ータで、それぞれの割り込み回路と一対一に対応する複
数のレジスタと、それぞれの割り込みが発生した時点で
ＣＰＵからアクセスするレジスタを切り替える回路を有
している。
〔実施例〕
次に、本発明について図面を参照して説明する。
第１図は本発明の一実施例のブロック図である。
第１図において割り込み回路１９，２０．２１のいずれ
からも割り込み要求信号３０，３１゜３２がない時、Ｃ
ＰＵ１８はレジスタ２２゜２３．２４は読み書きせずに
、レジスタ４１に対して読み書きする。このレジスタ２
２，２３゜２４．４１はまったく同一のものであって、
それぞれレジスタ書き込み信号３３，３５．３７゜３９
及びレジスタ読み出し信号３４，３６゜３８．４０が相
異なるだけである。レジスタ切り替え回路４４はＣＰＵ
１８からのレジスタ書き込み信号４５及びレジスタ読み
出し信号４６と、ＣＰＵ５の割り込み許可信号２７，２
８．２９によりレジスタ２２，２３，２４，４．１の内
どのレジスタに書き込みまたは読み出しを行うか決定す
る。
たとえば割り込み許可信号２７が出力されているときは
レジスタ２２が読み書きさせ、割り込み許可信号２８が
出力されているときはレジスタ２３が読み書きさせ、割
り込み許可信号２９が出力されているときはレジスタ２
４が読み書きさせ、割り込み許可信号２７，２８．２９
のいずれもが出力されていないときはレジスタ４１が読
み書きさせる。
〔発明の効果〕
以上説明したように本発明は、ＣＰＵが割り込み処理を
実行するかしないか、また、どの割り込み処理を実行す
るかによってレジスタを自動的に切り換えるので、ソフ
トウェア処理で割り込み処理実行時のレジスタの退避及
び復帰を行う必要がなく、割り込み処理の高速でしかも
ソフトウェアの生産性が高いという利点を有する。　　
　　　′
【図面の簡単な説明】
第１図は本発明のブコック図、第２図は従来のマイクロ
・コンピュータのブロック図である。第２図は従来例を
示す図である。 １．１８・・・・・・ＣＰＵ、２，３，４，１９゜２０
．２１・・・・・・割り込み回路、５，２２，２３゜２
４．４１・・・・・・レジスタ、６．２５・・・・・・
メモリー、７．２５・・・・・・メモリー、７．２６・
・・・・・バス、８゜９．１０，２７，２８．２９・・
・・・・割り込み許可信号、１１，１２，１３，３０，
３１．３２・・・・・・割り込み要求信号、１４，３３
，３５，３７゜３９．４５・・・・・・レジスタ書き込
み信号、１５゜３４．３６，３８，４０．４６・・・・
・・レジスタ読み出し信号、１６．４２・・・・・・メ
モリー書き込み信号、１７．４３・・・・・・メモリー
読み出し信号、４４・旧・・レジスタ切り替え回路。 代理人　弁理士　　内　原　　　音

Claims (1)

    【特許請求の範囲】
  1. 　ＣＰＵ及び周辺回路を制御するためのレジスタ及び複
    数の割り込み回路を有するマイクロ・コンピュータでそ
    れぞれの割り込み回路と一対一に対応する複数のレジス
    タを持ち、それぞれの割り込みが発生した時点でＣＰＵ
    からアクセスするレジスタを切り替える回路を有するこ
    とを特徴とするマイクロ・コンピュータ。
JP62283403A 1987-11-09 1987-11-09 マイクロ・コンピュータ Pending JPH01124031A (ja)

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JP62283403A JPH01124031A (ja) 1987-11-09 1987-11-09 マイクロ・コンピュータ

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JPH01124031A true JPH01124031A (ja) 1989-05-16

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ID=17665074

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JP62283403A Pending JPH01124031A (ja) 1987-11-09 1987-11-09 マイクロ・コンピュータ

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Cited By (14)

* Cited by examiner, † Cited by third party
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