JP7147502B2 - 半導体装置、電力変換装置および半導体装置の製造方法 - Google Patents

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Description

本発明は、半導体装置、電力変換装置および半導体装置の製造方法に関する。
特許文献1には、絶縁基板の銅箔回路パターンに半導体チップを重ねてはんだ接合した半導体装置の製造方法が開示されている。この半導体装置の製造方法では、銅箔回路パターンの接合面域内にレーザ光を照射して、凹凸状のクレータを分散形成する。その後、接合面域にはんだを挟んで絶縁基板と半導体チップの間を接合する。レーザ光の照射で形成するクレータが銅箔を貫通しないようにするために、銅箔の厚さを0.5mm以上にしておく。
特開2008-282834号公報
有機絶縁層は、一般にセラミックに比べて熱伝導率が低い。有機絶縁層を有した絶縁基板に0.5mm厚の回路パターンが形成される場合、有機絶縁層の影響で十分な放熱ができない可能性がある。
本発明は、上述の課題を解決するためになされたもので、効率よく放熱できる半導体装置、電力変換装置および半導体装置の製造方法を得ることを目的とする。
本開示に係る半導体装置は、有機絶縁層と、該有機絶縁層の上に設けられた回路パターンと、を有する絶縁基板と、該回路パターンの上面に設けられた半導体チップと、を備え、該回路パターンの厚さは1mm以上3mm以下であり、前記回路パターンの前記上面には凹部が形成され、前記半導体チップは平面視で前記凹部の内部に収まり、前記凹部は前記半導体チップと前記回路パターンとを接合する接合材によって埋められ、前記半導体チップと前記凹部の幅は同じであり、前記半導体チップの下面は前記回路パターンの前記上面よりも上方に位置する。
本開示に係る半導体装置の製造方法は、有機絶縁層の上に厚さが1mm以上3mm以下の金属層を形成し、該金属層を機械加工でパターン化して回路パターンを形成し、該回路パターンの上面に半導体チップを設け、前記回路パターンの前記上面には凹部が形成され、前記半導体チップは平面視で前記凹部の内部に収まり、前記凹部は前記半導体チップと前記回路パターンとを接合する接合材によって埋められ、前記半導体チップと前記凹部の幅は同じであり、前記半導体チップの下面は前記回路パターンの前記上面よりも上方に位置する。
本発明に係る半導体装置および半導体装置の製造方法では、回路パターンの厚さを1mm以上3mm以下とすることで、熱伝導率が低い有機絶縁層を用いても回路パターンから十分に放熱できる。従って、効率よく放熱できる。
実施の形態1に係る半導体装置の断面図である。 実施の形態1に係る半導体装置の拡大図である。 熱抵抗のシミュレーションに用いた半導体装置の構成を説明する図である。 熱抵抗の計算結果を示す図である。 実施の形態1の比較例に係る半導体装置の断面図である。 実施の形態1の第1の変形例に係る半導体装置の断面図である。 実施の形態1の第2の変形例に係る半導体装置の断面図である。 実施の形態1の第3の変形例に係る半導体装置の断面図である。 実施の形態1の第4の変形例に係る半導体装置の断面図である。 実施の形態1の第5の変形例に係る半導体装置の断面図である。 実施の形態2に係る電力変換装置を適用した電力変換システムの構成を示すブロック図である。
本発明の実施の形態に係る半導体装置、電力変換装置および半導体装置の製造方法について図面を参照して説明する。同じ又は対応する構成要素には同じ符号を付し、説明の繰り返しを省略する場合がある。
実施の形態1.
図1は、実施の形態1に係る半導体装置100の断面図である。半導体装置100は絶縁基板10を備える。絶縁基板10の上面には半導体チップ24が設けられる。半導体チップ24は例えば珪素から形成される。半導体チップ24は、接合材22で絶縁基板10の上面に接合される。接合材22は、例えばはんだである。半導体チップ24は、例えばIGBT(Insulated Gate Bipolar Transistor)等のスイッチング素子である。
絶縁基板10の上には、半導体チップ24を囲むようにケース20が設けられる。絶縁基板10とケース20は接着剤等で接着される。ケース20の上には端子26、28が設けられる。端子26は、ワイヤを介して絶縁基板10が有する回路パターンに接続される。端子28はワイヤを介して半導体チップ24と接続される。端子26、28は、それぞれ半導体チップ24の主電極端子、駆動端子であっても良い。ケース20の内部は、半導体チップ24を覆うように封止樹脂30で封止される。封止樹脂30は例えばエポキシ樹脂から形成される。
図2は、実施の形態1に係る半導体装置100の拡大図である。絶縁基板10は、ベース板12と、ベース板12の上に設けられた有機絶縁層14と、有機絶縁層14の上に設けられた回路パターン16を有する。回路パターン16の上面には、接合材22を介して半導体チップ24が設けられる。図2において、ワイヤは省略されている。ベース板12と回路パターン16は、例えば銅から形成される。有機絶縁層14は、エポキシ樹脂等の樹脂または液晶ポリマーから形成される。有機絶縁層14の厚さは例えば0.1mm~0.2mmである。
本実施の形態では、半導体装置100は2つの半導体チップ24を備える。これに限らず、半導体装置100は、1つ以上の半導体チップ24を備えればよい。また、複数の半導体チップ24は異なる種類の半導体チップを含んでも良い。
回路パターン16の厚さは1mm以上3mm以下である。回路パターン16の上面の幅と下面の幅は等しい。ここで、回路パターン16の下面は、上面と反対側の面であり、有機絶縁層14と対向する面である。回路パターン16の有機絶縁層14の上面と垂直な断面の形状は、矩形である。回路パターン16の上面の幅は、例えばチップ幅の1.2倍である。
次に、半導体装置100の製造方法を説明する。まず、絶縁基板10の製造方法として、有機絶縁層14を2つの金属層で挟む態様で、有機絶縁層14と金属層を張り合わせる。その後、有機絶縁層14と金属層を加熱および加圧する。これにより、有機絶縁層14の上面側と下面側の両面に金属層を形成する。金属層は、例えば銅板等の導電板である。金属層は、後述する加工を経ることで回路パターン16とベース板12となる。回路パターン16として用いられる金属層は厚さが1mm以上3mm以下であり、ベース板12として用いられる金属層は例えば厚さが2mmである。
次に、金属層を機械加工でパターン化して回路パターン16を形成する。機械加工は、例えば切削加工またはルータ加工である。次に、回路パターン16の上面に半導体チップ24を設ける。次に、絶縁基板10の上にケース20および端子26、28を搭載する。次に、端子26、28と半導体チップ24および回路パターン16とをワイヤで接続する。次に、ケース20の内部を封止樹脂30で封止する。
本実施の形態では、絶縁基板10に有機絶縁層14を使用することで、セラミック絶縁基板と比較して製造コストを低減できる。ここで、有機絶縁層14は、セラミックに比べると熱伝導率が低い。有機絶縁層14の熱伝導率は、例えば5~20W/m・Kである。また、セラミックの熱伝導率は、窒化ケイ素の場合約70W/m・Kであり、窒化アルミニウムの場合約170W/m・Kである。このため、絶縁基板10は、有機絶縁層14の影響で熱抵抗が大きくなる可能性がある。
これについて、回路パターン16の厚さを変更した場合の半導体装置100aの熱抵抗の値を算出した。図3は、熱抵抗のシミュレーションに用いた半導体装置100aの構成を説明する図である。半導体装置100aにおいて、空冷フィン32の上面に絶縁基板10が放熱グリース34を介して接合される。放熱グリース34は、空冷フィン32と絶縁基板10とに挟まれる。空冷フィン32はアルミから形成される。絶縁基板10の上面には、はんだ22によって半導体チップ24が接合される。
図4は熱抵抗の計算結果を示す図である。図4には、半導体チップ24とベース板12との間の熱抵抗のシミュレーションによる計算結果が示されている。また、図4には、回路パターン16の厚さが0.5mmの場合の熱抵抗に対する熱抵抗比が示されている。回路パターン16が厚いほど熱抵抗は低下する。
本実施の形態では、回路パターン16の厚さが1mm以上において、熱抵抗を低減させる有意な効果が得られる。回路パターン16の厚さが2.0mmの場合、0.5mmの場合と比較して熱抵抗を15%程度低減できる。このとき、半導体装置100aの熱抵抗を、窒化アルミニウムからなるセラミック絶縁基板を使用した場合の熱抵抗と同等にできる。また、回路パターン16が厚くなるほど、回路パターン16の厚さの変化量に対する熱抵抗の変化量が小さくなる。回路パターン16の厚さが3mm以上において、熱抵抗を低減させる効果は収束する傾向にある。
以上から、本実施の形態では回路パターン16の厚さは1mm以上3mm以下であることが望ましい。これにより、半導体チップ24が発する熱が有機絶縁層14に達する前に、回路パターン16により熱を十分に拡散させることができる。従って、半導体装置100の熱抵抗を低減することができる。
また、回路パターン16の厚さは2mm以上であっても良い。これにより、有機絶縁層14を使用しても、セラミック絶縁基板と同等またはセラミック絶縁基板よりも低い熱抵抗が得られる。
また、一般に有機絶縁基板では、熱抵抗を低減させるために有機絶縁層を薄く形成する場合がある。本実施の形態では、回路パターン16により熱抵抗を低減させることができるため、有機絶縁層14を厚く設けることができる。従って、絶縁基板10の耐電圧を向上できる。
図5は、実施の形態1の比較例に係る半導体装置200の断面図である。半導体装置200は、絶縁基板210を備える。絶縁基板210は回路パターン216を備える。半導体装置200は、回路パターン216の形成方法が半導体装置100と異なる。回路パターン216は金属層をエッチングして形成される。この場合、エッチングファクターにより、回路パターン216の下面の幅は、上面の幅よりも広くなる。
横方向のエッチング量は、回路パターン216が厚いほど大きくなる。このため、回路パターン216が厚いほど、回路パターン216の下面の幅と上面の幅との差分が大きくなる。従って、回路パターン216が厚いほど、回路パターン216間の距離を大きくする必要がある。このため、回路パターン216を厚くすると、半導体装置200が大型化するおそれがある。
これに対して本実施の形態では、機械加工により回路パターン16を形成する。このため、回路パターン16の有機絶縁層14の上面と垂直な断面の形状を長方形にすることができる。従って、エッチングで回路パターン16を形成する場合と比較して、回路パターン16間の距離を近接させることができる。よって、半導体装置100の大型化を抑制しつつ、回路パターン16を厚くすることができる。また、回路パターン16の断面積を大きくできるため、半導体装置100の電流密度を大きくできる。
本実施の形態では、機械加工により回路パターン16を形成するものとした。この変形例として、金属層の上面から一定の深さまで機械加工により加工し、残った部分をエッチングで加工しても良い。例えば、機械加工で金属層の加工部分が残り50μmの厚さとなるまで加工したあと、エッチングで残りの加工部分を除去しても良い。これにより、機械加工のみで回路パターン16を形成する場合と比較して、回路パターン16の形成に際して、有機絶縁層14に機械的なダメージを及ぼすことを防止できる。
図6は、実施の形態1の第1の変形例に係る半導体装置300の断面図である。半導体装置300は、絶縁基板310を備える。絶縁基板310は回路パターン316を備える。回路パターン316の上面と側面を繋ぐ角は面取りされ、例えば図6に示されるように丸まっている。回路パターン316の丸い角は、エッチングまたは機械加工により形成される。回路パターン316の上面と側面とが滑らかに繋がることで、封止樹脂30に発生する応力を緩和できる。従って、クラックによる封止樹脂30の破壊を抑制できる。
図7は、実施の形態1の第2の変形例に係る半導体装置400の断面図である。半導体装置400は、絶縁基板410を備える。絶縁基板410は回路パターン416を備える。回路パターン416の上面には凹部417が形成される。凹部417は、ハーフエッチングまたは機械加工により形成される。凹部417には、接合材22が設けられる。接合材22および半導体チップ24は平面視で凹部417の内部に収まる。これにより、接合材22および半導体チップ24の位置ズレを抑制できる。従って、生産性を向上できる。
図8は、実施の形態1の第3の変形例に係る半導体装置500の断面図である。半導体装置500は、絶縁基板510を備える。絶縁基板510は回路パターン516を備える。回路パターン516には、段差が形成される。段差により、回路パターン516は内側に向かって厚くなる。段差はハーフエッチングまたは機械加工により形成される。半導体チップ24は、回路パターン516のうち中央部の最上段に接合される。このため、半導体チップ24の搭載位置の位置決めを容易にできる。従って、接合材22および半導体チップ24の位置ズレを抑制し、生産性を向上できる。また、段差と接する封止樹脂30は、アンカーとして機能する。このため、封止樹脂30と絶縁基板510との剥離を抑制できる。
回路パターン516には一段の段差に限らず、より大きなアンカー効果を得るべく、複数段の段差が形成されても良い。また、回路パターン516のうち半導体チップ24の両側に段差が形成されても良く、片側に段差が形成されても良い。
図9は、実施の形態1の第4の変形例に係る半導体装置600の断面図である。半導体装置600は、絶縁基板610を備える。絶縁基板610は回路パターン616を備える。回路パターン616には、溝618が形成される。溝618は、回路パターン616のうち半導体チップ24が搭載される領域の外側に形成される。溝618はハーフエッチングまたは機械加工により形成される。溝618を埋め込む封止樹脂30は、アンカーとして機能する。このため、封止樹脂30と絶縁基板610との剥離を抑制できる。従って、信頼性を向上できる。
溝618の断面形状は、長方形または正方形である。これに限らず、溝618の断面形状は、台形、三角形、多角形または半円形でも良い。また、溝618の断面形状は、回路パターン616の上面に近づくほど幅が狭まる形状でも良い。また、回路パターン616のうち半導体チップ24の両側に溝618が形成されても良く、片側に溝618が形成されても良い。
図10は、実施の形態1の第5の変形例に係る半導体装置700の断面図である。半導体装置700は、絶縁基板710を備える。絶縁基板710は回路パターン716を備える。回路パターン716は、第1回路パターン716aと第2回路パターン716bとを含む。第2回路パターン716bは、第1回路パターン716aよりも薄い。
また、半導体チップ24は、第1回路パターン716aの上面に設けられた第1半導体チップ724aと、第2回路パターン716bの上面に設けられた第2半導体チップ724bを含む。第2半導体チップ724bは、第1半導体チップ724aよりも厚い。第1半導体チップ724aと第2半導体チップ724bの上方には、端子738が設けられる。第1半導体チップ724aの上面と第2半導体チップ724bの上面は、接合材736によって共に端子738に接合される。端子738は平板状である。
半導体装置700では、第1半導体チップ724aと第2半導体チップ724bの厚さの差分を、回路パターン716が打ち消している。つまり、第1半導体チップ724aの上面の有機絶縁層14からの高さと、第2半導体チップ724bの上面の有機絶縁層14からの高さは等しい。これにより、半導体装置700の組み立てを容易にできる。従って、生産性を向上できる。
なお、半導体チップ24は、珪素に替えてワイドバンドギャップ半導体によって形成されても良い。ワイドバンドギャップ半導体は、炭化珪素、窒化ガリウム系材料またはダイヤモンドである。半導体チップ24をワイドバンドギャップ半導体によって形成することで、半導体装置100の耐圧性をさらに向上できる。
また、半導体チップ24がワイドバンドギャップ半導体によって形成されることで、耐熱性をさらに向上できる。従って、空冷フィン32の小型化が可能になり、半導体装置100を小型化できる。また、半導体装置100の高温動作が可能になる。更に電力損失を低減できるため、半導体装置100を高効率化できる。
これらの変形は以下の実施の形態に係る半導体装置、電力変換装置および半導体装置の製造方法について適宜応用することができる。なお、以下の実施の形態に係る半導体装置、電力変換装置および半導体装置の製造方法については実施の形態1との共通点が多いので、実施の形態1との相違点を中心に説明する。
実施の形態2.
本実施の形態は、上述した実施の形態1に係る半導体装置100を電力変換装置に適用したものである。本実施の形態は特定の電力変換装置に限定されるものではないが、以下、実施の形態2として、三相のインバータに実施の形態1に係る半導体装置100を適用した場合について説明する。
図11は、本実施の形態に係る電力変換装置800を適用した電力変換システムの構成を示すブロック図である。
図11に示す電力変換システムは、電源850、電力変換装置800、負荷900から構成される。電源850は、直流電源であり、電力変換装置800に直流電力を供給する。電源850は種々のもので構成することが可能であり、例えば、直流系統、太陽電池、蓄電池で構成することができる。また、電源850は、交流系統に接続された整流回路またはAC/DCコンバータで構成することとしてもよい。また、電源850を、直流系統から出力される直流電力を予め定められた電力に変換するDC/DCコンバータによって構成することとしてもよい。
電力変換装置800は、電源850と負荷900の間に接続された三相のインバータである。電力変換装置800は、電源850から供給された直流電力を交流電力に変換し、負荷900に交流電力を供給する。電力変換装置800は、図11に示すように、直流電力を交流電力に変換して出力する主変換回路801と、主変換回路801の各スイッチング素子を駆動する駆動信号を出力する駆動回路802と、駆動回路802を制御する制御信号を駆動回路802に出力する制御回路803とを備えている。
負荷900は、電力変換装置800から供給された交流電力によって駆動される三相の電動機である。なお、負荷900は特定の用途に限られるものではなく、各種電気機器に搭載された電動機である。負荷900は、例えば、ハイブリッド自動車、電気自動車、鉄道車両、エレベーター、もしくは、空調機器向けの電動機として用いられる。
以下、電力変換装置800の詳細を説明する。主変換回路801は、図示しないスイッチング素子と還流ダイオードを備えている。主変換回路801は、スイッチング素子がスイッチングすることによって、電源850から供給される直流電力を交流電力に変換し、負荷900に供給する。主変換回路801の具体的な回路構成は種々のものがあるが、本実施の形態に係る主変換回路801は2レベルの三相フルブリッジ回路である。2レベルの三相フルブリッジ回路は、6つのスイッチング素子とそれぞれのスイッチング素子に逆並列された6つの還流ダイオードから構成することができる。主変換回路801には、上述した実施の形態1の半導体装置100を適用する。6つのスイッチング素子は2つのスイッチング素子ごとに直列接続され上下アームを構成する。各上下アームはフルブリッジ回路の各相(U相、V相、W相)を構成する。そして、各上下アームの出力端子、すなわち主変換回路801の3つの出力端子は、負荷900に接続される。
駆動回路802は、主変換回路801のスイッチング素子を駆動する駆動信号を生成し、主変換回路801のスイッチング素子の制御電極に供給する。具体的には、後述する制御回路803からの制御信号に従い、スイッチング素子をオン状態にする駆動信号とスイッチング素子をオフ状態にする駆動信号とを各スイッチング素子の制御電極に出力する。スイッチング素子をオン状態に維持する場合、駆動信号はスイッチング素子の閾値電圧以上の電圧信号であるオン信号となる。スイッチング素子をオフ状態に維持する場合、駆動信号はスイッチング素子の閾値電圧以下の電圧信号であるオフ信号となる。
制御回路803は、負荷900に所望の電力が供給されるよう主変換回路801のスイッチング素子を制御する。具体的には、負荷900に供給すべき電力に基づいて主変換回路801の各スイッチング素子がオン状態となるべき時間であるオン時間を算出する。例えば、出力すべき電圧に応じてスイッチング素子のオン時間を変調するPWM制御によって主変換回路801を制御することができる。そして、各時点においてオン状態となるべきスイッチング素子にはオン信号を、オフ状態となるべきスイッチング素子にはオフ信号が出力されるよう、駆動回路802に制御指令である制御信号を出力する。駆動回路802は、この制御信号に従い、各スイッチング素子の制御電極にオン信号又はオフ信号を駆動信号として出力する。
本実施の形態に係る電力変換装置800では、主変換回路801として実施の形態1に係る半導体装置100を適用するため、電力変換装置800を効率よく放熱させることができる。
本実施の形態では、2レベルの三相インバータに実施の形態1を適用する例を説明したが、本実施の形態はこれに限られるものではなく、種々の電力変換装置に適用することができる。本実施の形態では、2レベルの電力変換装置としたが3レベルまたはマルチレベルの電力変換装置であっても構わない。また、単相負荷に電力を供給する場合には単相のインバータに実施の形態1を適用しても構わない。また、直流負荷等に電力を供給する場合にはDC/DCコンバータまたはAC/DCコンバータに実施の形態1を適用することも可能である。
また、実施の形態1を適用した電力変換装置800は、上述した負荷900が電動機の場合に限定されるものではなく、例えば、放電加工機、レーザ加工機、誘導加熱調理器または非接触器給電システムの電源装置として用いることもできる。さらに、電力変換装置800を、太陽光発電システムまたは蓄電システム等のパワーコンディショナーとして用いることも可能である。
なお、各実施の形態で説明した技術的特徴は適宜に組み合わせて用いてもよい。
100、100a、300、400、500、600、700 半導体装置、800 電力変換装置、10、310、410、510、610、710 絶縁基板、14 有機絶縁層、16、316、416、516、616、716 回路パターン、716a 第1回路パターン、716b 第2回路パターン、417 凹部、618 溝、24 半導体チップ、724a 第1半導体チップ、724b 第2半導体チップ、801 主変換回路、802 駆動回路、803 制御回路

Claims (11)

  1. 有機絶縁層と、前記有機絶縁層の上に設けられた回路パターンと、を有する絶縁基板と、
    前記回路パターンの上面に設けられた半導体チップと、
    を備え、
    前記回路パターンの厚さは1mm以上3mm以下であり、
    前記回路パターンの前記上面には凹部が形成され、
    前記半導体チップは平面視で前記凹部の内部に収まり、
    前記凹部は前記半導体チップと前記回路パターンとを接合する接合材によって埋められ
    前記半導体チップと前記凹部の幅は同じであり、
    前記半導体チップの下面は前記回路パターンの前記上面よりも上方に位置することを特徴とする半導体装置。
  2. 前記回路パターンの前記上面の幅と、前記回路パターンの前記上面と反対側の面である下面の幅は等しいことを特徴とする請求項1に記載の半導体装置。
  3. 前記回路パターンの厚さは2mm以上であることを特徴とする請求項1または2に記載の半導体装置。
  4. 前記回路パターンは、第1回路パターンと、前記第1回路パターンよりも薄い第2回路パターンと、を含み、
    前記半導体チップは、前記第1回路パターンの上面に設けられた第1半導体チップと、前記第2回路パターンの上面に設けられ、前記第1半導体チップよりも厚い第2半導体チップと、を含むことを特徴とする請求項1から3の何れか1項に記載の半導体装置。
  5. 前記回路パターンの前記上面と前記回路パターンの側面を繋ぐ角は丸まっていることを特徴とする請求項1から4の何れか1項に記載の半導体装置。
  6. 前記回路パターンには、前記回路パターンが内側に向かって厚くなるように段差が形成されることを特徴とする請求項1から5の何れか1項に記載の半導体装置。
  7. 前記回路パターンには、前記半導体チップが搭載される領域の外側に溝が形成されることを特徴とする請求項1から6の何れか1項に記載の半導体装置。
  8. 前記半導体チップはワイドバンドギャップ半導体によって形成されていることを特徴とする請求項1から7の何れか1項に記載の半導体装置。
  9. 前記ワイドバンドギャップ半導体は、炭化珪素、窒化ガリウム系材料またはダイヤモンドであることを特徴とする請求項8に記載の半導体装置。
  10. 請求項1から9の何れか1項に記載の半導体装置を有し、入力される電力を変換して出力する主変換回路と、
    前記半導体装置を駆動する駆動信号を前記半導体装置に出力する駆動回路と、
    前記駆動回路を制御する制御信号を前記駆動回路に出力する制御回路と、
    を備えた電力変換装置。
  11. 有機絶縁層の上に厚さが1mm以上3mm以下の金属層を形成し、
    前記金属層を機械加工でパターン化して回路パターンを形成し、
    前記回路パターンの上面に半導体チップを設け、
    前記回路パターンの前記上面には凹部が形成され、
    前記半導体チップは平面視で前記凹部の内部に収まり、
    前記凹部は前記半導体チップと前記回路パターンとを接合する接合材によって埋められ
    前記半導体チップと前記凹部の幅は同じであり、
    前記半導体チップの下面は前記回路パターンの前記上面よりも上方に位置することを特徴とする半導体装置の製造方法。
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Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7459395B1 (ja) 2022-06-28 2024-04-01 三菱電機株式会社 半導体装置
DE102022207525A1 (de) 2022-07-22 2024-01-25 Vitesco Technologies Germany Gmbh Leistungsmodul und Verfahren zur Herstellung desselben, Stromrichter mit einem Leistungsmodul

Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001169560A (ja) 1999-12-02 2001-06-22 Mitsubishi Electric Corp 電力変換装置
JP2002280705A (ja) 2001-03-19 2002-09-27 Hitachi Metals Ltd 複合基板の回路形成方法及び複合基板
JP2004296619A (ja) 2003-03-26 2004-10-21 Dowa Mining Co Ltd 回路基板と製造方法およびこれを用いたパワーモジュール
JP2012114360A (ja) 2010-11-26 2012-06-14 Toyota Motor Corp 半導体装置
JP2014053384A (ja) 2012-09-05 2014-03-20 Toshiba Corp 半導体装置およびその製造方法
JP2015156466A (ja) 2014-01-17 2015-08-27 ローム株式会社 パワーモジュールおよびその製造方法
WO2016190440A1 (ja) 2015-05-27 2016-12-01 Ngkエレクトロデバイス株式会社 パワーモジュール用基板およびパワーモジュール用基板集合体およびパワーモジュール用基板の製造方法
JP2017045804A (ja) 2015-08-25 2017-03-02 ローム株式会社 半導体装置およびその製造方法
JP2017073529A (ja) 2015-10-09 2017-04-13 三菱電機株式会社 半導体装置

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0777246B2 (ja) 1989-10-31 1995-08-16 株式会社住友金属セラミックス セラミックス回路基板
DE4406397A1 (de) 1994-02-26 1995-08-31 Curamik Electronics Gmbh Substrat für elektrische Schaltkreise sowie Verfahren zum Herstellen des Substrates
CN1941347A (zh) * 2005-09-29 2007-04-04 中国砂轮企业股份有限公司 高导热效率电路板
JP5077536B2 (ja) 2007-05-08 2012-11-21 富士電機株式会社 半導体装置の製造方法
DE102009033029A1 (de) 2009-07-02 2011-01-05 Electrovac Ag Elektronische Vorrichtung
DE102010039728A1 (de) 2010-08-25 2012-03-01 Robert Bosch Gmbh Verfahren zur Herstellung einer elektrischen Schaltung und elektrischen Schaltung
JP5976678B2 (ja) 2011-12-20 2016-08-24 株式会社東芝 セラミックス銅回路基板
JP6024750B2 (ja) * 2012-07-17 2016-11-16 富士電機株式会社 半導体モジュール
JP6210818B2 (ja) * 2013-09-30 2017-10-11 三菱電機株式会社 半導体装置およびその製造方法
DE102014105000B4 (de) 2014-04-08 2021-02-25 Infineon Technologies Ag Verfahren zur Herstellung und zum Bestücken eines Schaltungsträgers
JP6370257B2 (ja) * 2015-04-27 2018-08-08 三菱電機株式会社 半導体装置
US9979105B2 (en) * 2015-05-15 2018-05-22 Mitsubishi Electric Corporation Power semiconductor device
DE112017006866T5 (de) * 2017-02-23 2019-10-31 Ngk Insulators, Ltd. Isoliertes wärmeabfuhrsubstrat
DE112018001769B4 (de) 2017-03-31 2022-05-05 Rohm Co., Ltd. Leistungsmodul und Herstellungsverfahren des Leistungsmoduls

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001169560A (ja) 1999-12-02 2001-06-22 Mitsubishi Electric Corp 電力変換装置
JP2002280705A (ja) 2001-03-19 2002-09-27 Hitachi Metals Ltd 複合基板の回路形成方法及び複合基板
JP2004296619A (ja) 2003-03-26 2004-10-21 Dowa Mining Co Ltd 回路基板と製造方法およびこれを用いたパワーモジュール
JP2012114360A (ja) 2010-11-26 2012-06-14 Toyota Motor Corp 半導体装置
JP2014053384A (ja) 2012-09-05 2014-03-20 Toshiba Corp 半導体装置およびその製造方法
JP2015156466A (ja) 2014-01-17 2015-08-27 ローム株式会社 パワーモジュールおよびその製造方法
WO2016190440A1 (ja) 2015-05-27 2016-12-01 Ngkエレクトロデバイス株式会社 パワーモジュール用基板およびパワーモジュール用基板集合体およびパワーモジュール用基板の製造方法
JP2017045804A (ja) 2015-08-25 2017-03-02 ローム株式会社 半導体装置およびその製造方法
JP2017073529A (ja) 2015-10-09 2017-04-13 三菱電機株式会社 半導体装置

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