JP6134487B2 - ステッピングモータ制御回路、ムーブメント及びアナログ電子時計 - Google Patents
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これにより、駆動余裕が大きい場合はパルスダウンするまでの時間を短くしてパルスダウンし、駆動余裕が小さくても動作が安定している場合にはパルスダウンまでの時間を長くしてパルスダウンすることで、動作を安定化しながら低消費電力化を可能にしている。
また、区間T1において基準しきい電圧Vcompを超える誘起信号VRsが生じた場合、区間T2の前半(区間T2A)、後半(区間T2B)のいずれかにおいて基準しきい電圧Vcompを超える誘起信号VRsが生じた場合でもランク維持するように構成している。区間T2Aおいて基準しきい電圧Vcompを超える誘起信号VRsを検出した場合は駆動余裕が十分大きくパルスダウンできる状態であるにも拘わらずパルスダウンしていないため、無駄な電力を消費するという問題がある。
また、本発明は、駆動余裕の大きい状態では極力速やかにパルスダウンすることによって、より低消費電力化を図ると共に、可能な限り回転可能な小さなエネルギの駆動パルスにパルスダウンすることによって、より低消費電力化を図ることを課題としている。
本発明に係るムーブメントによれば、駆動余裕の大きい状態では極力速やかにパルスダウンすることによって、より低消費電力化を図ることが可能なアナログ電子時計を構築することができる。また、駆動余裕の大きい状態では極力速やかにパルスダウンすることによって、より低消費電力化を図ると共に、可能な限り回転可能な小さなエネルギの駆動パルスにパルスダウンすることによって、より低消費電力化を図ることが可能なアナログ電子時計を構築することができる。
また、本発明に係るアナログ電子時計によれば、駆動余裕の大きい状態では極力速やかにパルスダウンすることによって、より低消費電力化を図ることが可能になる。また、駆動余裕の大きい状態では極力速やかにパルスダウンすることによって、より低消費電力化を図ると共に、可能な限り回転可能な小さなエネルギの駆動パルスにパルスダウンすることによって、より低消費電力化を図ることが可能になる。
図1において、アナログ電子時計は、所定周波数の信号を発生する発振回路101、発振回路101で発生した信号を分周して計時の基準となる時計信号を発生する分周回路102、アナログ電子時計を構成する各電子回路要素の制御や駆動パルスの変更制御等の制御を行う制御回路103、制御回路103からの制御信号に基づいてモータ回転駆動用の駆動パルスを選択し出力する駆動パルス選択回路104、駆動パルス選択回路104からの駆動パルスによって回転駆動されるステッピングモータ105、ステッピングモータ105によって回転駆動され時刻を表示するための時刻針(図1の例では時針107、分針108、秒針109の3種類)を有するアナログ表示部106を備えている。
また、アナログ電子時計は、ステッピングモータ105の自由振動によって発生し回転状況を表す誘起信号VRsを所定の検出区間において検出する回転検出回路110、回転検出回路110が所定の基準しきい電圧Vcompを超える誘起信号VRsを検出した時刻と検出した区間とを比較して、前記誘起信号VRsがどの区間において検出されたのかを判別する検出区間判別回路111を有している。尚、後述するように、ステッピングモータ105が回転したか否かを検出する検出区間は4つの区間に区分している。
一般に、時計の動力源、時間基準などの装置からなる時計の機械体をムーブメントと称する。電子式のものをモジュールと呼ぶことがある。時計としての完成状態では、ムーブメントには文字板、針が取り付けられ、時計ケースの中に収容される。
図2において、ステッピングモータ105は、ロータ収容用貫通孔203を有するステータ201、ロータ収容用貫通孔203に回転可能に配設されたロータ202、ステータ201と接合された磁心208、磁心208に巻回されたコイル209を備えている。ステッピングモータ105をアナログ電子時計に用いる場合には、ステータ201及び磁心208はネジ(図示せず)によって地板(図示せず)に固定され、互いに接合される。コイル209は、第1端子OUT1、第2端子OUT2を有している。
制御回路103は、基本的には、相互に極性の異なる主駆動パルスP1で交互に駆動することによってステッピングモータ105を回転駆動し、主駆動パルスP1で回転できなかった場合には、当該主駆動パルスP1と同極性の補正駆動パルスP2で回転駆動する。
図3において、P1は主駆動パルスP1の駆動範囲を表すと共にロータ202が主駆動パルスP1によって回転駆動される範囲を表し、又、a〜eは主駆動パルスP1の駆動停止後の自由振動によるロータ202の回転位置を表す領域である。
検出区間Tにおいて誘起信号VRsを検出する場合、回転検出回路110は所定のサンプリング周期で誘起信号VRsをサンプリングすることによって誘起信号VRsを検出するように構成されている。検出区間Tは複数のサンプリング周期によって構成されており、前記各サンプリング周期において誘起信号VRsをサンプリングすることによって複数の時点で誘起信号VRsが検出される。
また制御回路103は、パターン(0,0,1,1/0)の場合、駆動余裕大の回転と判定して、この状態が所定の第1回数(本実施の形態では20回)連続した場合には主駆動パルスP1の駆動エネルギをパルスダウンするようにパルス制御を行う。
以下、図1〜図5を参照して、本発明の実施の形態の動作を詳細に説明する。
制御回路103は、前記時間信号を計数して計時動作を行い、先ず主駆動パルスP1nのエネルギランクn及び回数Nを0にして(図5のステップS501)、最小パルス幅の主駆動パルスP10でステッピングモータ105を回転駆動するように制御信号を出力する(ステップS502、S503)。
制御回路103は、処理ステップS506において基準しきい電圧Vcompを超える誘起信号VRsを区間T2後側区間T2_End内で検出していないと判定した場合(パターンが(0,0,0,x)の場合である。)、基準しきい電圧Vcompを超える誘起信号VRsを区間T3内で検出したか否かを判定する(ステップS507)。
制御回路103は、処理ステップS506において基準しきい電圧Vcompを超える誘起信号VRsを区間T2後側区間T2_End内で検出したと判定した場合(パターンが(0,0,1,x)の場合である。)、主駆動パルスP1のランクnが最低ランク0か否かを判定する(ステップS515)。
制御回路103は、処理ステップS505において基準しきい電圧Vcompを超える誘起信号VRsを区間T2前側区間T2_Frt内で検出したと判定した場合(パターンが(0,1,x,x)の場合である。)、主駆動パルスP1のランクnが最低ランク0か否かを判定する(ステップS512)。
制御回路103は、処理ステップS601において基準しきい電圧Vcompを超える誘起信号VRsを区間T2前側区間T2_Frt内で検出していないと判定した場合(パターンが(1,0,x,x)の場合である。)、基準しきい電圧Vcompを超える誘起信号VRsを区間T2後側区間T2_End内で検出したか否かを判定する(ステップS602)。
制御回路103は、処理ステップS603において、基準しきい電圧Vcompを超える誘起信号VRsを区間T3内で検出していないと判定した場合(パターンが(1,0,0,0)の場合であり、非回転の場合である。)には処理ステップS508に移行し、基準しきい電圧Vcompを超える誘起信号VRsを区間T3内で検出したと判定した場合(パターンが(1,0,0,1)の場合である。)には処理ステップS609に移行する。
制御回路103は、処理ステップS601において基準しきい電圧Vcompを超える誘起信号VRsを区間T2前側区間T2_Frt内で検出したと判定した場合(パターンが(1,1,x,x)の場合である。)、主駆動パルスP1のランクnが最低ランク0か否かを判定する(ステップS604)。
制御回路103は、処理ステップS604において主駆動パルスP1のランクnが最低ランク0と判定した場合、処理ステップS608に移行する。
また、前記制御部は、パターン(0,0,1,1/0)が所定の第1回数連続して得られた場合にパルスダウンするように構成することができる。
また、前記制御部は、前記パターンが前記第1区間において前記基準しきい電圧を超える誘起信号が生じていることを示す場合、前記第2区間前側区間及び前記第2区間後側区間において前記基準しきい電圧を超える誘起信号のパターンに基づいて前記主駆動パルスをパルスダウンするか否かを決定するように構成することができる。
また、前記制御部は、パターン(1,0,1,1/0)の場合は主駆動パルスのランクを維持し、パターン(1,1,1/0,1/0)が所定の第2回数連続して得られた場合にはパルスダウンするように構成することができる。
また、前記第2回数は前記第1回数よりも多いように構成することができる。
また、主駆動パルスP1を駆動限界までパルスダウンするようにパルス制御しているので、低消費電力を実現しつつ大きな負荷には駆動パルスのランクを大きくするようにパルス制御することにより、負荷変動に対して最少の電力変化で対応することが可能になる。
また、ステッピングモータの応用例として電子時計の例で説明したが、モータを使用する電子機器に適用可能である。
また、本発明に係るムーブメント及び電子時計は、カレンダ機能付きアナログ電子腕時計、クロノグラフ時計をはじめ、各種のアナログ電子時計に適用可能である。
102・・・分周回路
103・・・制御回路
104・・・駆動パルス選択回路
105・・・ステッピングモータ
106・・・アナログ表示部
107・・・時針
108・・・分針
109・・・秒針
110・・・回転検出回路
111・・・検出区間判別回路
112・・・時計ケース
113・・・ムーブメント
201・・・ステータ
202・・・ロータ
203・・・ロータ収容用貫通孔
204、205・・・切り欠き部(内ノッチ)
206、207・・・切り欠き部(外ノッチ)
208・・・磁心
209・・・コイル
210、211・・・可飽和部
OUT1・・・第1端子
OUT2・・・第2端子
Claims (4)
- 主駆動パルスのエネルギにより回転されるロータの回転状況を検出する回転検出部と、
前記ロータの回転状況に対して前記主駆動パルスのエネルギに余裕がある場合に当該主駆動パルスよりも小さなエネルギの主駆動パルスに変更するパルスダウンを行うことで前記ロータを駆動するように制御する制御部と、を備え、
前記回転検出部は、前記主駆動パルスの印加後に設定されており前記パルスダウンが必要とされない程度の駆動余裕を有するエネルギ状態において前記ロータを中心とする空間の第2象限における前記ロータの最初の正方向の回転状況を判定可能な第1区間、前記第1区間の後に設定されており前記パルスダウンが必要とされない程度の駆動余裕を有するエネルギ状態において前記ロータを中心とする空間の第2象限及び第3象限の少なくとも一方における前記ロータの最初の正方向の回転状況を判定可能な第2区間、及び、前記第2区間の後に設定されており前記パルスダウンが必要とされない程度の駆動余裕を有するエネルギ状態において前記ロータを中心とする空間の第3象限における前記ロータの最初の逆方向の回転以降の回転状況を判定可能な第3区間を含む検出区間であって、前記第2区間が前記第2区間前側区間と前記第2区間前側区間に続く前記第2区間後側区間とに分かれて設定される検出区間において、前記主駆動パルスの印加により生じた誘起信号を検出することにより前記ロータの回転状態を検出し、
前記制御部は、前記第1区間において基準しきい電圧を超える前記誘起信号が検出されず、前記第2区間前側区間において前記基準しきい電圧を超える前記誘起信号が検出された場合、前記主駆動パルスを駆動の都度パルスダウンする
ことを特徴とするステッピングモータ制御回路。 - 前記第2区間後側区間は前記第2区間における最後のサンプリング周期であることを特徴とする請求項1に記載のステッピングモータ制御回路。
- 請求項1または2に記載のステッピングモータ制御回路を備えて成ることを特徴とするムーブメント
- 請求項3記載のムーブメントを備えて成ることを特徴とするアナログ電子時計。
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