JP5990438B2 - 半導体装置の製造方法 - Google Patents
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Description
<半導体装置(BGAパッケージ)の構成例>
半導体装置は、MOSFET(Metal Oxide Semiconductor Field Effect Transistor)などの半導体素子と多層配線を形成した半導体チップと、この半導体チップを覆うように形成されたパッケージから形成されている。パッケージには、(1)半導体チップに形成されている半導体素子と外部回路とを電気的に接続するという機能や、(2)湿度や温度などの外部環境から半導体チップを保護し、振動や衝撃による破損や半導体チップの特性劣化を防止する機能がある。さらに、パッケージには、(3)半導体チップのハンドリングを容易にするといった機能や、(4)半導体チップの動作時における発熱を放散し、半導体素子の機能を最大限に発揮させる機能なども合わせ持っている。
BGAパッケージからなる半導体装置SA1は、上記のように構成されており、以下に、その製造方法について簡単に説明する。図5は、BGAパッケージからなる半導体装置SA1を製造する工程の流れを示すフローチャートである。
上述したように半導体装置SA1においては、配線基板WB上に搭載した半導体チップCHPに形成されているパッドPDと、配線基板WBに形成されているランド端子LD1とをワイヤWで接続することが行われている。
ところが、ソルダレジストSRに形成される開口部OP1の寸法精度が充分に高くないことから、目視による目合わせに使用された半導体装置と開口部OP1の形成位置が異なる半導体装置についても、上述した目視による目合わせに基づいて、ワイヤボンディング工程を実施する可能性がある。この場合、上述したように、例えば、ソルダレジストSRの左端から所定距離だけ離れた位置にワイヤボンディング領域を設定するという調整方法では、以下に示す改善の余地が存在することを本発明者は見出した。すなわち、関連技術では、開口部OP1から露出する帯状配線BLWには特徴パターンが存在しないことから、例えば、図9に示すように、ソルダレジストSRに形成された開口部OP1の左端を基準にして、ワイヤボンディング領域OSR1の座標位置を調整する調整方法が採用されている。
図18は、本実施の形態1における半導体装置SA3の構成例を示す模式図である。図18に示すように、本実施の形態1における半導体装置SA3は、矩形形状の配線基板WB上に半導体チップCHPが搭載されている。そして、半導体チップCHPに形成されているパッドPDと、配線基板WB上に形成されているランド端子LD1がワイヤWで電気的に接続されている。
以上のように、本実施の形態1では、ソルダレジストSRに設けられた開口部OP1内に、帯状配線BLWのボンディング領域AR1に対応づけてマークMK1を形成している点に特徴点がある。以下に、このように形成されているマークMK1による利点について説明する。
本実施の形態1における半導体装置は上記のように構成されており、以下に、その製造方法について図面を参照しながら説明する。
以下に、上述したワイヤボンディング工程の詳細について、図面を参照しながら説明する。具体的には、上述した第1利点および第2利点を考慮した本実施の形態1におけるワイヤボンディング工程について説明する。
次に、本実施の形態1の変形例1について説明する。例えば、図38は、本実施の形態1におけるマークMK1の形状を示す図である。図38に示すように、ソルダレジストSRに形成された開口部OP1から帯状配線BLWの一部が露出しており、この帯状配線BLWから突出するように凸形状のマークMK1が形成されている。つまり、本実施の形態1では、帯状配線BLWと一体的に形成され、かつ、突出した矩形形状からなるマークMK1が示されている。そして、このマークMK1は、帯状配線BLWのワイヤボンディング領域AR1に対応して設けられている。例えば、この矩形形状をしたマークMK1の中心線の延長線上にワイヤボンディング領域AR1が存在するように、マークMK1を配置することができる。なお、矩形形状をしたマークMK1においては、例えば、マークMK1のサイズを大きくすることができるため、マークMK1の視認性を向上させることができる。また、マークMK1のX方向の幅を信号線用のボンディングフィンガ(リードLD1)と同じ幅で設計することもできる。さらには、マークMK1のY方向の幅の分だけ、ワイヤを接続するY方向のマージンが増加する利点がある。
続いて、本実施の形態1の変形例2について説明する。図43は、本変形例2において、ソルダレジストSRに形成された開口部OP1の近傍領域を示す拡大図である。図43に示すように、ソルダレジストSRには、開口部OP1が設けられており、この開口部OP1から帯状配線BLWの一部領域が露出している。そして、例えば、図43に示すように、開口部OP1から露出する帯状配線BLWの一部領域に、マークMK1〜MK3が形成されている。すなわち、本変形例2において、開口部OP1から露出する帯状配線BLWには、マークMK1〜MK3が所定間隔を置いて並んで配置されている。具体的に、本変形例2においては、ワイヤボンディング領域AR1に対応づけられてマークMK1が形成され、ワイヤボンディング領域AR2に対応づけられてマークMK2が形成されている。さらに、ワイヤボンディング領域AR3に対応づけられてマークMK3が形成されている。
認識によってマークMK2を検出し、検出したマークMK2の位置を基準としてワイヤボンディング領域AR2を特定することができる。さらに、続けて、本変形例2では、カメラ認識によってマークMK3を検出し、検出したマークMK3の位置を基準としてワイヤボンディング領域AR3を特定することができる。このようにして、特定されたワイヤボンディング領域AR1〜AR3にワイヤが接続される。
次に、本実施の形態1の変形例3について説明する。図44は、本変形例3において、ソルダレジストSRに形成された開口部OP1の近傍領域を示す拡大図である。図44に示すように、ソルダレジストSRには、開口部OP1が設けられており、この開口部OP1から帯状配線BLWの一部領域が露出している。そして、例えば、図44に示すように、開口部OP1から露出する帯状配線BLWの一部領域に、マークMK1およびマークMK3が形成されている。すなわち、本変形例3において、開口部OP1から露出する帯状配線BLWには、マークMK1およびマークMK3が所定間隔を置いて配置されている。具体的に、本変形例3においては、ワイヤボンディング領域AR1に対応づけられてマークMK1が形成され、ワイヤボンディング領域AR3に対応づけられてマークMK3が形成されている。なお、本変形例3においては、ワイヤボンディング領域AR2に対応づけられたマークは形成されていない。
<配線基板のレイアウト構成>
図45は、本実施の形態2における半導体装置に使用される配線基板WBの主面(表面)のレイアウト構成を示す図である。図45に示すように、本実施の形態2における配線基板WBは矩形形状をしており、中央部に矩形形状をしたGNDプレーン(プレーン配線)GPが形成されている。このGNDプレーンGPは、ビアVA(G)を介して基準電位(GND電位、接地電位)が供給されるようになっており、このGNDプレーンGP上に半導体チップが搭載される。つまり、GNDプレーンGPと半導体チップとは、平面視において重なるように配置されていることになる。
続いて、本実施の形態2における特徴について説明する。図49は、本実施の形態2における配線基板WBの表面(第1層)に形成されている一部領域を拡大して示す図である。図49に示すように、まず、本実施の形態2における配線基板WBでは、GNDプレーンGPの外側に帯状配線BLW(G)が配置されており、このGNDプレーンGPと帯状配線BLW(G)が複数の接続配線GWLで接続されていることがわかる。具体的に、帯状配線BLW(G)は、基本的にソルダレジストSRで覆われており、帯状配線BLW(G)の一部分がソルダレジストSRに設けられた開口部OP1から露出している。この開口部OP1から露出している帯状配線BLW(G)の一部分がGNDプレーンGPと複数の接続配線GWLで電気的に接続されている。これにより、帯状配線BLW(G)に供給される基準電位の安定化を図ることができ、これによって、半導体装置の電気的特性の向上を図ることができる。
図50は、本実施の形態2の変形例1における配線基板WBの表面(第1層)に形成されている一部領域を拡大して示す図である。図50に示す本変形例1の構成は、図49に示す実施の形態2の構成とほぼ同様の構成をしているため、相違点を中心に説明する。
図51は、本実施の形態2の変形例2における配線基板WBの表面(第1層)に形成されている一部領域を拡大して示す図である。図51に示す本変形例2の構成は、図49に示す実施の形態2の構成とほぼ同様の構成をしているため、相違点を中心に説明する。
次に、本実施の形態2におけるワイヤボンディング工程の詳細について、図面を参照しながら説明する。
次に、本実施の形態2における他のワイヤボンディング工程の詳細について、図面を参照しながら説明する。
上述したように、本実施の形態2における技術的思想は、ワイヤボンディング工程1やワイヤボンディング工程2で実現することができる。特に、本実施の形態1におけるワイヤボンディング工程1では、ワイヤボンディング工程2よりも有利な点が存在する。以下に、ワイヤボンディング工程1の利点について説明する。
AR0 ワイヤボンディング領域
AR1 ワイヤボンディング領域
AR2 ワイヤボンディング領域
AR3 ワイヤボンディング領域
AR4 ワイヤボンディング領域
AR5 ワイヤボンディング領域
BLW 帯状配線
BLW(G) 帯状配線
BLW(V1) 帯状配線
BLW(V2) 帯状配線
BR1 ワイヤボンディング領域
CAD1 ワイヤボンディング領域
CAD2 ワイヤボンディング領域
CAD3 ワイヤボンディング領域
CAD4 ワイヤボンディング領域
CAD5 ワイヤボンディング領域
CAP キャピラリ
CHP 半導体チップ
GP GNDプレーン
GPT1 GNDパターン
GPT2 GNDパターン
GWL 接続配線
ISD1 第1内辺
LD1 ランド端子
LD2 端子
MK1 マーク
MK1(G) マーク
MK1(V1) マーク
MK1(V2) マーク
MK2 マーク
MK2(G) マーク
MK2(V1) マーク
MK2(V2) マーク
MK3 マーク
MK4 マーク
MK5 マーク
MR 樹脂
MSD1 第1マーク辺
MSD2 第2マーク辺
OP1 開口部
OP2 開口部
OP3 開口部
OSD1 第1外辺
OSR1 ワイヤボンディング領域
OSR2 ワイヤボンディング領域
OSR3 ワイヤボンディング領域
OSR4 ワイヤボンディング領域
OSR5 ワイヤボンディング領域
PD パッド
PTN1(V1) 電源パターン
PTN1(V2) 電源パターン
PTN2(V1) 電源パターン
PTN2(V2) 電源パターン
RR 認識領域
SA1 半導体装置
SB 半田ボール
SD1 第1辺
SD2 第2辺
SR ソルダレジスト
VA ビア
VA(G) ビア
VA(V1) ビア
VA(V2) ビア
W ワイヤ
W1 ワイヤ
W2 ワイヤ
W3 ワイヤ
W4 ワイヤ
W5 ワイヤ
WB 配線基板
WL 配線
Claims (17)
- (a)第1帯状配線が配置され、前記第1帯状配線の一部を覆う絶縁膜が形成された第1主面を有する配線基板を準備する工程と、
(b)複数のパッドが配置された表面を有する矩形状の半導体チップを前記配線基板の前記第1主面上に搭載する工程と、
(c)前記半導体チップの前記複数のパッドと前記第1帯状配線の一部とをそれぞれ第1金属ワイヤおよび第2金属ワイヤを含む複数の金属ワイヤにより電気的に接続する工程と、
(d)前記配線基板の一部、前記半導体チップ、および、前記複数の金属ワイヤを封止して封止体を形成する工程と、を備え、
平面視において、前記配線基板の前記第1主面には、前記半導体チップの外縁に沿って、前記第1帯状配線が配置され、
前記配線基板の前記絶縁膜には、第1開口部が形成され、
前記第1開口部からは、前記第1帯状配線の第1領域と、前記第1領域に対応して設けられた第1マーク領域と、前記第1帯状配線の一部領域であって、前記第1領域とは第1所定間隔だけ離れた第2領域と、が露出し、
前記(c)工程は、
(c1)前記第1マーク領域を検出することにより、前記第1領域の位置を特定する工程と、
(c2)前記(c1)工程後、前記(c1)工程で特定した前記第1領域の位置に基づいて、前記第1金属ワイヤを前記第1領域に接続する工程と、
(c3)前記(c2)工程後、前記(c1)工程で特定した前記第1領域の位置に基づいて、前記第1領域とは前記第1所定距離だけ離れた前記第2領域に前記第2金属ワイヤを接続する工程と、を有する半導体装置の製造方法。 - 請求項1に記載の半導体装置の製造方法であって、
前記第1開口部内において、前記第1帯状配線は前記半導体チップの第1辺に沿う方向である第1方向に伸びるように配置され、
前記第1方向に直交する方向である第2方向において、前記第1金属ワイヤと前記第1帯状配線の前記第1領域との接続点の延長線上に前記第1マーク領域の中心が位置するように前記第1マーク領域は配置されている半導体装置の製造方法。 - 請求項2に記載の半導体装置の製造方法であって、
前記第1帯状配線は、前記半導体チップの前記第1辺と対向する第1内辺と、前記第1内辺と対向し、前記第1内辺よりも外側に位置する第1外辺と、を有し、
前記第1マーク領域は、前記第1外辺よりも外側に設けられている半導体装置の製造方法。 - 請求項3に記載の半導体装置の製造方法であって、
前記第1マーク領域は、前記第1帯状配線の一部であって、前記第1外辺と接している半導体装置の製造方法。 - 請求項4に記載の半導体装置の製造方法であって、
平面視において、前記第1マーク領域は前記第1外辺から突出している半導体装置の製造方法。 - 請求項5に記載の半導体装置の製造方法であって、
前記第1マーク領域は、前記第1外辺から凸状に突出し、
前記第1マーク領域は、前記第1外辺と交差する第1マーク辺と、前記第1マーク辺と交差し、かつ前記第1外辺と対向する第2マーク辺と、を有し、
前記第2マーク辺の長さは、前記第1マーク辺の長さよりも長い半導体装置の製造方法。 - 請求項1に記載の半導体装置の製造方法であって、
前記第1開口部からは、さらに、前記第1帯状配線の一部領域であって、前記第1領域とは第2所定間隔だけ離れた第3領域が露出し、
前記(c)工程は、
(c4)前記(c3)工程の後、前記(c1)工程で特定した前記第1領域の位置に基づいて、前記第1領域とは前記第2所定間隔だけ離れた前記第3領域に前記複数の金属ワイヤのうちの第3金属ワイヤを接続する工程をさらに有し、
前記(c4)工程は、前記第1領域上の前記第1金属ワイヤが接続された点から前記第2領域上の前記第2金属ワイヤが接続された点までの第1距離と、前記第2領域上の前記第2金属ワイヤが接続された点から前記第3領域上の前記第3金属ワイヤが接続された点までの第2距離と、が等しくなるように前記第3領域に前記第3金属ワイヤを接続する半導体装置の製造方法。 - 請求項1に記載の半導体装置の製造方法であって、
平面視において、前記配線基板の前記第1主面には、前記半導体チップと前記第1帯状配線との間に、前記半導体チップの前記外縁に沿って、第2帯状配線が配置され、
前記配線基板の前記絶縁膜には、第2開口部が形成され、
前記第2開口部からは、前記第2帯状配線の第4領域と、前記第4領域に対応して設けられた第4マーク領域と、が露出し、
前記(c1)工程は、さらに前記第4マーク領域も検出することにより、前記第4領域の位置を特定し、
前記(c)工程は、前記(c1)工程後、前記(c2)工程前に、前記(c1)工程で特定した前記第4領域の位置に基づいて、前記複数の金属ワイヤのうちの第4金属ワイヤを前記第4領域に接続する半導体装置の製造方法。 - 請求項8に記載の半導体装置の製造方法であって、
前記第2帯状配線は、前記半導体チップの第1辺と対向する第2内辺と、前記第2内辺と対向し、前記第2内辺よりも外側に位置する第2外辺と、を有し、
前記第4マーク領域は、前記第2外辺よりも外側に設けられている半導体装置の製造方法。 - 請求項8に記載の半導体装置の製造方法であって、
前記第1帯状配線は、前記半導体チップに第1電源電位を供給する配線であり、
前記第2帯状配線は、前記半導体チップに接地電位を供給する配線である半導体装置の製造方法。 - 請求項8に記載の半導体装置の製造方法であって、
平面視において、前記配線基板の前記第1主面には、前記第1帯状配線の外側に、前記半導体チップの前記外縁に沿って、第3帯状配線が配置され、
前記配線基板の前記絶縁膜には、第3開口部が形成され、
前記第3開口部からは、前記第3帯状配線の第5領域と、前記第5領域に対応して設けられた第5マーク領域と、が露出し、
前記(c1)工程は、さらに前記第5マーク領域も検出することにより、前記第5領域の位置を特定し、
前記(c)工程は、前記(c2)工程後に、前記(c1)工程で特定した前記第5領域の位置に基づいて、前記複数の金属ワイヤのうちの第5金属ワイヤを前記第5領域に接続する半導体装置の製造方法。 - 請求項11に記載の半導体装置の製造方法であって、
前記第3帯状配線は、前記半導体チップの第1辺と対向する第3内辺と、前記第3内辺と対向し、前記第3内辺よりも外側に位置する第3外辺と、を有し、
前記第5マーク領域は、前記第3外辺よりも外側に設けられている半導体装置の製造方法。 - 請求項11に記載の半導体装置の製造方法であって、
前記第3帯状配線は、前記半導体チップに第2電源電位を供給する配線である半導体装置の製造方法。 - 請求項11に記載の半導体装置の製造方法であって、
前記配線基板は、前記第1主面とは反対側であって、複数の外部端子が配置された第2主面を有し、
平面視において、前記第1帯状配線と前記第3帯状配線との間には前記複数の外部端子の一部と電気的に接続されたビアが配置されており、
前記ビアは、前記第1帯状配線もしくは前記第3帯状配線のいずれかと電気的に接続されている半導体装置の製造方法。 - 請求項8に記載の半導体装置の製造方法であって、
前記配線基板は、前記第1主面とは反対側であって、複数の外部端子が配置された第2主面を有し、
前記配線基板の前記第1主面には、平面視において、前記半導体チップと重なる領域にプレーン配線が配置されており、
前記プレーン配線は、前記複数の外部端子の一部と電気的に接続されており、さらに、前記第2帯状配線と複数の第1配線を介して電気的に接続されている半導体装置の製造方法。 - 請求項15に記載の半導体装置の製造方法であって、
前記第2帯状配線は、前記半導体チップの第1辺と対向する第2内辺と、前記第2内辺と対向し、前記第2内辺よりも外側に位置する第2外辺と、を有し、
前記第4マーク領域は、前記第2内辺よりも内側に設けられ、
平面視において、前記第4マーク領域は、前記複数の第1配線のうちの互いに隣接する2本の配線の間に配置される半導体装置の製造方法。 - 請求項1に記載の半導体装置の製造方法であって、
前記第1開口部からは、さらに、前記第2領域とは所定間隔だけ離れた第3領域と、前記第3領域に対応して設けられた第3マーク領域と、が露出し、
前記(c1)工程は、さらに前記第3マーク領域も検出することにより、前記第3領域の位置を特定し、
前記(c)工程は、前記(c3)工程後、前記(c1)工程で特定した前記第3領域の位置に基づいて、前記複数の金属ワイヤのうちの第3金属ワイヤを前記第3領域に接続する半導体装置の製造方法。
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