JP5987203B1 - A/d変換装置、d/a変換装置、及びplc - Google Patents
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Abstract
Description
図1は、この発明に係るPLCシステムの構成図である。PLCシステムは、PLC1000及び周辺装置2000を備える。PLC1000は、少なくともA/D変換装置100、D/A変換装置200及びCPU装置300とを備える。PLC1000は、例えば、外部メモリ400、外部機器の入出力制御を実現するI/O制御装置、PLCネットワークを実現するためのネットワーク通信装置等を備えていても良い。PLC1000が備える各装置は、互いにユニット間バス500を介して接続される。周辺装置2000は、例えばパーソナルコンピュータであり、ユーザプログラムの設定または内部メモリ330のデータの状態の表示等を行う。
図1は、この発明に係るPLCシステムの構成図である。この実施の形態におけるPLCシステムは、実施の形態1と同態様である。
Claims (7)
- アナログデータをデジタルデータに変換するA/D変換部と、
前記A/D変換部による変換後のデジタルデータを格納する一時記憶領域を備える記憶部と、
前記A/D変換部による変換後のデジタルデータを前記一時記憶領域に格納させ、前記一時記憶領域のうち前記A/D変換部による変換後のデジタルデータを最後に格納したアドレスの次のアドレスに前記A/D変換部により新たに変換されたデジタルデータを格納させるとともに、前記一時記憶領域に格納されかつ転送されていないデジタルデータのうち最初に格納されたデジタルデータを転送させる制御部と
を備え、
前記一時記憶領域は、第一及び第二の領域に分割され、
前記制御部は、前記A/D変換部によるA/D変換後のデジタルデータを前記第一の領域に格納させ、当該格納したデジタルデータのデータ量が前記第一の領域に割り当てられたデータ量と一致した場合に、前記第一の領域に格納されているデジタルデータを出力可能にするとともに前記A/D変換部により新たに変換されたデジタルデータを前記第二の領域に格納させるA/D変換装置。 - 前記一時記憶領域は、第一、第二及び第三の領域に分割され、
前記制御部は、前記第二の領域に格納したデジタルデータのデータ量が前記第二の領域に割り当てられたデータ量と一致したときに前記第一の領域に格納されているデジタルデータを出力している場合に、前記第二の領域に格納されているデジタルデータを出力可能にするとともに前記第一の領域に格納されているデジタルデータの出力を継続し前記A/D変換部により新たに変換されたデジタルデータを前記第三の領域に格納させる請求項1に記載のA/D変換装置。 - 前記制御部は、前記記憶部に、前記一時記憶領域を構成する各領域に割り当てられたデータ量及び前記A/D変換部による変換後のデジタルデータが最後に格納されたアドレスを格納させ、前記一時記憶領域のいずれかの領域に格納されたデジタルデータのデータ量が当該領域に割り当てられたデータ量と一致した場合に、当該領域に格納されているデジタルデータの取出要求と当該領域に割り当てられたデータ量と前記A/D変換部による変換後のデジタルデータが最後に格納されたアドレスとを出力する請求項1または請求項2のいずれかに記載のA/D変換装置。
- デジタルデータをアナログデータに変換するD/A変換部と、
前記D/A変換部に変換されるデジタルデータを格納する一時記憶領域を備える記憶部と、
前記一時記憶領域に前記D/A変換部に変換されるデジタルデータが格納されている場合に、当該デジタルデータを前記D/A変換部への出力を継続させながら前記D/A変換部へすでに出力されているデジタルデータが格納されているアドレスに新たに読み出したデジタルデータを書き込む制御部と
を備え、
前記一時記憶領域は、第一及び第二の領域に分割され、
前記制御部は、前記第一及び前記第二の領域それぞれに前記D/A変換部に変換されるデジタルデータが格納されている場合に前記一時記憶領域の前記第一の領域に格納されているデジタルデータを前記D/A変換部へ出力させ、当該出力したデジタルデータのデータ量が前記第一の領域に割り当てられたデータ量と一致した場合に、前記第一の領域に前記D/A変換部により新たに変換されるデジタルデータを書き込み可能にするとともに前記第二の領域に格納されているデジタルデータを前記D/A変換部へ出力させるD/A変換装置。 - 前記一時記憶領域は、第一、第二及び第三の領域に分割され、前記第一、第二及び第三の領域それぞれに前記D/A変換部に変換されるデジタルデータを格納し、
前記制御部は、前記第二の領域に格納されているデジタルデータを前記D/A変換部へ出力し終えたときに前記第一の領域へ前記D/A変換部により新たに変換されるデジタルデータの格納を行っている場合に、
前記第二の領域に前記D/A変換部により新たに変換されるデジタルデータを書き込み可能にするとともに前記第一の領域への前記D/A変換部により新たに変換されるデジタルデータの格納を継続し前記第三の領域に格納されているデジタルデータを前記D/A変換部へ出力させる請求項4に記載のD/A変換装置。 - 前記制御部は、前記記憶部に、前記一時記憶領域を構成する各領域に割り当てられたデータ量及び前記D/A変換部に変換されるデジタルデータが最後に出力されたアドレスを格納させ、前記一時記憶領域のいずれかの領域に格納されたデジタルデータを出力し終えた場合に、当該領域へのデジタルデータの取得要求と当該領域に割り当てられたデータ量と前記D/A変換部に変換されるデジタルデータが最後に出力されたアドレスとを出力する請求項4または請求項5のいずれかに記載のD/A変換装置。
- 請求項1から請求項3のいずれか1項に記載のA/D変換装置と、
請求項4から請求項6のいずれか1項に記載のD/A変換装置と、
デジタルデータを格納する内部メモリを備え、前記A/D変換装置が前記A/D変換装置の一時記憶領域に格納されているデジタルデータを出力すると当該デジタルデータを前記内部メモリに格納し、前記D/A変換装置の一時記憶領域に格納するデジタルデータを前記内部メモリから出力するCPU装置と
を備えるPLC。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/JP2015/000417 WO2016120906A1 (ja) | 2015-01-30 | 2015-01-30 | A/d変換装置、d/a変換装置、及びplc |
Publications (2)
Publication Number | Publication Date |
---|---|
JP5987203B1 true JP5987203B1 (ja) | 2016-09-07 |
JPWO2016120906A1 JPWO2016120906A1 (ja) | 2017-04-27 |
Family
ID=56542574
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2015553699A Active JP5987203B1 (ja) | 2015-01-30 | 2015-01-30 | A/d変換装置、d/a変換装置、及びplc |
Country Status (6)
Country | Link |
---|---|
JP (1) | JP5987203B1 (ja) |
KR (1) | KR101781324B1 (ja) |
CN (1) | CN107210750A (ja) |
DE (1) | DE112015006089T5 (ja) |
TW (1) | TW201633168A (ja) |
WO (1) | WO2016120906A1 (ja) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7067260B2 (ja) * | 2018-05-18 | 2022-05-16 | オムロン株式会社 | 制御装置及びデータ記録方法 |
WO2020105173A1 (ja) | 2018-11-22 | 2020-05-28 | 三菱電機株式会社 | データ制御装置、プログラマブルロジックコントローラ及びデータ制御方法 |
JP7358772B2 (ja) * | 2019-05-09 | 2023-10-11 | オムロン株式会社 | 制御装置、制御方法、制御プログラム |
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Publication number | Priority date | Publication date | Assignee | Title |
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-
2015
- 2015-01-30 WO PCT/JP2015/000417 patent/WO2016120906A1/ja active Application Filing
- 2015-01-30 CN CN201580074927.2A patent/CN107210750A/zh active Pending
- 2015-01-30 KR KR1020177020860A patent/KR101781324B1/ko active IP Right Grant
- 2015-01-30 JP JP2015553699A patent/JP5987203B1/ja active Active
- 2015-01-30 DE DE112015006089.8T patent/DE112015006089T5/de not_active Withdrawn
- 2015-12-22 TW TW104143102A patent/TW201633168A/zh unknown
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Also Published As
Publication number | Publication date |
---|---|
DE112015006089T5 (de) | 2017-10-19 |
CN107210750A (zh) | 2017-09-26 |
KR20170093986A (ko) | 2017-08-16 |
KR101781324B1 (ko) | 2017-09-22 |
WO2016120906A1 (ja) | 2016-08-04 |
TW201633168A (zh) | 2016-09-16 |
JPWO2016120906A1 (ja) | 2017-04-27 |
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