JP5684281B2 - ナノワイヤを有する垂直フォトゲート(vpg)ピクセル構造 - Google Patents
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Description
本出願は、「VERTICAL WAVEGUIDES WITH VARIOUS FUNCTIONALITY ON INTEGRATED
CIRCUITS」と題する米国特許出願第12/270,233号の一部継続出願である。当該米国特許出願の内容は参照により全体として本明細書に組み込まれる。本出願は、2009年11月19日に出願され「NANOWIRE CORE-SHELL LIGHT PIPES」と題する米国特許出願12/621,497に関連する。当該米国特許出願の内容は参照により全体として本明細書に組み込まれる。
図2は、マイクロレンズを備えるイメージセンサの一実施形態の断面図を示す。
図3−1〜図3−19は、一実施形態に係るイメージセンサのライトガイドを作製する様々な工程を示す。
図4は、一実施形態に係るイメージセンサのライトガイドの作製時にPN接合を有するナノワイヤを成長させる工程を示す。
図5は、一実施形態に係るイメージセンサのライトガイドの作製時にPIN接合を有するナノワイヤを成長させる工程を示す。
図6は、一実施形態に係るイメージセンサの一つの空洞内にあるナノワイヤアレイの一実施形態を示す。
図7は、本明細書に開示されている実施形態に係るイメージセンサを備えるデバイスの上面図の概略図を示し、各イメージセンサは、補色を表す2つの出力を有する。
図8aは、一実施形態に係るナノワイヤデバイスの断面図を示す。
図8bは、一実施形態に係るナノワイヤデバイスの上面図を示す。
図9aは、図8a及び図8bに図示された実施形態の簡略化した断面図を示す。
図9bは、A−A線に沿うナノワイヤにおけるポテンシャルをプロットした図を示す。
図10は、図9aのC−C線に沿うナノワイヤのポテンシャルをプロットした図を示す。
図11aは、徐々に先細となるフォトゲートを備えるナノワイヤの断面図を示す。
図11bは、階段状に先細となる一実施形態のフォトゲートを有するナノワイヤの断面図を示す。
図12aは、徐々に先細となるフォトゲートを備えるナノワイヤの断面図を示す。
図12bは、階段状に先細となる一実施形態のフォトゲートを有するナノワイヤの断面図を示す。
図13は、一実施形態に係るナノワイヤデバイスの断面図を示す。
図14は、垂直PINナノワイヤを有する一実施形態に係るナノワイヤデバイスの断面図を示す。
図15は、垂直PINナノワイヤを有する一実施形態に係るナノワイヤデバイスの断面図を示す。
参照符号 構成要素
VPG 1 (VP Gate 1):第1垂直フォトゲート
VPG 2 (VP Gate 1):第2垂直フォトゲート
TX Gate:トランスファーゲート
FD:トランスファードレイン
RG:リセットゲート
RD:リセットドレイン
Sub:基板
VDD:正のトランジスタ電圧
Vout:出力電圧
NW (nw):ナノワイヤ
De:誘電体レイヤ
PG:フォトゲート
I (i):電流
n+, n-:過剰ドナーを有する半導体物質であり、n+は高濃度にドープされていることを示し、n-は低濃度にドープされていることを示す。
p+, p-:過剰ドナーを有する半導体物質であり、p+は高濃度にドープされていることを示し、p-は低濃度にドープされていることを示す。
図面においては、文脈上別に解される場合を除き、類似の記号は一般に類似のコンポーネントを示す。詳細な説明で説明された実施形態、図面、及び請求項は、本発明の範囲を限定することを意図するものではない。本明細書において提示される発明主題の趣旨や範囲を逸脱しない限り、詳細な説明で説明されていない実施形態を適用することも可能であり、詳細な説明で説明されていない変更をなすことも可能である。
しかしながら、ナノワイヤデバイスにおいては、フォトゲートは垂直方向に形成される。すなわち、ナノワイヤの側面から起立している。ナノワイヤは、約100ナノメートル以下の厚み又は径を有する構造であり、その長さは制約されない。換言すれば、ナノワイヤは、その径がナノメートルスケール(1nm〜 100nm)の長いワイヤ状の構造である。トランスファーゲートは、ピクセル内で用いられるスイッチのゲートである。トランスファーゲートの役割は、デバイスの一方から他方へ電荷を伝達することである。一部の実施形態においては、トランスファーゲートは、フォトダイオードからセンスノードへ電荷を伝達するため(又は浮動拡散のため)に用いられる。リセットゲートは、デバイスをリセットするために用いられるゲートである。一部の実施形態においては、デバイスはn+領域によって形成されるセンスノードである。リセットは、特定の電圧により設定されたオリジナル電圧レベルに復元することを意味する。一部の実施形態においては、リセットドレイン(RD)の電圧がリセットレベルとして用いられる電圧となる。
基板は、通常接地されている他の電極を有する。その間にある空乏領域は絶縁体を備える。
対照的に、深いレイヤは、数μmから数十μmの深さであってもよい。
好ましくは、デバイスは、コア及びクラッドにおいて検出された電磁放射エネルギーの適切な組み合わせによって、電磁放射に含まれている白黒又は発光情報を解決するように構成される。
導波管はカットオフ波長λctを有する。入射電磁放射のうちカットオフ波長よりも大きい波長を有する部分は、コアによって閉じ込められる。結果として、カットオフ波長が緑色の導波管として機能する光パイプは、コアの中を通って赤色光を伝播させない。
蓄積された電荷を制御及び検出するために、金属及び半導体に対して接触する。
コアは、ナノワイヤを成長させ、当該ナノワイヤを囲む絶縁体レイヤ及び金属レイヤを蒸着させることによって形成され得る。
(2)コアワイヤ内にポテンシャル勾配を誘起するPIN接合を備えるコア。コア内のPIN接合は、ナノワイヤを成長させ、当該ナノワイヤのコアがPIN接合として成長しているときにドープし、任意のデバイスの一部である様々な金属レイヤを用いて適切な時点で接触させることによって形成され得る。当該実施形態の感光性素子は、典型的には、フォトダイオードを備えるが、フォトダイオードのみに限定されるものではない。
誘電材料には、真空中での測定で約4〜20の誘電率を有するシリコンの酸化物、窒化物、及び酸窒化物が含まれるがこれらのものには限られない。また、約20から少なくとも約100の誘電率を有する、概して高い誘電率のゲート誘電材料も含まれるが、同様にこれらにも限定されない。これらの高誘電率の誘電材料には、酸化ハフニウム、ケイ酸ハフニウム、酸化チタン、チタン酸バリウムストロンチウム(BSTs)、及びチタン酸ジルコン酸鉛(PZTs)が含まれるが、これらのものには限られない。
シリコンの酸化物、窒化物、酸窒化物は、誘電性スペーサ材料として広く用いられている。その他の元素の酸化物、窒化物、及び酸窒化物も排除されない。
誘電性スペーサ材料は、上述したものと類似の、同等の、又は同一の方法を用いて堆積される。スペーサレイヤは、スペーサレイヤに内側に尖った形状の特徴を付与するブランケットレイヤ析出法及びエッチバック法を用いて形成することもできる。
表2
典型的な材料 屈折率
マイクロレンズ(ポリマー) 1.583
スペーサ 1.512
カラーフィルタ 1.541
平坦化 1.512
PESiN 2.00
PESiO 1.46
SiO 1.46
表2において、PESiNは、プラズマ強化SiNを示し、PESiOは、プラズマ強化SiOを示す。
これらの出力は、以下のように配置される。
1 2 1 2 1 2 1 2
1 2 1 2 1 2 1 2…
2 1 2 1 2 1 2 1
2 1 2 1 2 1 2 1…
1 2 1 2 1 2 1 2
1 2 1 2 1 2 1 2…
………………………………...
………………………………...
これらのコアは、異なる波長 (λB and λR)の光を導くために、d1及びd2の直径を有している。この二つのコアは、フォトダイオードとしても機能し、波長λB 及びλRの光を受容する。この二つのイメージセンサのクラッドは、波長w-B 及びw-R.の光を伝達する。クラッドを通って伝達される波長λW-B 及びλW-R の光は、コアを取り囲む周辺感光性素子によって検出される。ここで、(w)は、白色光の波長を示す。複合ピクセルにおける四つのフォトダイオード(二つコアに配置され、残りの二つは当該コアを取り囲む基板上又は基板内に配置される)からの信号は、色を構成するために用いられる。
ともも称される。)を有する。第1の屈折率が第2の屈折率よりも大きい、つまりn1> n2と仮定することにより、良好な波ガイド特性が光パイプに提供される。導波管特性は、導波管コアに光学的にアクティブなクラッドレイヤを導入することにより、さらに改善され得る。ナノワイヤコアは、導波管として用いられ、ナノ構造を有し、アクティブキャパシタでもあるPDとしても用いられる。本実施形態のナノ構造を有するPDは、大量生産に適しており、説明される方法は、工業用途に拡張可能である。
本実施形態の構成によれば、ナノワイヤ中にヘテロ構造及び異なるドーピングの領域の含有を可能にし、電気的及び/又は光学的特性の最適化を促進する。本実施形態のナノ構造を有するPDは、直立したナノワイヤを備える。本出願においては、直立したナノワイヤは、基板から所定の角度で突出しているナノワイヤとして解釈されるべきである。直立したナノワイヤは、例えば、基板から成長することができる。ナノワイヤは、好ましくは、VLS法で成長させることができる。
基板との角度は、典型的には、基板及びナノワイヤの材料、基板表面、及び成長条件によって決まる。これらのパラメータを制御することにより、ナノワイヤを一方向例えば垂直方向にのみ突出させることができ、限られた方向に突出させることもできる。例えば、ナノワイヤ及びせん亜鉛鉱及びダイヤモンド半導体の基板は、周期表の第3族、第4族及び第5族の元素から成る。かかるナノワイヤは{111}方向に成長し、次に基板表面の任意の{111}方向に向かう通常の方向に成長することができる。表面と垂直な方向とナノワイヤの軸方向との間の角度として与えられる方向には、70,53°傾斜した {111}方向、54,73°傾斜した {100}方向、および35,27°及び 90°傾斜した{110}方向が含まれる。このように、ナノワイヤは、一つの又は限定された組の方向を規定する。
本実施形態においては、ナノワイヤの径は、所望の光の波長と望ましく対応するように選択される。好ましくは、ナノワイヤの寸法は、生成光の特定の波長に最適化された均一な光学的キャビティがナノワイヤに沿って提供されるように、定められる。コアナノワイヤは、所望の光を取り込むことができる程度に幅広でなければならない。経験則によれば、径は、λ/2nwよりも大きくなければならない。ここで、λは、所望の光の波長であり、nwはナノワイヤの屈折率である。一例として、シリコンナノワイヤに限られるが、青色光のみを閉じ込めるには約60nmの径が適切であり、青色光及び緑色光を閉じ込めるには約60nmの径が適切である。
1.リソグラフィによりシリコン基板における局所的な触媒を決定する工程。
2.局所的な触媒からシリコンナノワイヤを成長させる工程。成長パラメータは、触媒によるワイヤ成長のために調整される。
3.他の半導体、パッシベーション、又はナノワイヤの周囲の絶縁体薄膜もしくは金属薄膜(クラッドレイヤ)の径方向の成長。
4.基板及びCMOS回路における他の金属レイヤへの接点をPDナノワイヤ上に形成。
成長処理は、例えばナノワイヤにヘテロ構造を含めること、反射レイヤを設けることなどの公知の方法により変更可能である。
ZnO, InSb, SOI (silicon-on-insulator) , CdS, ZnSe, 及びCdTe。ナノワイヤ110用に好適な材料には、以下のものが含まれるが、それらに限定されるものではない。Si, GaAs (p), InAs, Ge, ZnO, InN, GaInN, GaN AlGaInN, BN, InP,
InAsP, GaInP, InGaP:Si, InGaP:Zn, GaInAs, lInP, GaAlInP, GaAlInAsP, GaInSb,及びInSb。利用できるドナードーパントには、例えば、GaP, Te, Se, S等があり、同一材料に対するアクセプタドーパントには、Zn, Fe, Mg, Be, Cd等がある。ナノワイヤ技術によってSiN, GaN, InN及びAlN等の窒化物が利用可能になっている。これらの窒化物によって、従来技術によってはアクセスが困難だった波長領域においても光を検出するPDの作製が促進される。
AuGe, PdGe, Ti/Pt/Au, Ti/Al/Ti/Au, Pd/Au, 及びITO (InSnO)等の金属、金属合金、及び非金属化合物、並びにこれらの組み合わせ(例えば、金属とITOとの組み合わせ)を用いることができる。
また、これにより、イメージセンサに衝突する光の大部分の検出を可能にする複合フォトダイオードの構成が可能となる。
ナノワイヤの周囲のキャパシタ
実施例1の実施形態は、コア及びクラッドを備える光パイプの製造方法に関する。コアは、半導体ナノワイヤ、絶縁体、金属の三つのレイヤから成り、これによりナノワイヤにおいて光誘起キャリアによって生成された電荷を集めるキャパシタを形成する。
加えて、堆積温度が下げられるほど、直径のばらつきが狭まる傾向にある。
例えば、ナノワイヤは、ジボラン(B2H2)またはトリメチルボラン(TMB)を原料ガスに加えることにより、p型となる。シリコンナノワイヤに対してアクセプター原子を追加するその他のガスを用いても良い。ナノワイヤは、原料ガスにPH3またはAsH3を加えることにより、n型とすることができる。
シリコンナノワイヤに対してドナー原子を追加するその他のガスを用いても良い。
生成することができるドーピングプロファイルは、n−p−n、p−n−p、およびp−i−nが含まれるが、これらに限定されない。
ナノワイヤ内のPIN又はPNフォトダイオード
実施例2実施形態1の実施形態は、コア及びクラッドを備える光パイプの製造方法に関する。
実施例2の実施形態のクラッドは光学センサのシリコン基板の中又はその上に配置された、周辺導波管及び周辺フォトダイオードを備える。
実施例1の図3−1〜図3−6に示されている工程が実行される。実施例1の図3−7に示されている金属を垂直キャビティ壁に堆積させる工程は省略される。続いて、実施例1の図3-8〜図3-11に示されている工程が実行される。
典型的には、n−領域のポテンシャルは正である。ナノワイヤは、しかしながら、負のバイアスを有するフォトゲートVP Gate 1と容量性結合している。この結果、ナノワイヤ領域においてポテンシャル勾配が現れる。換言すれば、N -ウェルから遠くなるほど、チャネルのポテンシャルは低くなる。n-ウェルに近くなるほど、チャネルのポテンシャルは高くなる。
そこで、このピクセルは、従来のカラーフィルタを用いないモノクロピクセルとしての使用に適している。
次に、ITOレイヤが、p+領域を負のバイアス電圧を供給する電極に接続するために堆積される。負のバイアスは、印加時に、ナノワイヤ、及び、p-基板におけるナノワイヤの底部のn-領域を空乏化させる。また、負バイアスは、ナノワイヤ表面からコアへの同軸方向の電場を形成する。また、負バイアスは、光生成キャリアがナノワイヤコアへ移動し、垂直フォトゲート(V gate)がオンされたときにn-レイヤへ滑り落ちることができるように、垂直方向に電場を形成する。
ワイヤを囲む金属レイヤは、光波のガイドを提供し、隣あうナノワイヤ間での光学的な漏話を防止する。シャロートレンチアイソレーション(STI)は、CMOSプロセス中に形成される。
Claims (43)
- ナノワイヤを含むナノワイヤフォトダイオードと、
前記ナノワイヤフォトダイオードに当該ナノワイヤフォトダイオードを囲むように接続された少なくとも一つの垂直フォトゲートと、
を備えるデバイス。 - 基板と、基板フォトダイオードと、を更に備える請求項1のデバイス。
- トランスファーゲートと、リセットゲートと、を更に備える請求項2のデバイス。
- 前記ナノワイヤフォトダイオード及び前記基板フォトダイオードが低濃度にドープされている、請求項2のデバイス。
- 前記基板の表面と前記基板フォトダイオードとの間の前記基板内の領域をさらに備え、前記領域は、暗電流を抑制するように構成された、請求項2のデバイス。
- 前記基板が電気的接地に接続されている、請求項2のデバイス。
- 前記トランスファーゲートがオンのときに、前記基板フォトダイオードが正にバイアスされる、請求項2のデバイス。
- 前記基板フォトダイオードが空乏化される、請求項7のデバイス。
- 前記トランスファーゲート及び前記リセットゲートがオフのときに、前記基板フォトダイオードが前記基板に関してフローティングしているキャパシタを形成する、請求項7のデバイス。
- 前記ナノワイヤフォトダイオードと前記基板との間にポテンシャル差が形成されるように、前記垂直フォトゲートが、ナノワイヤにおけるポテンシャルを制御するように構成された、請求項1のデバイス。
- 前記ナノワイヤフォトダイオードと動作可能に接続された第2の垂直フォトゲートをさらに備え、当該第2の垂直フォトゲートが、前記ナノワイヤフォトダイオードで生成された信号電荷を、基板フォトダイオードで生成された信号電荷から分離するオン/オフスイッチとなるように構成された、請求項1のデバイス。
- 光電荷が、前記ナノワイヤフォトダイオード及び前記基板フォトダイオードにおいて、実質的に同時に、しかし異なるポテンシャルウェルにおいて、統合される、請求項2のデバイス。
- 前記第2の垂直フォトゲートがオフのときに、前記ナノワイヤフォトダイオードと前記基板フォトダイオードとの間にポテンシャル障壁が形成される、請求項11のデバイス。
- 前記ナノワイヤに印加された負のバイアスによって、正孔が前記ナノワイヤの表面に蓄積され、電子が前記ナノワイヤの中心に蓄積される、請求項1のデバイス。
- 前記ナノワイヤにおいてポテンシャルの傾斜が存在する、請求項14のデバイス。
- 前記ナノワイヤフォトダイオードが、ナノワイヤと、当該ナノワイヤを取り囲み当該ナノワイヤの屈折率よりも小さな屈折率を有するクラッドと、を備え、当該クラッドが先細になっている、請求項1のデバイス。
- 前記クラッドは、除々に、又は、段階的に、先細になる、請求項16のデバイス。
- 複数のナノワイヤフォトダイオードデバイスを備えた装置であって、当該ナノワイヤフォトダイオードデバイスが、ナノワイヤフォトダイオードと、当該ナノワイヤフォトダイオードに当該ナノワイヤフォトダイオードを囲むように接続された少なくとも一つの垂直フォトゲートと、を備え、当該ナノワイヤフォトダイオードがナノワイヤ及びクラッドを備える、装置。
- 一つの垂直フォトゲートが、オン/オフスイッチとして構成され、前記装置が、前記オン/オフスイッチの全てがオン又はオフに同時になり得るように構成された、請求項18の装置。
- 前記複数のナノワイヤフォトダイオード装置がトランスファーゲートをさらに備え、前記装置が、前記トランスファーゲートの全てがオン又はオフに同時になり得るように構成された、請求項19の装置。
- 前記オン/オフスイッチが、第1のグローバルコネクションに接続され、前記トランスファーゲートが第2のグローバルコネクションに接続された、請求項20の装置。
- 前記複数のナノワイヤフォトダイオードが、行列のアレイ形状に構成され、前記複数のナノワイヤフォトダイオードの各々がリセットゲートを含み、前記ナノワイヤフォトダイオードのアレイが、行ごとにリセットするように構成された、請求項18の装置。
- 前記複数のナノワイヤフォトダイオードが、個別に動作可能に構成された、請求項18の装置。
- ナノワイヤを含むナノワイヤフォトダイオードと、
前記ナノワイヤフォトダイオードに当該ナノワイヤフォトダイオードを囲むように接続された少なくとも一つの垂直フォトゲートと、
少なくとも三つのトランジスタと、
を備えるデバイス。 - 前記少なくとも三つのトランジスタが、ソースフォロワー増幅器、選択スイッチ、及びリセットトランスファーを含む、請求項24のデバイス。
- 垂直フォトゲートが、前記ナノワイヤへ接続するキャパシタを提供する、請求項25のデバイス。
- 蓄積された正孔により、熱的に生成された暗電流を抑制する、請求項14のデバイス。
- 第1のドーピング型の基板をさらに備え、当該基板が第2のドーピング型のウェルを含み、前記第1の型及び前記第2の型が異なる、請求項24のデバイス。
- ウェルが、前記ナノワイヤ又は前記基板において生成された電子を集めるように構成された請求項28のデバイス。
- ウェルの上部に狭い薄膜レイヤを含み、当該薄膜レイヤは、前記第1の型のドーピングを含む、請求項28のデバイス。
- 前記ウェルの上部に真性レイヤをさらに含む請求項30のデバイス。
- 前記薄膜レイヤ、前記真性レイヤ、及び前記ウェルがPINフォトダイオードを構成する、請求項31のデバイス。
- ピクセルが、バイアス電圧を前記垂直フォトゲートに印加するように構成され、前記バイアス電圧は、DCバイアス又はパルスバイアスのいずれかである、請求項1のデバイス。
- 基板と、シャロートレンチアイソレーションレイヤを更に備える請求項1のデバイス。
- インジウムスズ酸化物(ITO)レイヤをさらに備える請求項1のデバイス。
- 前記ナノワイヤの上部にp+レイヤを含む請求項1のデバイス。
- 前記p+レイヤを囲む金属レイヤをさらに備える請求項36のデバイス。
- 前記金属レイヤが光学的導波管を提供し、光学的漏話を防止する、請求項37のデバイス。
- バッファ増幅器をさらに備える請求項1のデバイス。
- 実質的に前記ナノワイヤ全体を囲むp+レイヤさらに備える、請求項1のデバイス。
- 前記ナノワイヤが、真性半導体レイヤで囲まれたn−コアを有する、請求項1のデバイス。
- 前記ナノワイヤが真性半導体を備える請求項1のデバイス。
- ナノワイヤを含むナノワイヤフォトダイオードを形成する工程と、
少なくとも一つの垂直フォトゲートを前記ナノワイヤフォトダイオードに当該ナノワイヤフォトダイオードを囲むように接続する工程と、を備える装置の製造方法。
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