JP5509055B2 - 画像形成装置 - Google Patents
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Description
本発明における画像形成装置の構成を、図1を用いて説明する。図1は本発明の画像形成装置の構成を説明するための概略図である。図1では、レーザビームプリンタの例を用いて示している。レーザビームプリンタは、レーザビームを走査することによって転写材に画像を形成する画像形成装置であるが、本発明はレーザビームに限られるものではなく、搬送される用紙上に画像を形成する任意の形式の画像形成装置に適用することができる。
S−CLK周波数=カウンタ値c0/時間間隔t0 …(1)
S−CLK周波数=カウンタ値c0/時間間隔t0 …(1)
S−CLK周波数=カウンタ値c0/時間間隔t0 …(1)
S−CLK周波数=カウンタ値c0/時間間隔t0 …(1)
2 画像形成部
3 感光体
4 レーザスキャナ
5 主電源
6 転写紙
7 給紙ローラ
8 レジストセンサ
9 転写ローラ
10 定着装置
11 排紙センサ
12 フラッパ
13 現像装置
14 イメージ展開部
15 排紙口
16 給紙部
17 オプションカセット
18 送信データ
18a ROM
19 スレーブCPU
19a ROM
20 通信手段
22 マスターCPU用クロック回路
23 クロックS−CLK
24 スレーブ用クロック回路
30 ホストコンピュータ
31 オプションピックアップローラ
32 カセット桶
33 カセット桶
34 搬送ローラ
35 オプションカセット給紙搬送ローラ
36 オプションモータ
37 駆動信号
101 スレーブCPU用クロック回路
308 補正信号
CMD0 コマンド信号
CMD1 コマンド信号
Claims (8)
- 画像形成制御および紙搬送制御を行うマスターCPUと、そのマスターCPUからのデータに基づいて前記マスターCPUが制御する紙搬送より搬送方向上流側の紙搬送制御を行うスレーブCPUと、
前記マスターCPUと前記スレーブCPUとを接続して所定の負荷の動作を制御するためのデータを送信するシリアル通信線と、
を備え、
前記マスターCPU及び前記スレーブCPUはそれぞれの動作の基準となるクロック信号を発生する発振回路を有し、
前記マスターCPUと前記スレーブCPU間で所定の通信データの受け渡しを、前記シリアル通信線を使用して、前記マスターCPU側の発振回路のクロック信号により予め決められた所定時間を有するシリアル通信で行い、
前記スレーブCPU側の発振回路のクロック信号による前記所定時間のカウント値に応じて前記スレーブCPU側の発振回路のクロック信号に基づく紙搬送制御に係る前記所定の負荷に関連する信号を補正することを特徴とする画像形成装置。 - マスターCPUとそのマスターCPUからのデータに基づいて所定の負荷の動作を制御するスレーブCPUを備え、
前記マスターCPUは画像形成制御および紙搬送制御を行い、
前記スレーブCPUは前記マスターCPUが制御する紙搬送より搬送方向上流側の紙搬送制御を行い、
前記マスターCPUと前記スレーブCPU間で所定の通信データの受け渡しを、前記マスターCPU側の発振回路のクロック信号により予め決められた所定時間を有するシリアル通信で行い、
前記スレーブCPU又は前記マスターCPUは、
各CPU側の発振回路のクロック信号により、前記シリアル通信の予め決められた所定時間をカウントし、
前記予め決められた所定時間と前記カウントで得られたカウンタ値とからスレーブCPU側の発振回路のクロック周波数(又は周期)を算出し、
前記算出したスレーブCPU側の発振回路のクロック周波数(又は周期)と、当該スレーブCPU側において予め決められたクロック周波数(又は周期)とを比較し、両クロック周波数(又は周期)の差異からスレーブCPU側の発振回路のクロック周波数(又は周期)の変動を検出し、
前記検出したスレーブCPU側の発振回路のクロック周波数の変動に基づいて、スレーブCPUによる紙搬送の動作が、スレーブCPU側において予め決められたクロック周波数に基づく動作となるように前記スレーブCPU側の発振回路のクロック信号に基づく紙搬送制御に係る前記所定の負荷に関連する信号の補正を行う画像形成装置。 - 請求項2において、
前記予め決められた所定時間は、シリアル通信において通信データ間の送信間隔であり、
前記マスターCPUは、前記スレーブCPUへ予め決められた所定時間の送信間隔でシリアル通信を行い、
前記スレーブCPUは、前記スレーブCPU側の発振回路のクロック信号で前記送信間隔をカウントし、前記予め決められた所定時間と前記カウントで得られたカウンタ値とからスレーブCPU側の発振回路のクロック周波数を算出する画像形成装置。 - 請求項2において、
前記予め決められた所定時間は、前記通信データのデータ送信時間であり、
前記マスターCPUは、前記スレーブCPUへ予め決められた所定時間のデータ送信時間の通信データをシリアル通信し、
前記スレーブCPUは、スレーブCPU側の発振回路のクロック信号で前記通信データのデータ送信時間をカウントし、予め決められた所定時間と前記カウントで得られたカウンタ値とからスレーブCPU側の発振回路のクロック周波数を算出する画像形成装置。 - 請求項1から4までのいずれか1項において、
前記スレーブCPU側の発振回路の発振精度は、前記マスターCPU側の発振回路の発振精度より低い画像形成装置。 - 請求項2において、
前記画像形成部および複数段の紙搬送部は直列接続自在であり、各紙搬送部はそれぞれスレーブCPUを備え、
マスターCPUと各スレーブCPUとをカスケード接続し、当該カスケード接続においてマスターCPU側を上流側としてシリアル通信を行い、
下流側のスレーブCPUは、予め決められた所定時間のカウントにおいて、当該下流側のスレーブCPUに接続される上流側のマスターCPU又はスレーブCPUからの通信データのデータ長及び/又は通信データ間の時間間隔に基づいて、前記予め決められた所定時間を取得し、取得した所定時間を当該下流側のCPU側の発振回路のクロック信号によりカウントし、
前記予め決められた所定時間と前記カウントで得られたカウンタ値とからスレーブCPU側の発振回路のクロック周波数を算出する画像形成装置。 - 請求項2において、
前記画像形成部および複数段の紙搬送部は直列接続自在であり、各紙搬送部はそれぞれスレーブCPUを備え、
マスターCPUと各スレーブCPUとをカスケード接続し、当該カスケード接続においてマスターCPU側を上流側としてシリアル通信を行い、
上流側のスレーブCPU又はマスターCPUは、予め決められた所定時間のカウントにおいて、当該上流側のスレーブCPUに接続される下流側のマスターCPUからの通信データのデータ長及び/又は通信データ間の時間間隔に基づいて、前記予め決められた所定時間を取得し、取得した所定時間を当該上流側のスレーブCPU側の発振回路のクロック信号又はマスター側の発振回路のクロック信号によりカウントし、
前記予め決められた所定時間と前記カウントで得られたカウンタ値とからスレーブCPU側の発振回路のクロック周波数を算出する画像形成装置。 - 請求項2において、
前記画像形成部および複数段の紙搬送部は直列接続自在であり、各紙搬送部はそれぞれスレーブCPUを備え、
マスターCPUと各スレーブCPUとをカスケード接続し、当該カスケード接続においてマスターCPU側を上流側としてシリアル通信を行い、
下流側のスレーブCPUは、予め決められた所定時間のカウントにおいて、当該下流側のスレーブCPUに接続される上流側のマスターCPU又はスレーブCPUからの通信データのデータ長及び/又は通信データ間の時間間隔に基づいて、前記予め決められた所定時間を取得し、取得した所定時間を当該下流側のCPU側の発振回路のクロック信号によりカウントし、前記予め決められた所定時間と前記カウントで得られたカウンタ値とからスレーブCPU側の発振回路のクロック周波数(又は周期)を算出して第1のクロック周波数(又は周期)とし、
上流側のスレーブCPUは、予め決められた所定時間のカウントにおいて、当該上流側のスレーブCPUに接続される下流側のマスターCPUからの通信データのデータ長及び/又は通信データ間の時間間隔に基づいて、前記予め決められた所定時間を取得し、取得した所定時間を当該上流側のスレーブCPU側の発振回路のクロック信号によりカウントし、前記予め決められた所定時間と前記カウントで得られたカウンタ値とからスレーブCPU側の発振回路のクロック周波数を算出して第2のクロック周波数とし、
前記第1のクロック周波数と第2のクロック周波数とに重み付けを行って当該スレーブCPUのクロック周波数を算出する画像形成装置。
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