JP5464815B2 - 撮像システムおよび撮像システムのセルフチェック処理の動作方法 - Google Patents
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Description
前記出力検知手段が前記信号処理回路からの信号の出力の有無を検知する映像信号検知ステップと、前記映像信号検知ステップにおいて出力があった場合に実行される、前記信号処理装置の接続検知手段が、前記第1のFPGA及び前記第2のFPGAによるJTAGチェーンを用いて、前記コネクタ部の電気的接続の有無を検知する接続検知ステップと、前記接続検知ステップにおいて、前記コネクタ部の電気的接続があった場合に実行される、前記デジタルの撮像信号のビット数と前記所定ビット数とが同一ビット数の場合に、前記アナログフロントエンドが正常に動作していることを、前記撮像装置のAFE検知手段が検知するAFE検知ステップと、を有する。
以下、図1、図2および図3を用いて本発明の第1の実施の形態の撮像システムである内視鏡システム1について説明する。図1は、本実施の形態の内視鏡システム1の構成を示す外観図であり、図2は内視鏡システム1の構成を説明するための説明図であり、図3は内視鏡システム1の構成を説明するためのブロック図である。
内視鏡2(スコープ)が外部プロセッサ3に接続される。そして、内視鏡システム1の電源が入れられる。すなわち、内視鏡2(スコープ)、外部プロセッサ3およびモニタ4の電源が投入される。
内視鏡システム1は、メンテナンスモードを起動する。メンテナンスモードは、内視鏡システム1に故障箇所がないか一連のセルフチェック処理を行うモードである。
内視鏡システム1は、後段処理回路30とキャプチャ回路37との切り替えのスイッチを後段処理回路30に切り替える。前述のように、切り替えには図示しないスイッチ手段等を用いる
<ステップS13>
後段処理回路30のテストパターン発生部32は、テストパターン信号を出力する。
出力検知回路31は、後段処理回路30からテストパターン信号の出力の有無を検知する。すなわち、ステップS14は、後段処理回路30からの映像信号の出力の有無を検知する映像信号検知ステップであると同時に、テストパターン信号の有無を検知するテストパターン信号検知ステップでもある。
JTAGチェーン形成部28および34により、FPGA29およびFPGA35の入出力線が直列に接続されたJTAGチェーンが作成される。すなわち、コネクタ部8Aを介して接続されている複数の信号配線の端部が接続され、いわゆる数珠つなぎで機能上は1本の配線となる。なお、JTAGチェーン形成部34の入出力線のうちの2本がJTAGチェーンの端部となり、接続検知部33と接続される。
接続検知部33は、JTAGチェーンがOPEN状態、すなわち導通不良、であれば、FPGA29とFPGA35との間のどこかで接続不良が発生していることを検知することができる。すなわち、ステップS17は、コネクタ部8Aの電気的接続の有無を検知する接続検知ステップである。接続検知部33が、接続不良を検知した場合(Yes)には、ステップS18において、告知回路38が、モニタ4に「スコープ接続不良」の表示を行い告知する。
前段処理回路20のテストパターン発生部27は、テストパターン信号を出力する。
出力検知回路31は、前段処理回路20からテストパターン信号の出力の有無を検知する。すなわち、ステップS20は、内視鏡2からの撮像信号、すなわちデジタル撮像信号の出力の有無を検知するデジタル撮像信号検知ステップであると同時に、テストパターン信号の有無を検知するテストパターン信号検知ステップでもある。
内視鏡システム1は、後段処理回路30とキャプチャ回路37との切り替えのスイッチをキャプチャ回路37に切り替える。
出力検知回路31がキャプチャ回路37を介しても、モニタ4への出力信号を検知できなかった場合(No)には、前段処理回路20が故障していると判断され、ステップS23において、告知回路38が、モニタ4に「前段処理回路不良」の表示を行い告知する。
ステップS20において、出力検知回路31が前段処理回路20からテストパターン信号の出力を検知した場合(Yes)には、CCD6の出力系の検査を行う。CCD6からのアナログ撮像信号は、CDS回路23とAD変換回路24とを有するAFE25により、12ビットのデジタル撮像信号に変換された後に、FPGA29に出力される。
FPGA29は、AFE25からの12ビットデジタル撮像信号を、後段処理回路30に出力する。なお、後段処理回路30とキャプチャ回路37との切り替えスイッチは、後段処理回路30に切り替えられる
<ステップS27>
出力検知回路31がCCD6から出力された信号を検知できた場合(Yes)には、CCD6は故障していないと判断され、ステップS32からの処理が行われる。
内視鏡システム1は、後段処理回路30とキャプチャ回路37との切り替えのスイッチをキャプチャ回路37に切り替える。
出力検知回路31がキャプチャ回路37を介しても、モニタ4への出力信号を検知できなかった場合(No)には、CCD6が故障していると判断され、ステップS30において、告知回路38が、モニタ4に「CCD不良」の表示を行い告知する。
内視鏡システム1は、CCD6、前段処理回路20、および後段処理回路30に問題がない場合には、最後に、AFE25に問題がないかを確認する。
AFE検知部26は、ビット欠けがあった場合(No)には、AFE25が故障箇所であると判断し、ステップS31において、告知回路38が、モニタ4に「AFE不良」の表示を行い告知する。すなわち、ステップS33は、デジタル撮像信号のビット数と所定ビット数とが同一ビット数の場合には、AFE25が正常に動作していると検知するAFE検知ステップである。
上記の全ての処理において故障箇所が検知されない場合、内視鏡システム1は正常動作していると判断し、告知回路38が、モニタ4に「正常動作中」の表示を行い告知する。
内視鏡システム1は、メンテナンスモードを終了し、通常動作を開始する。これに対して、メンテナンスモードにおいて異常が検知された場合、すなわち、図4または図5において、(I)の場合、には、内視鏡システム1は、通常動作を開始しないで、術者の対応を待つ。
以下、図5および図6を用いて本発明の第2の実施の形態の撮像システムである内視鏡システム1B等について説明する。本実施の形態の内視鏡システム1B等は、第1の実施の形態の内視鏡システム1等と類似しているため、同じ構成要素には同じ符号を付し、説明は省略する。
以下、図7を用いて本発明の第2の実施の形態の変形例の撮像システムである内視鏡システム1C等について説明する。本変形例の内視鏡システム1C等は、第1の実施の形態の内視鏡システム1等と類似しているため、同じ構成要素には同じ符号を付し、説明は省略する。図7は本変形例の内視鏡システム1Cについて説明するための説明図である。
以下、図8および図9を用いて本発明の第3の実施の形態の内視鏡システム1Dについて説明する。本実施の形態の内視鏡システム1Dは、第1の実施の形態の内視鏡システム1と類似しているため、同じ構成要素には同じ符号を付し、説明は省略する。図8は、本実施の形態の内視鏡システム1Dの使用形態を説明するための概念図であり、図9は、本実施の形態の内視鏡システム1Dの構成を説明するためのブロック図である。
以下、図10を用いて本発明の第4の実施の形態の内視鏡システム1Eについて説明する。本実施の形態の内視鏡システム1Eは、第1の実施の形態の内視鏡システム1と類似しているため、同じ構成要素には同じ符号を付し、説明は省略する。図10は、本実施の形態の内視鏡システム1Eの構成を説明するためのブロック図である。
通信回線としては、インターネット回線、携帯電話回線等、公知の通信回線を用いることができる。
Claims (11)
- 撮像装置と、信号処理装置と、前記撮像装置と前記信号処理装置とを電気的に接続可能なコネクタ部と、を具備し、
前記撮像装置が、
被写体を撮像した撮像信号を出力する、JTAGチェーンを形成可能な第1のFPGAを有し、
前記信号処理装置が、
前記第1のFPGAと形成したJTAGチェーンを用いて前記コネクタ部の電気的接続の有無を検知する接続検知手段を含む第2のFPGAを有し、前記撮像装置から入力された前記撮像信号を処理し表示手段に出力可能な映像信号を生成する信号処理回路と、
前記撮像信号を前記信号処理回路と異なる方法で処理し、キャプチャ信号を出力するキャプチャ回路と、
前記信号処理回路、および、前記キャプチャ回路からの信号の出力の有無から前記信号処理回路の不良を検知する出力検知手段と、を有することを特徴とする撮像システム。 - 前記撮像装置は、
前記被写体を撮像してアナログの撮像信号を出力する撮像素子と、
前記アナログの撮像信号を処理し、所定ビット数のデジタルの撮像信号を出力するアナログフロントエンドと、
前記アナログフロントエンドが正常に動作しているか検知するAFE検知手段と、を有することを特徴とする請求項1に記載の撮像システム。 - 前記AFE検知手段は、前記デジタルの撮像信号のビット数と前記所定ビット数とが同一ビット数の場合には前記アナログフロントエンドが正常に動作していると検知することを特徴とする請求項2に記載の撮像システム。
- 前記第1のFPGAと前記第2のFPGAとは、それぞれテストパターン信号出力機能を有し、
前記出力検知手段は、それぞれの前記テストパターン信号の有無を検知することを特徴とする請求項1から請求項3のいずれか1項に記載の撮像システム。 - 前記出力検知手段、前記接続検知手段、AFE検知手段の少なくともいずれか1つの検知結果を告知する告知手段を有することを特徴とする請求項2から請求項4のいずれか1項に記載の撮像システム。
- 前記撮像装置が内視鏡であり、前記信号処理装置が内視鏡信号処理装置であることを特徴とする請求項1から請求項5のいずれか1項に記載の撮像システム。
- 前記信号処理装置が通信手段を有し、
前記出力検知手段、前記接続検知手段、AFE検知手段の少なくともいずれか1つが、前記通信手段を介して制御可能なことを特徴とする請求項2から請求項6のいずれか1項に記載の撮像システム。 - 撮像装置と、信号処理装置と、前記撮像装置と前記信号処理装置とを電気的に接続するコネクタと、を具備する撮像システムの起動時に自動的に実行されるセルフチェック処理の動作方法であって、
前記撮像装置が、
被写体を撮像してアナログ撮像信号を出力する撮像素子と、
前記アナログ撮像信号を処理し所定ビット数のデジタル撮像信号を出力するアナログフロントエンドと、
前記デジタル撮像信号を出力する、JTAGチェーンを形成可能な第1のFPGAと、を有し、
前記信号処理装置が、
前記コネクタ部を介して、入力された前記デジタル撮像信号を処理し表示手段に出力可能な映像信号を出力する、JTAGチェーンを形成可能な第2のFPGAを含む信号処理回路と、
出力検知手段と、を有し、
前記出力検知手段が前記信号処理回路からの信号の出力の有無を検知する映像信号検知ステップと、
前記映像信号検知ステップにおいて出力があった場合に実行される、前記信号処理装置の接続検知手段が、前記第1のFPGA及び前記第2のFPGAによるJTAGチェーンを用いて、前記コネクタ部の電気的接続の有無を検知する接続検知ステップと、
前記接続検知ステップにおいて、前記コネクタ部の電気的接続があった場合に実行される、前記デジタルの撮像信号のビット数と前記所定ビット数とが同一ビット数の場合に、前記アナログフロントエンドが正常に動作していることを、前記撮像装置のAFE検知手段が検知するAFE検知ステップと、を有することを特徴とする撮像システムのセルフチェック処理の動作方法。 - 前記第1のFPGAと前記第2のFPGAとは、それぞれテストパターン信号出力機能を有し、
前記映像信号検知ステップにおいて、前記出力検知手段が前記第2のFPGAからのテストパターン信号の出力の有無を検知するとともに、
前記接続検知ステップにおいて、前記コネクタ部の電気的接続があった場合に前記AFE検知ステップの前に実行される、前記出力検知手段が前記第1のFPGAからのテストパターン信号の出力の有無を検知する撮像信号検知ステップを有することを特徴とする請求項8に記載のセルフチェック処理の動作方法。 - 前記接続検知ステップ、前記映像信号検知ステップ、前記AFE検知ステップ、前記撮像信号検知ステップの少なくともいずれか1つの検知結果を告知手段が告知する告知ステップを有することを特徴とする請求項9に記載の撮像システムのセルフチェック処理の動作方法。
- 前記撮像装置が内視鏡であり、前記信号処理装置が内視鏡信号処理装置であることを特徴とする請求項8から請求項10のいずれか1項に記載の撮像システムのセルフチェック処理の動作方法。
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