JP5438358B2 - データ処理装置及びその制御方法 - Google Patents

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Families Citing this family (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5852320B2 (ja) * 2011-04-13 2016-02-03 キヤノン株式会社 画像形成装置及びその制御方法
JP5546500B2 (ja) * 2011-04-26 2014-07-09 三菱電機株式会社 Ｆｐｇａ搭載装置の遠隔保守システム
KR20130057310A (ko) * 2011-11-23 2013-05-31 삼성전자주식회사 화상독취장치 및 화상독취방법
JP5943736B2 (ja) * 2012-06-28 2016-07-05 キヤノン株式会社 情報処理装置、情報処理装置の制御方法及びプログラム
JP6036719B2 (ja) * 2014-01-30 2016-11-30 コニカミノルタ株式会社 プログラム可能な論理回路デバイスを備えた電子装置および書き換え方法
JP2015149025A (ja) * 2014-02-07 2015-08-20 キヤノン株式会社 画像処理装置およびその制御方法、並びにプログラム
JP6370063B2 (ja) * 2014-03-04 2018-08-08 キヤノン株式会社 画像処理装置及びその制御方法、並びにプログラム
JP6308821B2 (ja) * 2014-03-13 2018-04-11 キヤノン株式会社 画像処理装置
JP2016035692A (ja) * 2014-08-04 2016-03-17 キヤノン株式会社 画像処理装置、システム、情報処理方法及びプログラム
JP2016042296A (ja) * 2014-08-18 2016-03-31 キヤノン株式会社 画像処理装置、情報処理方法及びプログラム
JP2016111633A (ja) * 2014-12-09 2016-06-20 キヤノン株式会社 回路情報に従って論理回路を構成可能な回路を持つデバイスと、複数の制御手段とを有する情報処理システム
US20180143860A1 (en) * 2016-11-22 2018-05-24 Intel Corporation Methods and apparatus for programmable integrated circuit coprocessor sector management
JP6911600B2 (ja) * 2017-07-18 2021-07-28 富士通株式会社 情報処理装置、情報処理方法および情報処理プログラム
CN117529706A (zh) 2021-04-13 2024-02-06 芯片尖端技术株式会社 信息处理系统、信息处理装置、服务器装置、程序、可重构器件或者方法
WO2023181380A1 (ja) 2022-03-25 2023-09-28 Ｃｈｉｐｔｉｐ Ｔｅｃｈｎｏｌｏｇｙ株式会社 情報処理システム、情報処理装置、サーバ装置、プログラム、リコンフィグラブルデバイス、又は方法

Family Cites Families (20)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5684980A (en) * 1992-07-29 1997-11-04 Virtual Computer Corporation FPGA virtual computer for executing a sequence of program instructions by successively reconfiguring a group of FPGA in response to those instructions
JP3351452B2 (ja) * 1995-03-08 2002-11-25 日本電信電話株式会社 プログラマブルゲートアレイ
JP3834935B2 (ja) 1997-06-05 2006-10-18 富士ゼロックス株式会社 印刷処理装置
JP3489608B2 (ja) * 1997-06-20 2004-01-26 富士ゼロックス株式会社 プログラマブル論理回路システムおよびプログラマブル論理回路装置の再構成方法
JP2891979B1 (ja) * 1998-02-06 1999-05-17 日本電気アイシーマイコンシステム株式会社 部分書き換え可能なｐｌｄ
JPH11274915A (ja) * 1998-03-25 1999-10-08 Victor Co Of Japan Ltd Ｆｐｇａの書換処理装置
JP3587095B2 (ja) * 1999-08-25 2004-11-10 富士ゼロックス株式会社 情報処理装置
DE60133595T2 (de) * 2000-01-07 2009-04-30 Nippon Telegraph And Telephone Corp. Funktionsrekonfigurierbare Halbleitervorrichtung und integrierte Schaltung zum Konfigurieren der Halbleitervorrichtung
US8058899B2 (en) * 2000-10-06 2011-11-15 Martin Vorbach Logic cell array and bus system
US7152151B2 (en) * 2002-07-18 2006-12-19 Ge Fanuc Embedded Systems, Inc. Signal processing resource for selective series processing of data in transit on communications paths in multi-processor arrangements
JP4258137B2 (ja) * 2001-05-30 2009-04-30 横河電機株式会社 監視装置
JP3944639B2 (ja) * 2002-06-17 2007-07-11 コニカミノルタホールディングス株式会社 プログラマブル論理装置
JP3904072B2 (ja) 2002-07-10 2007-04-11 コニカミノルタホールディングス株式会社 プログラマブル論理回路及びコンピュータシステム並びに回路の初期化方法
JP3837136B2 (ja) * 2004-02-12 2006-10-25 松下電器産業株式会社 プログラマブル論理回路
US7328335B1 (en) * 2004-10-01 2008-02-05 Xilinx, Inc. Bootable programmable logic device for internal decoding of encoded configuration data
US7689726B1 (en) * 2004-10-01 2010-03-30 Xilinx, Inc. Bootable integrated circuit device for readback encoding of configuration data
JP2006260654A (ja) * 2005-03-16 2006-09-28 Mitsubishi Electric Engineering Co Ltd 論理処理装置
JP2006352256A (ja) * 2005-06-13 2006-12-28 Canon Inc プログラマブル論理回路及びその論理回路構成の再構築方法、並びにプログラム
JP2007251329A (ja) * 2006-03-14 2007-09-27 Matsushita Electric Ind Co Ltd プログラマブルロジックデバイス
JP5045036B2 (ja) * 2006-09-05 2012-10-10 富士ゼロックス株式会社 データ処理装置

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