JP5426412B2 - 保護継電器 - Google Patents
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Description
上記各保護処理部は、上記入力変換手段と上記演算手段を含む内部状態を監視して内部異常が発生した場合にバイパス指令を発生させる常時監視手段と、この常時監視手段から出力されるバイパス指令に応じて閉となるバイパス制御接点と開となるバイパス制御接点と、上記両バイパス制御接点が同時に閉となることがないように上記バイパス指令の出力タイミングを調整する出力タイミング調整手段とを有し、
かつ、各保護処理部における上記遮断器制御出力接点とバイパス指令に応じて閉となるバイパス制御接点とが並列接続され、この並列回路が両保護処理部間で直列接続され、この直列接続された回路に対して、各保護処理部のバイパス指令に応じて開となるバイパス制御接点が互いに並列接続されてなる並列回路が直列に接続されているものである。
図1は、本発明の実施の形態1における保護継電器の構成を示すブロック図である。
この場合、各保護処理部1A,1Bの演算手段3A,3Bによって電力系統の異常が検出されると、これに応じて遮断器制御出力信号が発生され、この信号により、A系、B系の両保護処理部1A,1Bの遮断器制御出力a接点7A,7Bが共に同時に閉となる。その際、両保護処理部1A,1Bのバイパス制御a接点8A,8Bは共に開、バイパス制御b接点9A,9Bは共に閉であるから、図外の遮断器がトリップされて電力系統の事故から設備が保護される。
この場合、B系の保護処理部1Bの常時監視手段4Bによって当該保護処理部1Bの内部異常等が検出されると、これに応じてバイパス指令が発生され、これにより、バイパス制御a接点8Bが閉となり、遮断器制御出力a接点7Bに対してバイパス経路が形成される。
この場合、A系の保護処理部1Aの常時監視手段4Aによって当該保護処理部1Aの内部異常等が検出されると、これに応じてバイパス指令が発生され、これにより、バイパス制御a接点8Aが閉となり、遮断器制御出力a接点7Aに対してバイパス経路が形成される。
この場合、A系、B系の両保護処理部1A,1Bの常時監視手段4A,4Bによって当該保護処理部1A,1Bの内部異常等が検出されると、これに応じて共にバイパス指令が発生され、これにより、各バイパス制御a接点8A,8Bが共に閉となり、各遮断器制御出力a接点7A,7Bに対してバイパス経路が形成される。このため、各々の遮断器制御出力a接点7A,7Bは、バイパス制御a接点8A,8Bが閉となることで無効となる。
図4は本発明の実施の形態2における保護継電器の構成を示すブロック図であり、図1に示した実施の形態1と対応もしくは相当する構成部分には同一の符号を付す。
図6は本発明の実施の形態3における保護継電器の構成を示すブロック図であり、図4に示した実施の形態2と対応もしくは相当する構成部分には同一の符号を付す。
4A,4B 常時監視手段、5A,5B 立上り遅延手段(出力タイミング調整手段)、6A,6B 立下り遅延手段(出力タイミング調整手段)、
7A,7B 遮断器制御出力a接点、
8A,8B バイパス制御a接点(バイパス制御接点)、
9A、9B バイパス制御b接点(バイパス制御接点)、11A,11B リレー部。
Claims (5)
- 保護演算処理を行う保護処理部が二重化されており、各保護処理部は、電力系統の電気量をディジタル値に変換する入力変換手段と、所定の算法による演算結果より電力系統の異常を検出して遮断器制御出力接点を制御する演算手段と、を備えている保護継電器において、
上記各保護処理部は、上記入力変換手段と上記演算手段を含む内部状態を監視して内部異常が発生した場合にバイパス指令を発生させる常時監視手段と、この常時監視手段から出力されるバイパス指令に応じて閉となるバイパス制御接点および開となるバイパス制御接点と、上記両バイパス制御接点が同時に閉となることがないように上記バイパス指令の出力タイミングを調整する出力タイミング調整手段とを有し、
かつ、各保護処理部における上記遮断器制御出力接点とバイパス指令に応じて閉となるバイパス制御接点とが並列接続され、この並列回路が両保護処理部間で直列接続され、この直列接続された回路に対して、各保護処理部のバイパス指令に応じて開となるバイパス制御接点が互いに並列接続されてなる並列回路が直列に接続されている、ことを特徴とする保護継電器。 - 保護演算処理を行う保護処理部が二重化されており、各保護処理部は、電力系統の電気量をディジタル値に変換する入力変換手段と、所定の算法による演算結果より電力系統の異常を検出して遮断器制御出力接点を制御する演算手段と、を備えている保護継電器において、
上記各保護処理部は、上記入力変換手段と上記演算手段を含む内部状態を監視して内部異常が発生した場合にバイパス指令を発生させる常時監視手段と、この常時監視手段から出力されるバイパス指令に応じて閉となるバイパス制御接点および開となるバイパス制御接点とを有するとともに、上記両バイパス制御接点が同時に閉となることがない接点機構が設けられたリレー部とを有し、
かつ、一方の保護処理部のバイパス指令により閉となるバイパス制御接点と他方の保護処理部のバイパス指令により開となるバイパス制御接点との直列回路に対して、一方の保護処理部の遮断器制御出力接点を並列接続してなる並列回路と、他方の保護処理部のバイパス指令により開となるバイパス制御接点と一方の保護処理部のバイパス指令により閉となるバイパス制御接点との直列回路に対して、他方の保護処理部の遮断器制御出力接点を並列接続してなる並列回路と、が互いに直列接続されている、ことを特徴とする保護継電器。 - 上記二重化された各保護処理部を構成する入力変換手段、演算手段、常時監視手段、およびリレー部の全体が一つにユニット化されていることを特徴とする請求項2記載の保護継電器。
- 上記開閉動作が上記の場合とは逆になるように入れ替わったバイパス制御接点を設けるとともに、上記常時監視手段と上記出力タイミング調整手段との間にバイパス指令の出力を反転させるインバータを介在させていることを特徴とする請求項1に記載の保護継電器。
- 上記開閉動作が上記の場合とは逆になるように入れ替わったバイパス制御接点を設けるとともに、上記常時監視手段と上記リレー部との間にバイパス指令の出力を反転させるインバータを介在させていることを特徴とする請求項2または請求項3に記載の保護継電器。
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