JP5340905B2 - 表示装置 - Google Patents
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Description
本実施の形態では、タッチパネルについて以下に説明する。
実施の形態1の図2において、信号線側のフォトセンサ読み出し回路109では、第1のA/D変換回路201〜第9のA/D変換回路209でA/D変換することにより得られた信号を、出力信号線220から出力する。
実施の形態1で示したA/D変換回路の動作は、各種A/D変換回路の制御信号(「タイミング信号」ともいう。)を供給することによって制御する。ここで、A/D変換回路に信号を供給する方法として、外部駆動回路からタイミング信号線を介して供給する方法や、タッチパネルに搭載したタイミング信号生成回路からタイミング信号線を介して供給する方法などがある。ここで、用いるタイミング信号線の本数は、A/D変換回路の数に比例し、且つ、A/D変換回路のビット数に比例する。
実施の形態3ではタイミング信号生成回路の構成について説明したが、タイミング信号生成回路のシフトレジスタを、タッチパネルの画像描画用に設けられている信号線側の表示素子駆動回路107を構成しているシフトレジスタと共通とすることができる。
本実施の形態では、実施の形態1〜4で説明したタッチパネルについて、図10、11を参照して説明する。本実施の形態において、タッチパネルはフォトセンサと表示素子を有している。表示素子は液晶素子又は発光素子を有する。
本実施の形態では、実施の形態1〜5で説明したタッチパネルを表示部に適用した電子機器の一例について、図12(A)(B)、図13(A)(B)を用いて説明する。
101 画素回路
102 表示素子制御回路
103 フォトセンサ制御回路
104 画素
105 表示素子
106 フォトセンサ
107 表示素子駆動回路
108 表示素子駆動回路
109 フォトセンサ読み出し回路
110 フォトセンサ駆動回路
201〜209 A/D変換回路
210 読み出し回路
211〜219 フォトセンサ信号線
220 出力信号線
221〜229 出力信号線
231〜239 制御信号線
301 比較回路
302 逐次変換レジスタ
303 D/A変換回路
304 出力信号線
305 出力信号線
306 出力信号線
307 出力信号線
308 保持回路
309 保持回路
310 イネーブル信号線
311 リセット信号線
312 リセット信号線
313 セット信号線
314 セット信号線
401〜410 信号
501〜515 信号
600 タイミング信号生成回路
601〜615 エッジセンシティブラッチ
616 スタート信号線
617 クロック信号線
621〜635 出力信号線
640 論理和回路
641 出力信号線
642 論理和回路
643 出力信号線
644 論理和回路
645 出力信号線
651 シフトレジスタ
652 論理回路
701〜718 信号
900 表示素子選択回路
901〜915 セレクタ
916 画像信号入力線
921〜935 ソース信号線
1000 基板
1001 薄膜トランジスタ
1002 薄膜トランジスタ
1003 フォトセンサ
1004 絶縁層
1005 絶縁層
1006 絶縁層
1007 画素電極
1008 下部電極
1010 n型半導体層
1011 i型半導体層
1012 p型半導体層
1013 ゲート電極
1014 信号線
1020 対向基板
1021 対向電極
1022 カラーフィルタ層
1023 オーバーコート層
1024 液晶層
1025 スペーサ
1035 指
1100 基板
1101 薄膜トランジスタ
1102 薄膜トランジスタ
1103 フォトセンサ
1104 絶縁層
1105 絶縁層
1106 絶縁層
1109 センサ用配線
1110 n型半導体層
1111 i型半導体層
1112 p型半導体層
1120 対向基板
1123 画素電極
1124 発光層
1125 対向電極
1126 バンク
1127 EL素子
1135 指
1211 筐体
1212 表示部
1213 支持台
1221 筐体
1222 表示部
1223 表示部
1224 スピーカ部
1225 操作キー
1226 記録媒体挿入部
1227 外部接続ポート
1228 LEDランプ
1229 マイクロフォン
1300 筐体
1301 表示部
1302 操作ボタン
1303 外部接続ポート
1304 スピーカ
1305 マイク
1306 キーボード
1307 画面
Claims (4)
- 第1のセンサと、第2のセンサと、第1のA/D変換回路と、第2のA/D変換回路と、前記第1のA/D変換回路及び前記第2のA/D変換回路に信号を入力することができる機能を有する第1の回路と、を有し、
前記第1の回路は、複数段のラッチを有するシフトレジスタと、第1の論理回路と、第2の論理回路と、を有し、
前記第1の論理回路は、前記シフトレジスタのi(iは自然数)段目のラッチの出力信号を入力信号とする論理演算により第1の信号を生成し、
前記第2の論理回路は、前記シフトレジスタのi+1段目のラッチの出力信号を入力信号とする論理演算により第2の信号を生成し、
前記第1のA/D変換回路には、前記第1の信号及び前記第1のセンサの出力信号が入力され、
前記第2のA/D変換回路には、前記第2の信号及び前記第2のセンサの出力信号が入力され、
前記第1の信号は、前記第1のA/D変換回路を制御することができる機能を有し、
前記第2の信号は、前記第2のA/D変換回路を制御することができる機能を有することを特徴とする表示装置。 - 請求項1において、
前記第1のA/D変換回路及び前記第2のA/D変換回路は、逐次変換方式のA/D変換回路であることを特徴とする表示装置。 - 請求項1または2において、
前記第1のセンサ及び前記第2のセンサは、フォトセンサであることを特徴とする表示装置。 - 請求項1乃至3のいずれか一において、
前記第1のA/D変換回路は、第1の比較回路を有し、
前記第2のA/D変換回路は、第2の比較回路を有し、
前記第1の比較回路と前記第2の比較回路とは、互いに異なるタイミングで動作することを特徴とする表示装置。
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