JP5243192B2 - 増幅器 - Google Patents
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Description
従来のドハティ増幅器について図6を用いて説明する。図6は、従来のドハティ増幅器の構成ブロック図である。
図6に示すように、従来のドハティ増幅器は、入力端子1と、分配器2と、移相器3と、キャリア増幅回路4と、ピーク増幅回路5と、ドハティ合成部6と、λ/4変成器7と、出力端子8とから構成されている。
更に、キャリア増幅回路4は、入力整合回路41と、増幅素子42と、出力整合回路43とから構成され、ピーク増幅回路5は、入力整合回路51と、増幅素子52と、出力整合回路53とから構成され、ドハティ合成部6は、λ/4変成器61と、ノード(合成点)62とから構成されている。
分配器2は、入力端子1から入力された信号を、2つに分配するものである。
移相器3は、分配器2で分配された一方の信号の位相を90°遅らせるものである。
キャリア増幅回路4の入力整合回路41は、分配器2で分配された一方の信号と増幅素子42の入力側との整合をとるものである。
増幅素子42は、AB級にバイアスされた増幅素子であり、入力電力レベルが低いときから動作するものである。
出力整合回路43は、増幅素子42からの出力側とλ/4変成器61との整合をとるものである。
増幅素子52は、B級又はC級にバイアスされた増幅素子であり、入力レベルが十分高いときに動作するものである。
出力整合回路53は、増幅素子52からの出力側とノード62との整合をとるものである。
ノード62は、λ/4変成器61からの出力とピーク増幅回路5からの出力とを合成するものである。
λ/4変成器7は、ノード62での合成信号をインピーダンス変換して、出力負荷9に整合させるものである。
入力端子1から入った信号は、分配器2で分配される。分配された一方の信号は、キャリア増幅器4に入力され、増幅素子42で増幅される。キャリア増幅器4の出力は、λ/4変成器61でインピーダンス変換される。
λ/4変成器61の出力及びピーク増幅器5の出力はノード62において合成される。合成された信号は、λ/4変成器7でインピーダンス変換され、出力端子8を介して出力負荷9に接続される。このようにして従来のドハティ増幅器における動作が行われるものである。
キャリア増幅器4とピーク増幅器5は、増幅素子42がAB級にバイアスされ、増幅素子52がB又はC級にバイアスされている点で異なる。そのため、増幅素子52が動作する入力までは増幅素子42は単独で動作し、増幅素子42が飽和領域に入る(増幅素子42の線形性が崩れ始める)と、増幅素子52が動作し始め、増幅素子52の出力が負荷に供給され、増幅素子42とともに負荷を駆動する。このとき増幅出力整合回路43の負荷線は、後述するように高い抵抗から低い抵抗へ移動するが、増幅素子42は飽和領域にあるので効率は良い。入力端子1からの入力が更に増加すると、増幅素子52も飽和し始めるが、増幅素子42、52ともに飽和しているのでこのときも効率は良い。
次に、ドハティ増幅器の効率−出力電力特性について図7を用いて説明する。図7は、ドハティ増幅器と通常のB級増幅器の効率−出力電力特性を示す説明図である。図7では、点線は、一般的なB級増幅器の効率を示し、実線は、簡単なモデルにおけるドハティ増幅器の理論上のコレクタ効率又はドレイン効率を示している。
尚、ここでいう「コレクタ効率」とは、コレクタに印加される電源の電圧(直流)とその電源から供給される電流(直流)の積に対する、コレクタから取り出せる無線周波出力電力の割合の意味であり、ドレイン効率についても同様である。
このとき、キャリア増幅回路4とピーク増幅回路5の出力電力の和は、入力端子1への入力電力に対し、A区間と同じ比例定数で比例する。ピーク増幅器5が動作し始めると、効率は一旦低下するが、ピーク増幅回路5も飽和し始めるコンプレッションポイントで再びピークを迎える。コンプレッションポイントにおいて、キャリア増幅回路4とピーク増幅回路5の出力は等しくなる。
次に、図6を用いてドハティ増幅器の各部のインピーダンスについて説明する。
図6に示すように、出力負荷Z0は一定に規定されているので、これを起点とする。
ノード62からλ/4変成器7をみたインピーダンスZ7は、λ/4変成器7の特性インピーダンスをZ2とすると、
Z7=Z2 2/Z0
となる。
出力整合回路43からλ/4変成器61をみたインピーダンスZ4は、A区間においては出力整合回路53の出力インピーダンスが実質的に無限大となるために上記と同様に求まり、C区間においては負荷を等しく分担するため、λ/4変成器61の負荷インピーダンス(ノード62でのキャリア増幅回路4の寄与分)Z4と整合回路53の負荷インピーダンスZ5は、それぞれ2Z7となるので、次式となる。
また、Z4及びZ5は、B区間ではA区間の時の値とC区間の時の値との間をそれぞれ遷移する。
Z4は、入力信号レベルの小さいとき(A区間)のインピーダンス値に対して、入力信号レベルが大きいとき(C区間)には半分になり、換言すれば、2倍の負荷変動を起こす。例えば、Z7=25Ω、Z1=50Ωとすると、Z4は、100〜50Ωの間で変化する。従って増幅素子42の負荷インピーダンスも変動している。一般的には負荷変調と呼ぶ。
これらについても基本的な原理は上述したものと同じである。
尚、ドハティ増幅器に関連する従来技術としては、特開2006−332829号公報(特許文献1)、特開2006−197556号公報(特許文献2)、特開2007−006164号公報(特許文献3)、特開2006−165856号公報(特許文献4)、特開2006−157900号公報(特許文献5)がある。
特許文献1〜5には、入力信号を分配して、一方をAB級又はB級で動作するキャリア増幅器で増幅し、他方をB級又はC級で動作するピーク増幅器で増幅し、合成して出力することが記載されている。
更に、特許文献1,2には、ドハティ増幅器において、ピーク増幅器を複数並列に接続し、入力レベルに応じて段階的に動作させることが記載されている。
本発明の実施の形態について図面を参照しながら説明する。
本発明の実施の形態に係る増幅器は、入力信号を分配して、AB級又はB級で動作するキャリア増幅器(キャリア増幅回路)と、B級又はC級で動作する複数のピーク増幅器(ピーク増幅回路)で増幅し、各増幅器の出力を合成して出力するN−WAYドハティ増幅器であって、各ピーク増幅器は入力レベルに応じて段階的に動作し、最小の入力レベルで動作を開始するピーク増幅器の最大出力は、キャリア増幅器の最大出力より小さいものとしており、キャリア増幅器が飽和する前の入力レベルにおけるピーク増幅器側に流れる電流を低減し、増幅器全体の効率を向上させることができるものである。
本発明の実施の形態に係る増幅器について図1を用いて説明する。図1は、本発明の実施の形態に係る増幅器(本増幅器)の構成ブロック図である。尚、図6と同様の構成をとる部分については同一の符号を付して説明する。
図1に示すように、本増幅器は、従来と同じ部分として、入力端子1と、分配器21と、キャリア増幅回路4と、λ/4変成器61と、λ/4変成器7と、出力端子8と、出力負荷9とを備え、更に、分配器22と、ピーク増幅回路5-1〜5-nと、伝送線路54-1〜54-nとを備えている。
ドハティ合成部6は、長さ0〜λ/2の任意の電気長となるよう構成されている。
また、伝送線路54-1〜54-nは、ピーク増幅回路5-1〜5-nが動作しないときに、ノード62から各ピーク増幅回路5-1〜5-nをみたインピーダンスが大きくなるような電気長を備えている。
本増幅器の動作について図1を用いて説明する。
本増幅器では、入力端子1から入力された信号は、分配器21で2つに分配され、その一方はキャリア増幅回路4に入力され、他方は分配器22に入力される。
キャリア増幅回路4に入力された信号は、増幅素子で増幅されて、λ/4変成器61でインピーダンス変換されてノード62に入力される。
そして、合成された増幅信号は、λ/4変成器7でインピーダンス変換されて出力端子8に出力され、負荷9に供給される。
このようにして本増幅器における動作が行われる。
次に、本増幅器の特性について図2を用いて説明する。図2では、ピーク増幅回路群として、2段のピーク増幅回路を備えた増幅器の特性について説明する。すなわち、図1において分配器22の出力段にピーク増幅回路5-1とピーク増幅回路5-2とを接続した構成である。
図2(a)は、入力−出力電力特性を示す説明図であり、(b)は、入力−増幅器効率を示す説明図であり、(c)はピーク増幅器に流れる電流を示す説明図である。
図2(a)において、横軸は入力電力、縦軸は出力電力を表す。キャリア増幅回路4の飽和出力をPとし、ピーク増幅回路5-1の飽和出力を0.25P、ピーク増幅回路5-2の飽和出力を0.75Pとしている。
図2(a)に示すように、入力電力の低い領域からキャリア増幅回路4が動作し、入力の増加に伴ってキャリア増幅回路4の出力400が増加する。そして、出力電力が飽和電力の1/2付近となるP1点においてキャリア増幅回路4は飽和し始める。
このときの全体の出力800は、キャリア増幅回路4の出力400と、ピーク増幅回路5-1の出力511と、ピーク増幅回路5-2の出力512とを合わせたものとなる。
効率について図2(b)を用いて説明する。
ここでは、ピーク増幅回路5-1と5-2を備えた第1の増幅器の効率を801とし、理想的な等出力2WAYドハティ増幅器の効率を802とし、従来の2WAYドハティ増幅器の効率を803として示している。
理想的な等出力2WAYドハティ増幅器の効率802は、キャリア増幅回路4が飽和し始めるP1点において効率が高くなり、P1以上の領域では一旦著しい効率の低下が見られるのに対して、第1の増幅器の効率801は、ピーク増幅回路5-1が飽和したとき(P2点)において高くなるため、この領域での効率を大幅に改善していることがわかる。
ピーク増幅回路5に流れる電流について図2(c)を用いて説明する。
ここでは、ピーク増幅回路5-1と5-2を備えた第1の増幅器のピーク増幅回路に流れる電流を501とし、理想的な等出力2WAYドハティ増幅器のピーク増幅回路の電流を502とし、従来の2WAYドハティ増幅器のピーク増幅回路の電流を503として示している。
第1の増幅器のピーク増幅回路では、V1点から少し低いVa点から流れ始め、全体として従来に比べてかなり低くなり、その結果(b)に示したように効率が向上する。
本発明の実施の形態に係る増幅器によれば、入力レベルに応じて段階的に動作するピーク増幅回路5-1〜5-nを備えたN−WAYドハティ増幅器であって、ピーク増幅回路5-1〜5-nの飽和出力がキャリア増幅回路4の飽和出力より小さくなるよう構成しているので、キャリア増幅回路4が飽和する前にピーク増幅回路5に流れる電流を低減し、全体の効率を向上させることができる効果がある。
ドハティ増幅器の効率を向上させる構成として、キャリア増幅回路及びピーク増幅回路に高調波を反射する高調波反射回路を備えたものが知られている。
そこで、本発明の別の実施の形態に係る増幅器は、高調波反射による効率向上の効果を更に高める増幅器としている。
図3に示すように、別の増幅器では、上述した図1の増幅器の構成を基本として、分配器21の入力段に、高調波を発生する高調波発生回路30を備えたものである。また、キャリア増幅回路4′及び各ピーク増幅回路5′-1〜5′-nには、高調波を反射する高調波反射回路を設けている。
高調波反射回路30の構成については後で説明する。
図4は、別の増幅器におけるキャリア増幅回路4′及びピーク増幅回路5′-1〜5′-nの構成ブロック図である。尚、ここではキャリア増幅回路4′を例として符号を付しているが、ピーク増幅回路5′-1〜5′-nについても同様の構成となっている。
図4に示すように、キャリア増幅回路4′は、入力整合回路41と、増幅素子(FET)42と、出力整合回路43と、高調波反射回路45とを備えている。
高調波反射回路45は、基本波の周波数に対して高入力インピーダンスで、且つ、その2次高調波周波数に対して低入力インピーダンスとなる高周波終端回路である。すなわち、高調波反射回路は、2次高調波をよく反射する特性を備えている。
高調波発生回路30の構成について図5を用いて説明する。図5は、高調波発生回路30の構成ブロック図である。
図5に示すように、高調波発生回路30は、別の増幅器において分配器21の入力に注入する高調波を発生する回路であり、分配器31と、遅延線35と、2次高調波発生器32と、可変移相器33と、可変減衰器34と、合成器36とから構成されている。
高調波発生器32は、高調波を発生するものであり、第1の増幅器では2次高調波を発生するものとしている。
可変移相器33は、高調波発生器32で発生した2次高調波の位相を調整する。
可変減衰器34は、高調波発生器32で発生した2次高調波の振幅を調整する。
尚、可変移相器33及び可変減衰器34から成る部分は、発生した2次高調波のベクトル調整を行うベクトル調整器に相当し、可変移相器33、可変減衰器34、高調波発生器32の配列順が変わっても構わない。
そして、合成器36は、遅延された基本波信号と、可変減衰器34から出力された位相及び振幅が調整された2次高調波とを合成して、分配器21に出力する。
そこで、別の増幅器では、ピーク増幅回路5-1に低飽和電力の増幅素子を用いたN−WAYドハティ増幅器とすることにより、効率改善を図り、高調波注入による効率向上の効果を高めるようにしている。
本発明の別の実施の形態に係る増幅器によれば、入力レベルに応じて段階的に動作するピーク増幅回路5-1〜5-nを備えたN−WAYドハティ増幅器であって、ピーク増幅回路5-1〜5-nの飽和出力がキャリア増幅回路4の飽和出力より小さくなるよう構成し、また、キャリア増幅回路4及びピーク増幅回路5-1〜5-nに高調波反射回路を備え、更に、入力段に高調波発生回路30を備えた増幅器としているので、変調波入力時においても、高調波の調整点以外での効率低下を抑制し、高調波注入及び高調波反射による効率向上を一層高め、全体の効率を向上させることができる効果がある。
Claims (2)
- AB級又はB級で動作する増幅素子を有するキャリア増幅回路と、
B級又はC級で動作する増幅素子を有する複数のピーク増幅回路とを備えた増幅器であって、
前記キャリア増幅回路と前記複数のピーク増幅回路の出力を合成して出力し、
前記複数のピーク増幅回路は、それぞれ飽和出力が異なり、入力レベルに応じて段階的に動作を開始するものであり、
前記複数のピーク増幅回路の内、最も低い入力レベルで動作を開始するピーク増幅回路の飽和出力が前記キャリア増幅回路の飽和出力より小さく、
前記キャリア増幅回路の出力が飽和出力になる前に、前記最も低い入力レベルで動作を開始するピーク増幅回路が動作を開始し、
前記複数のピーク増幅回路の内、特定のピーク増幅回路の出力が飽和出力になる前に、前記特定のピーク増幅回路の次に飽和出力が大きいピーク増幅回路が動作を開始することを特徴とする増幅器。 - 基本波周波数の入力信号を分配する分配器と、
前記分配された一方の基本波信号から2次高調波を発生する高調波発生器と、
前記高調波発生器で発生した2次高調波の位相及び振幅を調整する調整器と、
位相及び振幅が調整された2次高調波と前記分配された他方の基本波信号とを合成して出力する合成器とを有する高調波発生回路を備え、
前記高調波発生回路から出力された2次高調波がキャリア増幅回路又は/及びピーク増幅回路の入力信号に注入され、
前記キャリア増幅回路又は/及び前記ピーク増幅回路のそれぞれは、更に、高調波を反射する高調波反射回路を備え、
前記高調波反射回路は、基本周波数に対して高入力インピーダンスとなり、2次高調波に対して低入力インピーダンスとなることを特徴とする請求項1記載の増幅器。
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