JP4212596B2 - ドハティ型増幅器 - Google Patents
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Description
この発明は上記事情によりなされたもので、その目的は、単品ごとの特性のばらつきを抑え、外部擾乱への耐性を高めたドハティ型増幅器を提供することにある。
図1はこの発明に係わるドハティ型増幅器(以下ドハティアンプと称する)の第1の実施形態を示すブロック図である。図1において、入力信号をハイブリッド回路1で2系統に分配し、一方をメインアンプ2に入力し、他方を遅延器4を介してハイブリッド回路6に入力する。ハイブリッド回路6には、メインアンプ2の出力を方向性結合器5により一部分岐したモニタ信号が入力される。ハイブリッド回路6はモニタ信号と遅延器4の出力とを逆相で加算し、ピーキングアンプ3に入力する。ピーキングアンプ3の出力は方向性結合器5を介したメインアンプ2の出力と合成され、インピーダンス整合器7を介して出力信号として取り出される。
しかしながら図2の構成においては、メインアンプ2およびピーキングアンプ3の特性のばらつきが考慮されていない。従って図3に示す理想的な特性を得るためには部品ごとのバイアス調整が必要になり、歩留まりが悪い。
図1に示すようにピーキングアンプ3が1段の構成では、ピーキングアンプがB級またはC級にバイアスされていることから完全な線形増幅器とすることは難しく、出力信号に誤差が生ずる場合がある。この実施形態では線形特性をさらに改善可能な構成を以下に開示する。
Claims (5)
- 入力信号を2系統に分配する分配手段と、
前記分配された一方の信号をAB級またはB級動作のもとで増幅する主増幅器と、
この主増幅器の出力の一部を分岐してモニタ信号を取り出す方向性結合器と、
前記分配された他方の信号と前記モニタ信号とを逆相で加算して、前記主増幅器が飽和して利得が低下した分の電力を抽出する加算手段と、
前記電力をB級またはC級動作のもとで増幅する副増幅器と、
前記主増幅器の出力と前記副増幅器の出力とを合成する合成手段とを具備することを特徴とするドハティ型増幅器。 - 前記分配された他方の信号を遅延して前記加算手段に入力される信号の位相を整合させる遅延手段をさらに具備することを特徴とする請求項1に記載のドハティ型増幅器。
- 入力信号を第1信号と第2信号とに分配する分配手段を有し、前記入力信号を増幅する主増幅部と、
この主増幅部の出力の一部を分岐してモニタ信号を取り出す第1方向性結合器と、
前記第1信号を2つに分枝した一方の信号と前記モニタ信号とを逆相で加算して、前記主増幅部が飽和して利得が低下した分の電力成分を抽出する加算部と、
前記電力成分をB級またはC級動作のもとで増幅する副増幅部と、
前記主増幅部の出力と前記副増幅部の出力とを合成する手段とを具備し、
前記主増幅部は、
前記第2信号をAB級またはB級動作のもとで増幅する主増幅器と、
この主増幅器の出力の一部を分岐してモニタ出力を取り出す第2方向性結合器と、
前記第1信号を2つに分枝した他方の信号と前記モニタ出力とを逆相で加算して、前記主増幅器が飽和して利得が低下した分の電力を抽出する加算手段と、
前記電力をB級またはC級動作のもとで増幅する副増幅器と、
前記主増幅器の出力と前記副増幅器の出力とを合成する手段とを備えることを特徴とするドハティ型増幅器。 - 前記第1信号を2つに分枝した一方の信号を遅延して前記加算部に入力される信号の位相を整合させる遅延部をさらに具備することを特徴とする請求項3に記載のドハティ型増幅器。
- 前記主増幅部は、
前記第1信号を2つに分枝した他方の信号を遅延して前記加算手段に入力される信号の位相を整合させる遅延手段をさらに具備することを特徴とする請求項3に記載のドハティ型増幅器。
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