JP5224128B2 - 電流検出回路 - Google Patents
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Description
4:コンバータ
6:平滑回路
8:負荷
10,10b,10c,10d:電流検出回路
12,12b:電圧制限回路
14,14b:電圧計測回路
16,16b:PWM信号生成部
18,18b:A/D変換器
20,20b:電圧指令生成部
22,22b:ゲート駆動回路
30:電流計測部
32,34:制御部
34:電圧計測部
Sup,Sun,Svp,Svn,Swp,Swn,Srp,Srn,Ssp,Ssn,Stp,Stn:スイッチング素子
Ru,Rw,Rr,Rt,Rn:シャント抵抗
ZD,ZD2:ツェナーダイオード
Dup,Dun,Dvp,Dvn,Dwp,Dwn,Drp,Drn,Dsp,Dsn,Dtp,Dtn:ダイオード
R:抵抗
C1:コンデンサ
C2:スナバ回路
So:電源
Claims (11)
- 複数のスイッチング素子を有する電力変換回路に直列接続されたシャント抵抗と、
前記シャント抵抗の両端にそれぞれ接続され、電圧値を所定の範囲に制限する電圧制限回路と、
前記電圧制限回路に接続され、入力端の電位差を検出する電圧計測回路と、
を備えた電流検出回路。 - 前記電圧制限回路が、
シャント抵抗に接続された抵抗と、
前記抵抗に直列接続されたツェナーダイオードと、
を備え、
前記電圧計測回路が、抵抗とツェナーダイオードとの接続部に接続される請求項1の電流検出回路。 - 前記ツェナーダイオードのブレークダウン電圧が、前記電圧計測回路の許容入力電圧の上限値よりも小さい、または下限値よりも大きい請求項2の電流検出回路。
- 前記電力変換回路が上側アームと下側アームにそれぞれスイッチング素子を備えたインバータであり、該インバータの下側アームのスイッチング素子と前記電圧制限回路とが並列に接続されており、該下側アームのスイッチング素子がオンのときにツェナーダイオードはブレークダウンせず、該インバータの出力電圧が電圧計測回路の許容入力電圧の上限よりも小さな所定値以上、または下限よりも大きな所定値以下のときに該ツェナーダイオードはブレークダウンする請求項2または3の電流検出回路。
- 前記下側アームのスイッチング素子がオンのときに前記電圧計測回路がシャント抵抗の入力端の電位差を検出する請求項4の電流検出回路。
- 前記インバータが三相交流インバータであり、少なくとも2相の出力線にそれぞれ前記シャント抵抗が直列接続された請求項4または5の電流検出回路。
- 前記インバータが前記シャント抵抗を介して負荷と接続されており、該シャント抵抗と該負荷との間にリアクトルを備えた請求項4から6の電流検出回路。
- 前記電力変換回路が上側アームと下側アームにそれぞれスイッチング素子を備えたコンバータであり、該コンバータの下側アームのスイッチング素子と電圧制限回路とが並列に接続されており、該下側アームのスイッチング素子がオンのときにツェナーダイオードはブレークダウンせず、該コンバータの入力電圧が電圧計測回路の許容入力電圧の上限よりも小さな所定値以上、または下限よりも大きな所定値以下のときにツェナーダイオードはブレークダウンする請求項2または3の電流検出回路。
- 前記下側アームのスイッチング素子がオンのときに前記電圧計測回路がシャント抵抗の入力端の電位差を検出する請求項8の電流検出回路。
- 前記コンバータに入力する電圧が三相交流電圧であり、少なくとも2相の入力線にそれぞれ前記シャント抵抗が直列接続された請求項8または9の電流検出回路。
- 前記コンバータが前記シャント抵抗を介して電源と接続されており、該シャント抵抗と該電源との間にリアクトルを備えた請求項8から10の電流検出回路。
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- 2009-01-14 JP JP2009005914A patent/JP5224128B2/ja not_active Expired - Fee Related
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