JP5034225B2 - 半導体装置の製造方法 - Google Patents
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Description
そして、高エネルギーイオン注入による不純物注入をレジストによりマスクすることにより、P型ウエル領域と半導体基板を電気的に接続する貫通口が、N型ウエル領域の一部を構成する上記のN型不純物領域を貫通して設けられている。
その結果、半導体基板からのノイズ及び半導体基板中の少数キャリヤー電流の注入の防止の効果は維持しつつ、P型ウエル領域に所定の電位レベルが半導体基板から供給されている。(例えば、特許文献1)
そこで、半導体基板表面から浅い領域に止まった不純物を補償するため、その不純物とは反対の導電型を有する不純物を、半導体基板表面から浅い領域に注入することが提案されている。(例えば、特許文献2)
そこで、補償の対象である不純物が存在しない領域では、補償に用いる不純物の濃度が増加し、所定の不純物分布を得ることができない問題点が生じる。
また、不純物の高エネルギーイオン注入をマスクすべき領域の境界領域において、半導体表面から浅い部分の導電型が、高エネルギーイオン注入を行った不純物と同じ導電型であった場合には、半導体表面から浅い部分に補償用の不純物を注入すると、境界領域以外の領域の不純物も補償されてしまう問題点もある。
本発明において、形成されるべき前記不純物領域に対して、前記半導体基板の表面上のイオン注入すべき面積を拡大若しくは縮小しつつ複数回のイオン注入を複数回行う。そうすると、イオン注入用のレジストマスク端の配置の変更を伴った、複数回のイオン注入を行うことになる。従って、不純物の高エネルギーイオン注入をマスクすべき領域の境界領域において、イオン注入を行った不純物が分散するため、その不純物の濃度は薄くなる。その結果、レジストマスク端が斜め形状であるため、不純物の高エネルギーイオン注入によって、レジストマスクを突き抜けて半導体表面から浅い部分に止まる不純物の濃度も薄くなる。従って、レジストマスクを突き抜けた不純物が半導体素子へ悪影響を及ぼすことは殆どない。また、高エネルギーイオン注入を行った不純物であって、半導体表面から浅い部分に止まった不純物を補償するために、補償用の不純物を注入する必要がないため、不純物のイオン注入をマスクすべき領域の境界領域以外における不純物分布はほぼ保持される。そうすると、レジストマスク端が斜め形状であるために生じる問題は解決される。
はじめに、図1A、図1B、及び、図1Cは、従来の半導体装置の製造方法の問題点の詳細を説明するための図である。そして、図1AはP型ウエル領域2、不純物の注入深さが深いN型ウエル領域3a、レジストを突き抜けて不純物が注入された領域3b、P型半導体基板4、及び、図1Bと対応する領域10を示す。
一方、図1Bが示す点線17aと点線17bで挟まれる領域では、レジスト16中及び半導体基板15中に、縦方向に7.5E16/cm3を示す等濃度線13で囲まれた不純物領域が存在し、その不純物領域の両側に2.5E16/cm3等濃度線12で囲まれる不純物領域が存在する。
そうすると、従来の製造方法により不純物の注入深さが深いN型ウエル領域3aを形成すると、レジストを突き抜けて不純物が注入された領域3bに配置されたMOSトランジスタの特性が、他のMOSトランジスタの特性と比較して不安定となる問題がある。
例えば、不純物の注入深さが深いN型ウエル領域3aの境界領域であって、P型ウエル2中に形成されているMOSトランジスタの特性の内、ソース端子とドレイン端子間のリーク特性が悪化する等の問題がある。P型ウエル領域2のP型不純物の働きは、N型不純物により相殺されるため、P型ウエル領域2中のP型不純物濃度が低下したのと同様な状態となる。その結果、P型ウエル領域2とソース及びドレイン領域とで形成されるP−Nジャンクションの電気的な耐圧が劣化するからである。
なお、上記の説明では、レジスト16が境界で傾斜を持つ状態について説明したが、たとえレジスト16が境界で理想的な垂直の形状になったとしても、イオン注入において全ての注入イオンを完全に半導体基板15に対して垂直に入射させることは技術的に困難である。このため、その場合においても同様に半導体基板15の表面に不純物濃度が高い領域が形成されやすい。
そして、図2A、図2B、及び、図2Cは、実施例1に係わる半導体装置の製造方法を示す図であり、高エネルギーイオン注入29、レジストマスク21、レジストを突き抜けて不純物が注入された領域22、不純物の注入深さが深いN型ウエル領域23、P型ウエル領域24a、P型半導体基板24b、不純物の注入深さが深いN型ウエル領域25、レジストを突き抜けて不純物が注入された領域26、不純物の注入深さが深いN型ウエル領域27、及び、レジストを突き抜けて不純物が注入された領域28を示す。
図4Bは矢印44bで示す範囲であって、半導体基板表面の近傍の領域において、N型不純物の濃度分布を示すグラフである。縦軸は1.0E15/cm-3から5.0E17/cm-3までのN型不純物の濃度範囲をLOGスケールで表している。また、横軸は、レジストマスク41の端の位置を原点として、半導体表面における位置を-1.9μmから0.5μmの範囲で表している。
その結果、実施例1の半導体装置の製造方法によれば、一固まりの不純物領域の内、濃度が濃い部分は、図1Aに示したN型不純物領域3aと同程度の濃度となる不純物領域が形成できる。一方、一固まりの不純物領域を形成するために、イオン注入用のマスクパターン端の配置の変更を伴った、複数回のイオン注入を行う工程を行うので、P型ウエル領域内にできるレジストマスクの端部分を突き抜けた各N型不純物の領域の不純物濃度は薄くなる。その結果、一固まりの不純物領域の境界領域であって、P型ウエル領域内に半導体素子が形成されても、その半導体素子の電気的な特性の変化を抑えることができる。例えば、P型ウエル領域内に配置した能動素子の端子間のリーク電流の増加を抑えられる。
なお、上記図4では、点線47乃至点線49に対応する注入は、同一注入種の同一注入エネルギーを3回に等分割し、注入マスクのシフト量も同一である例を示した。本発明の効果を得るためは、分割回数を増やし、等分割にし、注入マスクのシフト量も同一にすることが最も好ましい。しかし、分割回数や分割した各注入の注入量はこれに限ることはないし、注入エネルギー、注入イオン種や注入マスクのシフト量を様々に変えてもよい。
実施例2は半導体基板の表面から所定の深さを有するウエル領域と、平面的にみた場合に、一固まりの不純物領域の境界領域内であって、上記のウエル領域内に形成されている半導体素子と、上記のウエル領域の底部からさらに深い半導体基板内部に、半導体表面から離れた上記の一固まりの不純物領域とが形成されている半導体装置の製造方法に関する実施例である。
そして、図5A乃至図5Dは、レジストマスク50、半導体素子51、P型ウエル領域52、N型不純物の高エネルギーイオン注入によって形成した、半導体表面から離れた一固まりの不純物領域53、P型不純物の高エネルギーイオン注入によって形成した、半導体表面から離れた一固まりの不純物領域55、及び、N型ウエル領域56を示す。半導体素子51とは、不純物濃度が何らかの形で特性に影響を与える素子ならばいずれでもよく、トランジスタ又はMOSトランジスタのような能動素子でも、ダイオードや容量、抵抗などでもよい。
そして、図6A、図6B、図6C、及び、図6Dは、レジストマスク60、P型ウエル領域61、不純物の注入深さが深いP型不純物領域62、N型不純物の高エネルギー注入63、半導体基板64、半導体素子65、P型不純物の高エネルギー注入66、及び、不純物の注入深さが深いN型不純物領域67を示す。半導体素子65は図5A乃至図5Dに示した半導体素子と同様なものである。
そして、図7A、図7B、図7C、及び、図7Dは、レジストマスク70、N型ウエル領域71、不純物の注入深さが深いP型不純物領域72、N型不純物の高エネルギー注入73、半導体基板74、半導体素子75、P型不純物の高エネルギー注入76、及び、不純物の注入深さが深いN型不純物領域77を示す。半導体素子75は図5A乃至図5Dに示した半導体素子と同様なものである。
図7Bは、図6Bと同様にN型不純物の高エネルギー注入73を行っているところを示す図である。ただし、半導体基板表面には、P型ウエル領域が形成されているのではなく、N型ウエル領域71が予め形成されている点で異なる。
図7Cは、図6Cと同様にN型不純物の高エネルギー注入73を行っているところを示す図である。ただし、半導体基板表面には、P型ウエル領域が形成されているのではなく、N型ウエル領域71が予め形成されている点で異なる。
図7Dは、図6Dと同様にP型不純物の高エネルギー注入76を行っているところを示す図である。ただし、半導体基板表面には、P型ウエル領域が形成されているのではなく、N型ウエル領域71が予め形成されている点で異なる。
従って、実施例2の半導体装置の製造方法によれば、レジストマスクの端部において、レジストを突き抜ける不純物が分布する位置は、高エネルギーイオン注入毎に異なる。また、複数回の高エネルギーイオン注入によって所定の不純物濃度を得ることが目的であるため、一回の高エネルギーイオン注入における不純物量は、高エネルギーイオン注入の回数をNとすると、N分割された量となる。すなわち、図4Bに示すように、P型ウエル領域内において、レジストマスクの端部においてレジストを突き抜ける不純物は分散して分布することになり、レジストを突き抜ける不純物ピーク不純物濃度は低下する。
はじめに、図8A、図8B、及び、図8Cを用いて従来の半導体装置の製造方法の問題点の詳細を説明する。そして、図8Aは、不純物の注入深さが浅いN型ウエル領域80、トリプルウエル構造を構成するP型ウエル領域81a、トリプルウエル構造ではないP型ウエル領域81b、不純物の注入深さが深いN型ウエル領域82a、レジストを突き抜けて不純物が注入された領域82b、P型半導体基板83、MOSトランジスタのゲート電極及びチャネル領域84、ソース及びドレイン領域85、厚い酸化膜からなる素子分離領域86、P型ウエル領域と半導体基板を導通するための貫通口領域87、トリプルウエル構造ではないP型ウエル領域81bに電位を供給するウエルタップ88、及び、拡大領域89を示す。
一方、図8Bが示す点線96aと点線96bで挟まれる領域では、レジスト95中及び半導体基板中94に、レジストを突き抜けて不純物が注入された領域82bが形成され、縦方向に7.5E16/cm3を示す等濃度線92で囲まれた不純物領域、及び、その不純物領域の両側に2.5E16/cm3等濃度線91で囲まれる不純物領域が形成される。
図10A、図10B、図10C、図10D、図11A、図11B、図11C、及び、図11Dは半導体基板35、不純物の注入深さが深いN型不純物領域115、レジスト開口パターン116、STI117、レジスト開口パターン118、不純物の注入深さが浅いN型不純物領域119、ポリシリコン層及びゲート酸化膜120、レジストパターン121、MOSトランジスタのゲート電極122、MOSトランジスタのソース・ドレイン123、貫通口領域124、トリプルウエル構造を構成するP型ウエル領域125a、トリプルウエル構造を構成しないP型ウエル領域125b、レジストパターン126、ウエルタップ127、及び、拡大領域128をそれぞれ示す。
なお、上記のイオン注入方法は、後に、拡大領域128についての図12A乃至図12D又は図13A乃至図13Dを用いて説明するが、概略は、レジスト開口パターン116の開口を徐々に狭めながら、又は、その開口を拡大しながら、イオン注入を複数回行う方法である。また、後に、拡大領域128ついて示す図8A乃至図8D又は図9A乃至図9Bを用いて説明するようなイオン注入方法によっても、注入深さが深いN型不純物領域115を形成することができる。すなわち、半導体基板の表面上のイオン注入すべき面積を拡大若しくは縮小するため、イオン注入用のマスク端の配置を変えて、イオン注入を行う方法によって、注入深さが深いN型不純物領域115を形成することができる。
はじめに、図12A、図12B、図12C、及び、図12Dは、半導体基板132、深いN型ウエル領域131、貫通口領域135、STI130、レジストパターン133、拡大領域を示す点線134、イオン注入136、1回目のイオン注入に用いるレジストパターン137、1回目のイオン注入によりできる深いN型ウエル領域138、2回目のイオン注入に用いるレジストパターン139、2回目のイオン注入によりできる深いN型ウエル領域140、3回目のイオン注入に用いるレジストパターン141、及び、3回目のイオン注入によりできる深いN型ウエル領域142をそれぞれ示す。
上記の状況を一般的な表現とすると、深いN型ウエル領域131はn回のイオン注入によって形成されることになる。従って、深いN型ウエル領域131の不純物濃度が所定の量であり、注入量をn回に等分したとすると、1回に行われる不純物のイオン注入量は、所定の量の1/nである。すなわち、貫通口領域135の境界部分の半導体基板表面において生じる、図8B、及び、図8Cの現象は、位置が移動しながらn回起きる。従って、N型不純物のイオン注入箇所が分散するため、N型不純物のピーク不純物濃度が下がる。あるいは、イオン注入量の分割はn等分でなくともよく、総量が所定の量に等しければよい。なお、図12Cにおけるレジストマスクパターン端の配置の移動量と、図12Dにおけるレジストマスクパターン端の配置の移動量は、一定量であることが望ましい。レジストマスクパターン端の配置の移動量が一定でない場合には、不純物の注入量をイオン注入回数分に分割したとしても、不純物分布に偏りができるためである。
はじめに、図13A、図13B、図13C、及び、図13Dは、半導体基板148、深いN型ウエル領域146、貫通口領域147、STI145、レジストパターン149、拡大する領域を示す点線150、イオン注入151、1回目のイオン注入に用いるレジストパターン152、1回目のイオン注入によりできる深いN型ウエル領域153、2回目のイオン注入に用いるレジストパターン154、2回目のイオン注入によりできる深いN型ウエル領域155、3回目のイオン注入に用いるレジストパターン156、及び、3回目のイオン注入によりできる深いN型ウエル領域157をそれぞれ示す。図13Aは、半導体装置の断面図であり、深いN型ウエル領域146を形成するために、STI145が形成されている半導体基板148の表面にレジストを塗布し、フォトリソグラフィー工程を行って、レジストパターン149を形成したところである。そして、レジストパターン149は、半導体基板148の法線方向からN型不純物をイオン注入して、深いN型ウエル領域146及び貫通口領域147を形成するために使用される。
すなわち、半導体基板の表面上のイオン注入すべき面積を縮小するため、イオン注入用のレジストマスクパターン端の配置を変えてイオン注入を行うことにより、深いN型ウエル領域146及び貫通口領域147は、3回のイオン注入で形成される。上記の状況を一般な表現とすると、深いN型ウエル領域146及び貫通口領域147は、n回のイオン注入によって形成される。従って、深いN型ウエル領域146の不純物濃度が所定の量であり、注入量をn回に等分したとすると、1回に行われる不純物のイオン注入量は、所定の量の1/nである。すなわち、貫通口領域147の境界部分の半導体基板表面において生じる、図8B、及び、図8Cの現象は、位置が移動しながらn回起きる。従って、N型不純物のイオン注入箇所が分散するため、N型不純物のピーク不純物濃度が下がる。あるいは、イオン注入量の分割はn等分でなくともよく、総量が所定の量に等しければよい。なお、図13Cにおけるレジストマスクパターン端の配置の移動量と、図13Dにおけるレジストマスクパターン端の配置の移動量は、一定量であることが望ましい。レジストマスクパターン端の配置の移動量が一定でない場合には、不純物の注入量をイオン注入回数分に分割したとしても、不純物分布に偏りができるためである。
その結果、図9A、及び、図9Bに示すトリプルウエルを構成するP型ウエル領域内に、深いN型ウエル領域を形成するためのイオン注入によって、N型不純物が注入されることが抑制される。そうすると、上記のP型ウエル領域内のP型不純物の働きが、上記のN型不純物により相殺されることが抑制される。すなわち、P型ウエル領域内のP型不純物の濃度がほぼ一定となるため、P型ウエル領域内に配置するMOSトランジスタを貫通口領域の境界部分に重ねて配置した場合でも、MOSトランジスタの特性が悪影響を受けることが抑制される。
また、P型ウエル領域の底部にある、N型ウエル領域を貫通する貫通口領域の大きさは、MOSトランジスタと同程度に大きい。また、貫通口領域の配置場所はMOSトランジスタの直下にある。従って、貫通口領域がP−Nジャンクションに起因する空乏層の広がりにより、閉じることがなく、P型ウエル領域への給電が安定する。また、給電が安定することにより、P型ウエル領域上のトランジスタの特性が安定となる。
さらに、トランジスタの直下に貫通口領域の境界部分を配置することができ、すなわち、トランジスタと貫通口領域又は貫通口領域の境界部分とを平面的に重ねることができ、貫通口領域を独立に設ける場合に比較して、P型ウエル領域の小型化が容易である。
なお、上記の実施例3においては、トリプルウエル構造を構成するP型ウエル領域内にMOSトランジスタが形成されており、貫通口領域の境界領域が、MOSトランジスタの特性に与える悪影響を抑制できると記載している。一方、図8A及び図8Bに示す半導体装置の貫通口領域の境界領域は、MOSトランジスタ以外のトランジスタ、例えば、バイポーラトランジスタの動作にも悪影響を及ぼすことが考えられる。P型ウエル領域の貫通口の境界部分において、N型不純物の作用による、P−Nジャンクションの耐圧の低下は、バイポーラトランジスタ等に対しても、端子間のリーク特性の悪化の原因となり得るからである。そこで、実施例3の半導体装置の製造方法は、MOSトランジスタ以外のトランジスタに対しても、端子間のリーク特性の悪化の抑制に有効であることはいうまでもない。
図14A、図14B、図14C、図14D、及び、図14Eは、開口が徐々に縮小していくレジストパターンを積み重ねていくことにより、イオン注入用のレジストパターンの開口を徐々に縮小するとともに、イオン注入を複数回行う方法を示す。そして、図14A乃至図14Eは、イオン注入166、レジストパターン167、172、175、レジスト171、174、STI168、半導体基板169、及び、注入深さが深いN型不純物領域170、173、176をそれぞれ示す。
図14Bは、図14Aの工程を終了後に、レジスト171を塗布したところを示す図である。
図14Cは、図14Bの工程を終了後に、フォトリソグラフィー工程を行って、レジストパターン167の開口より小さい開口を有するレジストパターン172を形成したところを示す図である。また、図14Cは、その後、さらに、2回目のイオン注入166を行って、注入深さが深いN型不純物領域173を形成したところを示す図である。
図14Dは、図14Cの工程を終了後に、レジスト174を塗布したところを示す図である。
図14Eは、図14Dの工程を終了後に、フォトリソグラフィー工程を行って、レジストパターン172の開口より小さい開口を有するレジストパターン175を形成したところを示す図である。また、図14Eは、その後、さらに、3回目のイオン注入166を行って、注入深さが深いN型不純物領域187を形成したところを示す図である。その後、レジストパターン167、172、175を一括して除去し、イオン注入工程を終了する。以上より、半導体基板の表面上のイオン注入すべき面積を縮小するため、イオン注入用のレジストマスクパターン端の配置を変えてイオン注入を行うことにより、注入深さが深いN型不純物領域170、173、176が形成される。
図15Bは、図15Aの工程を終了後に、酸化膜層182を塗布したところを示す図である。
図15Cは、図15Bの工程を終了後に、異方性のエッチング工程を行って、酸化膜層のサイドウオールスペーサー183を形成したところを示す図である。また、図15Cは、その後、さらに、2回目のイオン注入177を行って、注入深さが深いN型不純物領域184を形成したところを示す図である。
図15Dは、図15Cの工程を終了後に、酸化膜層185を塗布したところを示す図である。
図15Eは、図15Dの工程を終了後に、異方正のエッチング工程を行って、酸化膜層のサイドウオールスペーサー183より内側に酸化膜層のサイドウオールスペーサー186を形成したところを示す図である。また、図15Eは、その後、さらに、3回目のイオン注入177を行って、注入深さが深いN型不純物領域177を形成したところを示す図である。その後、酸化膜層のパターン178、酸化膜層のサイドウオールスペーサー183、186を一括で除去して、イオン注入工程を終了する。以上より、半導体基板の表面上のイオン注入すべき面積を縮小するため、イオン注入用の酸化膜層からなるマスクパターン端の配置を変えてイオン注入を行うことにより、注入深さが深いN型不純物領域181、184、187が形成される。
ところで、図15A乃至図15Eにおいては、イオン注入用のマスク及びサイドウオールスペーサーをシリコン酸化物で形成しているが、シリコン窒化膜(SiN2)又はシリコン酸化窒化膜(SiON)であっても同様の効果を奏する。
図16は実施例5の半導体装置のSRAMセルのレイアウトについて説明する平面図である。そして、図16はワード線190、VDD線191、ビット線192、GND線193、MOSトランジスタのゲート電極194、フィールド領域195、コンタクト196、N型MOSトランジスタ197、N型MOSトランジスタ198、P型MOSトランジスタ199、P型MOSトランジスタ200、N型MOSトランジスタ201、N型MOSトランジスタ202、P型ウエル領域203、N型ウエル領域204、及び、貫通口領域の境界部分205を示す。
すなわち、コンタクト196が配置されている箇所を除き、フィールド領域195とMOSトランジスタのゲート電極194との交差部分にMOSトランジスタのチャネルが形成される。一方、フィールド領域195とMOSトランジスタのゲート電極194との交差部分であって、コンタクト196が配置されている箇所では、フィールド領域195とMOSトランジスタのゲート電極194が電気的に接続されている。
そして、マトリックス状態に配置されたMOSトランジスタの中から、例えば、N型ウエル領域204にあるP型MOSトランジスタ199、200と、P型ウエル領域203にあるN型MOSトランジスタ197、198、201、202を、図16の太線で示したように配線層で接続をすることにより、SRAMセルを構成することができる。すなわち、上記の接続により、N型MOSトランジスタ198とP型MOSトランジスタ199はインバータ回路を形成する。N型MOSトランジスタ201とP型MOSトランジスタ200はインバータ回路を形成する。そして、双方のインバータ回路はクロス接続をしている。また、N型MOSトランジスタ197及びN型MOSトランジスタ202はSRAMセルのトランスファーゲートを形成する。
ワード線190は、配線層から構成されており、SRAMセルを構成するN型MOSトランジスタ197、及び、N型MOSトランジスタ202のゲート電極194と接続する。そして、ワード線190はSRAMセルの記憶部分へ、ビット線信号を取り込むための選択信号を伝える役割を果たす。
(付記1)
(イ)第1導電型の半導体基板を準備する工程と、
(ロ)第2導電型の不純物を前記半導体基板のウエル領域にイオン注入する工程と、
(ハ)第1導電型の不純物を前記ウエル領域の底部に接した不純物領域へイオン注入するために、形成されるべき前記不純物領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程とを備える半導体装置の製造方法。
(付記2)
(イ)第1導電型の半導体基板を準備する工程と、
(ロ)第1導電型の不純物を前記半導体基板のウエル領域にイオン注入する工程と、
(ハ)第2導電型の不純物を前記ウエル領域の底部に接した不純物領域へイオン注入するために、形成されるべき前記不純物領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程とを備える半導体装置の製造方法。
(付記3)
(イ)第1導電型の半導体基板を準備する工程と、
(ロ)第2導電型の不純物を前記半導体基板のウエル領域にイオン注入する工程と、
(ハ)第2導電型の不純物を前記ウエル領域の底部に接した不純物領域へイオン注入するために、形成されるべき前記不純物領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程とを備える半導体装置の製造方法。
(付記4)
(イ)第1導電型の半導体基板を準備する工程と、
(ロ)第1導電型の不純物を前記半導体基板のウエル領域にイオン注入する工程と、
(ハ)第1導電型の不純物を前記ウエル領域の底部に接した不純物領域へイオン注入するために、形成されるべき前記不純物領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程とを備える半導体装置の製造方法。
(付記5)
前記イオン注入を複数回行う工程において、前記イオン注入各々におけるイオン注入量が、所定のイオン注入量をイオン注入の回数で除したイオン注入量であることを特徴とする付記1から付記4までのいずれかに記載した半導体装置の製造方法。
(付記6)
前記イオン注入を複数回行う工程において、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小するために、イオン注入用のマスクパターン端の配置を移動し、かつ、前記マスクパターン端の配置の移動量が一定量であることを特徴とする付記1から付記5までのいずれかに記載した半導体装置の製造方法。
(付記7)
前記ウエル領域の表面近傍に半導体素子をさらに形成する工程を備えることを特徴とする付記1から付記6までのいずれかに記載した半導体装置の製造方法。
(付記8)
半導体基板の表面から前記半導体基板内に向けて形成したウエル領域と、
前記ウエル領域の表面近傍に配置した半導体素子と、
前記ウエル領域の底部に半導体表面から離れて形成された第1の不純物領域と、
前記第1の不純物領域から一定の幅拡大した第2の不純物領域と
を備えることを特徴とする半導体装置。
(付記9)
第1導電型の半導体基板の表面から前記半導体基板内部に向けて第2導電型の第1不純物領域を形成する工程と、
前記第1不純物領域の底部から前記半導体基板内部に向けて配置する前記第2導電型の第2不純物領域及び第1導電型の貫通口領域を一体として形成する工程であって、形成されるべき前記第2不純物領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程と、
前記第1不純物領域に平面的に内包され、かつ、半導体基板の表面から前記第2不純物領域及び前記貫通口領域に至るように第1導電型のウエル領域を形成する工程とを備えることを特徴とする半導体装置の製造方法。
(付記10)
第1導電型の半導体基板の表面から前記半導体基板内部に向けて第2導電型の第1不純物領域を形成する工程と、
前記第2導電型の第2不純物領域を前記第1不純物領域の底部から前記半導体基板内部に向けて形成する工程と、
前記第1不純物領域に平面的に内包され、半導体基板の表面から前記第2不純物領域に至るように第1導電型のウエル領域を形成する工程と、
前記第2不純物領域を貫通する第1導電型の貫通口領域を形成する工程であって、形成されるべき前記貫通口領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程とを備えることを特徴とする半導体装置の製造方法。
(付記11)
全体として第1導電型の半導体基板の表面から前記半導体基板内部に向けて第1導電型のウエル領域を形成する工程と、
前記ウエル領域の周囲を平面的に取り囲むように、前記ウエル領域に隣接した第2導電型の第1不純物領域を、前記半導体基板の表面から前記半導体基板内部に向けて形成する工程と、
前記ウエル領域及び前記第1不純物領域の底部から前記半導体基板内部に向けて第2導電型の第2不純物領域及び第1導電型の貫通口領域を一体として形成するために、形成されるべき前記第2不純物領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程と
を備えることを特徴とする半導体装置の製造方法。
(付記12)
全体として第1導電型の半導体基板の表面から前記半導体基板内部に向けて第1導電型の第1ウエル領域を形成する工程と、
前記第1ウエル領域の周囲を平面的に取り囲むように、前記第1ウエル領域に隣接した第2導電型の第1不純物領域を、前記半導体基板の表面から前記半導体基板内部に向けて形成する工程と、
前記第1ウエル領域及び前記第1不純物領域の底部から前記半導体基板内部に向けて第2導電型の第2不純物領域を形成する工程と、
前記第2不純物領域を貫通する第1導電型の貫通口領域を形成するために、形成されるべき前記貫通口領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程と
を備えることを特徴とする半導体装置の製造方法。
(付記13)
前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小することをイオン注入用のマスクパターン端の配置の変更で行ったことを特徴とする付記1から付記4まで、及び、付記9から付記12までに記載した半導体装置の製造方法。
(付記14)
前記イオン注入用のマスクパターンを酸化膜層、窒化膜層、又は、酸窒化膜層で形成したことを特徴とする付記13に記載した半導体装置の製造方法。
(付記15)
前記イオン注入用のマスクパターン端の配置の変更を、当初のマスクパターン上に酸化膜層、窒化膜層、又は、酸窒化膜層を形成し、異方性エッチング法によりマスクパターンの開口部分の内側の側面にサイドウオールスペーサーを形成することにより行うことを特徴とする付記14に記載した半導体装置の製造方法。
(付記16)
前記ウエル領域内又は前記第1不純物領域内にトランジスタを形成する工程をさらに備えることを特徴とする付記9から付記12までに記載された半導体装置の製造方法。
(付記17)
前記貫通口領域の境界が、前記トランジスタに重ねるように配置されていることを特徴とする付記16に記載された半導体装置の製造方法。
(付記18)
前記トランジスタはMOSトランジスタであることを特徴とする付記16又は付記17に記載された半導体装置の製造方法。
(付記19)
付記9から付記12までの半導体装置の製造方法で製造されるとともに、SRAMセルを有する半導体装置。
本発明によれば、第1ウエル領域のノイズ遮断効果により、第2ウエル領域内のトランジスタは、半導体基板からの電気的な影響を受けなくなるとともに、第2ウエル領域の電源を供給する貫通口領域の境界部分に止まった不純物の影響も受けなくなるため、トランジスタの特性が安定した半導体装置の製造方法を提供できる効果がある。
3a 不純物の注入深さが深いN型ウエル領域
3b レジストを突き抜けて不純物が注入された領域
4 P型半導体基板
15 半導体基板
16 レジスト
20 不純物濃度を示す実線
29 高エネルギーイオン注入
21、30 レジストマスク
22、26、28、31、35、37 レジストを突き抜けて不純物が注入された領域
23、25、27、32、34、36 不純物の注入深さが深いN型ウエル領域
24a、33a P型ウエル領域
24b、33b P型半導体基板
40、41、42 レジストマスク
43 高エネルギーイオン注入
44a 半導体基板
46 図2A乃至図2C又は図3A乃至図3Cにおける各イオン注入によって注入されるすべてのN型不純物の濃度を示す実線
47、48、49 図2A又は図3Cにおける高エネルギーイオン注入によって注入されるN型不純物の濃度を示す点線
50 レジストマスク
51 半導体素子
52 P型ウエル領域
53、55 一固まりの不純物領域
56 N型ウエル領域56
60、70 レジストマスク
61 P型ウエル領域
62、72 不純物の注入深さが深いP型不純物領域
63、73 N型不純物の高エネルギー注入
64、74 半導体基板
65、75 半導体素子
66、76 P型不純物の高エネルギー注入
67、77 不純物の注入深さが深いN型不純物領域
71 N型ウエル領域
80 不純物の注入深さが浅いN型ウエル領域
81a トリプルウエル構造を構成するP型ウエル領域
81b トリプルウエル構造ではないP型ウエル領域
82a 不純物の注入深さが深いN型ウエル領域
82b レジストを突き抜けて不純物が注入された領域
83 P型半導体基板
84 MOSトランジスタのゲート電極及びチャネル領域
85 ソース及びドレイン領域
86 厚い酸化膜からなる素子分離領域
87 貫通口領域
88 ウエルタップ
89 拡大領域
90 5E15/cm3を示す等濃度線
91 2.5E16/cm3を示す等濃度線
92 7.5E16/cm3を示す等濃度線
93 2.25E17/cm3を示す等濃度線
94 半導体基板
95 レジスト
96a、96b 点線
99 不純物濃度を示す実線
100 P型半導体基板
101 不純物の注入深さが深いN型不純物領域
102a、102b P型ウエル領域
103 不純物の注入深さが浅いN型不純物領域
104 貫通口領域
107 MOSトランジスタを画定するフィールド領域
108 MOSトランジスタのゲート電極
109 STI(shallow trench isolation)
112 境界領域
113 MOSトランジスタ
114 半導体基板
115 不純物の注入深さが深いN型不純物領域
116、118 レジスト開口パターン
117 STI
119 不純物の注入深さが浅いN型不純物領域
120 ポリシリコン層及びゲート酸化膜
121、126 レジストパターン
122 ゲート電極
123 ソース・ドレイン
124 貫通口領域
125a、125b P型ウエル領域
127 ウエルタップ
130 STI
131 深いN型ウエル領域
132 半導体基板
133 レジストパターン
134 拡大領域を示す点線
135 貫通口領域
136 イオン注入
137 1回目のイオン注入に用いるレジストパターン
138 1回目のイオン注入によりできる深いN型ウエル領域
139 2回目のイオン注入に用いるレジストパターン
140 2回目のイオン注入によりできる深いN型ウエル領域
141 3回目のイオン注入に用いるレジストパターン
142 3回目のイオン注入によりできる深いN型ウエル領域
145 STI
146 深いN型ウエル領域
147 貫通口領域
148 半導体基板
149 レジストパターン
150 拡大する領域を示す点線
151 イオン注入
152 1回目のイオン注入に用いるレジストパターン
153 1回目のイオン注入によりできる深いN型ウエル領域
154 2回目のイオン注入に用いるレジストパターン
155 2回目のイオン注入によりできる深いN型ウエル領域
156 3回目のイオン注入に用いるレジストパターン
157 3回目のイオン注入によりできる深いN型ウエル領域
166 イオン注入
167、172、175 レジストパターン
169 半導体基板
170、173、176 注入深さが深いN型不純物領域
171、174 レジスト
177 イオン注入
178 酸化膜層のパターン
183、186 酸化膜層からなるサイドウオールスペーサー
182、185 酸化膜層
179 STI
180 半導体基板
181、184、187 注入深さが深いN型不純物領域
190 ワード線
191 VDD線
192 ビット線
193 GND線
194 MOSトランジスタのゲート電極
195 フィールド領域
196 コンタクト
197、198、201、202 N型MOSトランジスタ
199、200 P型MOSトランジスタ
203 P型ウエル領域
204 N型ウエル領域
205 貫通口領域の境界部分
Claims (6)
- 第1導電型の半導体基板を準備する工程と、
第1導電型の不純物を前記半導体基板に注入し、第1ウエル領域を形成する工程と、
前記第1ウエル領域の底部に接した第2ウエル領域を形成する工程であって、前記第2ウエルを形成する領域に対して、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行う工程と、
前記第1ウエル領域の表面近傍に半導体素子を形成する工程と
を備え、
前記複数回のイオン注入工程において、前記イオン注入各々におけるイオン注入量が、所定のイオン注入量をイオン注入の回数で除したイオン注入量であり、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小するために、イオン注入用のマスクパターン端の配置を移動し、かつ、前記マスクパターン端の配置の移動量が一定量であることを特徴とする半導体装置の製造方法。 - 第1導電型の半導体基板の表面から前記半導体基板内部に向けて第2導電型の第1不純物領域を形成する第1の工程と、
前記第1の工程の後に、前記第1不純物領域の底部から前記半導体基板内部に向けて配置する前記第2導電型の第2不純物領域及び第1導電型の貫通口領域を一体として形成する工程であって、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行って前記第2不純物領域を形成する第2の工程と、
前記第2の工程の後に、前記第1不純物領域に平面的に内包され、かつ、半導体基板の表面から前記第2不純物領域及び前記貫通口領域に至るように第1導電型のウエル領域を形成する第3の工程と、
前記第3の工程の後に、前記ウエル領域の表面近傍に半導体素子を形成する第4の工程と
を備え、
前記複数回のイオン注入工程において、前記イオン注入各々におけるイオン注入量が、所定のイオン注入量をイオン注入の回数で除したイオン注入量であり、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小するために、イオン注入用のマスクパターン端の配置を移動し、かつ、前記マスクパターン端の配置の移動量が一定量であることを特徴とする半導体装置の製造方法。 - 第1導電型の半導体基板の表面から前記半導体基板内部に向けて第2導電型の第1不純物領域を形成する第1の工程と、
前記第1の工程の後に、第2導電型の第2不純物領域を前記第1不純物領域の底部から前記半導体基板内部に向けて形成する第2の工程と、
前記第2の工程の後に、前記第1不純物領域に平面的に内包され、半導体基板の表面から前記第2不純物領域に至るように第1導電型のウエル領域を形成する第3の工程と、
前記第3の工程の後に、前記第2不純物領域を貫通する第1導電型の貫通口領域を形成する工程であって、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を前記第2不純物領域に対して行い、前記第2不純物領域を貫通する前記第1導電型の前記貫通口領域を形成する第4の工程と、
前記第4の工程の後に、前記ウエル領域の表面近傍に半導体素子を形成する第5の工程と
を備え、
前記複数回のイオン注入工程において、前記イオン注入各々におけるイオン注入量が、所定のイオン注入量をイオン注入の回数で除したイオン注入量であり、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小するために、イオン注入用のマスクパターン端の配置を移動し、かつ、前記マスクパターン端の配置の移動量が一定量であることを特徴とする半導体装置の製造方法。 - 第1導電型の半導体基板の表面から前記半導体基板内部に向けて第1導電型のウエル領域を形成する第1の工程と、
前記第1の工程の後に、前記ウエル領域の周囲を平面的に取り囲むように、前記ウエル領域に隣接した第2導電型の第1不純物領域を、前記半導体基板の表面から前記半導体基板内部に向けて形成する第2の工程と、
前記第2の工程の後に、前記ウエル領域及び前記第1不純物領域の底部から前記半導体基板内部に向けて第2導電型の第2不純物領域及び第1導電型の貫通口領域を一体として形成するために、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を行って前記第2不純物領域を形成する第3の工程と、
前記第3の工程の後に、前記ウエル領域の表面近傍に半導体素子を形成する第4の工程と
を備え、
前記複数回のイオン注入工程において、前記イオン注入各々におけるイオン注入量が、所定のイオン注入量をイオン注入の回数で除したイオン注入量であり、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小するために、イオン注入用のマスクパターン端の配置を移動し、かつ、前記マスクパターン端の配置の移動量が一定量であることを特徴とする半導体装置の製造方法。 - 第1導電型の半導体基板の表面から前記半導体基板内部に向けて第1導電型のウエル領域を形成する第1の工程と、
前記第1の工程の後に、前記ウエル領域の周囲を平面的に取り囲むように、前記ウエル領域に隣接した第2導電型の第1不純物領域を、前記半導体基板の表面から前記半導体基板内部に向けて形成する第2の工程と、
前記第2の工程の後に、前記ウエル領域及び前記第1不純物領域の底部から前記半導体基板内部に向けて第2導電型の第2不純物領域を形成する第3の工程と、
前記第3の工程の後に、前記第2不純物領域を貫通する第1導電型の貫通口領域を形成するために、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小しつつ複数回のイオン注入を前記第2不純物領域に対して行い、前記第2不純物領域を貫通する前記第1導電型の前記貫通口領域を形成する第4の工程と、
前記第4の工程の後に、前記ウエル領域の表面近傍に半導体素子を形成する第5の工程と
を備え、
前記複数回のイオン注入工程において、前記イオン注入各々におけるイオン注入量が、所定のイオン注入量をイオン注入の回数で除したイオン注入量であり、前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小するために、イオン注入用のマスクパターン端の配置を移動し、かつ、前記マスクパターン端の配置の移動量が一定量であることを特徴とする半導体装置の製造方法。 - 前記半導体基板の表面上のイオン注入面積を拡大若しくは縮小することをイオン注入用のマスクパターン端の配置の変更で行ったことを特徴とする請求項1〜5のいずれか1項に記載の半導体装置の製造方法。
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