JP5026735B2 - 半導体チップ及び半導体チップパッケージ - Google Patents
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Description
前記複数の熱伝達ラインに対応し、対応する前記熱伝達ラインの他の一側が連結される複数の第2接続ラインと、前記複数の第2接続ラインと連結され、前記複数の第2金属配線、前記複数の熱伝達ライン及び前記複数の第2接続ラインを介して前記ウェル領域から伝達された熱を第2外部配線に伝達する複数の第1熱伝逹バンプと、前記第1外部配線及び前記第1熱伝逹バンプと接続された第2外部配線を含む支持基板と、を備える。
図6A〜図6Eは、本発明の第1の実施形態に係る半導体チップパッケージを説明するために示した図である。図6Aは、ソースドライバーICチップの平面図で、図6Bは、図6Aに示したA1-A1断面図であり、図6Cは図6Aに示したソースドライバーICチップをCOF技術によってフィルム基板に実装した平面図であり、図6Dは図6Cに示したA2-A2断面図であり、図6Eは、図6Aに示した電源入力端及びバンプと基板P-SUB又はウェル領域N-Wellの間の接続状態を示した断面図である。
図7A〜図7Hは、本発明の第2の実施形態に係る半導体チップパッケージを説明するために示した図である。図7Aは、ソースドライバーICチップの平面図であり、図7Bは、図7Aに示した「A」部位を拡大して示した平面図であり、図7Cは、図7Bに示したA1−A1断面図であり、図7Dは、図7Bに示したA2−A2断面であり、図7Eは、図7Bに示したA3−A3断面図である。
図9Aは、本発明の第3の実施形態に係る半導体チップパッケージを説明するために示した平面図であり、図9Bは、図9Aに示したA−A断面図である。
11,21 半導体チップ
12,140,161,181 フィルム基板
13,23,141A,141B,162,181A,182B 伝導性配線
14,24,138,139,158,178,179,198,199
バンプ
20 COGパッケージ
22 ガラス基板
25 画面表示領域
26 伝導性接着フィルム
110 LCDパネル
120 ソース駆動回路部
130 ゲート駆動回路部
140 タイミングコントローラ
121,131,151,171,191 入力端
122,132,152,172,192 出力端
123A〜123F、133A〜133F,153A〜153F、173A〜173F、193A〜193F チャネルブロック
124A〜124D,134A〜134d,154A〜154d,174A〜174D,194A〜194D 電源供給部
125A,125B,135A,135B,155A,155B,175A,175B,195A,195B 電源入力端
126,136,156,176,196 抵抗部
127,137,157,177,197 デジタル/アナログ制御部
1231,1232 ラッチ部
1233 D/Aコンバーター
1234 出力回路部
138 バンプ
159 熱伝達ライン
Claims (46)
- 基板と、
前記基板に配置された複数のウェル領域に分散されて配置された複数の単位素子からなるチャネルを複数個備えた複数のチャネルブロックと、
前記チャネルをなす複数の単位素子と外部とのデータ送受信のために、前記複数の単位素子それぞれと接続した複数の第1金属配線と、
前記第1金属配線を介して受信したデータ信号を、外部と接続する複数の第1外部配線を介して伝送する複数のノーマルバンプと、
前記複数のチャネルブロックの間の空間にそれぞれ配置され、それぞれが前記複数のウェル領域に接続した複数の第2金属配線と、
前記第2金属配線に搭載され、前記第2金属配線を介して前記チャネルブロックを駆動する間に発生する熱を伝達し、前記伝達された熱を外部と連結した複数の第2外部配線に伝達する複数の第1熱伝逹バンプと、を備えたことを特徴とする半導体チップ。 - 前記複数の第1熱伝逹バンプが、
前記複数の第2金属配線の内、基板に接続された第2金属配線上に接続された複数の第1−1バンプと、
前記複数の第2金属配線の内、ウェルに接続された第2金属配線上に接続された第1−2バンプと、を備えたことを特徴とする請求項1に記載の半導体チップ。 - 前記複数のチャネルブロックの駆動のため、外部から電源電圧又は接地電圧の電源入力端を介して印加されるための電源電圧入力部と、
前記チャネルブロック領域の前記基板及びウェル領域に配置された複数の第3金属配線と、
前記複数の第3金属配線と接続した複数の熱伝達ラインと、
前記複数の熱伝逹ラインに対応し、1つの第1接続ラインが、前記電源入力端と対応する熱伝達ラインの一方終端と接続する複数の第1接続ラインと、
前記複数の熱伝達ラインに対応し、1つの第2接続ラインが、対応する熱伝達ラインの他方終端と接続する複数の第2接続ラインと、
前記複数の第3金属配線、前記複数の熱伝達ライン及び前記複数の第2接続ラインを介して前記基板及びウェル領域から伝達された熱を外部に伝達するために、前記複数の第2接続ラインとそれぞれ接続した第2熱伝逹バンプと、をさらに備えたことを特徴とする請求項2に記載の半導体チップ。 - 前記第2熱伝逹バンプが、
前記半導体チップが形成された領域のエッジ領域に配置されたことを特徴とする請求項3に記載の半導体チップ。 - 前記第2熱伝逹バンプが、データ信号が入出力される入出力端が形成されたパッシベーション層の上部に配置されたことを特徴とする請求項4に記載の半導体チップ。
- 前記熱伝達ラインが、前記チャネルブロックごとに電気的に分離されて独立して配置されるか、前記複数のチャネルブロックの全体にかけて電気的に接続した形態に配置されたことを特徴とする請求項5に記載の半導体チップ。
- 前記熱伝達ラインが、
前記複数の第3金属配線の内、選択された第3金属配線を介して前記基板と接続する第1熱伝達ラインと、
前記第1熱伝逹ラインと電気的に分離され、前記第3金属配線の内、前記第1熱伝逹ラインと接続しない第3金属配線を介して前記ウェル領域と接続する第2熱伝達ラインと、を備えたことを特徴とする請求項6に記載の半導体チップ。 - 前記第2熱伝逹バンプが、
前記第1熱伝逹ラインに接続した第2−1接続ラインに接続した第2−1熱伝逹バンプと、
前記第2熱伝逹ラインに接続して第2−2接続ラインに接続した第2−2熱伝逹バンプと、を備え、
前記第2−1熱伝逹バンプ及び第2−2熱伝逹バンプは互いに電気的に分離されていることを特徴とする請求項7に記載の半導体チップ。 - 前記第3金属配線が、
前記基板と接続する第3−1金属配線と、
前記第3−1金属配線と電気的に分離されて、前記ウェル領域と接続した第3−2金属配線と、を備えたことを特徴とする請求項8に記載の半導体チップ。 - 前記チャネルブロック領域の前記基板及びウェル領域と接続する複数の第4金属配線と、
前記チャネルブロックの駆動時に発生する熱を前記複数の第4金属配線を介して伝達され、外部で接続する複数の第3配線に伝達するために、前記複数の第4金属配線とそれぞれ接続し、チャネルブロック領域上に配置される複数の第3熱伝逹バンプと、をさらに備えたことを特徴とする請求項5に記載の半導体チップ。 - 前記チャネルが、
入力端に入力される前記データ信号をラッチする第1及び第2ラッチ部と、
前記第2ラッチ部から出力されるデジタル信号をアナログ信号に変換するD/Aコンバーターと、
前記D/Aコンバーターから出力される前記アナログ信号を増幅して出力する出力回路部と、を備えたことを特徴とする請求項1に記載の半導体チップ。 - 前記第2金属配線が、
前記電源電圧入力部から伝達される駆動電圧の供給を受けて、前記基板又は前記複数のウェル領域に提供するための複数の駆動電圧供給用の第2−1金属配線と、
一方が前記基板又は前記複数のウェル領域にそれぞれ接続し、他方が複数の前記第1熱伝逹バンプにそれぞれ接続した複数の第2−2金属配線と、をさらに備えたことを特徴とする請求項3に記載の半導体チップ。 - 前記第2−1金属配線と前記第2−2金属配線が、同じ数の配線が配置されることを特徴とする請求項12に記載の半導体チップ。
- 基板と、
前記基板に配置された複数のウェル領域に分散されて配置された複数の単位素子からなるチャネルを複数個備えた複数のチャネルブロックと、
前記チャネルを形成する複数の単位素子と外部とのデータ送受信のために前記複数の単位素子それぞれと接続した複数の第1金属配線と、
前記第1金属配線を介して受信したデータ信号を外部と接続する複数の第1外部配線を介して伝送する複数のノーマルバンプと、
前記複数のチャネルブロックの駆動のために、電源入力端を介して外部から電源電圧又は接地電圧を受ける電源電圧入力端と、
前記複数のチャネルブロックの間の空間にそれぞれ配置され、それぞれが前記ウェル領域に接続された複数の第2金属配線と、
前記第2金属配線と接続された複数の熱伝達ラインと、
前記複数の熱伝逹ラインに対応し、前記対応する熱伝達ラインの一側と連結され、また他の一側が前記電源入力端と連結された複数の第1接続ラインと、
前記複数の熱伝達ラインに対応し、前記対応する熱伝達ラインの他の一側と連結された複数の第2接続ラインと、
前記複数の第2金属配線、前記複数の熱伝達ライン及び前記複数の第2接続ラインを介して前記ウェル領域から伝達された熱を外部に伝達するために、前記第2接続ラインとそれぞれ接続した複数の第1熱伝逹バンプと、を備えたことを特徴とする半導体チップ。 - 前記第1熱伝逹バンプが、
前記半導体チップが配置された領域のエッジに配置されることを特徴とする請求項14に記載の半導体チップ。 - 前記第1熱伝逹バンプが、データ信号が入出力される入出力端に形成されたパッシベーション層の上部に配置されたことを特徴とする請求項15に記載の半導体チップ。
- 前記熱伝達ラインが、前記チャネルブロックごとに電気的に分離されて独立して配置されるか、前記複数のチャネルブロックの全体にかけて電気的に接続した形態に配置されたことを特徴とする請求項16に記載の半導体チップ。
- 前記第2金属配線が、
前記基板と接続する第2−1金属配線と、
前記第2−1金属配線と電気的に分離されて、前記ウェル領域と接続した第2−2金属配線と、を備えたことを特徴とする請求項17に記載の半導体チップ。 - 前記熱伝達ラインが、
前記2−1金属配線を介して前記基板と接続する第1熱伝達ラインと、
前記第1熱伝逹ラインと電気的に分離され、前記第2−2金属配線を介して前記ウェル領域と接続する第2熱伝達ラインと、を備えたことを特徴とする請求項18に記載の半導体チップ。 - 前記第1熱伝逹バンプが、
前記第1熱伝達ラインに接続した第2−1接続ラインに接続した第1−1熱伝逹バンプと、
前記第2熱伝達ラインに接続した第2−2接続ラインに接続した第1−2熱伝逹バンプと、を備え、
前記第2−1熱伝逹バンプ及び前記第2−2熱伝逹バンプが互いに電気的に分離されたことを特徴とする請求項19に記載の半導体チップ。 - 前記チャネルブロック領域の前記基板及びウェル領域と接続する複数の第3金属配線と、
前記チャネルブロックの駆動時に発生する熱を前記複数の第3金属配線を介して伝達され、外部で接続する複数の第3配線に伝達するために、前記複数の第3金属配線とそれぞれ接続し、チャネルブロック領域上に配置される複数の第3熱伝逹バンプと、をさらに備えたことを特徴とする請求項20に記載の半導体チップ。 - 前記チャネルが、
入力端に入力される前記データ信号をラッチする第1ラッチ部及び第2ラッチ部と、
前記第2ラッチ部から出力されるデジタル信号をアナログ信号に変換するD/Aコンバーターと、
前記D/Aコンバーターから出力される前記アナログ信号を増幅して出力する出力回路部と、を備えたことを特徴とする請求項21に記載の半導体チップ。 - 基板と、
前記基板に配置された複数のウェル領域に分散されて配置された複数の単位素子からなるチャネルを複数個備えた複数のチャネルブロックと、
前記チャネルを形成する複数の単位素子と外部とのデータ送受信のために、前記複数の単位素子それぞれと接続した複数の第1金属配線と、
前記第1金属配線を介して受信されたデータ信号を外部と接続された複数の第1外部配線を介して伝送する複数のノーマルバンプと、
前記チャネルブロック間の領域にそれぞれ配置され、対応する前記ウェル領域に接続された複数の第2金属配線と、
前記チャネルブロック領域上に配置されて、前記第2金属配線と連結され、外部と連結された複数の第2外部配線を介して、前記ウェル領域から伝達された熱を伝達する第1熱伝逹バンプを備えたことを特徴とする半導体チップ。 - 前記複数の第1熱伝逹バンプが、
前記複数の第2金属配線の内、前記基板に接続した前記第2金属配線と接続した第2−1バンプと、
前記複数の第2金属配線の内、前記ウェル領域に接続した前記第2金属配線と接続した第2−2バンプと、を備えたことを特徴とする請求項23に記載の半導体チップ。 - 前記複数のチャネルブロックの駆動のために、外部から電源電圧又は接地電圧を電源入力端を介して印加する電源電圧入力端と、
前記チャネルブロック領域の前記基板及び前記ウェル領域に配置された複数の第3金属配線と、
前記第3金属配線と接続した複数の熱伝達ラインと、
前記複数の熱伝逹ラインに対応し、対応する前記熱伝達ラインを前記電源入力端と接続させる複数の第1接続ラインと、
前記複数の熱伝達ラインに対応し、対応する前記熱伝達ラインと接続する複数の第2接続ラインと、
前記複数の第3金属配線と、前記複数の熱伝達ライン及び前記複数の第2接続ラインを介して前記ウェル領域から伝達された熱を外部に伝達するために、前記複数の第2接続ラインとそれぞれ接続した複数の第2熱伝逹バンプをさらに備えたことを特徴とする請求項24に記載の半導体チップ。 - 前記第2熱伝逹バンプが、
前記半導体チップが配置された領域のエッジ領域に配置されたことを特徴とする請求項25に記載の半導体チップ。 - 前記第2熱伝逹バンプが、データ信号が入出力される入出力端に形成されたパッシベーション層の上部に配置されたことを特徴とする請求項26に記載の半導体チップ。
- 前記熱伝達ラインが、前記チャネルブロックごとに電気的に分離されて独立して配置されるか、前記複数のチャネルブロックの全体にかけて電気的に接続した形態に配置されたことを特徴とする請求項27に記載の半導体チップ。
- 前記第3金属配線が、
前記基板と接続する第3−1金属配線と、
前記第3−1金属配線と電気的に分離され、前記ウェル領域と接続した第3−2金属配線と、を備えたことを特徴とする請求項28に記載の半導体チップ。 - 前記熱伝達ラインが、
前記第3−1金属配線を介して前記基板と接続する第1熱伝達ラインと、
前記第1熱伝逹ラインと電気的に分離され、前記第3−2金属配線を介して前記ウェル領域と接続する第2熱伝達ラインと、を備えたことを特徴とする請求項29に記載の半導体チップ。 - 前記第2熱伝逹バンプが、
前記第1熱伝達ラインに接続した第2−1接続ラインに接続した第2−1熱伝逹バンプと、
前記第2熱伝達ラインに接続した第2−2接続ラインに接続し、前記第2−1熱伝逹バンプと電気的に分離された第2−2熱伝逹バンプと、を備えたことを特徴とする請求項30に記載の半導体チップ。 - 前記チャネルが、
入力端に入力される前記データ信号をラッチする第1ラッチ部及び第2ラッチ部と、
前記第2ラッチ部から出力されるデジタル信号をアナログ信号に変換するD/Aコンバーターと、
前記D/Aコンバーターから出力される前記アナログ信号を増幅して出力する出力回路部と、を備えたことを特徴とする請求項31に記載の半導体チップ。 - 前記第2金属配線が、
前記チャネルブロックの間の空間に配置され、駆動電圧の供給を受けて前記基板又は複数のウェル領域に提供するための複数の駆動電圧供給用の第2−1金属配線と、
一方が、前記基板又は複数のウェル領域に接続し、他方が、前記第1熱伝逹バンプにそれぞれ接続した複数の第2−2金属配線と、をさらに備えたことを特徴とする請求項23に記載の半導体チップ。 - 前記第2−1金属配線と前記第2−2金属配線が、同じ数の配線が配置されることを特徴とする請求項33に記載の半導体チップ。
- 基板と、
前記基板に配置された複数のウェル領域に分散されて配置された複数の単位素子からなるチャネルを複数個備える複数のチャネルブロックと、
前記チャネルを形成する複数の単位素子と外部とのデータ送受信のために、前記複数の単位素子それぞれと接続した複数の第1金属配線と、
前記第1金属配線を介して受信されたデータ信号を複数の第1外部配線を介して伝送する複数のノーマルバンプと、
前記複数のチャネルブロック間の空間にそれぞれ配置され、それぞれが複数のウェル領域に接続された複数の第2金属配線と、
前記第2金属配線が形成された領域上に搭載され、前記チャネルブロックを駆動する間に発生する熱を前記第2金属配線を介して伝達して、前記伝達された熱を外部と連結した複数の第2外部配線に伝達する複数の第1熱伝逹バンプと、
前記第1外部配線及び前記第1熱伝逹バンプと接続した複数の第2外部配線とを備える支持基板と、を備えたことを特徴とする半導体装置。 - 前記第1外部配線及び第2外部配線が、銅箔配線であることを特徴とする請求項35に記載の半導体装置。
- 前記支持基板が、フィルム又はガラス基板であることを特徴とする請求項35に記載の半導体装置。
- 前記支持基板が、COF技術、COG技術又はTCP技術で用いられる基板の内のいずれかであることを特徴とする請求項35に記載の半導体装置。
- 基板と、
前記基板に配置された複数のウェル領域に分散されて配置された複数の単位素子からなるチャネルを複数個備える複数のチャネルブロックと、
前記チャネルを形成する複数の単位素子と外部とのデータ送受信のために、前記複数の単位素子それぞれと接続した複数の第1金属配線と、
前記第1金属配線を介して受信されたデータ信号を外部と接続された複数の第1外部配線を介して伝送する複数のノーマルバンプと、
前記複数のチャネルブロックの駆動のために、電源入力端を介して外部から電源電圧又は接地電圧を印加するための電源電圧入力端と、
前記複数のチャネルブロック間の空間にそれぞれ配置され、それぞれが前記ウェル領域に配置された複数の第2金属配線と、
前記第2金属配線と接続される複数の熱伝達ラインと、
前記複数の熱伝逹ラインに対応し、対応する前記熱伝達ラインの一側と連結され、また他の一側が前記電源入力端と接続される複数の第1接続ラインと、
前記複数の熱伝達ラインに対応し、対応する前記熱伝達ラインの他の一側が連結される複数の第2接続ラインと、
前記複数の第2接続ラインと連結され、前記複数の第2金属配線、前記複数の熱伝達ライン及び前記複数の第2接続ラインを介して前記ウェル領域から伝達された熱を第2外部配線に伝達する複数の第1熱伝逹バンプと、
前記第1外部配線及び前記第1熱伝逹バンプと接続された第2外部配線を含む支持基板と、を備えたことを特徴とする半導体装置。 - 前記第1外部配線及び第2外部配線が、銅箔配線であることを特徴とする請求項39に記載の半導体装置。
- 前記支持基板が、フィルム又はガラス基板であることを特徴とする請求項39に記載の半導体装置。
- 前記支持基板が、COF技術、COG技術又はTCP技術で用いられる基板の内のいずれかであることを特徴とする請求項39に記載の半導体装置。
- 基板と、
前記基板に配置された複数のウェル領域に分散されて配置された複数の単位素子からなるチャネルを複数個備える複数のチャネルブロックと、
前記チャネルを形成する複数の単位素子と外部とのデータ送受信のために、前記複数の単位素子それぞれと接続した複数の第1金属配線と、
前記第1金属配線を介して受信されたデータ信号を外部と接続された複数の第1外部配線を介して伝送する複数のノーマルバンプと、
前記複数のチャネルブロックの駆動のために、電源入力端を介して外部から電源電圧又は接地電圧を受ける電源電圧入力端と、
前記チャネルブロック間の空間にそれぞれ配置され、それぞれが前記ウェル領域と接続された複数の第2金属配線と、
前記チャネルブロック領域上に配置され、前記第2金属配線を介して前記ウェル領域から伝達された熱を、連結された第2外部配線に伝達する複数の熱伝逹ポンプと、
前記第1外部配線及び前記第1熱伝逹バンプと接続された複数の第2外部配線を備える支持基板と、を備えたことを特徴とする半導体装置。 - 前記第1外部配線及び前記第2外部配線が、銅箔配線であることを特徴とする請求項43に記載の半導体装置。
- 前記支持基板が、フィルム又はガラス基板であることを特徴とする請求項43に記載の半導体チップパッケージ。
- 前記支持基板が、COF技術、COG技術又はTCP技術で用いられる基板の内のいずれかであることを特徴とする請求項43に記載の半導体装置。
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