JP4941906B2 - 有機el駆動回路およびこれを用いる有機el表示装置 - Google Patents
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Description
このような端子ピン数の増加により、特に、カラムライン側では複数のカラムドライバICが必要になる。例えば、QVGAのフルカラーでは三原色のR,G,B各120端子ピンの360端子ピンとなり、現在ところ3ドライバは必要になる。そのためカラムドライバIC相互間の特性の相違、特に、その駆動電流のばらつきにより、有機EL表示装置の画面上に輝度むらが発生する問題がある。
この種の問題を解決する技術として特開2001−42827号「ディスプレイ装置及びディスプレイパネルの駆動回路」を挙げることができる(特許文献1)。
カラムドライバIC22の駆動電流制御回路CCは、基準電流制御回路RCに対応している。その構成は、トランジスタQc、Qdのカレントミラー回路と、カレントミラー接続の出力側トランジスタQdで駆動されるトランジスタQeとからなる。入力側トランジスタQcが制御電流出力回路COからの電流Iout=icの電流を受けてカラムドライバIC22のトランジスタQeを駆動する。このトランジスタQeは、トランジスタQ1〜Qmとカレントミラー接続された入力側トランジスタとなっている。
なお、抵抗Ro、抵抗Rrの抵抗値は等しく、抵抗Rsの抵抗値は抵抗R1〜Rmと等しい。また、GA1〜GAm、GB1〜GBmは、スイッチブロックSBの各スイッチS1〜SmのON/OFFを制御する制御信号である。
このような問題を解決するために、出願人は、特開2003−288045号「有機EL駆動回路およびこれを用いる有機EL表示装置」を出願している(特許文献2)。これは、集積されたペア抵抗の抵抗値が実質的に等しいことを利用してカラムドライバIC間での駆動電流のばらつきを抑える技術である。
これら特許文献1、2のカラムドライバICは、マスターチップとスレーブチップでそれぞれ基準電流発生回路が相違するために、それぞれにドライバICを製造しなければならないので、ドライバICの製造コストが高くなる問題がある。
この発明の目的は、このような従来技術の問題点を解決するものであって、有機ELパネルを電流駆動するカラムドライバIC間での特性の相違による有機EL表示装置の画面上での輝度むらを低減でき、カラムドライバICの製造コストを低減でできる有機EL駆動回路あるいは有機EL表示装置を提供することにある。
このICの外部から基準電流と同じシンクあるいは吐き出しの電流であって基準電流の電流値に相当する電流値の電流が入力される第1の入力端子と、基準電流と同じシンクあるいは吐き出しの電流を他のICの前記第1の入力端子に相当する入力端子に供給するための出力端子と、第1の入力端子から入力される電流と基準電流のいずれか一方を選択する基準電流選択回路と、基準電流選択回路により選択された電流をシンクあるいは吐き出しの基準電流の電流方向とは逆方向の吐き出しあるいはシンクの電流にする電流反転回路と、この電流反転回路の電流を入力側トランジスタに受けて複数の第1の出力側トランジスタに駆動電流あるいはその基礎となる電流を基準電流と同じシンクあるいは吐き出しの電流として発生するカレントミラー回路とを備えていて、カレントミラー回路が、さらに電流方向が基準電流と同じシンクあるいは吐き出しの電流であって基準電流選択回路により選択される前記電流の電流値に実質的に等しい電流値の電流を出力端子に出力するための第2の出力側トランジスタを有し、カレントミラー回路の入力側トランジスタと第2の出力側トランジスタと出力端子とは、それぞれ複数個設けられ、複数の入力側トランジスタのうちの少なくとも2個が、複数の第1および第2の出力側トランジスタのトランジスタ配列の両端に配置されてこれら出力側トランジスタを両側から駆動し、前記第2の出力側トランジスタが、前記2個のうちいずれか一方の前記入力側トランジスタに対して前記複数の第1の出力側トランジスタより手前に配置されているものである。
スレーブICは、マスターICの出力端子から基準電流と実質的に等しい電流をこれと同相で受けてマスターICと同じ基準電流選択回路と電流反転回路とを経てマスターICと同じ回路のカレントミラー回路が駆動される。基準電流を受ける電流反転回路からカレントミラー回路までの回路はマスターICもスレーブICも同じ回路構成である。もちろん、カレントミラー回路より後の駆動電流発生までも同じ回路にすることができる。
その結果、各ICの出力端子から出力される駆動電流のばらつきが低減されて、有機ELパネルを電流駆動するカラムドライバIC間での特性の相違による有機EL表示装置の画面上での輝度むらを低減できる。
また、カレントミラー回路の入力側トランジスタを2個設けて、第1および第2の出力側トランジスタのトランジスタ配列の両端においてこれら第1および第2の出力側トランジスタを駆動するようにすれば、マスターとなるあるドライバICにおける最後のカラムラインとスレーブとなる次のドライバICにおける最初のカラムラインの駆動電流のばらつきの差を減少させることができ、表示画面の輝度むらを低減することができる。
その結果、この発明は、携帯電話機等において、端子ピン数が増加した場合でも、有機ELパネルを電流駆動するカラムドライバIC間での特性の相違による有機EL表示装置の画面上での輝度むらを低減できる。また、同じカラムドライバICがマスターにもスレーブにも使用できるので、カラムドライバICの製造コストを低減でできる。
なお、この明細書におけるカラムドライバは、アクティブマトリックス型の有機ELパネルにおいてデータ線を駆動するドライバであってもパッシブマトリックス型の有機ELパネルのカラムラインを駆動するドライバであってもよいので、これらを区別していない。
図1において、10は、アクティブマトリックス型の有機EL表示装置であって、11、12、13は、その有機EL駆動回路のカラムドライバIC(以下ドライバ)である。 ドライバ11〜13は、同一の構成であって、図2にドライバ11としてその詳細を示すように、それぞれ基準電流発生回路1と、基準電流選択回路2、基準電流分配回路3、有機ELパネルの各端子ピン対応に設けられたD/A変換ブロック(D/A)4とからなる。
D/A変換ブロック4は、MPU7からレジスタ6を介して表示データDATを受けて基準駆動電流を表示データ値分増幅してそのときどきの表示輝度に応じた駆動電流(吐き出し電流)を生成する。そして、生成したそれぞれの駆動電流をデータ線(カラムライン)側の出力端子P1,…Pi,……Pnを介してそれぞれにアクティブマトリックス型の有
機ELパネル5のピクセル回路9に送出してピクセル回路9に内蔵されたコンデンサCを充電して、ピクセル回路9の有機EL素子9aを駆動する。
なお、D/A変換ブロック4は、基準電流分配回路3のカレントミラー回路の入力側トランジスタを入力側トランジスタとし、これにカレントミラー接続された多数の出力側トランジスタ群と多数のスイッチ回路群(図示せず,図2参照)とからなる回路である。ここで、基準電流分配回路3の入力側トランジスタと出力側トランジスタ群とスイッチ回路群とは、カレントミラー回路による電流スイッチングD/Aを構成している。
また、有機ELパネル5におけるXa…Xi…Xn,X2a…X2i…X2n,X3a…X3i…X3n(図示せず)は、それぞれドライバ11〜13の出力端子P1…Pi…Pnに対応するデータ線(カラムライン)であり、これら全体で1水平ライン分の画素数に対応している。
ところで、R,G,B表示色によるカラー表示では、基準電流分配回路3とD/A4とがR,G,B対応にそれぞれ設けられる。そして、基準電流分配回路3に、あるいは基準電流発生回路1と基準電流分配回路3との間にR,G,B対応に基準電流調整回路(図示せず)が設けられる。R,G,B対応に設けられるこれらの基準電流調整回路により基準駆動電流が調整されて画面上でのホワイトバランス調整が行われる。
R,G,Bの相違とこれらの基準電流調整回路はこの実施例では直接関係していないので、ここでは、これを省略し、R,G,Bそれぞれを区別せずに以下説明する。
インバータ2cは、入力端子側が入力端子11bに接続され、出力端子側がアナログスイッチ2aのON/OFFコントロール信号の非反転側入力端子およびアナログスイッチ2bのON/OFFコントロール信号の反転側入力端子にそれぞれ接続されている。さらに、入力端子11bは、アナログスイッチ2aのON/OFFコントロール信号の反転側入力端子とアナログスイッチ2bのON/OFFコントロール信号の非反転側入力端子に直接に接続されている。
これにより、入力端子11bにビット“0”が入力されているときには、アナログスイッチ2aがONとなり、これと相補的にアナログスイッチ2bがOFFとなる。このときには、基準電流源1aの基準電流Irefが電流反転回路1bに加えられる。一方、入力端子11bにビット“1”が入力されているときには、アナログスイッチ2bがONとなり、アナログスイッチ2aがOFFとなる。このときには、このIC(ドライバ11)の外部から入力端子11aに加えられる電流が電流反転回路1bに送出される。
なお、図1に示すように、各ドライバの入力端子11b,12b,13bには、コントロール回路8からそれぞれぞ基準電流値を選択する選択ビット信号B1,B2,B3が入力される。また、基準電流源1aは、+VDDの電源ラインに接続され電力供給を受ける。
トランジスタTN2のドレインは、基準電流分配回路3のカレントミラー回路の両端に設けられた入力側トランジスタTPa,TPbのドレインに接続され、そのソースが接地されている。
これにより、基準電流源1aの基準電流Iref、および入力端子11aから入力される、基準電流Irefと同相の電流Ir(Ir:外部から供給される基準電流に相当する。)のいずれかの電流が電流反転回路1bに入力される。電流反転回路1bは、受けたいずれかの基準電流Iref又はIrを反転して出力側にシンク電流(入力電流に対して逆相の出力電流)をミラー電流として発生し、この電流を基準電流分配回路3の入力側トランジスタTPa,TPbのドレインに供給する。
基準電流分配回路3は、入力側の電流をミラー電流として出力側に複製して端子ピン対応に分配する電流複製分配回路であって、ダイオード接続の2個のPチャネルの入力側MOSトランジスタTPa,TPbと、6個の出力側のPチャネルのMOSトランジスタTP1〜TP6、そして各出力端子P1,…Pi,……Pnに対応に設けられた各D/A変換ブロック4とからなる。
各出力側のPチャネルのトランジスタTPc〜TPmは、それぞれ各D/A変換ブロック4の多数の出力側トランジスタの1つをその代表として示してある。以下、各D/A変換ブロック4の多数の出力側トランジスタをこれら出力側トランジスタTPc〜TPmをもって説明する。
多数のD/A変換ブロック4の手前にある出力側の各トランジスタTP1〜TP6のソースと各D/A変換ブロック4の各出力側トランジスタTPc〜TPmのソースは、電源ライン+VDDより高い電圧の電源ライン+Vccに接続されている。各トランジスタTP1〜TP6のドレインは、それぞれ出力端子11c〜11hに接続されている。
そこで、各D/A変換ブロック4の複数の出力側トランジスタの出力電流は、レジスタ6の表示データDATに応じてON/OFFする各スイッチ回路により選択されて各D/A変換ブロック4の選択された各出力側トランジスタの出力電流を合計した電流値が各D/A変換ブロック4のアナログ変換値として発生する。その合計電流値の出力が駆動電流として各出力端子P1,…Pi,……Pnに各D/A変換ブロック4からそれぞれに出力される。
トランジスタTP1〜TP6は6個程度であるが、トランジスタTPc〜TPmは、数十個は配列される。そこで、入力側トランジスタTPaに対してトランジスタTP1〜TP6をトランジスタTPaに近い位置に配置してこれらトランジスタの出力電流の精度を上げる。
したがって、入力側トランジスタTPaから離れ、入力側トランジスタTPaから最も遠い位置にあるトランジスタTPmの出力電流の精度はその分悪くなる。そこで、出力側トランジスタTPmの近傍あるいはこの後に入力側トランジスタTPbを設けることでトランジスタTPc〜TPmの出力電流のばらつきを抑えることができる。さらに、これにより、最後の出力側トランジスタTPmの出力電流値を最初の出力側トランジスタTPcの出力電流値に実質的に等しいものとして、次段のスレーブチップにおける最初のカラムライン(データ線)に対応する(最初の端子ピンに対応する)トランジスタTPcとの駆動電流のばらつきの差を低減する。
カレントミラーの出力側トランジスタの両側に位置する入力側トランジスタTPa,TPbは、基準電流分配回路3を構成するトランジスタセルあるいはこれとD/A変換ブロック4を構成するトランジスタセルが配列される端部に設けられる前記のダミートランジスタを割り当てることができる。
これにより、2個の入力側トランジスタTPa,TPbは、出力側の各トランジスタTP1〜TP6,TPc〜TPmのトランジスタ配列の両端に配置されてこれら出力側トランジスタを両側から駆動することができる。
そこで、トランジスタTP1のドレインの電流が出力端子11c,配線ライン20(図1参照)を介してスレーブチップ12の入力端子12aに入力される。また、トランジスタTP2のドレインの電流が出力端子11d,配線ライン21(図1参照)を介してスレーブチップ13の入力端子13aに入力される。
その他の出力端子11e〜11hは、グランドGNDに接続される。なお、このとき各トランジスタTP1〜TP6,TPc〜TPmの出力電流は、μAオーダのものであるので、直接グランドGNDへ流しても、全体の消費電力はほとんど増加しない。
ドライバ12の出力端子12e〜12hおよびドライバ13の出力端子13e〜13hも同様である。
一方、スレーブチップのドライバ12は、コントロール回路8から選択ビット信号B2(=“1”)を受けて、基準電流源1aからの基準電流Irefではなく、入力端子12aを選択する。そこで、ドライバ11のトランジスタTP6のドレインに分配され、これから送出された基準電流Irがドライバ12の電流反転回路1bに入力される。
スレーブチップのドライバ13もコントロール回路8から選択ビット信号B3(=“1”)を受けて、入力端子13aを選択して、ドライバ11のトランジスタTP5のドレインから送出された基準電流Irがドライバ13の電流反転回路1bに入力される。
その結果、スレーブチップのドライバ12,13の基準電流分配回路3は、それぞれ基準電流Irに基づいて各ドライバ12,13の各D/A変換ブロック4が有機ELパネルの端子ピンに送出する駆動電流を生成する。
この場合、スレーブチップのドライバ12,13は、マスターチップのドライバ11の出力端子11c,11dから基準電流Irefと実質的に等しい電流Irをこれと同相で受けてドライバ11と同じ基準電流選択回路2と電流反転回路1bとを経てドライバ11と同じ回路の基準電流分配回路3と各D/A変換ブロック4を構成するカレントミラー回路が駆動される。
このように、ドライバ11の基準電流発生回路1aの基準電流Irefを基準としてスレーブチップのドライバ12,13が同じ回路構成の回路を経て駆動電流を発生するので、各駆動電流のばらつきが低減される。
なお、実施例のように選択ビット信号B1,B2,B3によりマスターチップかスレーブチップかを選択できるようにしておけば、表示装置にドライバICが組み込まれ、画面を表示したときの、画面上の輝度むらを見て後から各IC内部で基準電流Irefか、外部から入力される電流Irのいずれか最適な方を選択することができる。
さらに、実施例では、基準電流分配回路3において、入力側トランジスタに近い側の出力側トランジスタTP1〜TP6の6個を6個分のスレーブドライバに対して基準電流を発生する出力トランジスタとして割当ている。
また、実施例では、入力側トランジスタTPa,TPbの2個を用いて出力側トランジスタの両側に配置して両端で駆動しているので、基準電流Irを出力する出力側トランジスタTP1〜TP6は、カレントミラー回路の出力側トランジスタにおいて前記2個のうちいずれか一方の入力側トランジスタTPa,TPbに対して複数の出力側トランジスタより手前に配置されているどの位置の出力側トランジスタが割当てられていてもよい。
なお、マスターチップのドライバ11とスレーブチップのドライバ12,13とは同じ回路構成になっているので、スレーブチップのドライバ12,13から他のスレーブチップのドライバに基準電流Irを分配することも可能である。もちろん、画面上の輝度むらに応じてマスターチップのドライバが複数個併存することになってもよい。
基準電流分配回路3+3個のD/A変換ブロック4からなる1つのカレントミラー回路でR,G,Bに対応させてホワイトバランス調整の基準電流調整回路とすることができる。この場合には、端子ピン対応の基準電流分配回路は別途設けることが必要になる。それは、R,G,B対応に設けたこれら3個のD/A変換ブロック4の下流にそれぞれ基準電流分配回路3とD/A変換ブロック4とからなるカレントミラー回路の基準電流分配回路を設けることによる。ただし、この場合のカレントミラー回路は、図2の基準電流分配回路3とD/A変換ブロック4とを構成するカレントミラー回路の2個のPチャネルの入力側MOSトランジスタTPa,TPbと、多数の出力側トランジスタTPc〜TPmとがそれぞれNチャネルの入力側MOSトランジスタになる。このカレントミラー回路は、ソース側がグランドGNDに接続され、Nチャネルの出力側トランジスタTPc〜TPmのドレイン側が出力端子に接続された電流シンク型の出力回路になる。NチャネルのトランジスタTPa,TPbのドレインは、基準電流調整回路から前記の基準駆動電流を受けることになる。
実施例では、マスターチップのドライバ11の位置が初段(先頭)にあって、その後段としてスレーブチップのドライバ12,13が設けられている。しかし、マスターチップのドライバ11の位置は先頭に置かれなくてもよい。特に、スレーブチップのドライバ12,マスターチップのドライバ11,スレーブチップのドライバ13の順のように複数のスレーブチップのドライバがあるときには、マスターチップのドライバを中央位置に配置し、マスターチップの左右両側にスレーブチップのドライバを設けてもよい。
さらに、この発明は、R,G,B対応のD/Aが前記した基準電流調整回路とは別の形態で設けられてこの基準電流調整回路により基準駆動電流が調整されて画面上でのホワイトバランス調整が行われてもよい。
また、実施例では、MOSFETトランジスタを主体として構成しているが、バイポーラトランジスタを主体として構成してもよいことはもちろんである。また、実施例のNチャンネル型(あるいはnpn型トランジスタ)は、Pチャンネル型(あるいはpnp型)トランジスタに、Pチャンネル型(あるいはpnp型)トランジスタは、Nチャンネル(あるいはnpn型)トランジスタに置き換えることができる。
3…基準電流分配回路、4…D/A変換ブロック、
5…有機ELパネル、6…レジスタ、
7…MPU、8…コントロール回路、
9…ピクセル回路、9a…有機EL素子、
10…有機EL表示装置、
11、12、13…カラムドライバIC、
TN1,TN2…NチャネルMOSトランジスタ、
TP1〜TP6,TPa,TPb〜TPm…PチャネルMOSトランジスタ、
RC…基準電流制御回路、CC…駆動電流制御回路、
CO…制御電流出力回路、OP…オペアンプ、
SW1,SW2…アナログスイッチ、
S1〜Sm…スイッチ、SB…スイッチブロック。
Claims (16)
- 基準電流発生回路からシンクあるいは吐き出しの基準電流に基づいて有機ELパネルの有機EL素子の陽極側駆動ラインあるいはデータ線に駆動電流を供給して前記有機ELパネルを電流駆動するIC化された有機EL駆動回路において、
このICの外部から電流方向が前記基準電流と同じシンクあるいは吐き出しの電流であって前記基準電流の電流値に相当する電流値の電流が入力される第1の入力端子と、
前記基準電流と同じシンクあるいは吐き出しの電流を他のICの前記第1の入力端子に相当する入力端子に供給するための出力端子と、
前記第1の入力端子から入力される前記電流と前記基準電流のいずれか一方を選択する基準電流選択回路と、
前記基準電流選択回路により選択された電流をシンクあるいは吐き出しの前記基準電流の電流方向とは逆方向の吐き出しあるいはシンクの電流にする電流反転回路と、
この電流反転回路の電流を入力側トランジスタに受けて複数の第1の出力側トランジスタに前記駆動電流あるいはその基礎となる電流を前記基準電流と同じシンクあるいは吐き出しの電流として発生するカレントミラー回路とを備え、
前記カレントミラー回路は、さらに電流方向が前記基準電流と同じシンクあるいは吐き出しの電流であって前記基準電流選択回路により選択される前記電流の電流値に実質的に等しい電流値の電流を前記出力端子に出力するための第2の出力側トランジスタを有し、
前記カレントミラー回路の前記入力側トランジスタと前記第2の出力側トランジスタと前記出力端子とは、それぞれ複数個設けられ、前記複数の入力側トランジスタのうちの少なくとも2個は、複数の前記第1および第2の出力側トランジスタのトランジスタ配列の両端に配置されてこれら出力側トランジスタを両側から駆動し、前記第2の出力側トランジスタは、前記2個のうちいずれか一方の前記入力側トランジスタに対して前記複数の第1の出力側トランジスタより手前に配置されている有機EL駆動回路。 - 前記第2の出力側トランジスタの出力電流は、前記ICと同一構成の他のICにおける前記第1の入力端子に供給される請求項1記載の有機EL駆動回路。
- 前記第1の入力端子は、前記ICと同一構成の他のICにおける前記第2の出力側トランジスタの出力電流を受ける請求項1記載の有機EL駆動回路。
- 前記複数の第1の出力側トランジスタは、前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応してぞれぞれ設けられ、前記駆動電流あるいはその基礎となる電流は前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応して生成される請求項2記載の有機EL駆動回路。
- 前記複数の第1の出力側トランジスタは、前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応してぞれぞれ設けられ、前記駆動電流あるいはその基礎となる電流は前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応して生成され、前記電流反転回路は、カレントミラー回路で構成されている請求項3記載の有機EL駆動回路。
- 前記基準電流選択回路は、製造過程での接続配線の選択によりあるいはこのICの外部から第2の入力端子を介して所定の選択信号を受けることにより前記電流と前記基準電流のいずれか一方を選択する請求項1記載の有機EL駆動回路。
- 前記所定の選択信号は、1ビットの信号であり、前記基準電流選択回路は、2個のアナログスイッチで構成され、これらアナログスイッチの一方の一端が前記基準電流発生回路に接続され、他方の一端が前記第1の入力端子に接続され、前記2個のアナログスイッチの他端が共通に前記電流反転回路に接続されて前記1ビットの信号により前記2つのアナログスイッチが相補的にON/OFFされる請求項6記載の有機EL駆動回路。
- 前記入力側トランジスタと前記複数の第1の出力側トランジスタとによるカレントミラー回路によりD/A変換回路が構成され、かつ、前記複数の第1の出力側トランジスタが前記D/A変換回路のD/A変換ブロックとされる請求項5記載の有機EL駆動回路。
- 前記カレントミラー回路は、PチャネルMOSトランジスタで構成され、前記D/A変換ブロックは、前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応してそれぞれ設けられている請求項6記載の有機EL駆動回路。
- 前記カレントミラー回路は、PチャネルMOSトランジスタで構成され、前記D/A変換ブロックは、三原色のR,G,B対応に設けられ、R,G,B対応に前記基準電流を調整する回路とされる請求項6記載の有機EL駆動回路。
- 基準電流発生回路からシンクあるいは吐き出しの基準電流に基づいて有機ELパネルの有機EL素子の陽極側駆動ラインあるいはデータ線に駆動電流を供給して前記有機ELパネルを電流駆動するICを複数個有する有機EL駆動回路において、
各前記ICは、それぞれ、外部から電流方向が前記基準電流と同じシンクあるいは吐き出しの電流であって前記基準電流の電流値に相当する電流値の電流が入力される第1の入力端子と、前記基準電流と同じシンクあるいは吐き出しの電流を他のICの前記第1の入力端子に供給するための出力端子と、前記第1の入力端子から入力される前記電流と前記基準電流のいずれか一方を選択する基準電流選択回路と、前記基準電流選択回路により選択された電流をシンクあるいは吐き出しの前記基準電流の電流方向とは逆方向の吐き出しあるいはシンクの電流にする電流反転回路と、この電流反転回路の電流を入力側トランジスタに受けて複数の第1の出力側トランジスタに前記駆動電流あるいはその基礎となる電流を前記基準電流と同じシンクあるいは吐き出しの電流として発生するカレントミラー回路とを備え、前記カレントミラー回路は、さらに電流方向が前記基準電流と同じシンクあるいは吐き出しの電流であって前記基準電流選択回路により選択される前記電流の電流値に実質的に等しい電流値の電流を前記出力端子に出力するための第2の出力側トランジスタを有し、
前記カレントミラー回路の前記入力側トランジスタと前記第2の出力側トランジスタと前記出力端子とは、それぞれ複数個設けられ、前記複数の入力側トランジスタのうちの少なくとも2個は、複数の前記第1および第2の出力側トランジスタのトランジスタ配列の両端に配置されてこれら出力側トランジスタを両側から駆動し、前記第2の出力側トランジスタは、前記2個のうちいずれか一方の前記入力側トランジスタに対して前記複数の第1の出力側トランジスタより手前に配置されている有機EL駆動回路。 - 各前記ICの前記複数の第1の出力側トランジスタは、前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応してぞれぞれ設けられ、前記駆動電流あるいはその基礎となる電流は自己の前記ICに割当てられた前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応して生成される請求項11記載の有機EL駆動回路。
- 前記基準電流選択回路は、製造過程での接続配線の選択によりあるいはこのICの外部から第2の入力端子を介して所定の選択信号を受けることにより前記電流と前記基準電流のいずれか一方を選択する請求項11記載の有機EL駆動回路。
- 基準電流発生回路からシンクあるいは吐き出しの基準電流に基づいて有機ELパネルの有機EL素子の陽極側駆動ラインあるいはデータ線に駆動電流を供給して前記有機ELパネルを電流駆動するICを複数個有する有機EL表示装置において、
各前記ICは、それぞれ、外部から電流方向が前記基準電流と同じシンクあるいは吐き出しの電流であって前記基準電流の電流値に相当する電流値の電流が入力される第1の入力端子と、前記基準電流と同じシンクあるいは吐き出しの電流を他のICの前記第1の入力端子に供給するための出力端子と、前記第1の入力端子から入力される前記電流と前記基準電流のいずれか一方を選択する基準電流選択回路と、前記基準電流選択回路により選択された電流をシンクあるいは吐き出しの前記基準電流の電流方向とは逆方向の吐き出しあるいはシンクの電流にする電流反転回路と、この電流反転回路の電流を入力側トランジスタに受けて複数の第1の出力側トランジスタに前記駆動電流あるいはその基礎となる電流を前記基準電流と同じシンクあるいは吐き出しの電流として発生するカレントミラー回路とを備え、前記カレントミラー回路は、さらに電流方向が前記基準電流と同じシンクあるいは吐き出しの電流であって前記基準電流選択回路により選択される前記電流の電流値に実質的に等しい電流値の電流を前記出力端子に出力するための第2の出力側トランジスタを有し、
前記カレントミラー回路の前記入力側トランジスタと前記第2の出力側トランジスタと前記出力端子とは、それぞれ複数個設けられ、前記複数の入力側トランジスタのうちの少なくとも2個は、複数の前記第1および第2の出力側トランジスタのトランジスタ配列の両端に配置されてこれら出力側トランジスタを両側から駆動し、各前記ICの前記第2の出力側トランジスタは、前記2個のうちいずれか一方の前記入力側トランジスタに対して前記複数の第1の出力側トランジスタより手前に配置され、
複数の前記ICの1つの前記第2の出力側トランジスタの出力電流がその前記出力端子を介して残りの前記ICの少なくとも1つの前記第1の入力端子に入力される有機EL表示装置。 - 各前記ICの前記複数の第1の出力側トランジスタは、前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応してぞれぞれ設けられ、前記駆動電流あるいはその基礎となる電流は自己の前記ICに割当てられた前記有機EL素子の陽極側駆動ラインあるいはデータ線に対応して生成される請求項14記載の有機EL表示装置。
- 前記基準電流選択回路は、製造過程での接続配線の選択によりあるいはこのICの外部から第2の入力端子を介して所定の選択信号を受けることにより前記電流と前記基準電流のいずれか一方を選択する請求項14記載の有機EL表示装置。
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