JP4926299B1 - プログラマブルロジックコントローラ - Google Patents
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Abstract
【選択図】図1
Description
図1は、本発明の実施の形態にかかるプログラマブルロジックコントローラの構成を示すブロック図である。本実施の形態では、基本ブロック11と2つの増設ブロック12、13とから構成されるプログラマブルロジックコントローラを例とする。基本ブロック11と増設ブロック12とは、増設ケーブル8を介して接続されている。増設ブロック12と増設ブロック13とは、増設ケーブル8を介して接続されている。
2 入出力ユニット
3 共通コネクタ
4 エンドカバー
5 内部バス
6 分岐ユニット
7 増設ユニット
8 増設ケーブル
9 バスI/F
10 増設ケーブル抜け検出信号
11 基本ブロック
12、13 増設ブロック
Claims (3)
- 基本ブロックと、増設ケーブルを介して前記基本ブロックに連結された増設ブロックと、を含み、ベースレス構造を備えるプログラマブルロジックコントローラであって、
前記基本ブロックに設けられたCPUユニットと、
前記CPUユニットにより制御され、共通コネクタを介して連結された各種ユニットと、
前記CPUユニットおよび前記各種ユニット内を通して設けられ、前記CPUユニットおよび前記各種ユニットを接続する内部バスと、
前記内部バスを分岐させたうちの一つが前記増設ケーブルに接続可能とされた前記各種ユニットである分岐ユニットと、を有し、
前記各種ユニットは、前記内部バスの異常検出のための異常検出用データを保持するバスインタフェースを備え、
前記分岐ユニットの前記バスインタフェースは、さらに、前記増設ケーブルの抜けを検出するための増設ケーブル抜け情報を保持し、
前記CPUユニットは、前記内部バスに通信異常が発生していると判断すると、前記分岐ユニットの前記バスインタフェースから読み出した前記増設ケーブル抜け情報から前記増設ケーブルの接続状態を検出し、前記増設ケーブルの接続が正常であると判断すると、前記各種ユニットの前記バスインタフェースから読み出した前記異常検出用データを照合することにより、前記内部バスの異常箇所を検出することを特徴とするプログラマブルロジックコントローラ。 - 前記CPUユニットは、前記増設ケーブルの接続状態の検出より先に、前記分岐ユニットの前記バスインタフェースから読み出した前記異常検出用データから、前記分岐ユニットにおける前記内部バスの異常の有無を判断することを特徴とする請求項1に記載のプログラマブルロジックコントローラ。
- 前記CPUユニットは、前記内部バスに通信異常が有ると判断した場合に、前記通信異常が発生した前記各種ユニットあるいは前記増設ケーブルを特定し、エラー通知を行うことを特徴とする請求項1または2に記載のプログラマブルロジックコントローラ。
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