JP4886513B2 - フィーチャ微小寸法の低減 - Google Patents
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Description
Claims (24)
- 複数の導電性ラインを形成する方法であって、
導電性レイヤを基板上に配置すること、
マスクを形成することであって、前記マスクは、前記マスクラインの間にマスク間隔を持つ複数のマスクラインを定義し、前記マスク間隔は幅を有し、前記マスクラインは幅および側壁を有する、マスクを形成すること、
プラズマ処理チャンバ内に前記基板を置くこと、
前記プラズマ処理チャンバ内に前記基板を置いたままで、前記マスクの前記側壁上にコンフォーマルレイヤを堆積することであって、前記コンフォーマルレイヤの堆積は堆積されたコンフォーマルレイヤの無いビアの底部を提供する、コンフォーマルレイヤを堆積すること、
前記プラズマ処理チャンバ内に前記基板を置いたままで、前記マスクを通して前記導電性レイヤをエッチングすることによって、導電性ラインおよび前記導電性ライン間の間隔を形成することであって、前記導電性ラインは幅を有し、前記導電性ライン間の前記間隔は幅を有し、前記導電性ライン間の前記間隔の前記幅は、前記マスク間隔の前記幅より小さく、前記導電性ラインの前記幅は前記ラインマスクの前記幅より大きい、導電性ラインおよび前記導電性ライン間の間隔を形成すること
を含み、
前記堆積することは、
第1ガス化学物質での第1堆積によって第1堆積プラズマを形成することであって、
第1堆積ガスの流れを供給することと、
プラズマ中に前記第1堆積ガスを形成することと、
前記第1堆積ガスの流れを停止することと、を含む、第1堆積プラズマを形成すること、および
第2ガス化学物質での第2堆積によって第2堆積プラズマを形成することであって、前記第1ガス化学物質は前記第2ガス化学物質と異なり、
前記第1堆積ガスと異なる第2堆積ガスの流れを供給することと、
プラズマ中に前記第2堆積ガスを形成することと、
前記第1堆積ガスの流れと前記第2堆積ガスの流れとが同時ではなく交互に起こるように前記第2堆積ガスの流れを停止することと、を含む、第2堆積プラズマを形成すること、を含む、方法。 - 請求項1に記載の方法であって、前記マスク間隔の前記幅に対する前記マスクラインの前記幅の比は、1:1より小さく、前記導電性ラインの間の前記間隔の前記幅に対する前記導電性ラインの前記幅の比は、1:1より小さくない方法。
- 請求項1に記載の方法であって、前記マスク間隔の前記幅に対する前記マスクラインの前記幅の比は、1:1より小さく、前記導電性ラインの間の前記間隔の前記幅に対する前記導電性ラインの前記幅の比は、1:1より大きい方法。
- 請求項1に記載の方法であって、前記コンフォーマルレイヤを第1エッチングレシピでエッチングすることをさらに含み、前記導電性レイヤの前記エッチングは、前記第1エッチングレシピと異なる第2エッチングレシピを用いる方法。
- 請求項1に記載の方法であって、前記プラズマ処理チャンバ内に前記基板を置いたままで、前記コンフォーマルレイヤおよびマスクを単一の剥離ステップで剥離することをさらに含む方法。
- レイヤ中にフィーチャを形成する方法であって、
前記レイヤ上にフォトレジストレイヤを形成すること、
前記フォトレジストレイヤをパターン付けすることによって、フォトレジスト側壁を持つフォトレジストフィーチャを形成することであって、前記フォトレジストフィーチャは第1微小寸法を有する、フォトレジストフィーチャを形成すること、
前記フォトレジストフィーチャの前記側壁上にコンフォーマルレイヤを堆積することによって、前記フォトレジストフィーチャの前記微小寸法を低減することであって、
第1ガス化学物質での第1堆積によって第1堆積プラズマを形成することであって、
第1堆積ガスの流れを供給することと、
プラズマ中に前記第1堆積ガスを形成することと、
前記第1堆積ガスの流れを停止することとを含む、第1堆積プラズマを形成すること、および
第2ガス化学物質での第2堆積によって第2堆積プラズマを形成することであって、前記第1ガス化学物質は前記第2ガス化学物質と異なり、
前記第1堆積ガスと異なる第2堆積ガスの流れを供給することと、
プラズマ中に前記第2堆積ガスを形成することと、
前記第1堆積ガスの流れと前記第2堆積ガスの流れとが同時ではなく交互に起こるように前記第2堆積ガスの流れを停止することとを含む、第2堆積プラズマを形成すること、を含む、コンフォーマルレイヤを堆積すること、および
前記レイヤ内にフィーチャをエッチングすることであって、前記レイヤフィーチャは、前記第1微小寸法より小さい第2微小寸法を有する、エッチングすること
を含み、前記コンフォーマルレイヤの堆積は堆積されたコンフォーマルレイヤの無いビアの底部を提供する、方法。 - レイヤ中にフィーチャを形成する方法であって、
前記レイヤ上にフォトレジストレイヤを形成すること、
前記フォトレジストレイヤをパターン付けすることによって、フォトレジスト側壁を持つフォトレジストフィーチャを形成することであって、前記フォトレジストフィーチャは第1微小寸法を有する、フォトレジストフィーチャを形成すること、
前記フォトレジストフィーチャの前記側壁上にコンフォーマルレイヤを堆積することによって、前記フォトレジストフィーチャの前記微小寸法を低減することであって、前記フォトレジストフィーチャの前記側壁上にコンフォーマルレイヤを堆積することは、
第1ガス化学物質での第1堆積によって第1堆積プラズマを形成することであって、
第1堆積ガスの流れを供給することと、
プラズマ中に前記第1堆積ガスを形成することと、
前記第1堆積ガスの流れを停止することとを含む、第1堆積プラズマを形成すること、および
第2ガス化学物質での第2堆積によって第2堆積プラズマを形成することであって、前記第1ガス化学物質は前記第2ガス化学物質と異なり、
前記第1堆積ガスと異なる第2堆積ガスの流れを供給することと、
プラズマ中に前記第2堆積ガスを形成することと、
前記第1堆積ガスの流れと前記第2堆積ガスの流れとが同時ではなく交互に起こるように前記第2堆積ガスの流れを停止することとを含む、第2堆積プラズマを形成すること、を含む、前記フォトレジストフィーチャの前記側壁上にコンフォーマルレイヤを堆積すること、および
前記レイヤ内にフィーチャをエッチングすることであって、前記レイヤフィーチャは、第2微小寸法を有し、前記第2微小寸法は、前記第1微小寸法の70%より大きくない、エッチングすること
を含み、前記レイヤの堆積は堆積されたレイヤの無いビアの底部を提供する、方法。 - レイヤ中にフィーチャを形成する方法であって、
前記レイヤ上にフォトレジストレイヤを形成すること、
前記フォトレジストレイヤをパターン付けすることによって、フォトレジスト側壁を持つフォトレジストフィーチャを形成することであって、前記フォトレジストフィーチャは第1微小寸法を有する、フォトレジストフィーチャを形成すること、
前記フォトレジストフィーチャの前記側壁上にコンフォーマルレイヤを堆積することによって、前記フォトレジストフィーチャの前記微小寸法を低減することであって、
第1ガス化学物質での第1堆積によって第1堆積プラズマを形成することであって、
第1堆積ガスの流れを供給することと、
プラズマ中に前記第1堆積ガスを形成することと、
前記第1堆積ガスの流れを停止することとを含む、第1堆積プラズマを形成すること、および
第2ガス化学物質での第2堆積によって第2堆積プラズマを形成することであって、前記第1ガス化学物質は前記第2ガス化学物質と異なり、
前記第1堆積ガスと異なる第2堆積ガスの流れを供給することと、
プラズマ中に前記第2堆積ガスを形成することと、
前記第1堆積ガスの流れと前記第2堆積ガスの流れとが同時ではなく交互に起こるように前記第2堆積ガスの流れを停止することとを含む、第2堆積プラズマを形成すること、を含む、コンフォーマルレイヤを堆積すること、および
前記レイヤ内にフィーチャをエッチングすることであって、前記レイヤフィーチャは、前記第1微小寸法より小さい第2微小寸法を有する、エッチングすること
を含む方法。 - 請求項8に記載の方法であって、前記フォトレジストフィーチャ上にコンフォーマルレイヤを堆積することは、
前記第1ガス化学物質での第3堆積によって第3堆積プラズマを形成すること、および
前記第2ガス化学物質での第4堆積によって第4堆積プラズマを形成すること
をさらに含む方法。 - 請求項8および9のいずれかに記載の方法であって、前記第2微小寸法は、前記第1微小寸法の70%より大きくない方法。
- 請求項10に記載の方法であって、前記側壁上に前記コンフォーマルレイヤを堆積することは、実質的に垂直な側壁を形成する方法。
- 請求項8ないし11のいずれかに記載の方法であって、前記フォトレジストレイヤは248nmフォトレジストから形成され、前記フィーチャは140nmより大きくないCDを有する方法。
- 請求項11に記載の方法であって、前記フォトレジストマスクおよび堆積されたコンフォーマルレイヤを単一の剥離ステップで剥離することをさらに含む方法。
- 請求項13に記載の方法であって、前記フォトレジストマスクおよび堆積されたコンフォーマルレイヤを前記剥離することは、前記フォトレジストマスクおよび堆積されたレイヤをアッシングすることを含む方法。
- 請求項10に記載の方法であって、前記コンフォーマルレイヤは側壁厚さを有し、前記コンフォーマルレイヤは、前記フィーチャの上部から底部まで実質的に同じ側壁厚さを有する方法。
- 請求項10に記載の方法であって、前記コンフォーマルレイヤは、側壁厚さおよびフォトレジストフィーチャ底部厚さを有し、前記側壁厚さは、前記フォトレジストフィーチャ底部厚さより大きい方法。
- レイヤ中にフィーチャを形成する方法であって、
前記レイヤ上にフォトレジストレイヤを形成すること、
前記フォトレジストレイヤをパターン付けすることによって、フォトレジスト側壁を持つフォトレジストフィーチャを形成することであって、前記フォトレジストフィーチャは第1微小寸法を有する、フォトレジストフィーチャを形成すること、
前記フォトレジストフィーチャの前記側壁上にコンフォーマルレイヤを堆積することによって、前記フォトレジストフィーチャの前記微小寸法を低減することであって、前記フォトレジストフィーチャの前記側壁上にコンフォーマルレイヤを堆積することは、
第1ガス化学物質での第1堆積によって第1堆積プラズマを形成することであって、
第1堆積ガスの流れを供給することと、
プラズマ中に前記第1堆積ガスを形成することと、
前記第1堆積ガスの流れを停止することとを含む、第1堆積プラズマを形成すること、および
第2ガス化学物質での第2堆積によって第2堆積プラズマを形成することであって、前記第1ガス化学物質は前記第2ガス化学物質と異なり、
前記第1堆積ガスと異なる第2堆積ガスの流れを供給することと、
プラズマ中に前記第2堆積ガスを形成することと、
前記第1堆積ガスの流れと前記第2堆積ガスの流れとが同時ではなく交互に起こるように前記第2堆積ガスの流れを停止することとを含む、第2堆積プラズマを形成すること、を含む、前記フォトレジストフィーチャの前記側壁上にコンフォーマルレイヤを堆積すること、および
前記レイヤ内にフィーチャをエッチングすることであって、前記レイヤフィーチャは、第2微小寸法を有し、前記第2微小寸法は、前記第1微小寸法の70%より大きくない、エッチングすること
を含む方法。 - 請求項17に記載の方法であって、前記第2微小寸法は、前記第1微小寸法の60%より大きくない方法。
- 請求項17に記載の方法であって、前記フォトレジストフィーチャ上に前記コンフォーマルレイヤを堆積することは、
前記第1ガス化学物質での第3堆積によって第3堆積プラズマを形成すること、および
前記第2ガス化学物質での第4堆積によって第4堆積プラズマを形成すること
をさらに含む方法。 - 請求項19に記載の方法であって、前記側壁上に前記コンフォーマルレイヤを堆積することは、実質的に垂直な側壁を形成する方法。
- レイヤ中にフィーチャを形成する装置であって、前記レイヤは、基板によって支持され、前記レイヤは、第1CDを持つフォトレジストフィーチャを持つフォトレジストマスクによって覆われ、前記装置は、
プラズマ処理チャンバであって、
プラズマ処理チャンバエンクロージャを形成するチャンバ壁、
前記プラズマ処理チャンバエンクロージャ内で基板を支持する基板支持、
前記プラズマ処理チャンバエンクロージャ内の圧力を制御する圧力レギュレータ、
プラズマを維持するために前記プラズマ処理チャンバエンクロージャに電力を供給する少なくとも1つの電極、
ガスを前記プラズマ処理チャンバエンクロージャ内に供給するガス吸気口、および
ガスを前記プラズマ処理チャンバエンクロージャから排気するガス出口
を備えるプラズマ処理チャンバ、
前記ガス吸気口と流体連通するガスソースであって、
第1堆積ガスソース、
第2堆積ガスソース、および
エッチャントガスソース
を備えるガスソース、
前記ガスソースおよび前記少なくとも1つの電極に制御可能に接続されたコントローラであって、
少なくとも1つのプロセッサ、および
コンピュータで読み取り可能な媒体であって、
前記フォトレジストフィーチャ内に、第2CDを持つフィーチャを形成するためにフォトレジストマスク上にコンフォーマル側壁堆積を形成するよう少なくとも3つの堆積サイクルを行うコンピュータで読み取り可能なコードであって、
前記第1堆積ガスソースから前記プラズマ処理チャンバエンクロージャへ第1堆積ガスのフローを供給するコンピュータで読み取り可能なコード、
前記第1堆積ガスソースから前記プラズマ処理チャンバエンクロージャへの前記第1堆積ガスのフローを停止するコンピュータで読み取り可能なコード、
前記第1堆積ガスの流れが停止された後で、前記第2堆積ガスソースから前記プラズマ処理チャンバエンクロージャへ第2堆積ガスのフローを供給するコンピュータで読み取り可能なコード、および
前記第2堆積ガスソースから前記プラズマ処理チャンバエンクロージャへの前記第2堆積ガスのフローを停止するコンピュータで読み取り可能なコード
を含む少なくとも3つの堆積サイクルを行うコンピュータで読み取り可能なコード、
前記少なくとも3つの堆積サイクルの完了後に、前記エッチャントガスソースから前記プラズマ処理チャンバへエッチャントガスのフローを供給するコンピュータで読み取り可能なコード、および
前記エッチャントガスを用いて前記レイヤ中でフィーチャをエッチングするコンピュータで読み取り可能なコードであって、前記レイヤ中の前記フィーチャは第3CDを有する、コード
を備えるコンピュータで読み取り可能な媒体を備えるコントローラ
を備える装置。 - 請求項21に記載の装置であって、前記第2CDは前記第1CDの70%より小さく、前記第3CDは前記第1CDの70%より小さい装置。
- 請求項21に記載の装置であって、前記側壁堆積は高度にコンフォーマルである装置。
- 請求項1,2,6−8,17のいずれかに記載の方法であって、前記第1堆積は、ブレッドロウフィング堆積およびファセッティング堆積からなるグループから選択され、前記第2堆積は、ブレッドロウフィング堆積およびファセッティング堆積からなるグループから選択され、前記第1堆積および第2堆積は、両方ともブレッドロウフィング堆積ではなく、両方ともファセッティング堆積ではない方法。
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US10/648,953 US7250371B2 (en) | 2003-08-26 | 2003-08-26 | Reduction of feature critical dimensions |
| US10/648,953 | 2003-08-26 | ||
| PCT/US2004/024853 WO2005024904A2 (en) | 2003-08-26 | 2004-07-29 | Reduction of feature critical dimensions |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2011228441A Division JP2012019242A (ja) | 2003-08-26 | 2011-10-18 | フィーチャ微小寸法の低減 |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JP2007503720A JP2007503720A (ja) | 2007-02-22 |
| JP2007503720A5 JP2007503720A5 (ja) | 2008-02-14 |
| JP4886513B2 true JP4886513B2 (ja) | 2012-02-29 |
Family
ID=34216827
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2006524669A Expired - Fee Related JP4886513B2 (ja) | 2003-08-26 | 2004-07-29 | フィーチャ微小寸法の低減 |
| JP2011228441A Withdrawn JP2012019242A (ja) | 2003-08-26 | 2011-10-18 | フィーチャ微小寸法の低減 |
Family Applications After (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2011228441A Withdrawn JP2012019242A (ja) | 2003-08-26 | 2011-10-18 | フィーチャ微小寸法の低減 |
Country Status (7)
| Country | Link |
|---|---|
| US (2) | US7250371B2 (ja) |
| JP (2) | JP4886513B2 (ja) |
| KR (1) | KR101083622B1 (ja) |
| CN (1) | CN1922722B (ja) |
| SG (1) | SG149047A1 (ja) |
| TW (1) | TWI357094B (ja) |
| WO (1) | WO2005024904A2 (ja) |
Families Citing this family (59)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US20060134917A1 (en) * | 2004-12-16 | 2006-06-22 | Lam Research Corporation | Reduction of etch mask feature critical dimensions |
| US7271107B2 (en) * | 2005-02-03 | 2007-09-18 | Lam Research Corporation | Reduction of feature critical dimensions using multiple masks |
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| US7539969B2 (en) * | 2005-05-10 | 2009-05-26 | Lam Research Corporation | Computer readable mask shrink control processor |
| US7465525B2 (en) * | 2005-05-10 | 2008-12-16 | Lam Research Corporation | Reticle alignment and overlay for multiple reticle process |
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- 2003-08-26 US US10/648,953 patent/US7250371B2/en not_active Expired - Lifetime
-
2004
- 2004-07-29 WO PCT/US2004/024853 patent/WO2005024904A2/en not_active Ceased
- 2004-07-29 CN CN2004800313250A patent/CN1922722B/zh not_active Expired - Fee Related
- 2004-07-29 SG SG200809458-3A patent/SG149047A1/en unknown
- 2004-07-29 KR KR1020067004099A patent/KR101083622B1/ko not_active Expired - Fee Related
- 2004-07-29 JP JP2006524669A patent/JP4886513B2/ja not_active Expired - Fee Related
- 2004-08-09 TW TW093123824A patent/TWI357094B/zh not_active IP Right Cessation
-
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- 2007-06-22 US US11/821,422 patent/US7541291B2/en not_active Expired - Lifetime
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| TWI357094B (en) | 2012-01-21 |
| US20050048785A1 (en) | 2005-03-03 |
| CN1922722A (zh) | 2007-02-28 |
| US7541291B2 (en) | 2009-06-02 |
| JP2007503720A (ja) | 2007-02-22 |
| TW200509213A (en) | 2005-03-01 |
| JP2012019242A (ja) | 2012-01-26 |
| WO2005024904A3 (en) | 2006-06-15 |
| US7250371B2 (en) | 2007-07-31 |
| KR20060126909A (ko) | 2006-12-11 |
| SG149047A1 (en) | 2009-01-29 |
| KR101083622B1 (ko) | 2011-11-16 |
| WO2005024904A2 (en) | 2005-03-17 |
| CN1922722B (zh) | 2011-05-11 |
| US20070293050A1 (en) | 2007-12-20 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20070725 |
|
| A521 | Request for written amendment filed |
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|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20100723 |
|
| A131 | Notification of reasons for refusal |
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|
| A521 | Request for written amendment filed |
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|
| A131 | Notification of reasons for refusal |
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|
| A601 | Written request for extension of time |
Free format text: JAPANESE INTERMEDIATE CODE: A601 Effective date: 20110715 |
|
| A602 | Written permission of extension of time |
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|
| A521 | Request for written amendment filed |
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|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
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| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
| A61 | First payment of annual fees (during grant procedure) |
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|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20141216 Year of fee payment: 3 |
|
| R150 | Certificate of patent or registration of utility model |
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|
| R250 | Receipt of annual fees |
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|
| R250 | Receipt of annual fees |
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| R250 | Receipt of annual fees |
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| R250 | Receipt of annual fees |
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| R250 | Receipt of annual fees |
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|
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| R250 | Receipt of annual fees |
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