JP4861051B2 - 半導体装置および電気ヒューズの切断方法 - Google Patents
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Description
半導体基板と、
前記半導体基板上に形成され、導電体により構成された電気ヒューズと、
を含み、
前記電気ヒューズは、
切断前状態において、それぞれ異なる層に形成された第1の配線と、前記第1の配線に接続されたビアと、前記ビアに接続された第2の配線とを含み、
切断状態において、前記導電体が前記第2の配線から外方に流出してなる流出部が形成されるとともに、前記第1の配線と前記ビアとの間または前記ビアに空隙部が形成される半導体装置が提供される。
半導体基板上に形成され、それぞれ導電体により構成されるとともに異なる層に形成された第1の配線、前記第1の配線に接続されたビア、前記ビアに接続された第2の配線を含む電気ヒューズの切断方法であって、
前記第1の配線と前記第2の配線との間に所定の電圧を印加して前記電気ヒューズに電流を流し、前記導電体を前記第2の配線から外方に流出させるとともに前記ビアと前記第1の配線との間または前記ビアに空隙部を形成する電気ヒューズの切断方法が提供される。
(1)電気ヒューズに過剰なパワーを印加して、たとえば上層配線から電子を過剰に注入することで、配線およびビアを加熱する。
(2)加熱された配線およびビアを構成する導電体が膨張し、周囲の絶縁膜やバリアメタル膜にクラックが発生する。このとき、半導体基板の面内方向の面積が大きい配線(すなわち体積の大きい配線)周囲にクラックが発生する。
(3)絶縁膜やバリアメタル膜のクラック中に導電体が流出し、電気ヒューズを構成する導電体の密度が下がる。
(4)これに伴い、半導体基板の面内方向の面積が小さいビア部分(すなわち体積の小さいビア部分)の導電体が導電体が流出した方向に吸い上げられる。これにより、ビア部分に切断箇所が生じ、電気ヒューズが切断される。
電気ヒューズ200は、導電体206と、その一端および他端にそれぞれ設けられた第1の端子202および第2の端子204とを有する。導電体206は、配線やビアを構成する。ここでは、説明を簡単にするために直線として示す。電気ヒューズ200は、第1の端子202と第2の端子204との間に電流を流すことにより導電体206が切断される電気ヒューズ(Eヒューズ)である。電気ヒューズ200は、半導体基板(不図示)上に形成することができる。ここで、電気ヒューズ200の切断時には、第1の端子202を高電圧(たとえばVcc)とするとともに、第2の端子204を低電圧(たとえば接地)とする。これにより、第1の端子202から第2の端子204の方向に電流が流れる。そのため、電子は第2の端子204から第1の端子202の方向に移動する。第1の端子202と第2の端子204との間に所定の電流値を超える電流を流すと、導電体206が外方に流出してなる流出部212が形成される。また、流出部212の形成に伴い、導電体206が流出部212の方向に急激に移動して、切断箇所214が形成される。
上述したように、本実施の形態において、電気ヒューズ200に過剰なパワーを印加して導電体206に流出部212を形成するとともに切断箇所214を生じさせる。本実施の形態において、第1の端子202と第2の端子204との間には、たとえば2〜5V程度の電圧を印加する。これにより、電気ヒューズ200に流出部212および切断箇所214を形成するようにすることができる。
電気ヒューズ200の第1の端子202は電源線222に接続されており、第2の端子204はトランジスタ220のソース・ドレインの一方に接続されている。トランジスタ220のソース・ドレインの他方は接地される。また、ここでは図示していないが、半導体基板上には複数の電気ヒューズ200が形成され、複数の電気ヒューズ200が電源線222に接続される。そのため、電源線222には、浮遊容量224が付加された状態となる。このように構成された回路において、電気ヒューズ200を切断する手順を説明する。
図中、下の実線は、トランジスタ220のオンオフの状態を示し、上の実線は、電気ヒューズ200の第1の端子202に付与される電位の状態を示す図である。トランジスタ220をオンとするタイミングを図中一点破線で示す。電源線222をオンにした後にトランジスタ220をオンとすると、トランジスタ220がオンとなったタイミングで一瞬の電圧降下が生じるが、その後すぐに電位はVCCとなる。そのため、トランジスタ220をオンとした時点で電気ヒューズ200の両端に電圧値Vccが印加され、電気ヒューズ200に過剰なパワーが印加されることになる。これにより、導電体206を外方に流出させて流出部212を形成するとともに大きな切断箇所214を形成することができる。
ここで、第1の端子202を、電気ヒューズ200を切断することにより減少する電荷量よりも充分大きい電荷量を蓄積できる容量を有する回路に接続しておくことができる。電源線222は、外部端子300を介して外部電源302と接続されている。また、電源線222は、充分大きい容量を有するたとえば外部容量304やESD保護回路306等の回路に接続される。外部容量304は、たとえばプローブカード等のチップ外部に設けた構成とすることができる。電源線222は、外部容量304およびESD保護回路306の両方に接続された構成とすることもでき、いずれか一方に接続された構成とすることもできる。
Q=(C0+C1)×VCC
となる。
ΔQ=Icut×Tcut
となる。
ここで、第1の端子202および下層配線122(第1の配線)は、下層に形成される。第2の端子204および上層配線134(第2の配線)は、上層に形成される。下層配線122と上層配線134とは、上層と下層との間の層に形成されたビア128により電気的に接続される。
図6(a)は切断前の半導体装置100、図6(b)は切断後の半導体装置100の構成を示す断面図である。ここでは、シングルダマシン構造の配線構造を示す。
第1の端子202と第2の端子204との間に所定の電圧を印加して電気ヒューズ200に過剰なパワーが印加されると、電気ヒューズ200の上層配線134を構成する導電体が膨張して、柔らかい膜である第3の層間絶縁膜114の方向に膨張する。導電体の膨張に伴い、第3のバリアメタル膜132等にクラックが生じ、上層配線134を構成する導電体がクラックから第3の層間絶縁膜114中に流出する。つまり、上層配線134を構成する導電体が、配線溝外部に流出する。これにより、図6(b)に示すように、流出部142が形成される。
図7(a)は切断前の半導体装置100、図7(b)は切断後の半導体装置100の構成を示す断面図である。ここでは、配線構造がデュアルダマシン構造を有する点で図6に示した例と異なる。
ここで、ビア128が形成された層間絶縁膜は、SiOC(Black Diamond)により構成した。また、上層配線134が形成された層間絶縁膜は、SiOC(Aurora)により構成した。Black DiamondおよびAuroraはいずれもSiOCのポーラス膜であるが、Auroraの方がBlack Diamondよりも比誘電率が低く、膜密度が低く、柔らかい膜である。
102 第1のエッチング阻止膜
104 第1の層間絶縁膜
106 第1の保護膜
108 第2のエッチング阻止膜
110 第2の層間絶縁膜
112 第3のエッチング阻止膜
114 第3の層間絶縁膜
116 第2の保護膜
118 第4のエッチング阻止膜
120 第1のバリアメタル膜
122 下層配線
126 第2のバリアメタル膜
128 ビア
132 第3のバリアメタル膜
134 上層配線
140 空隙部
142 流出部
150 第5のバリアメタル膜
151 ビア
152 上層配線
154 デュアルダマシン配線
200 電気ヒューズ
202 第1の端子
204 第2の端子
206 導電体
212 流出部
214 切断箇所
220 トランジスタ
222 電源線
224 浮遊容量
300 外部端子
302 外部電源
304 外部容量
306 ESD保護回路
1100 ヒューズ
1101 電流流入端子
1102 電流流出端子
1103 第1往路直線部
1104 復路直線部
1106 第1直角接続部
1107 第2直角接続部
1108 外側の斜線部
1109 内側の斜線部
1113 第2往路直線部
Claims (12)
- 半導体基板と、
前記半導体基板上に形成され、導電体により構成された電気ヒューズと、
を含み、
前記電気ヒューズは、
切断前状態において、それぞれ異なる層に形成された第1の配線と、前記第1の配線に接続されたビアと、前記ビアに接続された第2の配線とを含み、
切断状態において、前記導電体が前記第2の配線から外方に流出してなる流出部が形成されるとともに、前記第1の配線と前記ビアとの間または前記ビアに空隙部が形成される半導体装置。 - 請求項1に記載の半導体装置において、
前記導電体は、銅を主成分として含む銅含有金属膜により構成された半導体装置。 - 請求項2に記載の半導体装置において、
前記電気ヒューズは、前記切断前状態において、前記第1の配線と前記ビアとの間にこれらに接して設けられた第1のバリアメタル膜をさらに含み、
前記切断状態において、前記第1のバリアメタル膜と前記第1の配線との間に前記空隙部が形成される半導体装置。 - 請求項2または3に記載の半導体装置において、
前記電気ヒューズは、前記切断前状態において、前記第2の配線の側面に当該第2の配線に接して設けられた第2のバリアメタル膜をさらに含み、
前記切断状態において、前記第2のバリアメタル膜にクラックが形成され、前記流出部は、前記導電体が前記クラックから流出して形成される半導体装置。 - 請求項1から4いずれかに記載の半導体装置において、
前記第2の配線は、前記第1の配線よりも、前記半導体基板の面内方向の面積が広く形成された半導体装置。 - 請求項1から5いずれかに記載の半導体装置において、
前記半導体基板上において、前記電気ヒューズの周囲に形成された絶縁層をさらに含み、
前記第2の配線は、前記絶縁層に形成された配線溝内に形成され、前記流出部は、前記導電体が前記配線溝外に流出して形成される半導体装置。 - 請求項1から5いずれかに記載の半導体装置において、
前記半導体基板上において、前記電気ヒューズの周囲に形成された絶縁層をさらに含み、
前記絶縁層は、前記ビアの周囲に形成された第1の絶縁層と、前記第2の配線の周囲に形成され、前記第1の絶縁層よりもヤング率の低い第2の絶縁層と、を含む半導体装置。 - 請求項1から5いずれかに記載の半導体装置において、
前記半導体基板上において、前記電気ヒューズの周囲に形成された絶縁層をさらに含み、
前記絶縁層は、前記ビアの周囲に形成された第1の絶縁層と、前記第2の配線の周囲に形成され、前記第1の絶縁層よりも膜密度が低い第2の絶縁層と、を含む半導体装置。 - 請求項1から5いずれかに記載の半導体装置において、
前記半導体基板上において、前記電気ヒューズの周囲に形成された絶縁層をさらに含み、
前記絶縁層は、前記ビアの周囲に形成された第1の絶縁層と、前記第2の配線の周囲に形成され、前記第1の絶縁層よりも誘電率の低い第2の絶縁層と、を含む半導体装置。 - 請求項7から9いずれかに記載の半導体装置において、
前記第2の配線は、前記第2の絶縁層に形成された配線溝内に形成され、前記流出部は、前記導電体が前記配線溝外に流出して形成される半導体装置。 - 半導体基板上に形成され、それぞれ導電体により構成されるとともに異なる層に形成された第1の配線、前記第1の配線に接続されたビア、前記ビアに接続された第2の配線を含む電気ヒューズの切断方法であって、
前記第1の配線と前記第2の配線との間に所定の電圧を印加して前記電気ヒューズに電流を流し、前記導電体を前記第2の配線から外方に流出させるとともに前記ビアと前記第1の配線との間または前記ビアに空隙部を形成する電気ヒューズの切断方法。 - 請求項11に記載の電気ヒューズの切断方法であって、
前記導電体を前記第2の配線から外方に流出させて、前記導電体を前記ビアから前記第2の配線の方向に移動させて、前記空隙部を形成する電気ヒューズの切断方法。
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