JP4766990B2 - 瞬時応答振幅制限増幅回路 - Google Patents
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請求項2にかかる発明は、請求項1に記載の瞬時応答振幅制限増幅回路において、前記n個の増幅手段は、直列接続された同一又は異なる利得のn段の増幅回路からなり、各段の増幅回路の出力を前記n個のヒステリシス比較回路にそれぞれ入力させたことを特徴とする。
請求項3にかかる発明は、請求項1に記載の瞬時応答振幅制限増幅回路において、前記n個の増幅手段は、入力が並列接続された異なる利得のn個の増幅回路からなり、各増幅回路の出力を前記n個のヒステリシス比較回路にそれぞれ入力させたことを特徴とする。
また、最適な利得の増幅手段の選択を各ヒステリシス比較回路の信号有無の判定出力に応じて行うことにより、高速な選択が可能となる。なぜなら、ヒステリシス比較回路の出力振幅は信号が飽和して出力されるため十分に大きく、その有無の判定は高々数ビットで行えるからである。これにより、瞬時応答性を備えることもできる。
2,2A〜2F:差動増幅回路
3,3A〜3C:ヒステリシス比較回路
4:振幅検出回路
5:選択回路
Claims (3)
- 入力信号と該入力信号をデータの1ビット以下だけ遅延した遅延信号との差信号を増幅する利得の異なるn個(nは2以上の整数)の増幅手段と、該n個の増幅手段の各出力をそれぞれ同一のしきい値と比較し前記出力が前記しきい値を超えるとき信号有りの出力を出すn個のヒステリシス比較回路と、該n個のヒステリシス比較回路の出力を入力してその内の1つを選択して出力する選択回路と、前記n個のヒステリシス比較回路の出力信号の有無によって前記ヒステリシス比較回路の出力を選択するよう前記選択回路の選択動作を制御する振幅検出回路とを具備する瞬時応答振幅制限増幅回路であって、
前記振幅検出回路は、前記n個のヒステリシス比較回路の出力信号の有無を検出し、
信号有りの出力をもつ前記ヒステリシス比較回路が1つも無いときは前記ヒステリシス比較回路のいずれの出力も選択しないよう前記選択回路の選択動作を制御し、
信号有りの出力をもつ前記ヒステリシス比較回路が1つのときは当該1つのヒステリシス比較回路の出力を選択するよう前記選択回路の選択動作を制御し、
信号有りの出力をもつ前記ヒステリシス比較回路が2以上あるときは、その内から、最も利得が小さい増幅手段に対応するヒステリシス比較回路の出力を選択するよう前記選択回路の選択動作を制御することを特徴とする瞬時応答振幅制限増幅回路。 - 請求項1に記載の瞬時応答振幅制限増幅回路において、
前記n個の増幅手段は、直列接続された同一又は異なる利得のn段の増幅回路からなり、各段の増幅回路の出力を前記n個のヒステリシス比較回路にそれぞれ入力させたことを特徴とする瞬時応答振幅制限増幅回路。 - 請求項1に記載の瞬時応答振幅制限増幅回路において、
前記n個の増幅手段は、入力が並列接続された異なる利得のn個の増幅回路からなり、各増幅回路の出力を前記n個のヒステリシス比較回路にそれぞれ入力させたことを特徴とする瞬時応答振幅制限増幅回路。
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