JP4758107B2 - 同期分離装置 - Google Patents
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Description
2 第1クランプ回路
3 第2クランプ回路
4 コンパレータ
5 同期信号
6 スライス回路
7,113 クランプパルス
101 入力映像信号
102 第1のクランプ回路
103,105 映像信号
104 第2のクランプ回路
106 スイッチ回路
107 同期分離回路
108 同期タイミング
109 フォーマット検出回路
110 垂直タイミング情報
111 フォーマット情報
112 クランプタイミング発生器
114 AFC回路
115 再生同期信号
116 ロック情報
Claims (8)
- 入力の映像信号にクランプをかける第1のクランプ回路と、
前記第1のクランプ回路の出力を入力とする第2のクランプ回路と、
前記第1のクランプ回路の出力と前記第2のクランプ回路の出力をそれぞれ入力とし、これらのうちの一方を選択して出力するスイッチ回路と、
前記スイッチ回路により選択された出力を入力として前記映像信号から同期信号のタイミング(以下、同期タイミングという)を分離する同期分離回路と、
前記同期分離回路により抽出された同期タイミングを入力として前記映像信号のフォーマット判定を行うフォーマット検出回路と、
前記同期分離回路により抽出された同期タイミングから、当該同期タイミングの内側において前記第2のクランプ回路でクランプをかける期間となるタイミングパルスを生成するクランプタイミング発生器と、
前記同期分離回路により抽出された同期タイミングを基準入力信号として位相同期ループをかけるAFC(Automatic Frequency Control)回路と、
を備え、
前記第1のクランプ回路は入力映像信号をシンク・チップ・クランプ方式によりクランプをかけた映像信号を出力し、
前記第2のクランプ回路は、前記クランプタイミング発生器で生成されたタイミングパルスにより動作して、前記第1のクランプ回路でクランプされた前記映像信号の同期信号の先端部分を当該同期信号の期間の内側において一定のDC電圧に引き込むようにクランプし、
前記スイッチ回路は、フォーマット検出回路が検出するフォーマット情報を確定できない場合は第1のクランプ回路の出力を選択して、前記フォーマット情報を確定した場合は第2のクランプ回路の出力を選択して出力することを特徴とする同期分離装置。 - 前記クランプタイミング発生器は、前記同期分離回路により抽出された同期タイミングのエッジから遅延を持たせて前記タイミングパルスを生成することを特徴とする請求項1記載の同期分離装置。
- 前記第2のクランプ回路は、前記クランプタイミング発生回路から前記タイミングパルスが入力されない場合は動作せずに以前の出力DCレベルを保持することを特徴とする請求項1記載の同期分離装置。
- 前記第2のクランプ回路は、前記クランプタイミング発生器の作成するタイミングパルスにより動作して、前記タイミングパルスの期間を前記フォーマット検出回路において検出した映像信号の各フォーマットによって異なる同期信号の幅に応じたフォーマット情報に基づき可変することを特徴とする請求項1記載の同期分離装置。
- 前記第2のクランプ回路は、フォーマット検出回路が検出するフォーマット情報を用いてクランプのゲインを可変して、映像信号の各フォーマットによって異なる同期信号の周期特性に応じて、前記映像信号をクランプ電圧に引き込むことを特徴とする請求項1記載の同期分離装置。
- 前記第2のクランプ回路は、垂直同期信号期間ではクランプのゲインを上げ、有効画面の水平同期信号期間ではクランプのゲインを下げるクランプ動作を行うことを特徴とする請求項1記載の同期分離装置。
- 前記スイッチ回路は、第1のクランプ回路の出力から第2のクランプ回路の出力に切替えるタイミングとして、フォーマット検出回路が検出した映像信号のフィールドタイミングまたはフレームタイミングの垂直同期タイミングを用いることを特徴とする請求項1記載の同期分離装置。
- 前記スイッチ回路は、第2のクランプ回路の出力から第1のクランプ回路の出力に切替えるタイミングとして、AFC回路における位相同期ループがロックからアンロックとなるタイミングを用いることを特徴とする請求項1記載の同期分離装置。
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