JP4748873B2 - 半導体装置の作製方法 - Google Patents

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Description

【0001】
【発明の属する技術分野】
本発明は、レーザまたはそれに準ずる強光により、基板上に形成された半導体膜に添加されたドーパントを活性化する方法により作製される半導体装置の作製方法に関する。前記半導体装置は、半導体特性を利用することで機能しうる装置全般を指し、例えば、液晶表示装置に代表される電気光学装置、及び電気光学装置を部品として搭載した電気機器、発光装置等も半導体装置の範疇に入るものとする。
【0002】
【従来の技術】
ガラス等の絶縁基板上に形成された半導体膜に対しレーザアニールを行い、結晶化させたり結晶性を向上させたり半導体膜に添加されたドーパントを活性化させたりする技術が広く研究されている。上記半導体膜には珪素膜がよく用いられる。
【0003】
上記絶縁基板にはガラス基板がよく用いられる。ガラス基板であれば、例えば600mm×720mm×0.7mmのサイズの大面積基板に加工することができる。ガラス基板以外には石英基板などが使用されるが、石英基板は大面積化が困難である。このようにガラス基板を使う利点は大きいが、石英基板と比較してガラス基板の融点が低いことが問題である。半導体膜のアニールには比較的高温を要するため、アニールの際のガラス基板の変形が問題となっていた。本問題を解決するために考案されたのが、半導体膜のレーザアニールである。レーザは非常に強いエネルギーを短時間に発光することができるため、物体を非平衡に加熱することが可能である。よって、ガラス基板の温度をあまり上げずに、半導体膜の温度のみを上昇させることが可能となる。すなわち、ガラス基板に成膜された半導体膜のアニールには、レーザを用いるのが好ましい。
【0004】
上記技術により得られた結晶性半導体膜は多くの結晶粒からできているため、多結晶半導体膜と呼ばれる。多結晶半導体膜は、非晶質半導体膜と比較し、非常に高い移動度を有する。このため、多結晶半導体膜を利用すると、例えば、従来の非晶質半導体膜を使って作製した半導体装置では実現できなかったアクティブマトリクス型の液晶表示装置(一枚の基板上に、画素駆動用と駆動回路用の薄膜トランジスタ(TFT)を作製した半導体装置)が作製できる。このように、多結晶半導体膜は、非晶質半導体膜と比較し、非常に特性の高い半導体膜である。
【0005】
一方、非晶質半導体膜の結晶化工程においては、比較的低温の熱処理で行える方法も考案された。前記方法の詳細は特開平7-183540号公報に記載されている。ここで、前記方法を簡単に説明する。まず、非晶質半導体膜にニッケルまたは、パラジウム、または鉛等の元素を微量に添加する。添加の方法は、プラズマ処理法や蒸着法、イオン注入法、スパッタ法、溶液塗布法等を利用すればよい。前記添加の後、非晶質半導体膜を例えば550℃の窒素雰囲気で4時間加熱すると、多結晶半導体膜が得られる。結晶化に最適な加熱温度や加熱時間等は、前記元素の添加量や、非晶質半導体膜の状態による。以上、加熱による非晶質半導体膜の結晶化の方法の例を記した。
【0006】
前述のように、レーザアニールによる結晶化は、基板の温度を余り上昇させずに、非晶質半導体膜にのみ高いエネルギーを与えることが出来るため、歪点の低いガラス基板には勿論、プラスティック基板等にも用いることが出来る。レーザアニールの工程は、半導体膜に添加されたドーパントを活性化させる工程にも用いられる。前記工程は熱アニールで行われることも多い。
【0007】
また、現在の量産工程において、レーザアニールに用いられるレーザはエキシマレーザである。エキシマレーザは、パルス発振式のため出力も大きく、また半導体膜でよく用いられる珪素膜に対し吸収係数が非常に高いため、前記量産工程に用いられる。出力の大きいパルス発振のレーザビームを被照射面において、数cm角の四角いスポットや、長さ10cm以上の線状となるように光学系にて成形し、レーザビームを走査させて(あるいはレーザビームの照射位置を被照射面に対し相対的に移動させて)、レーザアニールを行う方法が、生産性が高く工業的に優れているため、好んで使用されている。
【0008】
特に、被照射面においてレーザビームの形状が線状であるレーザビーム(以下線状ビームと表記する)を用いると、前後左右の走査が必要なスポット状のレーザビームを用いた場合とは異なり、線状ビームの線方向に直角な方向だけの走査で被照射面全体にレーザビームを照射することができるため、生産性が高い。線方向に直角な方向に走査するのは、それが最も効率の良い走査方向であるからである。この高い生産性により、現在レーザアニールにはパルス発振の大出力のレーザを適当な光学系で加工した線状ビームを使用することが主流になりつつある。線状ビームは特にサイズが600mm×720mm×0.7mmのような大面積基板を使った量産工程において有効である。
【0009】
【本発明が解決しようとする課題】
本発明は、半導体膜に添加されたドーパントのレーザによる活性化工程を課題とする。半導体膜にドーピングを行う場合、例えば、トップゲート型のTFTを作製するときは、ゲート電極をマスクとしてドーピングを行うことがよく行われる。ドーピングは主にドーパントをイオン化し加速電圧を加えることで、イオンに速度を与えて半導体膜に打ち込むことにより行われる。ドーピングが行われた後、半導体膜中のドーパントを活性化させるために、レーザや熱によるアニールが行われる。もしくはレーザと熱の両方を併用した方法も採られる。
【0010】
一般に、熱によるドーパントの活性化よりは、レーザによるドーパントの活性化の方が、低抵抗化の点で勝っている。しかしながら、例えばトップゲート型のTFTに対しレーザによるドーパントの活性化を行う場合においては、ゲート電極の下方、もしくはその近傍に位置する半導体膜の一部が陰になるので、そこにレーザが照射されないという欠点も有していた。特に半導体素子としてTFTの信頼性を考えた場合、ゲート電極の下方にも低濃度のドーパントを添加することもよく行われている。このような構造をGold(Gate-Drain Overlapped LDD)構造と呼ぶ。この場合は、ゲート電極の下方のドーパントにレーザを照射することは困難である。この場合は、ガラス基板の裏面側からレーザを照射すればゲート電極の下方のドーパントにレーザを照射することが可能となるが、一般に半導体膜に使われているエキシマレーザはガラスをあまり透過しないのでエネルギー効率が悪く実用的でない。なお、本明細書中においてガラス基板の裏面とは、半導体膜が成膜されていない方の面を指す。本明細書中においてガラス基板の表面とは、半導体膜が成膜されている方の面を指す。また、たとえ上記の低濃度のドーパントが添加された部分(以下低ドーズ領域と呼ぶ。)が無くても、ドーピングされた領域とドーピングされていないチャネル領域との間には高い電界が生じるので、この部分の欠陥密度を低下させる目的で、適当なエネルギーのレーザビームを照射することは重要である。
【0011】
エキシマレーザの発生するような紫外光線のガラスに対する透過率は比較的低いが、一方で可視光線はガラスに対してほとんど透明である。よって、可視光線のレーザをガラス基板の裏面側から照射し半導体膜全体をアニールすることは容易である。しかしながら、可視光線のレーザは一般に、半導体膜に対しても透光性を有しており、半導体膜に一部熱として吸収されるものの、他の一部は光として透過してしまう。可視光線のこの様な性質により、例えばトップゲート型のTFTの製造過程において、ガラス基板の裏面側からレーザ照射を行う場合、光に対する反射率の高いゲート電極の下方に位置するチャネル領域と、反射率の高い物質が上方に配置されないソース領域及びドレイン領域とで、照射されるレーザのエネルギーが変わってしまう。すなわち、ソース領域及びドレイン領域の上方には、特に光を反射するような媒体はないのであるが、チャネル領域の上方や、その他の低ドーズ領域(TFTの構造をGoldと呼ばれる構造とした場合に設けられる領域)の上方には、ゲート電極が位置しているため、ゲート電極からの反射光が、再度チャネル領域や、前記低ドーズ領域に照射されるため、これらの領域には、ソース領域及びドレイン領域に入るエネルギーよりも多くのエネルギーが投入される。従って、ソース領域及びドレイン領域の両方を十分に活性化できるエネルギーを投入すると必要以上にゲート電極の下方に位置するチャネル領域等にエネルギーが投入され、結晶状態が悪くなってしまう場合も出る。
【0012】
本発明の目的は、ソース領域及びドレイン領域に十分なレーザのエネルギーを投入すると同時に、チャネル領域やGold構造のTFTに設けられる低ドーズ領域に必要以上のエネルギーが投入されないレーザアニールの方法を提供することにある。
【0013】
【課題を解決するための手段】
上記目的を達するために、本発明は、基板に対して透明性の高いレーザ若しくはそれに準ずる強い光(本明細書中、これらを総称して光と呼ぶこととする。)を半導体膜が成膜された基板の裏面側から照射し、前記半導体膜を透過した光を基板の表面側に配置された反射板にて反射させ、基板の表面側からソース領域及びドレイン領域に反射光を照射することを特徴とする。本発明はこの様な思想に基づき考案された方法を提供する。本発明は大面積基板にも有効に適用できるため生産性にも優れている。本実施例において、それに準ずる強い光とは、ハロゲンランプ、メタルハライドランプ、高圧水銀ランプ、高圧ナトリウムランプ、キセノンランプ等を指す。基板には、可視光線に対して透過率の高い石英基板や、ガラス基板やプラスチック基板を用いると好ましい。
【0014】
具体的には、例えばガラス基板の表面上に設けられたトップゲート型のTFTのソース領域及びドレイン領域や、その他の低ドーズ領域を活性化する場合、ゲート電極をマスクとしてセルフアラインにてドーズを添加した領域を形成した後、ガラス基板の裏面側から適当な強度にてレーザビームを照射する。本工程を図1(a)に沿って説明する。図1(a)の中で、ガラス基板101と下地膜102とは、活性化工程に用いるレーザビームに対し透光性を有しており、ガラス基板101の側からレーザビームを入射させても活性層103に十分なレーザエネルギーを加えることができる。活性層103のソース領域及びドレイン領域1031には、ゲート電極105をマスクとしてN型もしくはP型の不純物が添加されており、ソース領域及びドレイン領域1031の間には、チャネル領域1032が形成される。活性層103とゲート電極105の間にはゲート絶縁膜104がある。Goldと呼ばれる構造を形成するために、チャネル領域1032の両端でゲート電極の下には低ドーズ領域が設けられる場合もある。
【0015】
図1(a)の状態で、例えば可視光線のレーザビームをガラス基板101の裏側から活性層103に照射すると、レーザビームの一部は活性層103に吸収されるが、他の一部は透過する。透過光の一部は、ゲート電極105にて反射され、再びチャネル領域1032に照射される。他の一部の透過光は、ソース領域及びドレイン領域1031を透過し、そのまま半導体膜の外部に抜けてしまう。この抜けてしまったレーザビームを反射体106にて再び活性層103に照射すると、ゲート電極105がマスクとなるため、ソース領域及びドレイン領域1031のみにレーザビームが照射され、チャネル領域1032にはレーザビームが照射されない。
【0016】
これにより、ゲート電極の下方に位置するチャネル領域等の領域と同等のエネルギーをソース領域及びドレイン領域に照射することが可能となる。ボトムゲート型のTFTのソース領域及びドレイン部分や、その他の低ドーズ領域を活性化する場合も同様の思想でレーザアニールを行えば、本発明の目的を達成できる。ボトムゲート型のTFTの図を図1(b)に示す。ガラス基板107の上にゲート電極108が形成されており、その上にゲート絶縁膜109が形成される。更にその上には、半導体膜110が形成されており、ゲート電極108の直上にチャネル領域1102が、チャネル領域1102の両側には、N型もしくはP型を付与する不純物元素が添加されたソース領域及びドレイン領域1101がある。ソース領域及びドレイン領域1101にドーパントを添加するには、ゲート電極の直上にマスクを形成してから、イオンドープ法もしくはイオン注入法により行えばよい。その後、前記マスクを除去する。この状態で、ガラス基板の表面側からレーザビームを照射し、ガラス基板の裏側に反射体111を配置すれば、トップゲートで得られる効果と同じ効果を得ることができる。
【0017】
反射体106、111はガラス基板からある程度距離をおいて配置した方がよい。特に光源にレーザを用いる場合は、ガラス基板の裏面側から照射されるレーザビーム1と、ガラス基板の表面側から照射されるレーザビーム2とが互いに干渉し、エネルギー分布の均一性が悪化することがあるため、レーザビーム1とレーザビーム2との光路差は、レーザのコヒーレント長以上とする方が好ましい。また、反射体からの反射光が入射光の光路と完全に一致すると、レーザビームがレーザ発振器に戻り、レーザ発振器を破損する恐れがあるので、反射体を2枚のミラーで構成する等、工夫して入射光と反射光との光路を一致させないことが重要である。反射光と入射光のガラス基板における照射位置を完全に一致させなくても本発明の本質には何ら影響しないので、1枚の反射体のみの使用でも構わない。
【0018】
また、このときレーザビームのエネルギーのみでは十分でない場合は、ランプやヒータによりガラス基板を加熱しながら行うとよい。例えば、このとき加熱手段はガラス基板の近傍に配置する。前記加熱手段があることで、レーザビームのエネルギーの不足を補えるため、線状ビームを使用する場合には、線状ビームの長さをより長くすることができる。これにより、一度にレーザアニールできる面積が広がるので、より大面積の基板を効率よく処理することができる。あるいは、反射体からの反射光の基板表面に於けるエネルギー密度が不十分であるときは、反射体を凹面鏡とし、基板表面でのレーザビームのエネルギー密度を増加させてもよい。また、ランプやヒータと凹面鏡を併用してもよい。
【0019】
次に、本発明のレーザの照射方法を実現する装置に関し説明する。基板を水平に設置することを前提とした場合、基板の裏面側から光を照射する方法は、基板を裏に返し上方から光を照射する方法か、基板の下方から光を照射する方法がある。基板を裏に返す方法は非常に装置を複雑にし、生産性も落ちてしまうことから、好ましくない。従って、基板の表面が上方を向くようにし、基板の下方から光を照射するようにすることが好ましい。このような装置構成を実現するためには、例えば、基板を配置するステージが光に対し透明であるとよい。あるいは、基板を配置するステージに隙間を設け、そこから光が入射できる構成としてもよい。この場合は、基板を光に対して相対的に送るために、例えばベルトコンベア方式のような方法を用いて基板を送るとよい。このとき、用いる光は線状ビームであると隙間を細長くできるので好ましい。すなわち、ステージに隙間を設けることによる基板のたわみが最小限に抑えられるので、線状ビームのピント位置の狂いが最小限となる。特に、ガラス基板に大面積のものを用いると基板のたわみは無視できない程度となるため、基板のたわみを抑制する装置構成とする必要が生じる。一般に線状ビームは非常に細いため、ピント位置が数mm狂うだけでエネルギー密度が大幅に変動してしまうので、基板のたわみは1mm以下に抑える必要がある。
【0020】
本発明を以下に列挙する。本発明の1つは、基板の表面に半導体膜を形成し、前記半導体膜上に絶縁膜を形成し、前記絶縁膜上にゲート電極を形成し、前記ゲート電極をマスクとして前記半導体膜に不純物元素を添加し、前記ガラス基板の裏面側から第1の光を照射し、前記基板の表面側から第2の光を照射し、前記第2の光は、前記第1の光の一部が前記基板および前記半導体膜を透過し、前記基板の表面側に設置する反射体によって反射する光であることを特徴とする半導体装置の作製方法である。
【0021】
本発明の他の1つは、基板の表面に半導体膜を形成し、前記半導体膜上に絶縁膜を形成し、前記絶縁膜上にゲート電極を形成し、前記ゲート電極をマスクとして前記半導体膜に不純物元素を添加し、前記ガラス基板の裏面側から第1の光を照射し、前記基板の表面側から第2の光を照射し、前記第2の光は、前記第1の光の一部が前記基板および前記半導体膜を透過し、前記基板の表面側に設置する反射体によって反射する光であり、前記基板の裏面から前記反射体を経由した前記基板の表面までの光路長は、前記第1の光のコヒーレント長より長いことを特徴とする半導体装置の作製方法である。
【0022】
本発明の他の1つは、基板の表面に半導体膜を形成し、前記半導体膜上に絶縁膜を形成し、前記絶縁膜上にゲート電極を形成し、前記ゲート電極をマスクとして前記半導体膜に不純物元素を添加し、前記ガラス基板の裏面側から第1の光を照射し、前記基板の表面側から第2の光を照射し、前記第2の光は、前記第1の光の一部が前記基板および前記半導体膜を透過し、前記基板の表面側に設置する反射体によって反射する光であり、前記第2の光は、前記基板の裏面から前記反射体に到達するまでの光路とは異なる光路で前記基板の表面に到達することを特徴とする半導体装置の作製方法である。
【0023】
上記発明において、前記第1の光および前記第2の光は、レーザ光もしくはそれに準ずる光であることを特徴としている。このようにすると生産性が高いので好ましい。
【0024】
また、上記発明において、前記第1の光は、YAGレーザの第2高調波、YLFレーザの第2高調波、ガラスレーザの第2高調波、YVO4レーザの第2高調波およびArレーザのうちいずれか1つ若しくはそれらの組み合わせからなる光であるとガラス基板や透明な基板等に対して本発明を利用できる。
【0025】
また、上記発明において、前記基板は、ガラス基板であると安価に半導体装置を作製できるのでよい。
【0026】
また、上記発明において、前記反射体は、シリンドリカルの凹面鏡であると前記第2の光の基板表面におけるエネルギー密度を高くできるので好ましい。
【0027】
【発明の実施の形態】
本実施形態では、ゲート電極の下方に低濃度のドーパントを添加したTFTに対しレーザアニールを行う例を示す。ゲート電極の下にレーザを照射するためには、上記で示したように、基板の裏面側から例えばYAGレーザの第2高調波を照射するのがエネルギー効率が良く効果的である。YAGレーザの第2高調波は、緑であるので可視光である。
【0028】
図2に本発明のレーザ照射装置を示す。レーザ発振器201はYAGレーザである。レーザ発振器201から射出されるレーザビームは光学系202〜206により、線状ビームに加工される。YAGレーザは一般に干渉性が高いので、エネルギー分布を均一化するためにはレーザビームを複数に分割して合成する方法(公知のビームの均一化の方法)と組み合わせて、分割されたレーザビームそれぞれに互いに光路差を設ける等の工夫をする必要がある。光路差は、例えば図2において、階段状に加工されたガラス板202にレーザビームを入射させることによりつければよい。階段の各々の段に入射するレーザビームには、ガラスの屈折率が1よりも大きいために光路差がつけられる。前記光路差がレーザビームのコヒーレント長よりも長ければ、レーザビームの干渉性が大きく弱められるため公知のビームの均一化の方法を用いることができる。光路差が付けられたレーザビームの各々をシリンドリカルレンズアレイ203を形成するシリンドリカルレンズに入射させ、これによりレーザビームを分割する。各々のシリンドリカルレンズから射出されるレーザビームはシリンドリカルレンズ204により、照射面またはその近傍にて1つに合成される。これにより一様なエネルギー分布をもつ線状ビームが得られる。
【0029】
レーザビームをガラス基板の下方に入射させるために、光学系を介したレーザビームはミラー205により上方に折り返される。レーザビームは、半導体膜が上方に形成されたガラス基板209に照射される。ガラス基板209は図1(a)の状態になっている。このとき、レーザビームのエネルギー密度を確保するために、集光用のシリンドリカルレンズ206を使って線状ビームを細くしてもよい。また、レーザビームをガラス基板209に対し垂直に入射させると、ガラス基板の裏面からの反射光と半導体膜からの反射光とが干渉し不均一なレーザアニールの原因となるので好ましくない。そこで、ミラー205の角度等を変えることでレーザビームの入射角度を適当に変えて、前記干渉を抑制するとよい。
【0030】
ガラス基板209は、線状ビームを通すための隙間が設けられたステージ207に配置される。ステージ207にはベルトコンベアのような搬送手段208が幾つか設けられており、ガラス基板209を1方向に送る役割を果たす。これによりガラス基板209の全面にレーザビームが照射される。前述した通り、レーザビームの一部はガラス基板209を透過するため、透過光をミラー210により折り返して再びガラス基板209に照射するようにする。ミラー210により折り返されたレーザビームはガラス基板の表に照射されるため、ソース領域及びドレイン領域の部分には照射されるが、ゲート電極の下方に設けられたチャネル領域等には照射されない。ガラス基板209上に設けられた素子に一様にレーザビームを照射するため、レーザビームを照射しながらガラス基板209を搬送手段208にて移動させ、ガラス基板209の全面にレーザビームが照射されるようにする。
【0031】
以上、レーザアニールの方法について述べた。次に、TFTの具体的な作製方法に関し述べる。
【0032】
ゲート電極の下に低ドーズのドーパントを添加したTFTで構成されるアクティブマトリクス基板の作製方法について図3を用いて説明する。本実施形態ではコーニング社の#1737ガラスで形成された基板211を用いる。なお、基板211としては、他のガラス基板や石英基板を用いても良い。また、本実施形態の処理温度に耐えうる耐熱性を有するプラスチック基板を用いてもよい。基板211はYAGの第2高調波に対し、高い透光性を有することが重要である。
【0033】
まず、基板211上に絶縁膜から成る下地膜212を形成する。下地膜212は公知の手段(スパッタ法、LPCVD法、またはプラズマCVD法等)により、酸化珪素膜や窒化酸化珪素膜(SiOxNy)などの珪素を含む絶縁膜を用いれば良い。もちろん下地膜は単層ではなく、積層としてもよい。
【0034】
次いで、下地膜上に半導体膜213を形成する。半導体膜213は、非晶質構造を有する半導体膜を公知の手段(スパッタ法、LPCVD法、またはプラズマCVD法等)により、25〜80nm(好ましくは30〜60nm)の厚さで形成する。半導体膜の材料に限定はないが、好ましくは珪素または珪素ゲルマニウム(SiGe)合金などで形成すると良い。続いて、公知の結晶化処理(レーザ結晶化法、熱結晶化法、またはニッケルなどの触媒を用いた熱結晶化法等)を行って得られる結晶質半導体膜を所望の形状にパターニングする。
【0035】
パターニングされた半導体膜215の上から、絶縁膜214を酸化珪素膜や窒化酸化珪素膜(SiOxNy)などの珪素を含む絶縁膜などで形成し、続いて導電膜216を形成する。導電膜の材料に特に限定はないが、Ta、W、Ti、Mo、Cu、Cr、Ndから選ばれた元素、または前記元素を主成分とする合金材料、もしくは化合物材料で形成してもよい。また、リン等の不純物元素をドーピングした結晶質珪素膜に代表される半導体膜を用いても良い。また、AgPdCu合金を用いてもよい。もちろん、導電膜は単層ではなく積層としてもよい。続いてエッチングを行って端部にテーパーを有するゲート電極217を形成する。
【0036】
そして、ドーピング処理を行って、不純物元素の導入を行う。ドーピング処理はイオンドープ法やイオン注入法などにより、N型またはP型を付与する不純物元素を導入する。ドーピング処理により、不純物元素が高濃度に導入された領域218とゲート電極の端部のテーパーにおり低濃度に導入された領域219および不純物が導入されない領域(チャネル領域)220が形成される。
【0037】
その後、発明実施の形態の前半で説明したレーザアニールの方法により、半導体層の結晶性の回復、半導体層に添加されたドーパントの活性化を行う。レーザは例えばYAGレーザの第2高調波を用い、適当な光学系、例えば図2に示した光学系により線状ビームとして基板の裏面から照射する。その後、例えば公知の方法にて、TFTを完成させる。あるいは実施者の考案した方法にてTFTを作製してもよい。後の実施例にて、TFTの作製工程の例を示す。
【0038】
【実施例】
[実施例1]
本実施例では、レーザビームの照射方法の他の例を示す。レーザビームの照射の際に、照射対象である基板の平坦性が十分でないと、レーザビームのピント位置と基板の位置の制御が困難となる。本実施例では、基板の平坦性を十分に保ちつつレーザビームの照射を行う方法の例を示す。本実施例では、基板を非常に平坦な板の上方にてエア浮上させた状態で基板を走査させ、基板全面をレーザアニールする例を示す。
【0039】
本実施例を図4に沿って説明する。ステージ221にはエアの吹き出し口222が複数個設けられており、これらの吹き出し口222から噴射されるエアの力により、基板224を浮上させる。用いるエアは、窒素や空気等の半導体素子に悪影響の及ばないものとすればよい。前記エアは、ボンベ225から供給される。ステージ221には線状ビーム223を導入する隙間が設けられており、隙間を通って線状ビーム223が基板224に照射される。線状ビーム223を基板224に照射しながら、ステージ221と平行な方向に基板を動かすことで基板224の全面にレーザアニールを行う。基板を動かす方法はさまざま考えられるが、基板がエア浮上している状態にあるので、図示しない手段により、基板の端を押すか、基板の端を把持して引っ張るか等の方法にて行えばよい。
【0040】
用いるレーザ発振器は、たとえばコンティナム社製のパワーライト9030をSHG結晶にて第2高調波に変換して用いる。本レーザ発振器は1パルスあたり800mJのエネルギーを出す能力を持っており、1秒間に最大30パルスを射出することが出来る。ビームのスポットは、直径9mmの円状である。本レーザ発振器から射出したレーザビームを例えば、図2に示した光学系により線状ビームに変換して、本実施例に利用する。YAGレーザのコヒーレント長dは通常10mm程度であることから、階段状に加工されたガラス板202の段差をd/(n-1) とすれば、干渉性を抑えることができる。ガラス板の屈折率はYAGレーザの第2高調波の波長に対して、1.5程度であることから、前記段差を20mmとすればよいことが判る。
【0041】
シリンドリカルレンズアレイ203は、例えば焦点距離30mm、3mm幅のシリンドリカルレンズを3つ使って形成する。これから、階段状に加工されたガラス板202の段数は2段でよいこととなる。階段状に加工されたガラス板202を介さないレーザビームが、シリンドリカルレンズアレイ203の最外のシリンドリカルレンズに入射するように光学系を配置する。階段状に加工されたガラス板202の各段を介したレーザビームはシリンドリカルレンズアレイを形成するシリンドリカルレンズの各々に入射するようにする。
【0042】
シリンドリカルレンズアレイ203を射出したレーザビームはシリンドリカルレンズ204に入射し、これにより照射面にて1つに合成される。このとき、シリンドリカルレンズ204の焦点距離を1500mmとすると、得られる線状ビームの長さは150mmとなる。このままでは、照射面において、十分なエネルギー密度が得られないので、シリンドリカルレンズ206にて、さらに細い線状ビームとし、エネルギー密度を増大させる。干渉の影響を抑えるために、シリンドリカルレンズ206の焦点距離は、400mm以上が好ましい。これにより、干渉の影響の少ない比較的一様なエネルギー分布を持つ線状ビームが得られる。ガラス基板の裏面での反射光との干渉を避けるため、線状ビームは、ガラス基板の斜め方向から入射させる。この角度は実施者が適宜決定すればよいが、目安としては10°前後が適当である。ガラス基板を透過した光は反射ミラーにて、ガラス基板に再び照射され、ソース領域及びドレイン領域のアニールに使われる。前記反射ミラーにより折り返されたレーザビームは、レーザ発振器に戻らないように、やや角度を付けて反射させる。レーザビームが発振器に戻ると固体レーザのロッドを破損する恐れがあるので、十分に注意しなければならない。
【0043】
線状ビームのエネルギー密度は、実施者が適宜決定すればよい。照射対象が厚さ50nm程度の半導体膜であれば、50〜250mJ/cm2程度を目安とすればよい。
【0044】
[実施例2]
本実施例では、レーザビームの照射方法の他の例を示す。本発明の場合、基板の裏面側から照射されたレーザビームは、基板の裏面にピントを合わせてあるので、基板を透過したレーザビームを再びミラー等で基板の表面側から照射するときは、ピント位置が適当でない場合がある。こういった場合には、ミラーに凹面鏡等を用いて再びレーザビームを集光させ、基板の表面にて十分なエネルギー密度を確保すればよい。
【0045】
本実施例を図5に沿って説明する。図中、図4と同一符号のものは、同一のものを指すとする。基板224を透過した線状ビーム223は、シリンドリカルの凹面鏡227により反射され、再び基板224に照射される。このとき、シリンドリカルの凹面鏡227により出来る線状ビームの集光位置の高さは、線状ビーム223により出来る線状ビームの集光位置の高さと同様にするとよい。これにより、ガラス基板の裏面側から照射される線状ビームと表面側から照射される線状ビームとをほぼ同じ短軸幅(本明細書中では、線状ビームを長方形とみたときの短辺の長さとする。)とすることができる。
【0046】
線状ビームの短軸幅は、あまりに細すぎると生産性に乏しくあまりに太すぎるとエネルギー密度を確保できないため、慎重に調整する必要がある。よって、ガラス基板の裏面側から照射される線状ビームの短軸幅と、ガラス基板の表面側から照射される線状ビームの短軸幅とを同様とすることは大切である。実施例1で、示したレーザ発振器を用いるとすると、適当な線状ビームの短軸幅は、50〜1000μm程度である。50μm以下の短軸幅を確保するとなると、非常に特殊な光学系とビーム品質の高いレーザ発振器が必要となるので、装置構成の点でも困難となる。また、1000μm以上の短軸幅を確保するとなるとレーザ発振器の出力が不十分となる可能性が高い。または、エネルギー密度を確保するために非常に短い線状ビームを形成することになる。これでは生産性が低く線状ビームを形成する意味が薄くなる。
【0047】
線状ビームのエネルギー密度は、実施者が適宜決定すればよい。反射体に凹面鏡を使っているため、必要なエネルギー密度は実施例1で示したものよりもやや小さめになる。照射対象が厚さ50nm程度の半導体膜であれば、50〜200mJ/cm2程度を目安とすればよい。
【0048】
[実施例3]
本実施例では、本発明のレーザビームの照射方法に基板の加熱を加えた例を示す。本発明の場合、線状ビームを使用するのが生産性が高く好ましい。また、線状ビームの長さが生産性に密接に関わることから、できるだけ長い線状ビームを得ることが重要である。しかしながら、レーザ発振器の能力以上に線状ビームを長くすることはできないため、本実施例では、レーザビームのエネルギーを補う別のエネルギーを加えることにより、より長い線状ビームを得る方法を示す。
【0049】
本実施例を図6に沿って説明する。図中、図4と同一符号のものは、同一のものを指すとする。基板224を透過した線状ビーム223は、反射体226により反射され、再び基板224に照射される。さらに、ランプ230により基板を加熱すると、レーザビームのエネルギーの不足を補うことができる。ランプ230には、ハロゲンランプ、メタルハライドランプ、高圧水銀ランプ、高圧ナトリウムランプ、キセノンランプ等を用いるとよい。ランプの光は一般的に、全方向に射出されるので、ランプの傘229を使って、光の方向を制限し、光の利用効率を増加させるとよい。
【0050】
ランプ230のガラス基板224における照射位置は、線状ビームの照射位置の辺りとすればよい。一般にガラス基板の歪み点温度は600℃程度であるため、ランプによるガラス基板224の最高到達温度は600℃程度以下とすれば安全である。しかしながら、ガラス基板224の任意の1点におけるランプの照射時間が僅かであるため、歪み点温度を超えた温度で使用しても構わないこともある。実施者は、生産性とガラス基板の耐久性との両方を考慮に入れて最適な組み合わせを決定する必要がある。
【0051】
線状ビームのエネルギー密度は、実施者が適宜決定すればよい。ランプを使っているため必要なエネルギー密度は実施例1で示したものよりもやや小さめになる。照射対象が厚さ50nm程度の半導体膜であれば、50〜200mJ/cm2程度を目安とすればよい。
【0052】
[実施例4]
本実施例では、レーザビームの照射方法の他の例を示す。前述した通り、レーザ装置において、戻り光の対策を考えることは非常に重要である。ガラス基板を透過したレーザビームを反射体にて反射させ再びガラス基板に照射するときに、全く同一箇所にレーザビームを戻してしまうと、レーザビームがレーザ発振器まで戻る可能性が高い。よって、前述の発明はすべて、表面側から照射されるレーザビームの位置と裏面側から照射されるレーザビームの位置をずらさねばならない。しかしながら、反射体の形態を工夫することで、戻り光の懸念を全く問題ない状態とすることができる。
【0053】
本実施例を図7に沿って説明する。図中、図4と同一符号のものは、同一のものを指すとする。基板224を透過した線状ビーム223は、反射体231および232により反射され、再び基板224に照射される。2枚の反射体をうまく配置すると、ガラス基板224の表面に入射する線状ビームの方向と、ガラス基板224の裏面に入射する線状ビームの方向とを互いに異ならしめることができる。よって、反射体からの反射光がレーザ発振器に戻る心配はなくなる。
【0054】
反射体231および232の片側を凹面鏡とし、レーザビームを集光することで照射面におけるエネルギー密度を高くしてもよい。また、半導体膜のアニールに必要なレーザエネルギーを下げるために、ランプと組み合わせてもよい。また、ガラス基板の裏側に入射する線状ビーム223の代わりに、ランプのみを使っても良い。
【0055】
本実施例は、他のいずれの実施例と組み合わせて用いることができる。
【0056】
[実施例5]
本実施例ではアクティブマトリクス基板の作製方法について図8〜12を用いて説明する。本明細書ではCMOS回路、及び駆動回路と、画素TFT、保持容量とを有する画素部を同一基板上に形成された基板を、便宜上アクティブマトリクス基板と呼ぶ。
【0057】
まず、本実施例ではコーニング社の#7059ガラスや#1737ガラスなどに代表されるバリウムホウケイ酸ガラス、またはアルミノホウケイ酸ガラスなどのガラスからなる基板300を用いる。なお、基板300としては、石英基板を用いても良い。また、本実施例の処理温度に耐えうる耐熱性を有し、本実施例で使用するレーザに対し透光性を有するプラスチック基板を用いてもよい。
【0058】
次いで、基板300上に酸化珪素膜、窒化珪素膜または酸化窒化珪素膜などの絶縁膜から成る下地膜301を形成する。本実施例では下地膜301として2層構造を用いるが、前記絶縁膜の単層膜または2層以上積層させた構造を用いても良い。下地膜301の一層目としては、プラズマCVD法を用い、SiH4、NH3、及びN2Oを反応ガスとして成膜される酸化窒化珪素膜301aを10〜200nm(好ましくは50〜100nm)形成する。本実施例では、膜厚50nmの酸化窒化珪素膜301a(組成比Si=32%、O=27%、N=24%、H=17%)を形成した。次いで、下地膜301のニ層目としては、プラズマCVD法を用い、SiH4、及びN2Oを反応ガスとして成膜される酸化窒化珪素膜301bを50〜200nm(好ましくは100〜150nm)の厚さに積層形成する。本実施例では、膜厚100nmの酸化窒化珪素膜301b(組成比Si=32%、O=59%、N=7%、H=2%)を形成する。
【0059】
次いで、下地膜上に図8(B)に示した半導体層402〜406を形成する。半導体層402〜406は公知の手段(スパッタ法、LPCVD法、またはプラズマCVD法等)により25〜80nm(好ましくは30〜60nm)の厚さで半導体膜を成膜し、公知の結晶化法(レーザ結晶化法、RTAやファーネスアニール炉を用いた熱結晶化法、結晶化を助長する金属元素を用いた熱結晶化法等)により結晶化させる。前記半導体膜としては、非晶質半導体膜や微結晶半導体膜、結晶質半導体膜などがあり、非晶質珪素ゲルマニウム膜などの非晶質構造を有する化合物半導体膜を適用しても良い。本実施例では、プラズマCVD法を用い、55nmの非晶質珪素膜302を成膜する。そして、例えば、ニッケルを含む溶液を非晶質珪素膜上に保持させ金属含有層303を形成し、この非晶質珪素膜に脱水素化(500℃、1時間)を行なった後、熱結晶化(550℃、4時間)を行なって結晶質珪素膜を形成する。
【0060】
続いてフォトリソグラフィ法を用いてレジストからなるマスクを半導体層402〜406の直上に形成し、半導体膜に15族に属する元素、または、希ガス、または、15族に属する元素および13族に属する元素を添加して、不純物領域を形成する。ドーピング処理はイオンドープ法、若しくはイオン注入法で行えば良い。イオンドープ法の条件はドーズ量を5×1013/cm2以上とし、加速電圧を10〜100keVとして行なう。本実施例ではドーズ量を5×1015/cm2とし、加速電圧を30keVとして行った。ここでは、希ガスに属する元素でArを用いた。
【0061】
次いで、結晶化を促進するために用いた金属元素を不純物領域にゲッタリングするための加熱処理を行なう。前記加熱処理はファーネスアニール炉を用いる熱アニール法で行なう。熱アニール法としては、酸素濃度が1ppm以下、好ましくは0.1ppm以下の窒素雰囲気中で400℃以上で行なう。本実施例では550℃、4時間の加熱処理を行った。これにより、被ゲッタリング領域のニッケルの含有量を大幅に減らすことが出来る。
【0062】
レジストを除去し、ゲッタリングの終了した結晶質半導体膜の不純物領域を除去して半導体層402〜406を形成する。
【0063】
また、レーザ結晶化法で結晶質半導体膜を作製する場合には、パルス発振型または連続発光型のエキシマレーザやYAGレーザ、YVO4レーザ、YLFレーザ、YAlO3レーザ、ガラスレーザ、ルビーレーザ、Ti:サファイアレーザ等を用いることができる。これらのレーザを用いる場合には、レーザ発振器から放射されたレーザビームを光学系で線状に集光し半導体膜に照射する方法を用いると良い。結晶化の条件は実施者が適宣選択するものであるが、エキシマレーザを用いる場合はパルス発振周波数300Hzとし、レーザエネルギー密度を100〜700mJ/cm2(代表的には200〜300mJ/cm2)とする。また、YAGレーザを用いる場合にはその第2高調波を用いパルス発振周波数30〜3000Hzとし、レーザエネルギー密度を300〜1000mJ/cm2(代表的には350〜500mJ/cm2)とすると良い。そして幅50〜1000μm、例えば400μmで線状に集光したレーザ光を基板全面に渡って照射し、この時の線状ビームの重ね合わせ率(オーバーラップ率)を50〜98%として行なってもよい。
【0064】
また、半導体層402〜406を形成した後、TFTのしきい値を制御するために微量な不純物元素(ボロンまたはリン)のドーピングを行なってもよい。
【0065】
次いで、半導体層402〜406を覆うゲート絶縁膜407を形成する。ゲート絶縁膜407はプラズマCVD法またはスパッタ法を用い、厚さを40〜150nmとして珪素を含む絶縁膜で形成する。本実施例では、プラズマCVD法により110nmの厚さで酸化窒化珪素膜(組成比Si=32%、O=59%、N=7%、H=2%)で形成した。もちろん、ゲート絶縁膜は酸化窒化珪素膜に限定されるものでなく、他の珪素を含む絶縁膜を単層または積層構造として用いても良い。
【0066】
また、酸化珪素膜を用いる場合には、プラズマCVD法でTEOS(Tetraethyl Orthosilicate)とO2とを混合し、反応圧力40Pa、基板温度300〜400℃とし、高周波(13.56MHz)電力密度0.5〜0.8W/cm2で放電させて形成することができる。このようにして作製される酸化珪素膜は、その後400〜500℃の熱アニールによりゲート絶縁膜として良好な特性を得ることができる。
【0067】
次いで、図8(B)に示すように、ゲート絶縁膜407上に膜厚20〜100nmの第1の導電膜408と、膜厚100〜400nmの第2の導電膜409とを積層形成する。本実施例では、膜厚30nmのTaN膜からなる第1の導電膜408と、膜厚370nmのW膜からなる第2の導電膜409を積層形成した。TaN膜はスパッタ法で形成し、Taのターゲットを用い、窒素を含む雰囲気内でスパッタした。また、W膜は、Wのターゲットを用いたスパッタ法で形成した。その他に6フッ化タングステン(WF6)を用いる熱CVD法で形成することもできる。いずれにしてもゲート電極として使用するためには低抵抗化を図る必要があり、W膜の抵抗率は20μΩcm以下にすることが望ましい。W膜は結晶粒を大きくすることで低抵抗率化を図ることができるが、W膜中に酸素などの不純物元素が多い場合には結晶化が阻害され高抵抗化する。従って、本実施例では、高純度のW(純度99.9999%)のターゲットを用いたスパッタ法で、さらに成膜時に気相中からの不純物の混入がないように十分配慮してW膜を形成することにより、抵抗率9〜20μΩcmを実現することができた。
【0068】
なお、本実施例では、第1の導電膜408をTaN、第2の導電膜409をWとしたが、特に限定されず、いずれもTa、W、Ti、Mo、Al、Cu、Cr、Ndから選ばれた元素、または前記元素を主成分とする合金材料若しくは化合物材料で形成してもよい。また、リン等の不純物元素をドーピングした結晶質珪素膜に代表される半導体膜を用いてもよい。また、AgPdCu合金を用いてもよい。また、第1の導電膜をタンタル(Ta)膜で形成し、第2の導電膜をW膜とする組み合わせ、第1の導電膜を窒化チタン(TiN)膜で形成し、第2の導電膜をW膜とする組み合わせ、第1の導電膜を窒化タンタル(TaN)膜で形成し、第2の導電膜をAl膜とする組み合わせ、第1の導電膜を窒化タンタル(TaN)膜で形成し、第2の導電膜をCu膜とする組み合わせとしてもよい。第1の導電膜を窒化タンタル(TaN)膜で形成し、第2の導電膜をAl膜とし、さらに第3の導電膜としてTi膜を組み合わせてもよい。
【0069】
次に、フォトリソグラフィ法を用いてレジストからなるマスク410〜415を形成し、電極及び配線を形成するための第1のエッチング処理を行なう。第1のエッチング処理では第1及び第2のエッチング条件で行なう。本実施例では第1のエッチング条件として、ICP(Inductively Coupled Plasma:誘導結合型プラズマ)エッチング法を用い、エッチング用ガスにCF4とCl2とO2とを用い、それぞれのガス流量比を25/25/10(sccm)とし、1Paの圧力でコイル型の電極に500WのRF(13.56MHz)電力を投入してプラズマを生成してエッチングを行った。ここでは、松下電器産業(株)製のICPを用いたドライエッチング装置(Model E645−□ICP)を用いた。基板側(試料ステージ)にも150WのRF(13.56MHz)電力を投入し、実質的に負の自己バイアス電圧を印加する。この第1のエッチング条件によりW膜をエッチングして第1の導電層の端部をテーパー形状とする。
【0070】
この後、レジストからなるマスク410〜415を除去せずに第2のエッチング条件に変え、エッチング用ガスにCF4とCl2とを用い、それぞれのガス流量比を30/30(sccm)とし、1Paの圧力でコイル型の電極に500WのRF(13.56MHz)電力を投入してプラズマを生成して約30秒程度のエッチングを行った。基板側(試料ステージ)にも20WのRF(13.56MHz)電力を投入し、実質的に負の自己バイアス電圧を印加する。CF4とCl2を混合した第2のエッチング条件ではW膜及びTaN膜とも同程度にエッチングされる。なお、ゲート絶縁膜上に残渣を残すことなくエッチングするためには、10〜20%程度の割合でエッチング時間を増加させると良い。
【0071】
上記第1のエッチング処理では、レジストからなるマスクの形状を適したものとすることにより、基板側に印加するバイアス電圧の効果により第1の導電層及び第2の導電層の端部がテーパー形状となる。このテーパー部の角度は15〜45°となる。こうして、第1のエッチング処理により第1の導電層と第2の導電層から成る第1の形状の導電層417〜422(第1の導電層417a〜422aと第2の導電層417b〜422b)を形成する。416はゲート絶縁膜であり、第1の形状の導電層417〜422で覆われない領域は20〜50nm程度エッチングされ薄くなった領域が形成される。
【0072】
そして、レジストからなるマスクを除去せずに第1のドーピング処理を行い、半導体層にn型を付与する不純物元素を添加する。(図9(A))ドーピング処理はイオンドープ法、若しくはイオン注入法で行なえば良い。イオンドープ法の条件はドーズ量を1×1013〜5×1015/cm2とし、加速電圧を60〜100keVとして行なう。本実施例ではドーズ量を1.5×1015/cm2とし、加速電圧を80keVとして行った。n型を付与する不純物元素として15族に属する元素、典型的にはリン(P)または砒素(As)を用いるが、ここではリン(P)を用いた。この場合、導電層417〜421がn型を付与する不純物元素に対するマスクとなり、自己整合的に第1の高濃度不純物領域306〜310が形成される。第1の高濃度不純物領域306〜310には1×1020〜1×1021/cm3の濃度範囲でn型を付与する不純物元素を添加する。
【0073】
次いで、レジストからなるマスクを除去せずに第2のエッチング処理を行なう。ここでは、エッチングガスにCF4とCl2とO2とを用い、W膜を選択的にエッチングする。この時、第2のエッチング処理により第2の導電層428b〜433bを形成する。一方、第1の導電層417a〜422aは、ほとんどエッチングされず、第2の形状の導電層428〜433を形成する。
【0074】
次いで、レジストからなるマスクを除去せずに、図9(B)に示すように、第2のドーピング処理を行なう。この場合、第1のドーピング処理よりもドーズ量を下げて、70〜120keVの高い加速電圧で、n型を付与する不純物元素を導入する。本実施例ではドーズ量を1.5×1014/cm2とし、加速電圧を90keVとして行なった。第2のドーピング処理は第2の形状の導電層428〜433をマスクとして用い、第2の導電層428b〜433bの下方における半導体層にも不純物元素が導入され、新たに第2の高濃度不純物領域423a〜427aおよび低濃度不純物領域423b〜427bが形成される。
【0075】
次いで、レジストからなるマスクを除去した後、新たにレジストからなるマスク434aおよび434bを形成して、図9(C)に示すように、第3のエッチング処理を行なう。エッチング用ガスにSF6およびCl2とを用い、ガス流量比を50/10(sccm)とし、1.3Paの圧力でコイル型の電極に500WのRF(13.56MHz)電力を投入してプラズマを生成し、約30秒のエッチング処理を行なう。基板側(資料ステージ)には10WのRF(13.56MHz)電力を投入し、実質的には不の自己バイアス電圧を印加する。こうして、前記大3のエッチング処理により、pチャネル型TFTおよび画素部のTFT(画素TFT)のTaN膜をエッチングして、第3の形状の導電層435〜438を形成する。
【0076】
次いで、レジストからなるマスクを除去した後、第2の形状の導電層428、430および第2の形状の導電層435〜438をマスクとして用い、ゲート絶縁膜416を選択的に除去して絶縁層439〜444を形成する。(図10(A))
【0077】
次いで、新たにレジストからなるマスク445a〜445cを形成して第3のドーピング処理を行なう。この第3のドーピング処理により、pチャネル型TFTの活性層となる半導体層に前記一導電型とは逆の導電型を付与する不純物元素が添加された不純物領域446、447を形成する。第2の導電層435a、438aを不純物元素に対するマスクとして用い、p型を付与する不純物元素を添加して自己整合的に不純物領域を形成する。本実施例では、不純物領域446、447はジボラン(B26)を用いたイオンドープ法で形成する。(図10(B))この第3のドーピング処理の際には、nチャネル型TFTを形成する半導体層はレジストからなるマスク445a〜445cで覆われている。第1のドーピング処理及び第2のドーピング処理によって、不純物領域446、447にはそれぞれ異なる濃度でリンが添加されているが、そのいずれの領域においてもp型を付与する不純物元素の濃度を2×1020〜2×1021/cm3となるようにドーピング処理することにより、pチャネル型TFTのソース領域およびドレイン領域として機能するために何ら問題は生じない。本実施例では、pチャネル型TFTの活性層となる半導体層の一部が露呈しているため、不純物元素(ボロン)を添加しやすい利点を有している。
【0078】
以上までの工程で、それぞれの半導体層に不純物領域が形成される。
【0079】
次いで、レジストからなるマスク445a〜445cを除去して第1の層間絶縁膜461を形成する。この第1の層間絶縁膜461としては、プラズマCVD法またはスパッタ法を用い、厚さを100〜200nmとして珪素を含む絶縁膜で形成する。本実施例では、プラズマCVD法により膜厚150nmの酸化窒化珪素膜を形成した。もちろん、第1の層間絶縁膜461は酸化窒化珪素膜に限定されるものでなく、他の珪素を含む絶縁膜を単層または積層構造として用いても良い。
【0080】
次いで、図10(C)に示すように、本発明が開示するレーザによる処理を行なう。これにより半導体層の結晶性の回復、それぞれの半導体層に添加された不純物元素の活性化を行なう。また、レーザの代わりになる光源があればそれを用いても良い。本工程の手順を以下に示す。基板300の裏面側からレーザを照射し、不純物領域446および447をレーザアニールする。このとき基板300を透過したレーザは反射ミラー106により反射され、基板300の表側から不純物領域446a、446b、447a、447bに再び照射される。これにより、不純物領域446c、446d、447c、447dに入射するレーザエネルギーを増やすことなしに、不純物領域446a、446b、447a、447bに入射するレーザエネルギーを増やすことができる。基板300全面に一様なレーザアニールを行うには、例えば、発明実施の形態で示した線状ビームを使用すればよい。あるいは、点光源のレーザをガルバノメータなどで走査して基板全面にレーザビームを照射してもよい。
【0081】
さらに、3〜100%の水素を含む雰囲気中で、300〜550℃で1〜12時間の熱処理を行ない、半導体層を水素化する工程を行なう。本実施例では水素を約3%の含む窒素雰囲気中で410℃、1時間の熱処理を行った。この工程は層間絶縁膜に含まれる水素により半導体層のダングリングボンドを終端する工程である。水素化の他の手段として、プラズマ水素化(プラズマにより励起された水素を用いる)を行なっても良い。
【0082】
次いで、第1の層間絶縁膜461上に無機絶縁膜材料または有機絶縁物材料から成る第2の層間絶縁膜462を形成する。本実施例では、膜厚1.6μmのアクリル樹脂膜を形成したが、粘度が10〜1000cp、好ましくは40〜200cpのものを用い、表面に凸凹が形成されるものを用いた。
【0083】
本実施例では、鏡面反射を防ぐため、表面に凸凹が形成される第2の層間絶縁膜を形成することによって画素電極の表面に凸凹を形成した。また、画素電極の表面に凹凸を持たせて光散乱性を図るため、画素電極の下方の領域に凸部を形成してもよい。その場合、凸部の形成は、TFTの形成と同じフォトマスクで行なうことができるため、工程数の増加なく形成することができる。なお、この凸部は配線及びTFT部以外の画素部領域の基板上に適宜設ければよい。こうして、凸部を覆う絶縁膜の表面に形成された凸凹に沿って画素電極の表面に凸凹が形成される。
【0084】
また、第2の層間絶縁膜462として表面が平坦化する膜を用いてもよい。その場合は、画素電極を形成した後、公知のサンドブラスト法やエッチング法等の工程を追加して表面を凹凸化させて、鏡面反射を防ぎ、反射光を散乱させることによって白色度を増加させることが好ましい。
【0085】
そして、駆動回路506において、各不純物領域とそれぞれ電気的に接続する配線463〜467を形成する。なお、これらの配線は、膜厚50nmのTi膜と、膜厚500nmの合金膜(AlとTiとの合金膜)との積層膜をパターニングして形成する。
【0086】
また、画素部507においては、画素電極470、ゲート配線469、接続電極468を形成する。(図11)この接続電極468によりソース配線(443bと449の積層)は、画素TFTと電気的な接続が形成される。また、ゲート配線469は、画素TFTのゲート電極と電気的な接続が形成される。また、画素電極470は、画素TFTのドレイン領域442と電気的な接続が形成され、さらに保持容量を形成する一方の電極として機能する半導体層458と電気的な接続が形成される。また、画素電極470としては、AlまたはAgを主成分とする膜、またはそれらの積層膜等の反射性の優れた材料を用いることが望ましい。
【0087】
以上の様にして、nチャネル型TFT501とpチャネル型TFT502からなるCMOS回路、及びnチャネル型TFT503を有する駆動回路506と、画素TFT504、保持容量505とを有する画素部507を同一基板上に形成することができる。こうして、アクティブマトリクス基板が完成する。
【0088】
駆動回路506のnチャネル型TFT501はチャネル領域423c、ゲート電極の一部を構成する第1の導電層428aと重なる低濃度不純物領域423b(GOLD領域)、とソース領域またはドレイン領域として機能する高濃度不純物領域423aを有している。このnチャネル型TFT501と電極466で接続してCMOS回路を形成するpチャネル型TFT502にはチャネル領域446d、ゲート電極の外側に形成される不純物領域446b、446c、ソース領域またはドレイン領域として機能する高濃度不純物領域446aを有している。また、nチャネル型TFT503にはチャネル領域425c、ゲート電極の一部を構成する第1の導電層430aと重なる低濃度不純物領域425b(GOLD領域)、とソース領域またはドレイン領域として機能する高濃度不純物領域425aを有している。
【0089】
画素部の画素TFT504にはチャネル領域426c、ゲート電極の外側に形成される低濃度不純物領域426b(LDD領域)とソース領域またはドレイン領域として機能する高濃度不純物領域426aを有している。また、保持容量505の一方の電極として機能する半導体層447a、447bには、それぞれp型を付与する不純物元素が添加されている。保持容量505は、絶縁膜444を誘電体として、電極(438aと438bの積層)と、半導体層447a〜447cとで形成している。
【0090】
また、本実施例の画素構造は、ブラックマトリクスを用いることなく、画素電極間の隙間が遮光されるように、画素電極の端部をソース配線と重なるように配置形成する。
【0091】
また、本実施例で作製するアクティブマトリクス基板の画素部の上面図を図12に示す。なお、図8〜図11に対応する部分には同じ符号を用いている。図11中の鎖線A−A’は図12中の鎖線A―A’で切断した断面図に対応している。また、図11中の鎖線B−B’は図12中の鎖線B―B’で切断した断面図に対応している。
【0092】
[実施例6]
本実施例では、実施例5で作製したアクティブマトリクス基板から、反射型液晶表示装置を作製する工程を以下に説明する。説明には図13を用いる。
【0093】
まず、実施例5に従い、図11の状態のアクティブマトリクス基板を得た後、図11のアクティブマトリクス基板上、少なくとも画素電極470上に配向膜567を形成しラビング処理を行なう。なお、本実施例では配向膜567を形成する前に、アクリル樹脂膜等の有機樹脂膜をパターニングすることによって基板間隔を保持するための柱状のスペーサ572を所望の位置に形成した。また、柱状のスペーサに代えて、球状のスペーサを基板全面に散布してもよい。
【0094】
次いで、対向基板569を用意する。次いで、対向基板569上に着色層570、571、平坦化膜573を形成する。赤色の着色層570と青色の着色層572とを重ねて、遮光部を形成する。また、赤色の着色層と緑色の着色層とを一部重ねて、遮光部を形成してもよい。
【0095】
本実施例では、実施例5に示す基板を用いている。従って、実施例5の画素部の上面図を示す図12では、少なくともゲート配線469と画素電極470の間隙と、ゲート配線469と接続電極468の間隙と、接続電極468と画素電極470の間隙を遮光する必要がある。本実施例では、それらの遮光すべき位置に着色層の積層からなる遮光部が重なるように各着色層を配置して、対向基板を貼り合わせた。
【0096】
このように、ブラックマスク等の遮光層を形成することなく、各画素間の隙間を着色層の積層からなる遮光部で遮光することによって工程数の低減を可能とした。
【0097】
次いで、平坦化膜573上に透明導電膜からなる対向電極576を少なくとも画素部に形成し、対向基板の全面に配向膜574を形成し、ラビング処理を施した。
【0098】
そして、画素部と駆動回路が形成されたアクティブマトリクス基板と対向基板とをシール材568で貼り合わせる。シール材568にはフィラーが混入されていて、このフィラーと柱状スペーサによって均一な間隔を持って2枚の基板が貼り合わせられる。その後、両基板の間に液晶材料575を注入し、封止剤(図示せず)によって完全に封止する。液晶材料575には公知の液晶材料を用いれば良い。このようにして図13に示す反射型液晶表示装置が完成する。そして、必要があれば、アクティブマトリクス基板または対向基板を所望の形状に分断する。さらに、対向基板のみに偏光板(図示しない)を貼りつけた。そして、公知の技術を用いてFPCを貼りつけた。
【0099】
以上のようにして作製される液晶表示パネルは各種電子機器の表示部として用いることができる。
【0100】
また、本実施例は実施例1乃至5のいずれか一と自由に組み合わせることが可能である。
【0101】
[実施例7]
本実施例では、発光装置を作製した例について説明する。本明細書において、発光装置とは、基板上に形成された発光素子を該基板とカバー材の間に封入した表示用パネルおよび該表示用パネルにICを実装した表示用モジュールを総称したものである。なお、発光素子は、電場を加えることで発生するルミネッセンス(Electro Luminescence)が得られる有機化合物を含む層(発光層)と陽極層と、陰極層とを有する。また、有機化合物におけるルミネッセンスには、一重項励起状態から基底状態に戻る際の発光(蛍光)と三重項励起状態から基底状態に戻る際の発光(リン光)があり、これらのうちどちらか、あるいは両方の発光を含む。
【0102】
図14は本実施例の発光装置の断面図である。図14において、基板700上に設けられたスイッチングTFT603は図11のnチャネル型TFT503を用いて形成される。したがって、構造の説明はnチャネル型TFT503の説明を参照すれば良い。
【0103】
なお、本実施例ではチャネル領域が二つ形成されるダブルゲート構造としているが、チャネル領域が一つ形成されるシングルゲート構造もしくは三つ形成されるトリプルゲート構造であっても良い。
【0104】
基板700上に設けられた駆動回路は図11のCMOS回路を用いて形成される。従って、構造の説明はnチャネル型TFT501とpチャネル型TFT502の説明を参照すれば良い。なお、本実施例ではシングルゲート構造としているが、ダブルゲート構造もしくはトリプルゲート構造であっても良い。
【0105】
また、配線701、703はCMOS回路のソース配線、702はドレイン配線として機能する。また、配線704はソース配線708とスイッチングTFTのソース領域とを電気的に接続する配線として機能し、配線705はドレイン配線709とスイッチングTFTのドレイン領域とを電気的に接続する配線として機能する。
【0106】
なお、電流制御TFT604は図11のpチャネル型TFT502を用いて形成される。従って、構造の説明はpチャネル型TFT502の説明を参照すれば良い。なお、本実施例ではシングルゲート構造としているが、ダブルゲート構造もしくはトリプルゲート構造であっても良い。
【0107】
また、配線706は電流制御TFTのソース配線(電流供給線に相当する)であり、707は電流制御TFTの画素電極710上に重ねることで画素電極710と電気的に接続する電極である。
【0108】
なお、710は、透明導電膜からなる画素電極(発光素子の陽極)である。透明導電膜としては、酸化インジウムと酸化スズとの化合物、酸化インジウムと酸化亜鉛との化合物、酸化亜鉛、酸化スズまたは酸化インジウムを用いることができる。また、前記透明導電膜にガリウムを添加したものを用いても良い。画素電極710は、上記配線を形成する前に平坦な層間絶縁膜711上に形成する。本実施例においては、樹脂からなる平坦化膜711を用いてTFTによる段差を平坦化することは非常に重要である。後に形成される発光層は非常に薄いため、段差が存在することによって発光不良を起こす場合がある。従って、発光層をできるだけ平坦面に形成しうるように画素電極を形成する前に平坦化しておくことが望ましい。
【0109】
配線701〜707を形成後、図14に示すようにバンク712を形成する。バンク712は100〜400nmの珪素を含む絶縁膜もしくは有機樹脂膜をパターニングして形成すれば良い。
【0110】
なお、バンク712は絶縁膜であるため、成膜時における素子の静電破壊には注意が必要である。本実施例ではバンク712の材料となる絶縁膜中にカーボン粒子や金属粒子を添加して抵抗率を下げ、静電気の発生を抑制する。この際、抵抗率は1×106〜1×1012Ωm(好ましくは1×108〜1×1010Ωm)となるようにカーボン粒子や金属粒子の添加量を調節すれば良い。
【0111】
画素電極710の上には発光層713が形成される。なお、図14では一画素しか図示していないが、本実施例ではR(赤)、G(緑)、B(青)の各色に対応した発光層を作り分けている。また、本実施例では蒸着法により低分子系有機発光材料を形成している。具体的には、正孔注入層として20nm厚の銅フタロシアニン(CuPc)膜を設け、その上に発光層として70nm厚のトリス−8−キノリノラトアルミニウム錯体(Alq3)膜を設けた積層構造としている。Alq3にキナクリドン、ペリレンもしくはDCM1といった蛍光色素を添加することで発光色を制御することができる。
【0112】
但し、以上の例は発光層として用いることのできる有機発光材料の一例であって、これに限定する必要はまったくない。発光層、電荷輸送層または電荷注入層を自由に組み合わせて発光層(発光及びそのためのキャリアの移動を行わせるための層)を形成すれば良い。例えば、本実施例では低分子系有機発光材料を発光層として用いる例を示したが、高分子系有機発光材料を用いても良い。また、電荷輸送層や電荷注入層として炭化珪素等の無機材料を用いることも可能である。これらの有機発光材料や無機材料は公知の材料を用いることができる。
【0113】
次に、発光層713の上には導電膜からなる陰極714が設けられる。本実施例の場合、導電膜としてアルミニウムとリチウムとの合金膜を用いる。勿論、公知のMgAg膜(マグネシウムと銀との合金膜)を用いても良い。陰極材料としては、周期表の1族もしくは2族に属する元素からなる導電膜もしくはそれらの元素を添加した導電膜を用いれば良い。
【0114】
この陰極714まで形成された時点で発光素子715が完成する。なお、ここでいう発光素子715は、画素電極(陽極)710、発光層713及び陰極714で形成されたダイオードを指す。
【0115】
発光素子715を完全に覆うようにしてパッシベーション膜716を設けることは有効である。パッシベーション膜716としては、炭素膜、窒化珪素膜もしくは窒化酸化珪素膜を含む絶縁膜からなり、該絶縁膜を単層もしくは組み合わせた積層で用いる。
【0116】
この際、カバレッジの良い膜をパッシベーション膜として用いることが好ましく、炭素膜、特にDLC(ダイヤモンドライクカーボン)膜を用いることは有効である。DLC膜は室温から100℃以下の温度範囲で成膜可能であるため、耐熱性の低い発光層713の上方にも容易に成膜することができる。また、DLC膜は酸素に対するブロッキング効果が高く、発光層713の酸化を抑制することが可能である。そのため、この後に続く封止工程を行う間に発光層713が酸化するといった問題を防止できる。
【0117】
さらに、パッシベーション膜716上に封止材717を設け、カバー材718を貼り合わせる。封止材717としては紫外線硬化樹脂を用いれば良く、内部に吸湿効果を有する物質もしくは酸化防止効果を有する物質を設けることは有効である。また、本実施例においてカバー材718はガラス基板や石英基板やプラスチック基板(プラスチックフィルムも含む)の両面に炭素膜(好ましくはダイヤモンドライクカーボン膜)を形成したものを用いる。
【0118】
こうして図14に示すような構造の発光装置が完成する。なお、バンク712を形成した後、パッシベーション膜716を形成するまでの工程をマルチチャンバー方式(またはインライン方式)の成膜装置を用いて、大気解放せずに連続的に処理することは有効である。また、さらに発展させてカバー材718を貼り合わせる工程までを大気解放せずに連続的に処理することも可能である。
【0119】
こうして、基板700上にnチャネル型TFT601、602、スイッチングTFT(nチャネル型TFT)603および電流制御TFT(nチャネル型TFT)604が形成される。ここまでの製造工程で必要としたマスク数は、一般的なアクティブマトリクス型発光装置よりも少ない。
【0120】
即ち、TFTの製造工程が大幅に簡略化されており、歩留まりの向上および製造コストの低減が実現できる。
【0121】
さらに、図14を用いて説明したように、ゲート電極に絶縁膜を介して重なる不純物領域を設けることによりホットキャリア効果に起因する劣化に強いnチャネル型TFTを形成することができる。そのため、信頼性の高い発光装置を実現できる。
【0122】
また、本実施例では画素部と駆動回路の構成のみ示しているが、本実施例の製造工程に従えば、その他にも信号分割回路、D/Aコンバータ、オペアンプ、γ補正回路などの論理回路を同一の絶縁体上に形成可能であり、さらにはメモリやマイクロプロセッサをも形成しうる。
【0123】
さらに、発光素子を保護するための封止(または封入)工程まで行った後の本実施例の発光装置について図15を用いて説明する。なお、必要に応じて図14で用いた符号を引用する。
【0124】
図15(A)は、発光素子の封止までを行った状態を示す上面図、図15(B)は図15(A)をC−C’で切断した断面図である。点線で示された801はソース側駆動回路、806は画素部、807はゲート側駆動回路である。また、901はカバー材、902は第1シール材、903は第2シール材であり、第1シール材902で囲まれた内側には封止材907が設けられる。
【0125】
なお、904はソース側駆動回路801及びゲート側駆動回路807に入力される信号を伝送するための配線であり、外部入力端子となるFPC(フレキシブルプリントサーキット)905からビデオ信号やクロック信号を受け取る。なお、ここではFPCしか図示されていないが、このFPCにはプリント配線基盤(PWB)が取り付けられていても良い。本明細書における発光装置には、発光装置本体だけでなく、それにFPCもしくはPWBが取り付けられた状態をも含むものとする。
【0126】
次に、断面構造について図15(B)を用いて説明する。基板700の上方には画素部806、ゲート側駆動回路807が形成されており、画素部806は電流制御TFT604とそのドレインに電気的に接続された画素電極710を含む複数の画素により形成される。また、ゲート側駆動回路807はnチャネル型TFT601とpチャネル型TFT602とを組み合わせたCMOS回路(図15参照)を用いて形成される。
【0127】
画素電極710は発光素子の陽極として機能する。また、画素電極710の両端にはバンク712が形成され、画素電極710上には発光層713および発光素子の陰極714が形成される。
【0128】
陰極714は全画素に共通の配線としても機能し、接続配線904を経由してFPC905に電気的に接続されている。さらに、画素部806及びゲート側駆動回路807に含まれる素子は全て陰極714およびパッシベーション膜567で覆われている。
【0129】
また、第1シール材902によりカバー材901が貼り合わされている。なお、カバー材901と発光素子との間隔を確保するために樹脂膜からなるスペーサを設けても良い。そして、第1シール材902の内側には封止材907が充填されている。なお、第1シール材902、封止材907としてはエポキシ系樹脂を用いるのが好ましい。また、第1シール材902はできるだけ水分や酸素を透過しない材料であることが望ましい。さらに、封止材907の内部に吸湿効果をもつ物質や酸化防止効果をもつ物質を含有させても良い。
【0130】
発光素子を覆うようにして設けられた封止材907はカバー材901を接着するための接着剤としても機能する。また、本実施例ではカバー材901を構成するプラスチック基板901aの材料としてFRP(Fiberglass-Reinforced Plastics)、PVF(ポリビニルフロライド)、マイラー、ポリエステルまたはアクリルを用いることができる。
【0131】
また、封止材907を用いてカバー材901を接着した後、封止材907の側面(露呈面)を覆うように第2シール材903を設ける。第2シール材903は第1シール材902と同じ材料を用いることができる。
【0132】
以上のような構造で発光素子を封止材907に封入することにより、発光素子を外部から完全に遮断することができ、外部から水分や酸素等の発光層の酸化による劣化を促す物質が侵入することを防ぐことができる。従って、信頼性の高い発光装置が得られる。
【0133】
[実施例8]
本発明を適用して、様々な電気光学装置(アクティブマトリクス型液晶表示装置、アクティブマトリクス型発光装置、アクティブマトリクス型EC表示装置)を作製することができる。即ち、それら電気光学装置を表示部に組み込んだ電子機器全てに本発明を実施できる。
【0134】
その様な電子機器としては、ビデオカメラ、デジタルカメラ、プロジェクター、ヘッドマウントディスプレイ(ゴーグル型ディスプレイ)、カーナビゲーション、カーステレオ、パーソナルコンピュータ、携帯情報端末(モバイルコンピュータ、携帯電話または電子書籍等)などが挙げられる。それらの一例を図16、図17及び図18に示す。
【0135】
図16(A)はパーソナルコンピュータであり、本体2001、画像入力部2002、表示部2003、キーボード2004等を含む。本発明を表示部2003に適用することができる。
【0136】
図16(B)はビデオカメラであり、本体2101、表示部2102、音声入力部2103、操作スイッチ2104、バッテリー2105、受像部2106等を含む。本発明を表示部2102に適用することができる。
【0137】
図16(C)はモバイルコンピュータ(モービルコンピュータ)であり、本体2201、カメラ部2202、受像部2203、操作スイッチ2204、表示部2205等を含む。本発明は表示部2205に適用できる。
【0138】
図16(D)はゴーグル型ディスプレイであり、本体2301、表示部2302、アーム部2303等を含む。本発明は表示部2302に適用することができる。
【0139】
図16(E)はプログラムを記録した記録媒体(以下、記録媒体と呼ぶ)を用いるプレイヤーであり、本体2401、表示部2402、スピーカ部2403、記録媒体2404、操作スイッチ2405等を含む。なお、このプレイヤーは記録媒体としてDVD(Digtial Versatile Disc)、CD等を用い、音楽鑑賞や映画鑑賞やゲームやインターネットを行なうことができる。本発明は表示部2402に適用することができる。
【0140】
図16(F)はデジタルカメラであり、本体2501、表示部2502、接眼部2503、操作スイッチ2504、受像部(図示しない)等を含む。本発明を表示部2502に適用することができる。
【0141】
図17(A)はフロント型プロジェクターであり、投射装置2601、スクリーン2602等を含む。本発明は投射装置2601の一部を構成する液晶表示装置2808やその他の駆動回路に適用することができる。
【0142】
図17(B)はリア型プロジェクターであり、本体2701、投射装置2702、ミラー2703、スクリーン2704等を含む。本発明は投射装置2702の一部を構成する液晶表示装置2808やその他の駆動回路に適用することができる。
【0143】
なお、図17(C)は、図17(A)及び図17(B)中における投射装置2601、2702の構造の一例を示した図である。投射装置2601、2702は、光源光学系2801、ミラー2802、2804〜2806、ダイクロイックミラー2803、プリズム2807、液晶表示装置2808、位相差板2809、投射光学系2810で構成される。投射光学系2810は、投射レンズを含む光学系で構成される。本実施例は三板式の例を示したが、特に限定されず、例えば単板式であってもよい。また、図17(C)中において矢印で示した光路に実施者が適宜、光学レンズや、偏光機能を有するフィルムや、位相差を調節するためのフィルム、IRフィルム等の光学系を設けてもよい。
【0144】
また、図17(D)は、図17(C)中における光源光学系2801の構造の一例を示した図である。本実施例では、光源光学系2801は、リフレクター2811、光源2812、レンズアレイ2813、2814、偏光変換素子2815、集光レンズ2816で構成される。なお、図17(D)に示した光源光学系は一例であって特に限定されない。例えば、光源光学系に実施者が適宜、光学レンズや、偏光機能を有するフィルムや、位相差を調節するフィルム、IRフィルム等の光学系を設けてもよい。
【0145】
ただし、図17に示したプロジェクターにおいては、透過型の電気光学装置を用いた場合を示しており、反射型の電気光学装置及び発光装置での適用例は図示していない。
【0146】
図18(A)は携帯電話であり、本体2901、音声出力部2902、音声入力部2903、表示部2904、操作スイッチ2905、アンテナ2906等を含む。本発明を表示部2904に適用することができる。
【0147】
図18(B)は携帯書籍(電子書籍)であり、本体3001、表示部3002、3003、記憶媒体3004、操作スイッチ3005、アンテナ3006等を含む。本発明は表示部3002、3003に適用することができる。
【0148】
図18(C)はディスプレイであり、本体3101、支持台3102、表示部3103等を含む。本発明は表示部3103に適用することができる。本発明のディスプレイは特に大画面化した場合において有利であり、対角10インチ以上(特に30インチ以上)のディスプレイには有利である。
【0149】
以上の様に、本発明の適用範囲は極めて広く、あらゆる分野の電子機器に適用することが可能である。また、本実施例の電子機器は実施例1〜7のどのような組み合わせからなる構成を用いても実現することができる。
【0150】
【発明の効果】
本発明を半導体装置の作製工程に適用すれば、半導体膜の不純物領域を熱処理の場合と比較して低抵抗化でき、かつ、TFTのチャネル領域近傍の結晶の欠陥を修復できるので、特性の向上につながる。また、半導体装置の作製工程において、熱工程を減らすことができるので生産性が上がる。
【図面の簡単な説明】
【図1】 本発明の実施の一例を示す側面図。
【図2】 本発明の実施の一例を示す立体図。
【図3】 半導体装置の作製工程の一例を示す側面図。
【図4】 本発明の実施の一例を示す立体図。
【図5】 本発明の実施の一例を示す立体図。
【図6】 本発明の実施の一例を示す立体図。
【図7】 本発明の実施の一例を示す立体図。
【図8】 半導体装置の作製工程の一例を示す側面図。
【図9】 半導体装置の作製工程の一例を示す側面図。
【図10】 半導体装置の作製工程の一例を示す側面図。
【図11】 半導体装置の作製工程の一例を示す側面図。
【図12】 半導体装置の作製工程の一例を示す上面図。
【図13】 半導体装置の作製工程の一例を示す側面図。
【図14】 発光装置の構造の一例を示す側面図。
【図15】 発光装置の構造の一例を示す上面図及び側面図。
【図16】 半導体装置の例を示す図。
【図17】 半導体装置の例を示す図。
【図18】 半導体装置の例を示す図。
【符号の説明】
101 ガラス基板
102 下地膜
103 活性層
1031 ソース領域及びドレイン領域
1032 チャネル領域
104 ゲート絶縁膜
105 ゲート電極
106 反射体
107 ガラス基板
108 ゲート電極
109 ゲート絶縁膜
110 半導体膜
1101 ソース領域及びドレイン領域
1102 チャネル領域
111 反射体
201 レーザ発振器
202 階段状に加工されたガラス板
203 シリンドリカルレンズアレイ
204 シリンドリカルレンズ
205 ミラー
206 集光用のシリンドリカルレンズ
207 ステージ
208 搬送手段
209 ガラス基板
210 ミラー
211 基板
212 下地膜
213 半導体膜
214 絶縁膜
215 パターニングされた半導体膜
216 導電膜
217 ゲート電極
218 不純物元素が高濃度に導入された領域
219 不純物元素が低濃度に導入された領域
220 不純物が導入されない領域
221 ステージ
222 エアの吹き出し口
223 線状ビーム
224 基板
225 ボンベ
226 反射体
227 シリンドリカルの凹面鏡
228 反射体
229 かさ
230 ランプ
231 反射体
232 反射体

Claims (10)

  1. 不純物元素を添加した半導体膜と、ゲート電極と、前記半導体膜と前記ゲート電極に挟まれた絶縁膜と、を形成し、
    前記半導体膜側に設置された光源から前記半導体膜に第1の光を照射し、
    前記ゲート電極側から前記半導体膜に第2の光を照射し、
    前記第2の光は、前記第1の光の一部が前記ゲート電極側に設置された反射体によって反射した光であることを特徴とする半導体装置の作製方法。
  2. 透光性を有する板表面に半導体膜を形成
    前記半導体膜上に絶縁膜を形成
    前記絶縁膜上にゲート電極を形成
    前記ゲート電極をマスクとして前記半導体膜に不純物元素を添加
    記基板の裏面側に設置された光源から前記半導体膜に第1の光を照射し、
    前記基板の表面側から前記半導体膜に第2の光を照射し、
    記第2の光は、前記第1の光の一部が前記基板の表面側に設置された反射体によって反射した光であることを特徴とする半導体装置の作製方法。
  3. 透光性を有する基板表面にゲート電極を形成し、
    前記基板および前記ゲート電極上に絶縁膜を形成し、
    前記絶縁膜上に半導体膜を形成し、
    前記半導体膜に不純物元素を添加し、
    前記基板の表面側に設置された光源から前記半導体膜に第1の光を照射し、
    前記基板の裏面側から前記半導体膜に第2の光を照射し、
    前記第2の光は、前記第1の光の一部が前記基板の裏面側に設置された反射体によって反射した光であることを特徴とする半導体装置の作製方法。
  4. 請求項1乃至請求項3のいずれか一項において、
    前記光源から前記反射体を経由した前記半導体膜までの光路長は、前記第1の光のコヒーレント長より長いことを特徴とする半導体装置の作製方法。
  5. 請求項1乃至請求項4のいずれか一項において、
    前記第2の光は、前記光源から前記反射体に到達するまでの光路とは異なる光路で前記半導体膜に照射されることを特徴とする半導体装置の作製方法。
  6. 請求項5において、
    前記反射体は、2枚のミラーからなることを特徴とする半導体装置の作製方法。
  7. 請求項1乃至請求項6のいずれか一項において、
    前記第1の光および前記第2の光は、レーザ光もしくはそれに準ずる光であることを特徴とする半導体装置の作製方法。
  8. 請求項1乃至請求項7のいずれか一項において、
    前記第1の光は、YAGレーザの第2高調波、YLFレーザの第2高調波、ガラスレーザの第2高調波、YVOレーザの第2高調波およびArレーザのうちいずれか1つしくはそれらの組み合わせからなる光であることを特徴とする半導体装置の作製方法。
  9. 請求項1乃至請求項8のいずれか一項において、
    前記反射体は、シリンドリカルの凹面鏡であることを特徴とする半導体装置の作製方法。
  10. 請求項2乃至請求項9のいずれか一項において、
    ランプにより前記基板を加熱することを特徴とする半導体装置の作製方法。
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP3831790A4 (en) * 2018-07-27 2022-06-01 Cowindst Co., Ltd. LOW EMISSIVITY GLASS Annealing Device

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4660074B2 (ja) * 2003-05-26 2011-03-30 富士フイルム株式会社 レーザアニール装置
JP4954497B2 (ja) * 2004-05-21 2012-06-13 株式会社半導体エネルギー研究所 半導体装置及び半導体装置の作製方法
US7569503B2 (en) * 2004-11-24 2009-08-04 Nanosys, Inc. Contact doping and annealing systems and processes for nanowire thin films
JP6991927B2 (ja) * 2018-05-30 2022-01-13 キヤノン株式会社 基板保持装置、露光装置及び物品の製造方法
WO2021048758A1 (en) * 2019-09-10 2021-03-18 King Abdullah University Of Science And Technology Self-forming nanogap method and device

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS58186949A (ja) * 1982-04-26 1983-11-01 Toshiba Corp 薄膜半導体装置の製造方法
JPH09246555A (ja) * 1996-03-04 1997-09-19 Matsushita Electric Ind Co Ltd 薄膜トランジスタの製造方法
JPH10178178A (ja) * 1996-12-19 1998-06-30 Sharp Corp 半導体装置の製造方法
JPH1187724A (ja) * 1997-09-11 1999-03-30 Matsushita Electric Ind Co Ltd 半導体素子の製造方法
JP2000133810A (ja) * 1998-10-28 2000-05-12 Sony Corp 薄膜トランジスタの製造方法及びアニール装置
JP3185881B2 (ja) * 1998-10-28 2001-07-11 日本電気株式会社 レーザ照射装置およびレーザ照射方法
JP3504528B2 (ja) * 1999-03-18 2004-03-08 株式会社日本製鋼所 レーザ光照射装置
JP4501173B2 (ja) * 1999-05-14 2010-07-14 ソニー株式会社 半導体膜の製造方法および半導体素子の製造方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP3831790A4 (en) * 2018-07-27 2022-06-01 Cowindst Co., Ltd. LOW EMISSIVITY GLASS Annealing Device

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