JP3331090B2 - ディスク記録再生装置のデータ再生処理装置及びデータ再生方法 - Google Patents
ディスク記録再生装置のデータ再生処理装置及びデータ再生方法Info
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- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/48—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed
- G11B5/58—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed with provision for moving the head for the purpose of maintaining alignment of the head relative to the record carrier during transducing operation, e.g. to compensate for surface irregularities of the latter or for track following
- G11B5/596—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed with provision for moving the head for the purpose of maintaining alignment of the head relative to the record carrier during transducing operation, e.g. to compensate for surface irregularities of the latter or for track following for track following on disks
- G11B5/59688—Servo signal format patterns or signal processing thereof, e.g. dual, tri, quad, burst signal patterns
Description
【０００１】
【産業上の利用分野】本発明は、例えば磁気ディスク装
置等のディスク記録再生装置に使用し、特にＰＲＭＬ方
式の信号処理技術を採用したデータ再生処理装置に関す
る。
置等のディスク記録再生装置に使用し、特にＰＲＭＬ方
式の信号処理技術を採用したデータ再生処理装置に関す
る。
【０００２】
【従来の技術】従来、ハードディスク装置（ＨＤＤ）等
の磁気ディスク装置は、ヘッドによりディスクから読出
したリード信号を再生処理して、記録データ（例えばＮ
ＲＺコード等の変調コード）に再生するためのデータ再
生処理回路（以下リードチャネルと称する）を有する。
の磁気ディスク装置は、ヘッドによりディスクから読出
したリード信号を再生処理して、記録データ（例えばＮ
ＲＺコード等の変調コード）に再生するためのデータ再
生処理回路（以下リードチャネルと称する）を有する。
【０００３】リードチャネルは、図６に示すように、ヘ
ッドアンプ１から出力されたリード信号ＲＳを再生処理
して、再生した記録データＮＲＺをリードＰＬＬ（ＶＦ
Ｏ回路）１２から出力されたリードクロック（同期クロ
ック信号）ＲＣと共に、ディスクコントローラ（ＨＤ
Ｃ）２に出力する。ヘッドアンプ１は、ヘッドにより読
出されたリード信号を増幅する増幅器である。
ッドアンプ１から出力されたリード信号ＲＳを再生処理
して、再生した記録データＮＲＺをリードＰＬＬ（ＶＦ
Ｏ回路）１２から出力されたリードクロック（同期クロ
ック信号）ＲＣと共に、ディスクコントローラ（ＨＤ
Ｃ）２に出力する。ヘッドアンプ１は、ヘッドにより読
出されたリード信号を増幅する増幅器である。
【０００４】ところで近年、記憶容量の大容量化に伴い
高記録密度化を実現する技術として、ＰＲＭＬ（Ｐａｒ
ｔｉａｌ Ｒｅｓｐｏｎｓｅ Ｍａｘｉｍｕｍ Ｌｉｋ
ｅｌｉｈｏｏｄ）方式と呼ばれる信号処理技術を採用し
たリードチャネルが提案されている。
高記録密度化を実現する技術として、ＰＲＭＬ（Ｐａｒ
ｔｉａｌ Ｒｅｓｐｏｎｓｅ Ｍａｘｉｍｕｍ Ｌｉｋ
ｅｌｉｈｏｏｄ）方式と呼ばれる信号処理技術を採用し
たリードチャネルが提案されている。
【０００５】このＰＲＭＬ方式のリードチャネルは、図
６に示すように、ＰＲ（Ｐａｒｔｉａｌ Ｒｅｓｐｏｎ
ｓｅ）等化器（ＰＲイコライザ）６と、予め相関させた
データ系列の再生に最も確からしい系列を選ぶＭＬ（最
尤）復号化方式のビタビ（ｖｉｔｅｒｂｉ）デコーダ
（復号化回路）９とを含む回路である。ＰＲＭＬ方式は
従来のピーク検出方式と比較してＳ／Ｎ特性が優れてお
り、エラーレートも極めて低いという特長を備えてい
る。
６に示すように、ＰＲ（Ｐａｒｔｉａｌ Ｒｅｓｐｏｎ
ｓｅ）等化器（ＰＲイコライザ）６と、予め相関させた
データ系列の再生に最も確からしい系列を選ぶＭＬ（最
尤）復号化方式のビタビ（ｖｉｔｅｒｂｉ）デコーダ
（復号化回路）９とを含む回路である。ＰＲＭＬ方式は
従来のピーク検出方式と比較してＳ／Ｎ特性が優れてお
り、エラーレートも極めて低いという特長を備えてい
る。
【０００６】リードチャネルは、前記の回路要素以外
に、自動ゲインコントローラ（ＡＧＣ）８によりゲイン
調整可能な利得調整機能を備えたアンプ（ＶＧＡ）３、
ローパスフィルタ（ＬＰＦ）４、Ａ／Ｄコンバータ５、
シンク（ｓｙｎｃ）バイト検出回路７、記録デコーダ
（ＮＲＺデコーダ）１０、ライトクロック生成回路１
１、クロック切換え回路１３を有する。
に、自動ゲインコントローラ（ＡＧＣ）８によりゲイン
調整可能な利得調整機能を備えたアンプ（ＶＧＡ）３、
ローパスフィルタ（ＬＰＦ）４、Ａ／Ｄコンバータ５、
シンク（ｓｙｎｃ）バイト検出回路７、記録デコーダ
（ＮＲＺデコーダ）１０、ライトクロック生成回路１
１、クロック切換え回路１３を有する。
【０００７】ＶＧＡ３はヘッドアンプ１からのリード信
号ＲＳのレベルを一定に保持する。ＬＰＦ４はリード信
号ＲＳから高域ノイズを除去する。Ａ／Ｄコンバータ５
はアナログのリード信号ＲＳをディジタルデータに変換
する。
号ＲＳのレベルを一定に保持する。ＬＰＦ４はリード信
号ＲＳから高域ノイズを除去する。Ａ／Ｄコンバータ５
はアナログのリード信号ＲＳをディジタルデータに変換
する。
【０００８】シンクバイト検出回路７は、図７に示すよ
うに、ディスク上のトラックフォーマットを構成する各
データエリアのシンクバイトエリア（ＳＢ）をサーチ
し、その検出信号ＳＢＤをＨＤＣ２に出力する。
うに、ディスク上のトラックフォーマットを構成する各
データエリアのシンクバイトエリア（ＳＢ）をサーチ
し、その検出信号ＳＢＤをＨＤＣ２に出力する。
【０００９】ここで、図７に示すフォーマットは、ディ
スク上のトラックフォーマット構成ではなく、ヘッドに
より読出されたリード信号ＲＳのフォーマットを意味す
る。各データエリアはユーザデータＵＤの記録エリアを
含むデータセクタであり、サーボ情報を記録した各サー
ボエリア（サーボセクタ）の間に配列されている。ＣＤ
Ｒ（ｃｏｎｓｔａｎｔ ｄｅｎｓｉｔｙ ｒｅｃｏｒｄ
ｉｎｇ）方式では、各サーボエリア間に配列されるデー
タセクタ数は同一ではない。
スク上のトラックフォーマット構成ではなく、ヘッドに
より読出されたリード信号ＲＳのフォーマットを意味す
る。各データエリアはユーザデータＵＤの記録エリアを
含むデータセクタであり、サーボ情報を記録した各サー
ボエリア（サーボセクタ）の間に配列されている。ＣＤ
Ｒ（ｃｏｎｓｔａｎｔ ｄｅｎｓｉｔｙ ｒｅｃｏｒｄ
ｉｎｇ）方式では、各サーボエリア間に配列されるデー
タセクタ数は同一ではない。
【００１０】シンクバイトエリア（ＳＢ）は、デコーダ
１０によりＮＲＺ（ｎｏｎ ｒｅｔｕｒｎ ｔｏ ｚｅ
ｒｏ）コード（ＮＲＺデータ）を、バイト単位で復調す
るときの同期を取るための情報を記録している。また、
ＶＦＯエリア（ＰＬＬシンクエリア）は、データ弁別ウ
インドウの同期を取るためのエリアであり、予め決定さ
れた周波数の同期パターンからなるプリアンブルデータ
を記録している。即ち、リードＰＬＬ１２はＶＦＯエリ
アのプリアンブルデータの範囲内で、位相引込み（ａｃ
ｑｕｉｓｉｔｉｏｎ）を実行する。図７において、リー
ドＰＬＬ１２の時間Ｔａｃはその位相引込み時間を示
す。
１０によりＮＲＺ（ｎｏｎ ｒｅｔｕｒｎ ｔｏ ｚｅ
ｒｏ）コード（ＮＲＺデータ）を、バイト単位で復調す
るときの同期を取るための情報を記録している。また、
ＶＦＯエリア（ＰＬＬシンクエリア）は、データ弁別ウ
インドウの同期を取るためのエリアであり、予め決定さ
れた周波数の同期パターンからなるプリアンブルデータ
を記録している。即ち、リードＰＬＬ１２はＶＦＯエリ
アのプリアンブルデータの範囲内で、位相引込み（ａｃ
ｑｕｉｓｉｔｉｏｎ）を実行する。図７において、リー
ドＰＬＬ１２の時間Ｔａｃはその位相引込み時間を示
す。
【００１１】リードチャネルは、通常ではＨＤＣ２から
供給されるリードゲートＲＧと称する起動タイミング信
号に同期してデータ再生処理を開始する。即ち、図７に
示すように、リードゲートＲＧがＯＮ（論理レベル
“Ｈ”）したときからデータ再生処理を開始し、ＯＦＦ
（論理レベル“Ｌ”）した時点で停止となる。
供給されるリードゲートＲＧと称する起動タイミング信
号に同期してデータ再生処理を開始する。即ち、図７に
示すように、リードゲートＲＧがＯＮ（論理レベル
“Ｈ”）したときからデータ再生処理を開始し、ＯＦＦ
（論理レベル“Ｌ”）した時点で停止となる。
【００１２】ＨＤＤでは、各データセクタの先頭部を検
出するためのセクタパルスＳＰを生成する制御回路（ゲ
ートアレイのロジック回路とＣＰＵからなる）が設けら
れている。ＨＤＣ２は、データ再生処理の開始時点で
は、セクタパルスＳＰの入力に同期してリードゲートＲ
ＧをＯＮする。
出するためのセクタパルスＳＰを生成する制御回路（ゲ
ートアレイのロジック回路とＣＰＵからなる）が設けら
れている。ＨＤＣ２は、データ再生処理の開始時点で
は、セクタパルスＳＰの入力に同期してリードゲートＲ
ＧをＯＮする。
【００１３】リードゲートＲＧのＯＮにより、図７に示
すように、リードＰＬＬ１２は位相引込み動作を開始
し、ＡＧＣ８は高速追従モードでリード信号ＲＳの振幅
を安定させるようにＶＧＡ３のゲインを制御する動作を
開始する（時間Ｔａｇ）。また、シンクバイト検出回路
７がシンクバイトエリア（ＳＢ）のサーチを開始する
（時間Ｔｓｓ）。
すように、リードＰＬＬ１２は位相引込み動作を開始
し、ＡＧＣ８は高速追従モードでリード信号ＲＳの振幅
を安定させるようにＶＧＡ３のゲインを制御する動作を
開始する（時間Ｔａｇ）。また、シンクバイト検出回路
７がシンクバイトエリア（ＳＢ）のサーチを開始する
（時間Ｔｓｓ）。
【００１４】ＮＲＺデコーダ１０は、図８に示すよう
に、リードゲートＲＧがＯＮしてからＯＦＦするまでに
ＮＲＺデータをＨＤＣ２に出力する。ＨＤＣ２はＥＣＣ
（ｅｒｒｏｒ ｃｈｅｃｋｉｎｇ ａｎｄ ｃｏｒｒｅ
ｃｔｉｏｎ）データを認識した後に、リードゲートＲＧ
をＯＦＦする。
に、リードゲートＲＧがＯＮしてからＯＦＦするまでに
ＮＲＺデータをＨＤＣ２に出力する。ＨＤＣ２はＥＣＣ
（ｅｒｒｏｒ ｃｈｅｃｋｉｎｇ ａｎｄ ｃｏｒｒｅ
ｃｔｉｏｎ）データを認識した後に、リードゲートＲＧ
をＯＦＦする。
【００１５】なお、図８において、「ＲＣ」はリードＰ
ＬＬ１２が出力するリードクロックＲＣによる制御状態
を示すタイミングチャートである。リードゲートＲＧが
ＯＦＦしている期間（Ｔ６，Ｔ７）の「Ｗ」は、リード
ＰＬＬ１２がライトクロック生成回路１１からのライト
クロックパルスＷＣにロックされていることを意味して
いる。即ち、図６に示すように、クロック切換え回路１
３は、リードゲートＲＧがＯＦＦすると、ライトクロッ
ク生成回路１１の出力側にスイッチを切り換える。した
がって、リードゲートＲＧがＯＮのときには、クロック
切換え回路１３は、リード信号ＲＳのＶＦＯエリアの同
期クロックをリードＰＬＬ１２に供給するように、ここ
ではＰＲイコライザ６の出力側にスイッチを切り換え
る。「Ｄ」は、リードゲートＲＧがＯＮしている期間
に、リードクロックＲＣをサンプルクロックとして、Ａ
／Ｄコンバータ５からのディジタルデータの出力を意味
している。
ＬＬ１２が出力するリードクロックＲＣによる制御状態
を示すタイミングチャートである。リードゲートＲＧが
ＯＦＦしている期間（Ｔ６，Ｔ７）の「Ｗ」は、リード
ＰＬＬ１２がライトクロック生成回路１１からのライト
クロックパルスＷＣにロックされていることを意味して
いる。即ち、図６に示すように、クロック切換え回路１
３は、リードゲートＲＧがＯＦＦすると、ライトクロッ
ク生成回路１１の出力側にスイッチを切り換える。した
がって、リードゲートＲＧがＯＮのときには、クロック
切換え回路１３は、リード信号ＲＳのＶＦＯエリアの同
期クロックをリードＰＬＬ１２に供給するように、ここ
ではＰＲイコライザ６の出力側にスイッチを切り換え
る。「Ｄ」は、リードゲートＲＧがＯＮしている期間
に、リードクロックＲＣをサンプルクロックとして、Ａ
／Ｄコンバータ５からのディジタルデータの出力を意味
している。
【００１６】
【発明が解決しようとする課題】前述したように、ＨＤ
Ｃ２はＥＣＣデータを認識した後に、リードゲートＲＧ
をＯＦＦする。このＥＣＣデータは、リードチャネルに
入力されてから相当の遅延時間を経てＨＤＣ２に出力さ
れる。これは、ビタビデコーダ９やＮＲＺデコーダ１０
のデコーダ回路の回路遅延が原因である。
Ｃ２はＥＣＣデータを認識した後に、リードゲートＲＧ
をＯＦＦする。このＥＣＣデータは、リードチャネルに
入力されてから相当の遅延時間を経てＨＤＣ２に出力さ
れる。これは、ビタビデコーダ９やＮＲＺデコーダ１０
のデコーダ回路の回路遅延が原因である。
【００１７】特に、ＰＲＭＬ方式のリードチャネルで
は、ビタビデコーダ９やＮＲＺデコーダ１０を高速ロジ
ック回路により構成し、消費電力の削減を図るために、
ビットインターリーブ処理やバイトインターリーブ処理
による並列処理を実行することで、デコーダ回路の動作
速度を減少させることが行なわれている。
は、ビタビデコーダ９やＮＲＺデコーダ１０を高速ロジ
ック回路により構成し、消費電力の削減を図るために、
ビットインターリーブ処理やバイトインターリーブ処理
による並列処理を実行することで、デコーダ回路の動作
速度を減少させることが行なわれている。
【００１８】また、高度のＰＲＭＬ方式のリードチャネ
ルでは、ディジタル方式のＰＲイコライザを構成するＦ
ＩＲ（ｆｉｎｉｔｅ ｉｍｐｕｌｓｅ ｒｅｓｐｏｎｓ
ｅ）フィルタのタップ数を増加したり、構造的にビタビ
検出回路のパスメモリ長を長くすることになるため、さ
らに回路遅延時間が増大することになる。
ルでは、ディジタル方式のＰＲイコライザを構成するＦ
ＩＲ（ｆｉｎｉｔｅ ｉｍｐｕｌｓｅ ｒｅｓｐｏｎｓ
ｅ）フィルタのタップ数を増加したり、構造的にビタビ
検出回路のパスメモリ長を長くすることになるため、さ
らに回路遅延時間が増大することになる。
【００１９】このようなデコーダ回路の回路遅延が大き
いリードチャネルでは、特に隣接するデータセクタから
連続的にデータを再生するときに、シンクバイトの検出
エラーが発生して、データの再生エラーの要因になる可
能性が高くなる。
いリードチャネルでは、特に隣接するデータセクタから
連続的にデータを再生するときに、シンクバイトの検出
エラーが発生して、データの再生エラーの要因になる可
能性が高くなる。
【００２０】具体例として、図７に示すように、前のデ
ータセクタに対するリードゲートＲＧをＯＦＦして、次
のデータセクタに対してリードゲートＲＧをＯＮすると
きに、ＨＤＣ２はデコーダ回路の回路遅延により、前の
データセクタのＥＣＣデータを相当遅れて認識した後
に、次のリードゲートＲＧをＯＮする。このため、シン
クバイト検出回路７が、次のデータセクタのシンクバイ
トエリア（ＳＢ）をサーチできずに、シンクバイトエラ
ーとなることがある。シンクバイトエラーが発生する
と、図８に示すように、リードＰＬＬ１２のロック動作
が不可となり、ＮＲＺデータにＥＣＣエラーが発生する
ことになる。
ータセクタに対するリードゲートＲＧをＯＦＦして、次
のデータセクタに対してリードゲートＲＧをＯＮすると
きに、ＨＤＣ２はデコーダ回路の回路遅延により、前の
データセクタのＥＣＣデータを相当遅れて認識した後
に、次のリードゲートＲＧをＯＮする。このため、シン
クバイト検出回路７が、次のデータセクタのシンクバイ
トエリア（ＳＢ）をサーチできずに、シンクバイトエラ
ーとなることがある。シンクバイトエラーが発生する
と、図８に示すように、リードＰＬＬ１２のロック動作
が不可となり、ＮＲＺデータにＥＣＣエラーが発生する
ことになる。
【００２１】このような問題点を解消するために、図９
に示すように、データセクタのギャップ（Ｇａｐ）エリ
ア９０を大きくすることが考えられる。このようなセク
タフォーマットであれば、図９と図１０に示すように、
連続してデータを再生する場合でも、次のデータセクタ
のシンクバイトエリア（ＳＢ）を確実にサーチし、正確
なＮＲＺデータを出力することができる。しかしなが
ら、ギャップ（Ｇａｐ）エリアを大きくすれば、データ
フォーマット効率が低下し、データの記録密度の低下を
招くことになる。
に示すように、データセクタのギャップ（Ｇａｐ）エリ
ア９０を大きくすることが考えられる。このようなセク
タフォーマットであれば、図９と図１０に示すように、
連続してデータを再生する場合でも、次のデータセクタ
のシンクバイトエリア（ＳＢ）を確実にサーチし、正確
なＮＲＺデータを出力することができる。しかしなが
ら、ギャップ（Ｇａｐ）エリアを大きくすれば、データ
フォーマット効率が低下し、データの記録密度の低下を
招くことになる。
【００２２】本発明の目的は、特にＰＲＭＬ方式のリー
ドチャネルを使用したデータ再生処理装置において、ギ
ャップエリアを大きくしてデータフォーマット効率を低
下させることなく、連続したデータセクタのデータ再生
処理を確実に実行して、結果的に高記録密度のディスク
記録再生装置の実現を図ることにある。
ドチャネルを使用したデータ再生処理装置において、ギ
ャップエリアを大きくしてデータフォーマット効率を低
下させることなく、連続したデータセクタのデータ再生
処理を確実に実行して、結果的に高記録密度のディスク
記録再生装置の実現を図ることにある。
【００２３】
【課題を解決するための手段】本発明は、例えばＰＲＭ
Ｌ方式のリードチャネルを使用したデータ再生処理装置
において、ディスクから読出したリード信号の再生処理
の起動タイミングを決定するリードゲートであって、例
えばＨＤＣに設けられた第１の生成手段により生成する
基準リードゲート信号に対して、再起動用リードゲート
信号を生成する第２の生成手段を備えた装置である。こ
の第２の生成手段は例えばリードチャネルの内部に設け
られており、隣接するデータセクタから連続的にデータ
を再生するときに、セクタパルス信号に同期して基準リ
ードゲート信号に先行する所定のタイミングで再起動用
リードゲート信号をＯＮする。
Ｌ方式のリードチャネルを使用したデータ再生処理装置
において、ディスクから読出したリード信号の再生処理
の起動タイミングを決定するリードゲートであって、例
えばＨＤＣに設けられた第１の生成手段により生成する
基準リードゲート信号に対して、再起動用リードゲート
信号を生成する第２の生成手段を備えた装置である。こ
の第２の生成手段は例えばリードチャネルの内部に設け
られており、隣接するデータセクタから連続的にデータ
を再生するときに、セクタパルス信号に同期して基準リ
ードゲート信号に先行する所定のタイミングで再起動用
リードゲート信号をＯＮする。
【００２４】
【作用】本発明では、データ再生処理の初期時には、第
２の生成手段は基準リードゲート信号のＯＮに同期し
て、再起動用リードゲート信号をＯＮさせる。したがっ
て、連続しているデータセクタの前のデータセクタから
データ再生を行なうときには、基準リードゲート信号に
相当する再起動用リードゲート信号により、データ再生
処理が開始される。そして、前のデータセクタから隣接
する次のデータセクタから連続的にデータを再生すると
きに、再起動用リードゲート信号を所定の期間だけ基準
リードゲート信号に先行してＯＮされる。したがって、
次のデータセクタのデータ再生に必要なシンクバイトエ
リアのサーチ処理等の再生処理が、再起動用リードゲー
ト信号により確実に実行される。これにより、シンクバ
イトエリアを確実に検出し、結果的に正確なデータを再
生することができる。
２の生成手段は基準リードゲート信号のＯＮに同期し
て、再起動用リードゲート信号をＯＮさせる。したがっ
て、連続しているデータセクタの前のデータセクタから
データ再生を行なうときには、基準リードゲート信号に
相当する再起動用リードゲート信号により、データ再生
処理が開始される。そして、前のデータセクタから隣接
する次のデータセクタから連続的にデータを再生すると
きに、再起動用リードゲート信号を所定の期間だけ基準
リードゲート信号に先行してＯＮされる。したがって、
次のデータセクタのデータ再生に必要なシンクバイトエ
リアのサーチ処理等の再生処理が、再起動用リードゲー
ト信号により確実に実行される。これにより、シンクバ
イトエリアを確実に検出し、結果的に正確なデータを再
生することができる。
【００２５】
【実施例】以下図面を参照して本発明の実施例を説明す
る。図１は本実施例に係わるデータ再生処理装置の要部
を示すブロック図であり、図２は本実施例に係わる再起
動ＲＧ生成回路１５の構成を示すブロック図であり、図
３と図４は本実施例の動作を説明するためのタイミング
チャートである。 （データ再生処理装置の構成）本実施例では、ＨＤＤに
使用されるＰＲＭＬ方式のリードチャネルを使用したデ
ータ再生処理装置を想定している。本実施例のリードチ
ャネル２０は、図１に示すように、再起動ＲＧ生成回路
１５とクロックコントローラ１４の各要素を含むリード
信号ＲＳの再生処理回路であり、通常ではワンチップの
集積回路として構成される。
る。図１は本実施例に係わるデータ再生処理装置の要部
を示すブロック図であり、図２は本実施例に係わる再起
動ＲＧ生成回路１５の構成を示すブロック図であり、図
３と図４は本実施例の動作を説明するためのタイミング
チャートである。 （データ再生処理装置の構成）本実施例では、ＨＤＤに
使用されるＰＲＭＬ方式のリードチャネルを使用したデ
ータ再生処理装置を想定している。本実施例のリードチ
ャネル２０は、図１に示すように、再起動ＲＧ生成回路
１５とクロックコントローラ１４の各要素を含むリード
信号ＲＳの再生処理回路であり、通常ではワンチップの
集積回路として構成される。
【００２６】ＨＤＤでは、ヘッドがディスクから記録磁
界（記録データ）をアナログのリード信号に変換して、
ヘッドアンプ１に出力する。ヘッドアンプ１は増幅した
リード信号ＲＳをリードチャネル２０に出力する。ＨＤ
Ｃ２は、データ再生動作を制御するためのリードゲート
（本実施例では基準リードゲートと称する）ＲＧを生成
してリードチャネル２０に出力する。
界（記録データ）をアナログのリード信号に変換して、
ヘッドアンプ１に出力する。ヘッドアンプ１は増幅した
リード信号ＲＳをリードチャネル２０に出力する。ＨＤ
Ｃ２は、データ再生動作を制御するためのリードゲート
（本実施例では基準リードゲートと称する）ＲＧを生成
してリードチャネル２０に出力する。
【００２７】さらに、ＨＤＤでは、各データセクタの先
頭部を検出するためのセクタパルスＳＰを生成する制御
回路３が設けられている。この制御回路３は、ゲートア
レイのロジック回路とＣＰＵとからなり、ヘッド位置決
め制御を行なうためのサーボコントローラの機能も含む
ＨＤＤのメイン制御回路とも称するものである。ＨＤＣ
２は、データ再生処理の開始時点では、セクタパルスＳ
Ｐの入力に同期してリードゲートＲＧをＯＮする。
頭部を検出するためのセクタパルスＳＰを生成する制御
回路３が設けられている。この制御回路３は、ゲートア
レイのロジック回路とＣＰＵとからなり、ヘッド位置決
め制御を行なうためのサーボコントローラの機能も含む
ＨＤＤのメイン制御回路とも称するものである。ＨＤＣ
２は、データ再生処理の開始時点では、セクタパルスＳ
Ｐの入力に同期してリードゲートＲＧをＯＮする。
【００２８】リードチャネル２０は、図１に示すよう
に、ＶＧＡ３、ＬＰＦ４、Ａ／Ｄコンバータ５、ＰＲイ
コライザ６、シンクバイト検出回路７、ＡＧＣ８、ビタ
ビデコーダ９、およびＮＲＺデコーダ１０を有する。
に、ＶＧＡ３、ＬＰＦ４、Ａ／Ｄコンバータ５、ＰＲイ
コライザ６、シンクバイト検出回路７、ＡＧＣ８、ビタ
ビデコーダ９、およびＮＲＺデコーダ１０を有する。
【００２９】ＶＧＡ３は、ＡＧＣ８により調整されたゲ
インにより、ヘッドアンプ１から出力されたリード信号
ＲＳの振幅を増幅し、レベルを一定に保持する。ＡＧＣ
８は、本実施例では再起動ＲＧ生成回路１５から出力さ
れる再起動用リードゲートＲＲＧ（後述する）に同期し
て動作を開始する。ＡＧＣ８は、ＰＲイコライザ６から
の出力データに基づいてディスク上のトラック間に発生
する振幅差を検出し、この振幅差を無くすようにＶＧＡ
３のゲイン調整を行なう。
インにより、ヘッドアンプ１から出力されたリード信号
ＲＳの振幅を増幅し、レベルを一定に保持する。ＡＧＣ
８は、本実施例では再起動ＲＧ生成回路１５から出力さ
れる再起動用リードゲートＲＲＧ（後述する）に同期し
て動作を開始する。ＡＧＣ８は、ＰＲイコライザ６から
の出力データに基づいてディスク上のトラック間に発生
する振幅差を検出し、この振幅差を無くすようにＶＧＡ
３のゲイン調整を行なう。
【００３０】ＬＰＦ４は、リード信号ＲＳから高域ノイ
ズを除去するローパスフィルタである。Ａ／Ｄコンバー
タ５は例えばフラッシュ型（並列型）のアナログ／ディ
ジタル変換回路であり、アナログのリード信号ＲＳをデ
ィジタルデータに変換する。
ズを除去するローパスフィルタである。Ａ／Ｄコンバー
タ５は例えばフラッシュ型（並列型）のアナログ／ディ
ジタル変換回路であり、アナログのリード信号ＲＳをデ
ィジタルデータに変換する。
【００３１】ＰＲイコライザ６とビタビデコーダ９は、
ＰＲＭＬ方式の信号再生処理に必要な回路要素である。
ＰＲイコライザ６は、Ａ／Ｄコンバータ５により変換さ
れたディジタルデータに対して、ＰＲ（Ｐａｒｔｉａｌ
Ｒｅｓｐｏｎｓｅ）特性の等化処理を行なうディジタ
ルフィルタ（ＦＩＲフィルタ）を有する。ビタビデコー
ダ９は、ビタビ・アルゴリズムに基づいて、ＰＲ等化さ
れたディジタルデータ（コードデータ列）から最尤のデ
ータ系列（最も確からしい系列）を検出する最尤（Ｍ
Ｌ）推定復号化回路である。
ＰＲＭＬ方式の信号再生処理に必要な回路要素である。
ＰＲイコライザ６は、Ａ／Ｄコンバータ５により変換さ
れたディジタルデータに対して、ＰＲ（Ｐａｒｔｉａｌ
Ｒｅｓｐｏｎｓｅ）特性の等化処理を行なうディジタ
ルフィルタ（ＦＩＲフィルタ）を有する。ビタビデコー
ダ９は、ビタビ・アルゴリズムに基づいて、ＰＲ等化さ
れたディジタルデータ（コードデータ列）から最尤のデ
ータ系列（最も確からしい系列）を検出する最尤（Ｍ
Ｌ）推定復号化回路である。
【００３２】シンクバイト検出回路７は、セクタフォー
マットを構成する各データセクタのシンクバイトエリア
（ＳＢ）をサーチし、その検出信号ＳＢＤをＨＤＣ２に
出力する。ＮＲＺデコーダ１０は、ビタビデコーダ９か
ら出力されたデータ系列を記録データのコード（通常で
はＮＲＺコード）に復号化して再生データ（ＮＲＺデー
タ）として出力する記録デコーダである。
マットを構成する各データセクタのシンクバイトエリア
（ＳＢ）をサーチし、その検出信号ＳＢＤをＨＤＣ２に
出力する。ＮＲＺデコーダ１０は、ビタビデコーダ９か
ら出力されたデータ系列を記録データのコード（通常で
はＮＲＺコード）に復号化して再生データ（ＮＲＺデー
タ）として出力する記録デコーダである。
【００３３】リードＰＬＬ（ＶＦＯ回路）１２は、クロ
ック切換え回路１３によりＶＦＯエリア（ＰＬＬシンク
エリア）の同期パターン（ＰＲイコライザ６の出力）ま
たはライトクロック生成回路１１からのライトクロック
パルスＷＣにより位相引込み（ａｃｑｕｉｓｉｔｉｏ
ｎ）を実行する（図３に示す位相引込み時間Ｔａｃ）。
クロック切換え回路１３は、本実施例では再起動用リー
ドゲートＲＲＧがＯＦＦのときに、ライトクロック生成
回路１１の出力側にスイッチを切換えてライトクロック
パルスＷＣをリードＰＬＬ１２に供給する。
ック切換え回路１３によりＶＦＯエリア（ＰＬＬシンク
エリア）の同期パターン（ＰＲイコライザ６の出力）ま
たはライトクロック生成回路１１からのライトクロック
パルスＷＣにより位相引込み（ａｃｑｕｉｓｉｔｉｏ
ｎ）を実行する（図３に示す位相引込み時間Ｔａｃ）。
クロック切換え回路１３は、本実施例では再起動用リー
ドゲートＲＲＧがＯＦＦのときに、ライトクロック生成
回路１１の出力側にスイッチを切換えてライトクロック
パルスＷＣをリードＰＬＬ１２に供給する。
【００３４】本実施例では、クロックコントローラ１４
が設けられており、再起動用リードゲートＲＲＧがＯＦ
Ｆの状態からＯＮした直後の期間（図４のＴ４，Ｔ５）
に、リードＰＬＬ１２からのリードクロックＲＣからラ
イトクロック（パルス）ＷＣに切換えて、ビタビデコー
ダ９とＮＲＺデコーダ１０に供給する。この時間Ｔ４，
Ｔ５はリードＰＬＬ１２の位相引込み時間Ｔａｃを含む
時間である。 （再起動ＲＧ生成回路１５の構成）本実施例の再起動Ｒ
Ｇ生成回路１５は、従来のＨＤＣ２からの基準リードゲ
ートＲＧを外部リードゲートとした場合に、いわばリー
ドチャネルの内部で内部リードゲートに相当する再起動
用リードゲートＲＲＧを生成するものである。
が設けられており、再起動用リードゲートＲＲＧがＯＦ
Ｆの状態からＯＮした直後の期間（図４のＴ４，Ｔ５）
に、リードＰＬＬ１２からのリードクロックＲＣからラ
イトクロック（パルス）ＷＣに切換えて、ビタビデコー
ダ９とＮＲＺデコーダ１０に供給する。この時間Ｔ４，
Ｔ５はリードＰＬＬ１２の位相引込み時間Ｔａｃを含む
時間である。 （再起動ＲＧ生成回路１５の構成）本実施例の再起動Ｒ
Ｇ生成回路１５は、従来のＨＤＣ２からの基準リードゲ
ートＲＧを外部リードゲートとした場合に、いわばリー
ドチャネルの内部で内部リードゲートに相当する再起動
用リードゲートＲＲＧを生成するものである。
【００３５】再起動ＲＧ生成回路１５は、図２に示すよ
うに、ライトクロックカウンタ２１、レジスタ２２、Ｒ
Ｇ検出回路２３、およびゲートパルス生成回路２４を有
する。ライトクロックカウンタ２１は、制御回路３から
のセクタパルスＳＰに同期してカウント動作を開始し、
ライトクロック生成回路１１からのライトクロックＷＣ
をカウントする。
うに、ライトクロックカウンタ２１、レジスタ２２、Ｒ
Ｇ検出回路２３、およびゲートパルス生成回路２４を有
する。ライトクロックカウンタ２１は、制御回路３から
のセクタパルスＳＰに同期してカウント動作を開始し、
ライトクロック生成回路１１からのライトクロックＷＣ
をカウントする。
【００３６】レジスタ２２には、ライトクロックカウン
タ２１のカウント回数を決定するための時間データＴ１
〜Ｔ３が予めセットされている。この時間データＴ１〜
Ｔ３は、図３に示すように、セクタパルスＳＰ（ＳＰ
２）の発生時からリードゲートＲＲＧをＯＦＦして、Ｏ
Ｎさせるタイミングを決定する時間Ｔ１〜Ｔ３に対応す
るデータである。
タ２１のカウント回数を決定するための時間データＴ１
〜Ｔ３が予めセットされている。この時間データＴ１〜
Ｔ３は、図３に示すように、セクタパルスＳＰ（ＳＰ
２）の発生時からリードゲートＲＲＧをＯＦＦして、Ｏ
Ｎさせるタイミングを決定する時間Ｔ１〜Ｔ３に対応す
るデータである。
【００３７】ライトクロックカウンタ２１は、時間デー
タＴ１までカウントすると、リードゲートＲＲＧをＯＦ
Ｆするためのゲート制御信号ＧＳ１を出力し、時間デー
タＴ２までカウントすると、リードゲートＲＲＧをＯＮ
するためのゲート制御信号ＧＳ２を出力する。また、ラ
イトクロックカウンタ２１は、時間データＴ３までカウ
ントすると、連続セクタ再生モード（後述する）の検出
信号ＳＤをＲＧ検出回路２３に出力する。
タＴ１までカウントすると、リードゲートＲＲＧをＯＦ
Ｆするためのゲート制御信号ＧＳ１を出力し、時間デー
タＴ２までカウントすると、リードゲートＲＲＧをＯＮ
するためのゲート制御信号ＧＳ２を出力する。また、ラ
イトクロックカウンタ２１は、時間データＴ３までカウ
ントすると、連続セクタ再生モード（後述する）の検出
信号ＳＤをＲＧ検出回路２３に出力する。
【００３８】ＲＧ検出回路２３は、ＨＤＣ２から出力さ
れた基準リードゲートＲＧのＯＮ状態をセクタパルスＳ
Ｐに同期してラッチし、検出信号ＳＤの入力に同期して
ラッチをリセットする。
れた基準リードゲートＲＧのＯＮ状態をセクタパルスＳ
Ｐに同期してラッチし、検出信号ＳＤの入力に同期して
ラッチをリセットする。
【００３９】ゲートパルス生成回路２４は、ＲＧ検出回
路２３のラッチ状態のときの論理レベル“Ｈ”の検出信
号ＲＤまたはＯＮ状態の基準リードゲートＲＧにより、
ライトクロックカウンタ２１からのゲート制御信号ＧＳ
１またはＧＳ２に応じたリードゲートＲＲＧを出力する
（図３を参照）。
路２３のラッチ状態のときの論理レベル“Ｈ”の検出信
号ＲＤまたはＯＮ状態の基準リードゲートＲＧにより、
ライトクロックカウンタ２１からのゲート制御信号ＧＳ
１またはＧＳ２に応じたリードゲートＲＲＧを出力する
（図３を参照）。
【００４０】次に、本実施例の動作を図３と図４を参照
して説明する。 （再起動リードゲートＲＲＧによるデータ再生処理）ま
ず、データ再生動作では、ヘッドにより読出されて、ヘ
ッドアンプ１により増幅されたリード信号ＲＳがリード
チャネル２０に入力される。リード信号ＲＳのフォーマ
ットは、図３に示すように、各データセクタのフォーマ
ット構成に従ったものである。
して説明する。 （再起動リードゲートＲＲＧによるデータ再生処理）ま
ず、データ再生動作では、ヘッドにより読出されて、ヘ
ッドアンプ１により増幅されたリード信号ＲＳがリード
チャネル２０に入力される。リード信号ＲＳのフォーマ
ットは、図３に示すように、各データセクタのフォーマ
ット構成に従ったものである。
【００４１】ＨＤＣ２は、リードチャネル２０の再生処
理を開始させる起動タイミングを決定する基準リードゲ
ートＲＧを生成して出力する。一方、制御回路３は、各
データセクタの先頭部を検出するためのセクタパルスＳ
Ｐを出力する。本実施例では、セクタパルスＳＰは、基
準リードゲートＲＧまたは本実施例の再起動リードゲー
トＲＲＧがＯＮする以前に発生することを想定してい
る。
理を開始させる起動タイミングを決定する基準リードゲ
ートＲＧを生成して出力する。一方、制御回路３は、各
データセクタの先頭部を検出するためのセクタパルスＳ
Ｐを出力する。本実施例では、セクタパルスＳＰは、基
準リードゲートＲＧまたは本実施例の再起動リードゲー
トＲＲＧがＯＮする以前に発生することを想定してい
る。
【００４２】本実施例では、リードチャネル２０は、基
準リードゲートＲＧとセクタパルスＳＰに基づいて、再
起動ＲＧ生成回路１５により生成される再起動リードゲ
ートＲＲＧにより再生処理の起動タイミングが決定され
る。
準リードゲートＲＧとセクタパルスＳＰに基づいて、再
起動ＲＧ生成回路１５により生成される再起動リードゲ
ートＲＲＧにより再生処理の起動タイミングが決定され
る。
【００４３】再起動ＲＧ生成回路１５は、図３に示すよ
うに、直前のデータセクタがリードされていないデータ
再生処理の初期時では、基準リードゲートＲＧに同期し
て再起動リードゲートＲＲＧをＯＮにする。即ち、本実
施例では、隣接する各データセクタから連続的にデータ
再生処理を実行する連続セクタ再生モード時に、ライト
クロックカウンタ２１の動作に従った再起動リードゲー
トＲＲＧを生成する。
うに、直前のデータセクタがリードされていないデータ
再生処理の初期時では、基準リードゲートＲＧに同期し
て再起動リードゲートＲＲＧをＯＮにする。即ち、本実
施例では、隣接する各データセクタから連続的にデータ
再生処理を実行する連続セクタ再生モード時に、ライト
クロックカウンタ２１の動作に従った再起動リードゲー
トＲＲＧを生成する。
【００４４】連続セクタ再生モードは、セクタパルスＳ
Ｐの入力時に、基準リードゲートＲＧの極性により判定
される。即ち、ＯＮであれば連続セクタ再生モードであ
り、ＯＦＦのときにはデータ再生処理の初期時となる。
具体的には、ＲＧ検出回路２３はセクタパルスＳＰの入
力に同期して、基準リードゲートＲＧのＯＮ状態をラッ
チしたときに論理レベル“Ｈ”の検出信号ＲＤをゲート
パルス生成回路２４に出力する。ゲートパルス生成回路
２４は、検出信号ＲＤが論理レベル“Ｌ”のときには、
基準リードゲートＲＧと同一レベルの再起動リードゲー
トＲＲＧを出力する。
Ｐの入力時に、基準リードゲートＲＧの極性により判定
される。即ち、ＯＮであれば連続セクタ再生モードであ
り、ＯＦＦのときにはデータ再生処理の初期時となる。
具体的には、ＲＧ検出回路２３はセクタパルスＳＰの入
力に同期して、基準リードゲートＲＧのＯＮ状態をラッ
チしたときに論理レベル“Ｈ”の検出信号ＲＤをゲート
パルス生成回路２４に出力する。ゲートパルス生成回路
２４は、検出信号ＲＤが論理レベル“Ｌ”のときには、
基準リードゲートＲＧと同一レベルの再起動リードゲー
トＲＲＧを出力する。
【００４５】図３に示すように、セクタパルスＳＰ２が
発生した時点では、基準リードゲートＲＧはＯＮしてい
るため、連続セクタ再生モードとなる。したがって、再
起動ＲＧ生成回路１５は、ライトクロックカウンタ２１
の動作に従った再起動リードゲートＲＲＧを生成する。
発生した時点では、基準リードゲートＲＧはＯＮしてい
るため、連続セクタ再生モードとなる。したがって、再
起動ＲＧ生成回路１５は、ライトクロックカウンタ２１
の動作に従った再起動リードゲートＲＲＧを生成する。
【００４６】即ち、再起動ＲＧ生成回路１５は、セクタ
パルスＳＰ２の発生時から時間Ｔ１経過後に、図２に示
すゲート制御信号ＧＳ１により再起動リードゲートＲＲ
ＧをＯＦＦさせる。このとき、ＨＤＣ２は、前のデータ
セクタからＥＣＣデータの読込みが終了していないた
め、基準リードゲートＲＧをＯＮ状態に維持している。
基準リードゲートＲＧは、ＥＣＣデータの読込みが終了
した後、即ち次のデータセクタのＶＦＯエリアやシンク
バイトエリアの入力時点の近傍でＯＦＦされる。
パルスＳＰ２の発生時から時間Ｔ１経過後に、図２に示
すゲート制御信号ＧＳ１により再起動リードゲートＲＲ
ＧをＯＦＦさせる。このとき、ＨＤＣ２は、前のデータ
セクタからＥＣＣデータの読込みが終了していないた
め、基準リードゲートＲＧをＯＮ状態に維持している。
基準リードゲートＲＧは、ＥＣＣデータの読込みが終了
した後、即ち次のデータセクタのＶＦＯエリアやシンク
バイトエリアの入力時点の近傍でＯＦＦされる。
【００４７】再起動ＲＧ生成回路１５は、セクタパルス
ＳＰ２の発生時から時間Ｔ２経過後に、図２に示すゲー
ト制御信号ＧＳ２により再起動リードゲートＲＲＧを再
ＯＮさせる。このとき、基準リードゲートＲＧがＯＦＦ
してから、時間Ｔ３の期間内に再ＯＮしない場合には、
連続セクタ再生モードではないことになる。したがっ
て、再起動ＲＧ生成回路１５は、時間Ｔ３の経過後に出
力される検出信号ＳＤによりＲＧ検出回路２３のラッチ
状態がリセットされて、基準リードゲートＲＧと同一レ
ベルになるように再起動リードゲートＲＲＧをＯＦＦす
る。
ＳＰ２の発生時から時間Ｔ２経過後に、図２に示すゲー
ト制御信号ＧＳ２により再起動リードゲートＲＲＧを再
ＯＮさせる。このとき、基準リードゲートＲＧがＯＦＦ
してから、時間Ｔ３の期間内に再ＯＮしない場合には、
連続セクタ再生モードではないことになる。したがっ
て、再起動ＲＧ生成回路１５は、時間Ｔ３の経過後に出
力される検出信号ＳＤによりＲＧ検出回路２３のラッチ
状態がリセットされて、基準リードゲートＲＧと同一レ
ベルになるように再起動リードゲートＲＲＧをＯＦＦす
る。
【００４８】以上のように本実施例によれば、連続セク
タ再生モード時には、予め設定した時間データＴ１〜Ｔ
３により、基準リードゲートＲＧがＯＮする前に、先行
して再起動リードゲートＲＲＧを再ＯＮさせる。
タ再生モード時には、予め設定した時間データＴ１〜Ｔ
３により、基準リードゲートＲＧがＯＮする前に、先行
して再起動リードゲートＲＲＧを再ＯＮさせる。
【００４９】従来では、特にＰＲＭＬ方式のリードチャ
ネルのデコーダ回路の回路遅延が原因で、ＨＤＣ２のＥ
ＣＣデータの読込み終了までに時間を要し、次のデータ
セクタを連続的に再生処理するために、基準リードゲー
トＲＧを再ＯＮさせるタイミングが遅くなる。このた
め、シンクバイト検出回路７によるシンクバイトエリア
（ＳＢ）のサーチができず、シンクバイトエラーが発生
することがある。
ネルのデコーダ回路の回路遅延が原因で、ＨＤＣ２のＥ
ＣＣデータの読込み終了までに時間を要し、次のデータ
セクタを連続的に再生処理するために、基準リードゲー
トＲＧを再ＯＮさせるタイミングが遅くなる。このた
め、シンクバイト検出回路７によるシンクバイトエリア
（ＳＢ）のサーチができず、シンクバイトエラーが発生
することがある。
【００５０】そこで、本実施例では、先行して再ＯＮす
る再起動リードゲートＲＲＧにより、リードＰＬＬ１
２、ＡＧＣ８、およびシンクバイト検出回路７を先行し
て再起動させる。したがって、連続セクタ再生モード時
に、次のデータセクタの連続的再生処理に必要なシンク
バイトエリア（ＳＢ）のサーチ処理を確実に実行するこ
とができる。これにより、図４に示すように、データエ
ラーが発生しない正確なＮＲＺデータを連続的に再生
し、ＨＤＣ２に出力することができる。 （クロックコントローラ１４の動作）本実施例では、再
起動リードゲートＲＲＧがＯＦＦの状態からＯＮした直
後のリードＰＬＬ１２の位相引込み期間（位相同期期
間）Ｔａｃは、クロックコントローラ１４により、ビタ
ビデコーダ９とＮＲＺデコーダ１０にはライトクロック
ＷＣが供給される。
る再起動リードゲートＲＲＧにより、リードＰＬＬ１
２、ＡＧＣ８、およびシンクバイト検出回路７を先行し
て再起動させる。したがって、連続セクタ再生モード時
に、次のデータセクタの連続的再生処理に必要なシンク
バイトエリア（ＳＢ）のサーチ処理を確実に実行するこ
とができる。これにより、図４に示すように、データエ
ラーが発生しない正確なＮＲＺデータを連続的に再生
し、ＨＤＣ２に出力することができる。 （クロックコントローラ１４の動作）本実施例では、再
起動リードゲートＲＲＧがＯＦＦの状態からＯＮした直
後のリードＰＬＬ１２の位相引込み期間（位相同期期
間）Ｔａｃは、クロックコントローラ１４により、ビタ
ビデコーダ９とＮＲＺデコーダ１０にはライトクロック
ＷＣが供給される。
【００５１】即ち、図４に示すように、再起動リードゲ
ートＲＲＧのＯＦＦからＯＮ直後の期間（Ｔ４，Ｔ５）
では、ビタビデコーダ９とＮＲＺデコーダ１０には、リ
ードＰＬＬ１２からのリードクロックＲＣが切換えられ
て、ライトクロックＷＣに相当するリードクロックＲＲ
Ｃが供給される（ＷＰＬＬ）。この期間Ｔ４，Ｔ５は、
再起動リードゲートＲＲＧのＯＦＦ時間とリードＰＬＬ
１２の位相引込み時間Ｔａｃとを加算した時間である。
ートＲＲＧのＯＦＦからＯＮ直後の期間（Ｔ４，Ｔ５）
では、ビタビデコーダ９とＮＲＺデコーダ１０には、リ
ードＰＬＬ１２からのリードクロックＲＣが切換えられ
て、ライトクロックＷＣに相当するリードクロックＲＲ
Ｃが供給される（ＷＰＬＬ）。この期間Ｔ４，Ｔ５は、
再起動リードゲートＲＲＧのＯＦＦ時間とリードＰＬＬ
１２の位相引込み時間Ｔａｃとを加算した時間である。
【００５２】そして、期間Ｔ４，Ｔ５の経過後では、ビ
タビデコーダ９とＮＲＺデコーダ１０には、ＰＬＬ１２
からのリードクロックＲＣがリードクロックＲＲＣとし
て供給される（ＲＰＬＬ）。
タビデコーダ９とＮＲＺデコーダ１０には、ＰＬＬ１２
からのリードクロックＲＣがリードクロックＲＲＣとし
て供給される（ＲＰＬＬ）。
【００５３】これにより、位相引込み期間Ｔａｃにおい
て、リードＰＬＬ１２の不安定動作の影響が、ビタビデ
コーダ９とＮＲＺデコーダ１０の動作に及ぼすことを防
止することができる。リードＰＬＬ１２の位相引込み期
間Ｔａｃが終了してロックされた後は、リードＰＬＬ１
２からの安定したリードクロックＲＣが供給される。 （変形例）本実施例は、リードチャネル２０の内部に設
けられた再起動ＲＧ生成回路１５により、再起動リード
ゲートＲＲＧを生成する方式である。これに対して、変
形例は、図５（Ａ）に示すように、従来のリードチャネ
ルまたは本実施例のクロックコントローラ１４を含むリ
ードチャネル２１を使用し、ＨＤＣ２が再起動リードゲ
ートＲＲＧを生成する方式である。
て、リードＰＬＬ１２の不安定動作の影響が、ビタビデ
コーダ９とＮＲＺデコーダ１０の動作に及ぼすことを防
止することができる。リードＰＬＬ１２の位相引込み期
間Ｔａｃが終了してロックされた後は、リードＰＬＬ１
２からの安定したリードクロックＲＣが供給される。 （変形例）本実施例は、リードチャネル２０の内部に設
けられた再起動ＲＧ生成回路１５により、再起動リード
ゲートＲＲＧを生成する方式である。これに対して、変
形例は、図５（Ａ）に示すように、従来のリードチャネ
ルまたは本実施例のクロックコントローラ１４を含むリ
ードチャネル２１を使用し、ＨＤＣ２が再起動リードゲ
ートＲＲＧを生成する方式である。
【００５４】ＨＤＣ２は、同図（Ｂ）のフローチャート
に示すような再起動リードゲートＲＲＧの生成処理を実
行する。即ち、最初のセクタパルスＳＰ１が発生する
と、基準リードゲートＲＧを出力する（ステップＳ１，
Ｓ２）。ここで、セクタパルスＳＰ１の発生時には、連
続セクタ再生モードではないため、基準リードゲートＲ
Ｇに同期して再起動リードゲートＲＲＧをＯＮする（ス
テップＳ３）。
に示すような再起動リードゲートＲＲＧの生成処理を実
行する。即ち、最初のセクタパルスＳＰ１が発生する
と、基準リードゲートＲＧを出力する（ステップＳ１，
Ｓ２）。ここで、セクタパルスＳＰ１の発生時には、連
続セクタ再生モードではないため、基準リードゲートＲ
Ｇに同期して再起動リードゲートＲＲＧをＯＮする（ス
テップＳ３）。
【００５５】次に、セクタパルスＳＰ２の発生すると、
タイマを起動して前述した時間データＴ１〜Ｔ３による
時間経過を測定する。即ち、時間Ｔ１が経過すると、再
起動リードゲートＲＲＧをＯＦＦする（ステップＳ６，
Ｓ７）。さらに、時間Ｔ２が経過すると、再起動リード
ゲートＲＲＧをＯＮする（ステップＳ８，Ｓ９）。本実
施例の図３に示すタイミングチャートに相当する処理で
ある。
タイマを起動して前述した時間データＴ１〜Ｔ３による
時間経過を測定する。即ち、時間Ｔ１が経過すると、再
起動リードゲートＲＲＧをＯＦＦする（ステップＳ６，
Ｓ７）。さらに、時間Ｔ２が経過すると、再起動リード
ゲートＲＲＧをＯＮする（ステップＳ８，Ｓ９）。本実
施例の図３に示すタイミングチャートに相当する処理で
ある。
【００５６】ここで、時間Ｔ３以内に、基準リードゲー
トＲＧがＯＮしないときは、連続セクタ再生モードでは
ないことになる（ステップＳ１０のＮＯ）。したがっ
て、ＨＤＣ２は、一度ＯＮした再起動リードゲートＲＲ
ＧをＯＦＦして、初期時の処理に戻ることになる（ステ
ップＳ１１）。一方、図３に示すように、基準リードゲ
ートＲＧがＯＮして連続セクタ再生モードのときには、
再起動リードゲートＲＲＧのＯＮ状態は維持されて、次
のセクタパルスＳＰ３の入力を待つことになる（ステッ
プＳ１０のＹＥＳ，Ｓ４）。
トＲＧがＯＮしないときは、連続セクタ再生モードでは
ないことになる（ステップＳ１０のＮＯ）。したがっ
て、ＨＤＣ２は、一度ＯＮした再起動リードゲートＲＲ
ＧをＯＦＦして、初期時の処理に戻ることになる（ステ
ップＳ１１）。一方、図３に示すように、基準リードゲ
ートＲＧがＯＮして連続セクタ再生モードのときには、
再起動リードゲートＲＲＧのＯＮ状態は維持されて、次
のセクタパルスＳＰ３の入力を待つことになる（ステッ
プＳ１０のＹＥＳ，Ｓ４）。
【００５７】以上のようにＨＤＣ２により再起動リード
ゲートＲＲＧを生成する方式でもよい。この方式の場合
には、ＨＤＣ２に従来とは異なる機能を付加することに
なるが、リードチャネル２１の回路構成を本実施例の方
式と比較して簡単化できる利点がある。
ゲートＲＲＧを生成する方式でもよい。この方式の場合
には、ＨＤＣ２に従来とは異なる機能を付加することに
なるが、リードチャネル２１の回路構成を本実施例の方
式と比較して簡単化できる利点がある。
【００５８】
【発明の効果】以上詳述したように本発明によれば、隣
接する各データエリアから連続的にデータの再生処理を
実行するときに、各データエリア間のギャップエリアを
特別に大きくする必要がなく、正確な記録データを再生
することができる。特にＰＲＭＬ方式のリードチャネル
を使用したディスク記録再生装置に適用すれば、ディス
クのデータフォーマット効率を低下させることなく、連
続したデータセクタのデータ再生処理を確実に実行でき
るため、高記録密度化の実現を図ることができる。
接する各データエリアから連続的にデータの再生処理を
実行するときに、各データエリア間のギャップエリアを
特別に大きくする必要がなく、正確な記録データを再生
することができる。特にＰＲＭＬ方式のリードチャネル
を使用したディスク記録再生装置に適用すれば、ディス
クのデータフォーマット効率を低下させることなく、連
続したデータセクタのデータ再生処理を確実に実行でき
るため、高記録密度化の実現を図ることができる。
【図１】本発明の実施例に係わるデータ再生処理装置の
要部を示すブロック図。
要部を示すブロック図。
【図２】本実施例の再起動ＲＧ生成回路の構成を示すブ
ロック図。
ロック図。
【図３】本実施例の動作を説明するためのタイミングチ
ャート。
ャート。
【図４】本実施例の動作を説明するためのタイミングチ
ャート。
ャート。
【図５】本実施例の変形例を説明するための図。
【図６】従来のデータ再生処理装置の要部を示すブロッ
ク図。
ク図。
【図７】従来のデータ再生処理装置の動作を説明するた
めのタイミングチャート。
めのタイミングチャート。
【図８】従来のデータ再生処理装置の動作を説明するた
めのタイミングチャート。
めのタイミングチャート。
【図９】従来のデータ再生処理装置の動作を説明するた
めのタイミングチャート。
めのタイミングチャート。
【図１０】従来のデータ再生処理装置の動作を説明する
ためのタイミングチャート。
ためのタイミングチャート。
１…ヘッドアンプ、２…ディスクコントローラ（ＨＤ
Ｃ）、３…ＶＧＡ、４…ローパスフィルタ（ＬＰＦ）、
５…Ａ／Ｄコンバータ、６…ＰＲイコライザ、７…シン
クバイト検出回路、８…ＡＧＣ、９…ビタビデコーダ、
１０…ＮＲＺデコーダ、１１…ライトクロック生成回
路、１２…リードＰＬＬ、１３…クロック切換え回路、
１４…クロックコントローラ、１５…再起動ＲＧ生成回
路。
Ｃ）、３…ＶＧＡ、４…ローパスフィルタ（ＬＰＦ）、
５…Ａ／Ｄコンバータ、６…ＰＲイコライザ、７…シン
クバイト検出回路、８…ＡＧＣ、９…ビタビデコーダ、
１０…ＮＲＺデコーダ、１１…ライトクロック生成回
路、１２…リードＰＬＬ、１３…クロック切換え回路、
１４…クロックコントローラ、１５…再起動ＲＧ生成回
路。
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) G11B 20/10 G11B 20/14 G11B 19/06
Claims (6)
- 【請求項１】 円周方向に複数のデータエリアが配列さ
れたディスク記録媒体を使用し、前記各データエリアの
記録データをヘッドにより読出したリード信号から再生
するディスク記録再生装置のデータ再生処理装置におい
て、 前記各データエリアから記録データを再生するために必
要な前記リード信号の再生処理の起動タイミングを決定
する基準リードゲート信号を生成する第１の生成手段
と、 前記各データエリアにおいて前のデータエリアとそれに
隣接する次のデータエリアとから連続的に記録データを
再生するときに、前記次のデータエリアに対応する前記
基準リードゲート信号の終了に先行して、前記リード信
号の再生処理の起動タイミングを決定する再起動用リー
ドゲート信号を生成する第２の生成手段とを具備したこ
とを特徴とするディスク記録再生装置のデータ再生処理
装置。 - 【請求項２】 前記各データエリアの先頭部を検出する
ためのセクタパルス信号を生成するセクタパルス生成手
段を更に有し、 前記第１の生成手段は、前記セクタパルス信号の生成に
応じて、前記基準リードゲート信号を生成し、 前記第２の生成手段は、前記次のデータエリアから連続
的に記録データを再生するときに、当該次のデータエリ
アの先頭部を検出するための次のセクタパルス信号の生
成に応じて、前記次のデータエリアに対応する前記基準
リードゲート信号が生成される時点より所定の時間前に
前記再起動用リードゲート信号を生成することを特徴と
する請求項１に記載のディスク記録再生装置のデータ再
生処理装置。 - 【請求項３】 円周方向に複数のデータセクタが配列さ
れたディスク記録媒体を使用し、前記各データエリアの
記録データをヘッドにより読出したリード信号から再生
するディスク記録再生装置のデータ再生処理装置におい
て、 前記各データセクタの先頭部を検出するためのセクタパ
ルス信号を生成するセクタパルス生成手段と、前記リード信号を入力して、前記各データセクタから記
録データを再生するた めに必要な前記リード信号の再生
処理を実行する内部回路群を含むリードチャネル手段
と、 前記セクタパルス信号の生成に応じて、前記リードチャ
ネル手段での再生処理の起動タイミングを決定する基準
リードゲート信号を生成するリードゲート生成手段とを
具備し、 前記リードチャネル手段は、 前記セクタパルス信号と前記基準リードゲート信号とに
基づいて、前記内部回路群の起動タイミングを決定する
内部リードゲート信号を生成する手段であって、 前のデータセクタとそれに隣接する次のデータセクタと
から連続的に記録データを再生するときに、当該前のデ
ータセクタに対応する前記基準リードゲート信号の生成
に同期して前記内部リードゲート信号を生成し、当該次
のデータセクタの先頭部を検出するセクタパルス信号の
生成に応じて、前記前のデータセクタに対応する前記基
準リードゲート信号の終了に先行して前記内部リードゲ
ート信号を生成する内部リードゲート生成回路を有する
ことを特徴とするディスク記録再生装置のデータ再生処
理装置。 - 【請求項４】 前記リードチャネル手段は、 位相同期回路により構成されて、前記内部リードゲート
信号に同期して起動し、前記リード信号から当該リード
信号に同期した同期クロックを抽出するための同期クロ
ック処理手段と、 前記内部リードゲート信号に同期して起動し、前記同期
クロックに同期して前記リード信号から記録データを復
号化するデータ復号処理手段とを有することを特徴とす
る請求項３に記載のディスク記録再生装置のデータ再生
処理装置。 - 【請求項５】 前記同期クロック処理手段から出力され
る前記同期クロックと予め設定された一定周期のクロッ
クの供給を制御する手段であって、 前記内部リードゲート信号がオフの状態からオンの状態
に移行した所定期間に、前記一定周期のクロックを同期
クロックとして前記データ復号処理手段に供給し、前記
所定期間の経過後では前記同期クロック処理手段から出
力された前記同 期クロックを前記データ復号処理手段に
供給するように制御するクロック制御手段を更に有する
ことを特徴とする請求項４に記載のディスク記録再生装
置のデータ再生処理装置。 - 【請求項６】 円周方向に複数のデータエリアが配列さ
れたディスク記録媒体を使用し、前記各データエリアの
記録データをヘッドにより読出したリード信号から再生
するディスク記録再生装置に適用するデータ再生方法で
あって、 データ再生時に、前記ヘッドからの前記リード信号によ
り前記各データエリアの先頭部を検出するためのセクタ
パルス信号を生成するステップと、 前記セクタパルス信号の生成に応じて、前記各データエ
リアから記録データを再生するために必要な前記リード
信号の再生処理の起動タイミングを決定する基準リード
ゲート信号を生成するステップと、 前記各データエリアにおいて前のデータエリアとそれに
隣接する次のデータエリアとから連続的に記録データを
再生することを、当該前のデータエリアに対応する前記
基準リードゲート信号と当該次のデータエリアの先頭部
を検出するためのセクタパルス信号とに基づいて検出す
るステップと、 前記連続的に記録データを再生するときに、前記次のデ
ータエリアの先頭部を検出するためのセクタパルス信号
の生成に応じて、前記次のデータエリアに対応する前記
基準リードゲート信号の終了に先行して、前記リード信
号の再生処理の起動タイミングを決定する再起動用リー
ドゲート信号を生成するステップとからなることを特徴
とするデータ再生方法。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11749895A JP3331090B2 (ja) | 1995-05-16 | 1995-05-16 | ディスク記録再生装置のデータ再生処理装置及びデータ再生方法 |
| US08/596,888 US5905601A (en) | 1995-05-16 | 1996-03-11 | Apparatus for reproducing data having a restart read gate signal generator in a disk storage system |
| US09/162,885 US6104560A (en) | 1995-05-16 | 1998-09-29 | Method and apparatus for data reproducing in disk storage system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11749895A JP3331090B2 (ja) | 1995-05-16 | 1995-05-16 | ディスク記録再生装置のデータ再生処理装置及びデータ再生方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH08315513A JPH08315513A (ja) | 1996-11-29 |
| JP3331090B2 true JP3331090B2 (ja) | 2002-10-07 |
Family
ID=14713230
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11749895A Expired - Lifetime JP3331090B2 (ja) | 1995-05-16 | 1995-05-16 | ディスク記録再生装置のデータ再生処理装置及びデータ再生方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (2) | US5905601A (ja) |
| JP (1) | JP3331090B2 (ja) |
Families Citing this family (20)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3331090B2 (ja) * | 1995-05-16 | 2002-10-07 | 株式会社東芝 | ディスク記録再生装置のデータ再生処理装置及びデータ再生方法 |
| CN1145946C (zh) * | 1997-04-28 | 2004-04-14 | 皇家菲利浦电子有限公司 | 用于再现记录载体中信息信号的装置 |
| JP3349934B2 (ja) * | 1997-12-01 | 2002-11-25 | 富士通株式会社 | 磁気ディスク装置及びこの装置に使用するリードチャネルｉｃ |
| JPH11251927A (ja) * | 1998-03-04 | 1999-09-17 | Sony Corp | 情報処理装置および方法、並びに提供媒体 |
| JP2002506557A (ja) * | 1998-04-28 | 2002-02-26 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | 記録担体から情報を再生する装置 |
| US6098100A (en) * | 1998-06-08 | 2000-08-01 | Silicon Integrated Systems Corp. | Method and apparatus for detecting a wake packet issued by a network device to a sleeping node |
| JP2000195172A (ja) * | 1998-12-24 | 2000-07-14 | Sony Corp | データ記録及び／又は再生装置 |
| US6567489B1 (en) * | 1999-02-08 | 2003-05-20 | Texas Instruments Incorporated | Method and circuitry for acquiring a signal in a read channel |
| US6307696B1 (en) * | 1999-05-06 | 2001-10-23 | Maxtor Corporation | Digital zero-phase restart circuit |
| US7389374B1 (en) | 2000-05-17 | 2008-06-17 | Marvell International Ltd. | High latency interface between hardware components |
| US7281065B1 (en) | 2000-08-17 | 2007-10-09 | Marvell International Ltd. | Long latency interface protocol |
| US6724553B2 (en) * | 2001-03-26 | 2004-04-20 | Samsung Electronics Co., Ltd. | Method and apparatus for generating the optimum read timing for read and write offset of a magneto resistive head |
| JP2002288943A (ja) | 2001-03-26 | 2002-10-04 | Hitachi Ltd | 情報記録再生装置及びデータ再生方法 |
| US7054398B1 (en) * | 2001-07-18 | 2006-05-30 | Marvell International Ltd. | Method for selecting sync marks and sync mark detectors |
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| US6891361B2 (en) * | 2002-12-31 | 2005-05-10 | Lsi Logic Corporation | Automatic gain control (AGC) loop for characterizing continuous-time or discrete-time circuitry gain response across frequency |
| JP4189280B2 (ja) | 2003-07-04 | 2008-12-03 | 株式会社東芝 | 複合ヘッドのヘッドギャップ長測定方法及びディスク記憶装置 |
| US7650474B2 (en) * | 2006-01-09 | 2010-01-19 | Lsi Corporation | Method and system for interleaving first and second halves of a data segment of unknown length |
| WO2007132398A2 (en) * | 2006-05-15 | 2007-11-22 | Koninklijke Philips Electronics N.V. | An optical disc reading apparatus and method therefore |
| US20090034109A1 (en) * | 2007-07-30 | 2009-02-05 | Kabushiki Kaisha Toshiba 1-1 | Disk drive apparatus and media defect detection method |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2819294B2 (ja) * | 1988-09-29 | 1998-10-30 | キヤノン株式会社 | デジタル情報再生装置 |
| JP2846441B2 (ja) * | 1990-09-26 | 1999-01-13 | ティアック株式会社 | 光ディスク再生装置 |
| JP3042790B2 (ja) * | 1991-01-23 | 2000-05-22 | 株式会社日立製作所 | 磁気ディスク装置及びそのデータ書き込み／読み出し制御方法 |
| JP3331090B2 (ja) * | 1995-05-16 | 2002-10-07 | 株式会社東芝 | ディスク記録再生装置のデータ再生処理装置及びデータ再生方法 |
-
1995
- 1995-05-16 JP JP11749895A patent/JP3331090B2/ja not_active Expired - Lifetime
-
1996
- 1996-03-11 US US08/596,888 patent/US5905601A/en not_active Expired - Lifetime
-
1998
- 1998-09-29 US US09/162,885 patent/US6104560A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
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| US5905601A (en) | 1999-05-18 |
| JPH08315513A (ja) | 1996-11-29 |
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