JP3313773B2 - 半導体装置 - Google Patents

半導体装置

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富久夫 石川
俊男 石田
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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明はパワーMOSFET(以
下パワーFETという)等の電流供給素子と、これの供
給電流を検出する電流検出素子を一体に形成した半導体
装置に関する。
【0002】
【従来の技術】かかる半導体装置の素子構成の一例を図
2に示す。図において、半導体チップA上には外部の負
荷Lに電流を供給するパワーFET1が形成されてお
り、該パワーFET1には供給電流idに比例した検出
電流isを出力するセンスMOSFET2(以下センス
FETという)が一体に形成されている。この検出電流
isは、チップA上に形成したオペアンプ7の入出力端
子間に接続された外付けの検出抵抗3に流れ、ここで検
出電圧Vsに変換されて差動増幅回路7に入力した後、
コンパレータ6で基準電圧Vcと比較される。
【0003】しかして、負荷短絡等により供給電流id
が過大になると検出電圧Vsが基準電圧Vcを越え、コ
ンパレータ6より電流検出信号が発せられて電源遮断等
のパワーFETを保護する処置が採られる。
【0004】
【発明が解決しようとする課題】ところで、上記従来装
置においては、検出抵抗3をチップA外に設けている。
これはチップA内に形成する拡散抵抗は、絶対精度が出
ず(誤差は通常±20%程度)、温度特性も悪いため、
同一検出電流に対して検出電圧がバラつき、一定の基準
電圧に対して電流検出信号発生のスレッショールドがチ
ップ間でバラつき、あるいは雰囲気温度によって変動す
るという問題が生じるからである。
【0005】そして、検出抵抗3をチップA外に設けた
上記構成によると、この抵抗3両端に現れる検出電圧V
sを基準電圧Vcと同じアースレベルにするための作動
増幅回路7を設ける等の必要があり、回路構造が複雑化
するとともに、同一半導体チップA上に全ての回路を形
成していないため、コストアップが避けられないという
問題がある。
【0006】本発明はかかる課題を解決するもので、コ
スト低減と正確な電流検出を併せて実現した半導体装置
を提供することを目的とする。
【0007】
【課題を解決するための手段】本発明は、半導体チップ
上に形成される抵抗素子は絶対精度は悪いが、同一チッ
プ上の複数の抵抗素子間の相対精度は良く、かつ同一の
温度特性を有することに注目してなされたもので、その
構成を説明すると、半導体装置は、外部負荷Lへ電流を
供給する電流供給素子1と、供給電流idに比例した検
出電流isを生じる電流検出素子2と、検出電流isを
流す抵抗素子であって、その電圧降下により検出電流i
sをこれに応じた検出電圧Vsに変換する検出抵抗素子
3と、定電流源4と、定電流源4からの定電流icを流
す抵抗素子であって、その電圧降下により定電流源4か
らの定電流icを一定の基準電圧Vcに変換する基準抵
抗素子5と、上記検出電圧Vsと基準電圧Vcを比較し
て比較結果を電流検出信号として出力するコンパレータ
素子6とを同一半導体チップA上に形成してなるもので
ある。
【0008】
【作用】上記構成において、電流検出素子2より出力さ
れた検出電流isは検出抵抗素子3に流れて検出電圧V
sに変換される。一方、基準抵抗素子5では定電流ic
を変換して基準電圧Vcを作成し、この基準電圧Vcと
上記検出電圧Vsがコンパレータ素子6にて比較され
て、電流検出信号が出力される。
【0009】同一チップA上に形成した検出抵抗素子3
と基準抵抗素子5は互いの相対精度が良いから、同一電
流に対して同一の電圧を発生する。また、雰囲気温度の
変化に伴い両抵抗素子3,5の抵抗値は変化するが、温
度特性が同一であるから、抵抗値変化に伴う電圧変化は
コンパレータ素子6で相殺され、比較結果には影響しな
い。かくして、正確な電流検出が可能である。
【0010】本発明では全ての回路素子が同一の半導体
チップA上に形成されるから、製造コストの大幅な低減
が可能である。
【0011】
【実施例】図1には本発明の半導体装置の構成を示す。
半導体チップA上には電流供給素子としてのパワーFE
T1が形成され、図略の制御回路より入力するゲート信
号により外部負荷Lへの供給電流を制御する。上記パワ
ーFET1のドレインより分岐して、ゲートを共通にす
る電流検出素子としてのセンスFET2が形成され、該
センスFET2は供給電流idに比例した極く小さい
(例えば400μA/A程度)検出電流を生じる。
【0012】オペアンプ素子7が形成され、その「−」
端子と出力端子間を結んで検出抵抗素子3が形成される
とともに、この「−」端子に上記センスFET2のソー
スが接続されている。オペアンプ7の「+」端子はパワ
ーFET1のソースに接続されている。
【0013】上記オペアンプ7の出力端子には基準抵抗
素子5の一端が接続され、該基準抵抗素子5は上記検出
抵抗素子3と同一形状で拡散形成してある。基準抵抗素
子5の他端は定電流源4に接続されている。
【0014】センスFET2からの検出電流isは検出
抵抗素子3に流入してこれに比例した検出電圧Vsに変
換される。また、定電流源4からの定電流icは基準抵
抗素子5に流入して一定の基準電圧Vcに変換される。
これら検出電圧Vsと基準電圧Vcはオペアンプ7の出
力端子電位を共通電位とし、コンパレータ素子6に入力
してここで大小が比較され、その比較結果が2値の電流
検出信号として出力される。
【0015】かかる構造において、検出抵抗素子3と基
準抵抗素子5は同一形状に拡散形成され、その抵抗値の
相対精度は±1%程度と極めて良いから、両者の抵抗値
の差は極く小さい。また、両抵抗素子3,5は温度特性
も殆ど同じであるから、雰囲気温度が変化しても抵抗値
の差が大きくなることはない。
【0016】しかして、雰囲気温度が変化しても、検出
電流isが定電流icに等しければ必ず検出電圧Vsは
基準電圧Vcに等しくなり、供給電流idが予め定めら
れた値に達して検出電流isが定電流icを越えると確
実に電流検出信号が出力される。
【0017】
【発明の効果】以上の如く、本発明の半導体装置によれ
ば、電流供給素子による供給電流を電圧に変換する抵抗
素子、及び電流検出素子による検出電流を電圧に変換す
る抵抗素子の相対精度に着目し、これらの素子を一体の
半導体チップ内に形成したため、各素子の相対精度の点
から確実な電流検出が可能であると共に、コスト低減が
可能である。
【図面の簡単な説明】
【図1】本発明の半導体装置の回路図である。
【図2】従来の半導体装置の回路図である。
【符号の説明】
1 パワーMOSFET(電流供給素子) 2 センスMOSFET(電流検出素子) 3 検出抵抗素子 4 定電流源 5 基準抵抗素子 6 コンパレータ素子 A 半導体チップ L 外部負荷
───────────────────────────────────────────────────── フロントページの続き (72)発明者 石田 俊男 愛知県安城市篠目町井山3番地 アンデ ン株式会社内 (72)発明者 池本 秀行 愛知県安城市篠目町井山3番地 アンデ ン株式会社内 (56)参考文献 特開 平2−288615(JP,A) 実開 平4−32543(JP,U) (58)調査した分野(Int.Cl.7,DB名) H01L 29/78 H01L 21/822 H03K 17/00 - 17/70 H01L 27/06

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項1】 外部負荷へ電流を供給する電流供給素子
    と、供給電流に比例した検出電流を生じる電流検出素子
    と、検出電流を流す抵抗素子であって、その電圧降下に
    より検出電流をこれに応じた検出電圧に変換する検出抵
    抗素子と、定電流源と、定電流源からの定電流を流す抵
    抗素子であって、その電圧降下により定電流源からの定
    電流を一定の基準電圧に変換する基準抵抗素子と、上記
    検出電圧と基準電圧を比較して比較結果を出力するコン
    パレータ素子とを同一半導体チップ上に形成してなる半
    導体装置。
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