JP3229294B2 - 被成膜面の改質方法及び半導体装置の製造方法 - Google Patents

被成膜面の改質方法及び半導体装置の製造方法

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Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、被成膜面の改質方
法及び半導体装置の製造方法に関し、より詳しくは、特
に酸素(O2 )中にオゾン(O3 )を含むオゾン含有ガ
スとテトラエチルオルソシリケート(TetraEthylOrthoS
ilicate :TEOS)を含んだ反応ガス(以下、O3
TEOS反応ガスと記す。)を用いた熱CVD法により
成膜する前に被成膜基板表面への成膜における下地依存
性を改善する被成膜面の改質方法及びこの改質方法を用
いた半導体装置の製造方法に関する。
【0002】
【従来の技術】近年、半導体装置の超高密度化及び多層
配線化に伴い、表面の平坦性、凹部埋め込み性及びステ
ップカバレージ性に優れ、かつ水分や不純物の透過を抑
制する絶縁膜の成膜技術の開発が要望されている。これ
らの要求を満たす絶縁膜の成膜技術としてO3 /TEO
S反応ガスを用いたCVD法が注目されている。
【0003】O3 /TEOS反応ガスを用いたCVD法
により成膜する場合、O3 濃度が高いほど優れた膜質が
得られる。一方、その成膜状態は下地の被成膜面の状態
に強く依存し、このような下地依存性の影響は、O3
度が低い成膜条件下ではみられないが、O3 濃度が高い
成膜条件下で顕著に現れる。
【0004】なお、以下、O3 濃度が高いO3 /TEO
S反応ガスをHigh O3/TEOS反応ガスと称し、この反応ガ
スを用いたCVD法により成膜された二酸化シリコン膜
をHigh O3/TEOS CVD SiO2 膜と称する。また、O3 濃度
が低いO3 /TEOS反応ガスをLow O3/TEOS 反応ガス
と称し、この反応ガスを用いたCVD法により成膜され
た二酸化シリコン膜をLow O3/TEOS CVD SiO2膜と称す
る。さらに、すべてのO 3 濃度を含むO3 /TEOS反
応ガスを用いたCVD法により成膜された二酸化シリコ
ン膜を単にO3/TEOS CVD SiO2膜と称する。図10は下地
依存性の影響により異常成長した状態を示す断面図であ
る。被成膜基板101の表面依存性の影響を受けてHigh
O3/TEOS CVD SiO2 膜4の表面に荒れが発生し、High O
3/TEOS CVD SiO2 膜4中にボイドが発生している。な
お、被成膜基板101は半導体基板1、その上の下地絶
縁膜2、及び下地絶縁膜2上の配線3a,3bからな
る。
【0005】従来、このような表面依存性を消去するた
め、図11(a)〜(d)に示すような方法が採られて
いる。図中、図10中のものと同じものには同じ符号を
付している。即ち、(i)被成膜基板101の被成膜面
にプラズマ照射する方法(図11(a))、(ii)被成
膜面をプラズマCVD SiO2膜5で覆う方法(図11
(b))、(iii )High O3/TEOS CVD SiO2 膜の成膜前
に下地膜としてLow O3/TEOS CVDSiO2膜6を形成する方
法(図11(c))、(iv)薄い膜厚のLow O3/TEOS CV
D SiO2膜6を形成し、その表面をプラズマ照射した後、
High O3/TEOS CVD SiO2 膜を形成する方法(図11
(d))などがある。なお、上記(iii )と(iv)は、
Low O3/TEOS CVD SiO2膜6とHighO3/TEOS CVD SiO2膜の
二重層を用いることになる。
【0006】
【発明が解決しようとする課題】しかしながら、上記
(i)〜(iv)に挙げた従来例の被成膜面の改質方法で
は、それぞれ以下のような問題がある。即ち、 (i)プラズマ照射による改質方法では、下地依存性の
抑制効果が現れる条件にばらつきがあった。このため、
プラズマによる改質条件はすべての被成膜基板表面につ
いて共通化及び標準化できるというわけではなく、その
都度最適化が必要であった。しかもプラズマ照射のため
に、プラズマCVD装置が別途必要である。
【0007】(ii)被成膜面へのプラズマ CVD SiO2
5の被覆による改質方法では、プラズマCVDによる成
膜条件によってはHigh O3/TEOS CVD SiO2 膜との適合性
が優れた膜が得られ、従って、その膜を下地膜として被
成膜面を覆えば優れた膜質のHigh O3/TEOS CVD SiO2
が得られる。しかし、プラズマCVD SiO2膜5 は、本質的
に段差被覆性が悪く、微細パターン化には適していな
い。また、プラズマCVD装置が別途必要である。
【0008】(iii )Low O3/TEOS CVD SiO2膜6被覆に
よる改質方法では、Low O3/TEOS CVD SiO2膜6はHigh O
3/TEOS CVD SiO2 膜と極めて相性がよく、表面依存性を
消去できる。しかし、Low O3/TEOS CVD SiO2膜6は等方
的な成膜特性を有する上に、この場合の下地膜としては
少なくとも100nmの膜厚が必要である。従って、微
細パターンには不向きである。
【0009】一方、Low O3/TEOS CVD SiO2膜6の代わり
に、低圧下でのO3/TEOS CVD SiO2膜を下地として用い、
表面依存性を消去する方法も試みられている。しかし、
これは本質的にはLow O3/TEOS CVD SiO2膜6と同等であ
り、同様な理由で微細パターンには向いていない。ま
た、Low O3雰囲気下及び低圧下でのO3/TEOS CVD SiO2
は、膜質的にはHigh O 3/TEOS CVD SiO2 膜に比べて劣っ
ている。
【0010】(iv)Low O3/TEOS CVD SiO2膜6被覆とそ
の後のプラズマ照射による改質方法では、微細パターン
に不向きである上に工程が複雑になる。このように、従
来方法による表面改質方法では、総じて狭く且つ深い凹
部を埋め込むことにあまり適していない。従って、高密
度化が要求される今日、CVD法による成膜方法を用い
て膜質の優れた層間絶縁膜やカバー絶縁膜を得ると共
に、特に狭く且つ深い凹部を埋め込むことが望まれてい
る。
【0011】本発明は、上記の従来例の問題点に鑑みて
創作されたものであり、プラズマ照射或いは高温加熱、
真空中の処理等の付加的なエネルギを用いることなく、
極めて簡単な手法により被成膜基板の被成膜面への成膜
に対する表面依存性をほぼ完全に消去することができる
被成膜面の改質方法及びこの改質方法を用いた半導体装
置の製造方法を提供するものである。
【0012】
【課題を解決するための手段】上記課題を解決するた
め、請求項1記載の発明は、被成膜面の改質方法に係
り、熱酸化法による或いは熱CVD法若しくはプラズマ
CVD法によるシリコン酸化膜、又は熱CVD法若しく
はプラズマCVD法によるシリコン窒化膜のうち少なく
とも何れか一の膜が露出している表面である被成膜基板
の被成膜面に絶縁膜を成膜する前に、アンモニア若しく
はヒドラジンのガス或いは水溶液、又はアンモニア若し
くはヒドラジンの誘導体のガス或いは水溶液を前記被成
膜面に接触させて前記成膜面を改質することを特徴と
し、請求項2記載の発明は、請求項1記載の被成膜面の
改質方法に係り、前記改質前の被成膜基板の被成膜面に
は、前記シリコン酸化膜、又は前記シリコン窒化膜のう
ち少なくとも何れか一の膜のほかに、半導体及び配線の
うち少なくとも何れか一が露出していることを特徴と
し、請求項3記載の発明は、半導体装置の製造方法に係
り、アンモニア若しくはヒドラジンのガス或いは水溶
液、又はアンモニア若しくはヒドラジンの誘導体のガス
或いは水溶液を被成膜基板の被成膜面に接触させて前記
被成膜面を改質する工程と、オゾン含有ガスとテトラエ
チルオルソシリケートとを含む反応ガスを用いた熱CV
D法により前記改質された被成膜基板の被成膜面にシリ
コン含有絶縁膜を形成する工程とを有することを特徴と
し、請求項4記載の発明は、請求項3記載の半導体装置
の製造方法に係り、前記改質前の被成膜基板の被成膜面
には、熱酸化法による或いは熱CVD法若しくはプラズ
マCVD法によるシリコン酸化膜、又は熱CVD法若し
くはプラズマCVD法によるシリコン窒化膜のうち少な
くとも何れか一の膜が露出しているか、又は前記シリコ
ン酸化膜、又は前記シリコン窒化膜のうち少なくとも何
れか一の膜と、半導体及び配線のうち少なくとも何れか
一とが露出していることを特徴としている。
【0013】以下に、上記本発明の構成により奏される
作用・効果を説明する。本発明の被成膜面の改質方法に
おいては、アンモニア若しくはヒドラジンのガス或いは
水溶液、又はアンモニア若しくはヒドラジンの誘導体の
ガス或いは水溶液を成膜前の被成膜面に接触させて被成
膜面を改質している。即ち、上記改質材は活性な窒素元
素を有し、親水性を有するという特徴を有する。被成膜
面のシリコンと結合している水酸基や水分子と反応し
て、脱水させる作用を有すると考えられる。これによ
り、被成膜面のシリコンのダングリングボンドをNH4
O−或いはNH2−で終端させることができる。このた
め、被成膜面への成膜に対する表面依存性を消去させる
ことができる。特に、改質材として中性のガスを用いて
いるので、狭く且つ深い凹部内にも改質材が行き渡って
凹部内の表面依存性を消去させることができる。
【0014】従って、表面依存性の消去した被成膜面に
熱CVD法により成膜した場合、表面荒れやボイド等の
ない膜質の優れた層間絶縁膜やカバー絶縁膜を成膜速度
の低下を来すことなく形成することができるとともに、
狭く且つ深い凹部をほぼ完全に埋め込むことが可能とな
る。
【0015】
【発明の実施の形態】以下に、本発明の実施の形態につ
いて図面を参照しながら説明する。 (本発明に至った経過)まず、本発明に至った経過、及
び本発明の原理について説明する。被成膜面としてSi
2 膜やSi3 4 膜等の表面に成膜した場合、成膜状
態は被成膜基板の被成膜面の状態に強く依存し、その成
膜は異常成長を示す。例えば、SiO2 膜やSi3 4
膜等では、種々の製法で作成されるもののうち、熱酸化
膜、O3 /TEOS反応ガスとの適合性が得られていな
いプラズマCVD膜、又は減圧熱CVD法により成膜さ
れた絶縁膜の表面に成膜する場合に下地表面状態の影響
を強く受けて、形成膜のポーラス化や表面荒れが生じた
り、成膜速度の低下が起きたりする。
【0016】これらのSiO2 膜表面は、空気中即ち湿
度の存在するクリーンルーム内においては、放置により
2 Oの吸着或いはOH基による水和状態が存在し、こ
れがHigh O3/TEOS NSG膜(NSG 膜とはリンやボロン等の
不純物を含まないシリコン酸化膜のことをいう)の形成
において、中間的な反応生成物のスムーズかつ均一な吸
着及びそれによる均一な成膜や埋め込み性、或いは均一
な流動性を阻害する要因となっていると推定される。
【0017】従って、成膜前に表面の吸着水、水酸基を
除去し、表面を疎水性とした後に、その疎水性が失われ
ないうちに成膜すればよいと考えられる。従来の被成膜
面の改質処理のうち、プラズマ照射処理においては、空
気中に曝した状態でクリーンルーム内に放置しても疎水
性は失われず、一週間程度保存できることがわかってい
る。この場合は、表面の水分等がプラズマ照射と熱によ
り除去されるとともに、表面は酸素原子で終端した形、
即ち、被成膜面に下記のような状態が形成されると推定
される。
【0018】
【化1】
【0019】一方、プラズマ処理の雰囲気によっては、
表面は−N,−NH2 ,−H等で終端されると考えられ
る。プラズマ照射処理において、熱が重要な役割を持つ
のはそのためである。しかるに、狭くて深い凹部内をプ
ラズマによってすべてこのように処理できるとは考えら
れない。図2(a)〜(c)は、推定されるシリコン酸
化膜の表面状態を示す。図2(a)は成膜直後の被成膜
面の状態を表し、図2(b)の上図及び下図は、大気中
に放置した後の被成膜面の状態を表し、それぞれSiの
ダングリングボンドに水酸基(OH)が結合した状態、
及び水分子(H2 O)が結合した状態を表す。
【0020】また、シリコン酸化膜のそのような表面に
対してシリコンのハロゲン化物、例えば最も反応性の高
いSiCl4 (四塩化シリコン)を用いた例がすでに本願発
明者によって発明されている。被成膜面をSiCl4 に曝す
ことにより、
【0021】
【化2】
【0022】のようにHClを発生し、シラノールとな
る。それにより、極めて強い脱水性を示す。このとき、
反応部の温度が100℃以上であればシラノールは徐々
に分解し、
【0023】
【化3】
【0024】となってSiO2となり、表面の反応場所から
H2O は離脱する。また、SiCl4 のClは−OHと反応し
てHClを発生すると同時にOと置換してSi−Cl結
合を生じ、SiO2の表面はClによって終端されることも
考えられる。このようにして処理した被成膜基板の被成
膜面では、被成膜基板の温度が100℃以上では、水
分、HClは系外に出され、表面には下記のようなSi
−O結合、又はSi−Cl結合状態が残される。
【0025】
【化4】
【0026】即ち、被成膜面は塩素化されることにな
る。それにより表面は疎水性を示す。その結果としてHi
gh O3/TEOS反応ガスを用いたCVD法による成膜に対し
ては表面依存性が消去されることがわかった。この発明
では、SiX4で表されるシリコンのハロゲン化物或いはそ
の関連化合物の代わりに、活性な窒素を有し、かつ親水
性を有する改質材を用いることにより、被成膜面に吸着
させてその被成膜面に優れた濡れ性を付与することにあ
る。
【0027】また、この発明の改質材は被成膜面に吸着
しているH2O またはOH基と反応し、脱水させる作用を持
つと考えられる。例えば、ウエハを室温において1時間
30%のアンモニア水中に浸漬した場合、アンモニア水
中では、SiO2膜表面のOH基と反応してH2O を生成すると
ともに脱水作用によりH2O を除去し、
【0028】
【化5】
【0029】が形成されて、SiO2膜表面はNH4O- で終端
されるようになる。処理されたSiO2膜表面は水洗、乾燥
後もそのまま維持され、High O3/TEOS反応ガスを用いた
CVD法による成膜において、表面依存性を完全に消去
させて、シリコン表面におけると全く同一の成膜速度、
膜質を保持して膜形成を行うことができた。但し、表面
乾燥後は、さらにH2O が抜け、
【0030】
【化6】
【0031】の形になったと考えられる。この推移を図
3(a)〜(c)に示す。また、SiO2膜表面が被成膜面
となっているウエハをNH3 ガス中に曝した場合も、上記
アンモニア水に浸漬した場合と同様な効果が得られた。
即ち、ウエハをチャンバ内に配置し、温度を100 ℃程度
に上昇させ、NH3 ガスを直接送り込んで1分間処理した
ところ、そのSiO2膜表面ではすべて表面依存性が消失し
ていた。この場合、被成膜面のOH基はNH3 のH と結合し
てH2O として除去され、OH基の代わりに残りのNH2 が被
成膜面のSiのダングリングボンドと結合するような機構
が考えられる。
【0032】この発明に用いうる改質ガスを以下に列挙
する。 (改質材)この発明では、改質材として、アンモニア
(NH3 )やヒドラジン((NH2) 2 )、或いはアミノ
基(- NH2 )をベースとする化合物を用いる。 (a)アンモニア(NH3 ) 常温で気体である。その水溶液は、アンモニア水とな
る。なお、アンモニア水は水酸化アンモニウムと称し、
以下の説明では、便宜上、アンモニア水をNH4OHと称す
る場合もある。
【0033】また、水酸化アンモニウムの誘導体とし
て、化学式NHn 4-n (OH)(n=1〜4、Rはア
ルキル基)で示されるものを用いることができる。例え
ば、上記化学式においてn=2、R=CH3 とした場
合、水酸化ジメチルアンモニウム(N(CH3)2H2(OH) )で
ある。 (b)ヒドラジン((NH2)2 ) 常温で液体である。ヒドラジンの誘導体として、( NR
2)2 (RはCH3 ,C 2 5 ,C3 7 等のアルキル基
や、アリール基(ベンゼン核を含む)など)を用いるこ
とができる。なお、RがCH3 の場合、ジメチルヒドラ
ジン( N( CH 3)2 2 である。
【0034】(c)アミン アンモニアの水素原子がアルキル基、アリール基(ベン
ゼン核を含む)など有機基(R)で置換された化合物で
あり、有機アルカリに属する。アミンとして、NRn
3-n (n=1,2,3) などを用いることができる。 (d)アミノ化合物 アミノ基(-NH2)を有する有機化合物である。
【0035】アミノ化合物として、アミノ酸(RNH2
COOH)、アミノベンゼン(アニリン)(C6 5
2 )、アミノフェノール(C6 4 NH2 OH)、ア
ミノベンゼンスルフォン酸(C6 4 SO3 HNH2
などを用いることができる。Rはアルキル基、アリール
基(ベンゼン核を含む)などの有機基である。 これらの改質材(a)〜(d)における共通点は活性な
窒素を有していることと、親水性を有していることであ
り、SiO2膜等の被成膜面において吸着し、優れた濡れ性
を示すことである。従って、本発明の改質材は上記
(a)〜(d)の具体例に限られず、このような性質を
有するものであれば、本発明の改質材として用いること
ができる。 (改質処理装置/成膜装置) 図7は本発明の実施の形態
の下地表面改質方法に係る改質処理装置を示す概略構成
図である。
【0036】 図7に示すように、容器21内にアンモニ
ア水等の液状の改質材22を入れたものである。被成膜
基板102の被成膜面を改質する場合、被成膜基板10
2を液中に浸漬する。また、図8はコールドウオール方
式の改質処理/CVD成膜装置を示す概略構成図であ
る。同一の装置で、改質処理とCVD法による成膜とを
行えるようになっている。
【0037】ステンレスからなる反応チャンバ61(チ
ャンバ)内には、シリコンウエハ1を保持するための保
持台62が設けられ、保持台62にはシリコンウエハ1
を加熱するためのヒータ(加熱手段)が内蔵されてい
る。反応チャンバ61には、ガス供給手段63から供給
されたO3/TEOS 混合ガス等の成膜ガス又は被成膜面の改
質ガスを反応チャンバ61内に導く配管68aと、該配
管68aの他端に接続された、保持台62上のシリコン
ウエハ1上に成膜ガス又は改質ガスを放出するガス分散
板64とが設置されている。また、反応チャンバ61に
は、反応チャンバ61内の圧力を調整する排気装置65
が接続されている。
【0038】ガス供給手段63は、改質ガス供給手段6
6、成膜ガス供給手段67、配管68b,68c及び切
替バルブ69(切替手段)から構成される。改質ガス供
給手段66は、被成膜面の改質の際に、反応チャンバ6
1内に改質ガスを供給し、成膜ガス供給手段67は、被
成膜面を改質した後に、成膜ガスを供給する。
【0039】この2つのガス供給装置66,67にはそ
れぞれ配管68bと68cが接続され、さらにこれらの
配管68b,68cは反応チャンバ61内に至る配管6
8aと接続されている。これら3つの配管68b,68
c,68aの接続部には切替バルブ69が設置されてお
り、配管68bから配管68aへと改質ガスを導く流路
を導通させ、或いは配管68cから配管68aへと成膜
ガスを導く流路を導通させるように流路の切り替えを行
う。切替バルブ69による流路の切り替えにより、改質
ガス又は成膜ガスが選択的に配管68aを通して反応チ
ャンバ61内に導かれる。
【0040】改質ガス供給手段66では、改質ガスをボ
ンベからそのまま供給する。或いは液状の改質材を蒸発
等させてそのまま、或いはキャリアガスとしてのN2、H2
又はArガス中に含ませて供給する。改質ガス供給手段6
6から供給された改質ガスは配管68bを通して反応チ
ャンバ61内に導かれる。なお、本実施の形態では、被
成膜面を改質するために用いるチャンバとO3/TEOS SiO2
膜2を成膜するためのチャンバとを分けずに、同一のチ
ャンバ61を用いたが、それぞれ別々のチャンバを用い
てもよい。
【0041】また、反応チャンバ61は、枚葉式のチャ
ンバでも、炉タイプのバッチ型装置でもよい。さらに、
本実施の形態では、コールドウオール方式の反応装置を
用いたが、図9に示すようなホットウオール方式で、図
9(a)に示す横型炉、あるいは図9(b)に示す縦型
炉の反応装置を用いてもよい。
【0042】この場合、ホットウオール方式の加熱手段
としては、チャンバの近くに設けられたヒータ又は赤外
線加熱装置を用いることができる。 (被成膜面の改質方法/半導体装置の成膜方法)次に、
本発明の実施の形態の被成膜面の改質方法及びこの改質
方法を用いた半導体装置の製造方法について説明する。
【0043】図1(a)〜(c)は本発明の実施の形態
の被成膜面の改質方法及びこの改質方法を用いた半導体
装置の製造方法を示す断面図であり、図2(a)は成膜
の下地層としての熱酸化膜12を形成した直後の熱酸化
膜12表面(被成膜面12a)の状態を示す断面図であ
り、図2(b)の上下の図は改質前の熱酸化膜12表面
の状態を示す断面図であり、図3(a)〜(c)は熱酸
化膜12表面での熱酸化膜12と改質材であるアンモニ
ア水との反応を示す図である。改質処理装置として図7
に示すものを用いた。
【0044】まず、シリコンからなる半導体基板11を
酸化炉内に入れ、酸素雰囲気中で約1100℃に加熱す
る。これにより、図1(a)に示すように、半導体基板
11表面が酸化し、SiO2からなる熱酸化膜12が形成さ
れる。この熱酸化膜12が成膜のための下地層となり、
熱酸化膜12の表面が被成膜面12aとなる。これらが
被成膜基板102を構成する。なお、熱酸化膜12上に
配線が形成される場合があるが、この場合配線を含む全
体が被成膜基板102を構成する。
【0045】なお、この下地層の成膜工程は、プラズマ
CVD法、低圧CVD法などを用いてもよい。形成され
た直後の熱酸化膜12の表面では、図2(a)に示すよ
うに、Siの未結合手(ダングリングボンド)が存在して
いると考えられるが、通常、熱酸化膜12の表面は、図
2(b)の上図に示すように、空気(湿気を含む)と接
触して水和し、SiとOHが結合してSi-OH 結合ができてい
るか、或いは図2(b)の下図に示すように、SiとH2O
とが結合してSi-H2O結合ができている状態となっている
と考えられる。いずれにしても、熱酸化膜12の表面は
親水性となっているとする。
【0046】次に、図7に示すように、被成膜基板10
2をアンモニア水(表面改質材)22に浸漬する。この
とき、熱酸化膜12の表面では、熱酸化膜12とアンモ
ニア水22との間で以下に説明するような反応が起こっ
ていると推定できる。その反応の様子を、Si-OH 結合で
終端している熱酸化膜12の表面の場合について説明す
る。
【0047】即ち、加熱された熱酸化膜12の表面で
は、図3(a)に示すように、NH4OHに曝されることに
より、Si-OH 結合している-OH とNH4OH 中の-Hが結合し
てH2Oを生成する。これにより、NH4OH から-Hが除かれ
て熱酸化膜12の表面のSiの結合手にはNH4Oが残る。な
お、生成したH2O は熱酸化膜12の表面の反応領域の外
に放出される。
【0048】次に、被成膜面12aを加熱などにより乾
燥させると、図3(c)に示すように、熱酸化膜12の
表面のSiと結合したNH4OからH2O が除かれて、NH2 が残
る。これにより、熱酸化膜12表面は疎水性を示すよう
になる。なお、熱酸化膜12表面のSiがH2O と結合して
いる場合は、NH4OH とH2O が反応し、上記と類似の反応
過程を経て、熱酸化膜12表面のSiと結合したH2O がN
2−で置換され、熱酸化膜12の表面は疎水性を示す
ようになると考えられる。
【0049】上記改質処理に引き続き、改質ガスを止め
て成膜用ガス供給手段67から成膜ガスとして High O3
/TEOS 成膜ガスを反応チャンバ61内に送り出す。そし
て、被成膜基板102を400℃程度に加熱し、O3とTE
OSを熱的に反応させる。所定の時間、その状態を保持す
ると、図1(c)に示すように、熱酸化膜12上にHigh
O3/TEOS CVD SiO2 膜13が形成される。
【0050】なお、図8に示す改質処理と成膜とを兼用
した装置を用いた場合、以下のように処理が行われる。
まず、上記と同じようにして、熱酸化膜12を形成す
る。被成膜面12aの表面状態は、図2(b)、又は同
図(c)と同じようになっているとする。次に、図8に
示すように、反応チャンバ61内の保持台62上にシリ
コンウエハ1を載せ、保持台62に内蔵したヒータによ
り100℃以上に加熱する。そして、改質ガス供給手段
66からNH3 ガス(改質ガス)を反応チャンバ61に
供給する。改質ガスは半導体基板11上に形成された熱
酸化膜12の表面に放出される。
【0051】 このとき、熱酸化膜12の表面では、熱酸
化膜12と表面改質ガスとの間で図3(a)〜(c)と
類似の反応が起こっていると推定できる。即ち、被成膜
面12aのOH基はNH3 のH と結合してH2O として除去さ
れ、OH基の代わりに残りのNH 2 が被成膜面12aのSiの
ダングリングボンドと結合するような機構が考えられ
る。
【0052】 上記被成膜面12aの改質処理では活性な
窒素元素を含有する改質ガスを用いているので、上記改
質処理後に、熱酸化膜12の表面に洗浄等の処理をせず
に、直ちに次の成膜工程に移行できる。即ち、上記改質
処理に引き続き、改質ガスを止めて成膜用ガス供給手段
67から成膜ガスとして O3/TEOSの混合ガスを反応チャ
ンバ61内に送り出す。
【0053】 そして、上記したと同様な成膜条件で、被
成膜基板102表面にHigh O3/TEOSCVD SiO2 膜13を
形成する。以上のように、本実施の形態では、熱酸化膜
12の表面を疎水性に改質したのちに、O3/TEOS 反応ガ
スを用いた成膜を行っているので、形成されたHigh O3/
TEOS CVD SiO2 膜13の流動性、平坦性、埋め込み性、
カバーレッジ性を向上することができる。
【0054】特に、活性な窒素元素を含む改質ガスを用
いているので、改質効果を維持することが可能となる。
即ち、被成膜面12aの改質を行った後に、熱酸化膜1
2 表面を空気中に24時間曝した後にHigh O3/TEOS CVD
SiO2 膜13を形成しても、形成されたHigh O3/TEOS C
VD SiO2 膜13の流動性、平坦化性、埋め込み性、ステ
ップカバーリッジ性を維持できた。
【0055】(第1の実施例) 以下、第1の実施例につ
いて図4を参照しながら説明する。この実施例では、熱
酸化膜12上に例えばアルミニウムからなる配線14
a、14bが形成されているような被成膜基板102の
表面(被成膜面)に本発明の改質方法を適用している。
【0056】 なお、図4において、図1中のものと同じ
ものには同じ符号を付している。 図4に示すように、酸
化雰囲気中、シリコンからなる半導体基板11を温度1
100℃に加熱して、表面に膜厚約300nmのSiO2
らなる熱酸化膜12を形成し、下地層とした。次に、被
成膜基板102の被成膜面を曝して表面改質した。表面
改質のための条件としては、NH3ガス(改質ガス)を
用い、この改質ガスを被成膜基板102の被成膜面に接
触させた。
【0057】 次いで、改質された下地層12表面に膜厚
約500nmのHigh O3/TEOS CVD SiO2 膜13を形成し
た。High O3/TEOS CVD SiO2 膜13の成膜条件のうち、
O3/TEOS の混合ガスからなる成膜ガス中のオゾン濃度
を、O2中のO3濃度5%の所謂高濃度とし、被成膜基板1
02の加熱温度を400℃とした。図4に示すように、
本実施例の被成膜面の改質方法を用いた処理を行った後
に、High O3/TEOS成膜ガスを用いたCVD法により成膜
することにより、ボイドのない、表面がスムーズなHigh
O3/TEOS CVD SiO2 膜13が形成された。
【0058】以上のように、活性な窒素元素を含有した
表面改質ガスにより、配線14a、14b等の凹凸を有
する被成膜面12aの表面改質を行うと、配線14a、
14b間の凹部に対するHigh O3/TEOS CVD SiO2 膜13
の埋め込み性、カバーレッジ性を向上させることができ
る。 (第2の実施例)次に、第2の実施例について図5を参
照しながら説明する。この実施例では、幅が狭く、かつ
深い溝が存在しているような被成膜面に本発明を適用し
ている。なお、比較のため、本発明の改質処理を行わな
い下地層に成膜した比較例を図6に示す。
【0059】 図5は被成膜面を改質処理した後に、High
O3/TEOS CVD SiO2 膜13を形成したときの断面図であ
り、図6は被成膜面を改質処理せずに、High O3/TEOS C
VD SiO2 膜13aを形成したときの断面図である。な
お、図5、6において、図1中のものと同じものには同
じ符号を付している。図5に示すように、シリコンから
なる半導体基板11に、幅が約0.1μmで、深さが約
0.6μmの溝15を形成し、この溝15を有する半導
体基板11表面に第1の実施例と同様な条件でSiO2から
なる熱酸化膜12を形成して下地層とした。そして、そ
の下地層12表面にHigh O3/TEOS CVD SiO2 膜13を形
成して、その埋め込み性、及びステップカバーリッジ性
について調べた。
【0060】表面改質材として、第1の実施例と異な
り、アンモニア水を用い、この中に被成膜基板102を
浸漬した。アンモニア水の液温を50−80℃とし、浸
漬時間を10分前後とした。また、High O3/TEOS CVD S
iO2 膜13の成膜条件は、オゾン濃度や被成膜基板10
2の加熱温度を第1の実施例と同じとした。
【0061】図5より、本実施例の被成膜面の改質方法
を用いた改質処理を行った試料では、ボイドのない、表
面が平坦化されたHigh O3/TEOS CVD SiO2 膜13が形成
されていることがわかる。それに対して、表面改質処理
をせずにHigh O3/TEOS CVD SiO2 膜13aを形成したと
きでは、図6のように、ボイドが生じたり、膜13aの
表面が波うち、平坦な膜とすることができないことがわ
かる。
【0062】以上のように、活性な窒素元素を含有した
表面改質ガスにより、溝15等の非常に狭い凹部領域を
有する下地層12の表面改質を行うと、溝15に対する
HighO3/TEOS CVD SiO2 膜13の埋め込み性、カバーレ
ッジ性を向上させることができる。なお、上記実施の形
態では、被成膜面12aに形成する絶縁膜として、High
O 3/TEOS SiO2 膜13を用いているが、他のシリコン含
有有機化合物、例えば、アルコキシシランやシロキサン
などと、酸化性ガスの組み合わせから成膜される絶縁膜
を用いてもよい。
【0063】また、被成膜面12aに形成する絶縁膜と
して、SiO2膜のほかに、PSG(Phosphosilicate glas
s) 膜,BSG(Borosilicate glass)膜又はBPSG(Bo
rophosphosilicate glass) 膜のうちいずれかを用いて
もよい。PSG膜を成膜する場合の成膜ガスとして、O
3 とTEOSとTMP(Trimetylphosphite:P(OCH3)3)又
はTMOP(Trimethylphosphate:PO(OCH3)3)との混合ガ
スを用い、BSG膜を成膜する場合の成膜用ガスとし
て、O3 とTEOSとTMB(Trimetylborate:B(OC
H3)3) の混合ガスを用い、BPSG膜を成膜する場合の
成膜用ガスとして、O3とTEOSとTMBとTMP又
はTMOPとの混合ガスを用いることができる。
【0064】さらに、上記実施の形態では、被成膜基板
102に何も加速度を加えずに液体或いは気体を用いて
改質処理を行っているが、被成膜基板102に超音波や
メガソニックを加えながら改質処理を行うと更に改質効
果が上がる。
【0065】
【発明の効果】以上のように、本発明の被成膜面の改質
方法によれば、アンモニア若しくはヒドラジンのガス或
いは水溶液、又はアンモニア若しくはヒドラジンの誘導
体のガス又は水溶液を成膜前の被成膜面に接触させて被
成膜面を改質しているので、被成膜面のシリコンのダン
グリングボンドをNH4O−或いはNH2−で終端させる
ことができる。このため、被成膜面への成膜に対する表
面依存性を消去させることができる。
【0066】 特に、改質材として中性のガスを用いてい
るので、狭く且つ深い凹部内にも改質材が行き渡って凹
部内の表面依存性を消去させることができる。 これによ
り、表面依存性の消去した被成膜面に熱CVD法により
成膜した場合、表面荒れやボイド等のない膜質の優れた
層間絶縁膜やカバー絶縁膜を成膜速度の低下を来すこと
なく形成することができるとともに、狭く且つ深い凹部
をほぼ完全に埋め込むことが可能となる。従って、デバ
イスの微細化、高密度化を実現することができる。
【図面の簡単な説明】
【図1】本発明の実施の形態の被成膜面の改質方法を示
す断面図である。
【図2】本発明の実施の形態の被成膜面の改質方法にお
ける改質の原理を示す図( その1) である。
【図3】本発明の実施の形態の被成膜面の改質方法にお
ける改質の原理を示す図( その2) である。
【図4】本発明の実施の形態の被成膜面の改質方法を配
線を有する被成膜面に適用した第1の実施例について示
す断面図である。
【図5】本発明の実施の形態の被成膜面の改質方法を溝
を有する被成膜面に適用した第2の実施例について示す
断面図である。
【図6】図5の比較例について示す断面図である。
【図7】本発明の実施の形態の被成膜面の改質方法に用
いられる改質処理装置について示す側面図である。
【図8】本発明の実施の形態の被成膜面の改質方法に用
いられるコールドウオール方式の改質処理/成膜装置に
ついて示す側面図である。
【図9】本発明の実施の形態の被成膜面の改質方法に用
いられるホットウオール方式の改質処理/成膜装置につ
いて示す側面図である。(a)は横型方式を示し、
(b)は縦型方式を示す。
【図10】従来例に係る被成膜面の改質処理前に、High
O3/TEOS CVD SiO2 膜を形成したときの断面図である。
【図11】従来例に係る被成膜面の改質処理方法につい
て示す断面図である。
【符号の説明】
11 半導体基板 12 熱酸化膜(下地層) 12a 被成膜面 13 High O3/TEOS CVD SiO2 膜(絶縁膜) 14a,14b 配線 15 溝 61 反応チャンバ(チャンバ) 62 保持台 63 ガス供給手段 64 ガス分散板 65 排気装置 66 改質ガス供給手段 67 成膜用ガス供給手段 68a,68b,68c,68d 配管 69 切替バルブ(切替手段) 102 被成膜基板
フロントページの続き (72)発明者 徳増 徳 東京都港区港南2−13−29 株式会社半 導体プロセス研究所内 (72)発明者 安住 孝芳 東京都港区港南2−13−29 株式会社半 導体プロセス研究所内 (56)参考文献 特開 平11−288933(JP,A) 特開 平11−74485(JP,A) 特開 平9−129632(JP,A) 特開 平9−148324(JP,A) 特開 平6−181205(JP,A) (58)調査した分野(Int.Cl.7,DB名) H01L 21/316 H01L 21/318

Claims (4)

    (57)【特許請求の範囲】
  1. 【請求項1】 熱酸化法による或いは熱CVD法若しく
    はプラズマCVD法によるシリコン酸化膜、又は熱CV
    D法若しくはプラズマCVD法によるシリコン窒化膜の
    うち少なくとも何れか一の膜が露出している表面である
    被成膜基板の被成膜面に絶縁膜を成膜する前に、アンモ
    ニア若しくはヒドラジンのガス或いは水溶液、又はアン
    モニア若しくはヒドラジンの誘導体のガス或いは水溶液
    を前記被成膜面に接触させて前記成膜面を改質すること
    を特徴とする被成膜面の改質方法。
  2. 【請求項2】 前記改質前の被成膜基板の被成膜面に
    は、前記シリコン酸化膜、又は前記シリコン窒化膜のう
    ち少なくとも何れか一の膜のほかに、半導体及び配線の
    うち少なくとも何れか一が露出していることを特徴とす
    る請求項1記載の被成膜面の改質方法。
  3. 【請求項3】 アンモニア若しくはヒドラジンのガス或
    いは水溶液、又はアンモニア若しくはヒドラジンの誘導
    体のガス或いは水溶液を被成膜基板の被成膜面に接触さ
    せて前記被成膜面を改質する工程と、 オゾン含有ガスとテトラエチルオルソシリケートとを含
    む反応ガスを用いた熱CVD法により前記改質された被
    成膜基板の被成膜面にシリコン含有絶縁膜を形成する工
    程とを有することを特徴とする半導体装置の製造方法。
  4. 【請求項4】 前記改質前の被成膜基板の被成膜面に
    は、熱酸化法による或いは熱CVD法若しくはプラズマ
    CVD法によるシリコン酸化膜、又は熱CVD法若しく
    はプラズマCVD法によるシリコン窒化膜のうち少なく
    とも何れか一の膜が露出しているか、又は前記シリコン
    酸化膜、又は前記シリコン窒化膜のうち少なくとも何れ
    か一の膜と、半導体及び配線のうち少なくとも何れか一
    とが露出していることを特徴とする請求項3記載の半導
    体装置の製造方法。
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TW088120346A TW439140B (en) 1999-06-04 1999-11-22 Method for modifying the surface of a substrate on which an insulating film is to be formed and method of manufacturing semiconductor device thereby
US09/444,991 US6255230B1 (en) 1999-06-04 1999-11-23 Method for modifying a film forming surface of a substrate on which a film is to be formed, and method for manufacturing a semiconductor device using the same
EP99123923A EP1058301A1 (en) 1999-06-04 1999-12-02 Method for modifying the surface of a substrate on which an insulating film is to be formed
KR1019990057361A KR100358589B1 (ko) 1999-06-04 1999-12-14 성막할 기판의 피성막면의 개질방법, 및 그 방법을 이용한 반도체 장치의 제조방법

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
USD997490S1 (en) * 2021-11-17 2023-09-05 Figs, Inc. Lab coat

Families Citing this family (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3549193B2 (ja) * 2000-03-31 2004-08-04 キヤノン販売株式会社 被成膜面の改質方法及び半導体装置の製造方法
US6559007B1 (en) 2000-04-06 2003-05-06 Micron Technology, Inc. Method for forming flash memory device having a tunnel dielectric comprising nitrided oxide
KR100797202B1 (ko) * 2000-06-23 2008-01-23 허니웰 인터내셔널 인코포레이티드 손상된 실리카 유전 필름에 소수성을 부여하는 방법 및 손상된 실리카 유전 필름 처리 방법
US6544908B1 (en) * 2000-08-30 2003-04-08 Micron Technology, Inc. Ammonia gas passivation on nitride encapsulated devices
JP3559026B2 (ja) 2001-08-24 2004-08-25 キヤノン販売株式会社 半導体装置の製造方法
US6812064B2 (en) * 2001-11-07 2004-11-02 Micron Technology, Inc. Ozone treatment of a ground semiconductor die to improve adhesive bonding to a substrate
US20030111438A1 (en) * 2001-12-18 2003-06-19 Mukai Kevin M. Process operation supplementation with oxygen
JP3586268B2 (ja) 2002-07-09 2004-11-10 株式会社東芝 半導体装置及びその製造方法
WO2004068555A2 (en) * 2003-01-25 2004-08-12 Honeywell International Inc Repair and restoration of damaged dielectric materials and films
US7709371B2 (en) * 2003-01-25 2010-05-04 Honeywell International Inc. Repairing damage to low-k dielectric materials using silylating agents
US7202186B2 (en) * 2003-07-31 2007-04-10 Tokyo Electron Limited Method of forming uniform ultra-thin oxynitride layers
US8475666B2 (en) * 2004-09-15 2013-07-02 Honeywell International Inc. Method for making toughening agent materials
US7183166B2 (en) * 2003-11-25 2007-02-27 Macronix International Co., Ltd. Method for forming oxide on ONO structure
JP4860733B2 (ja) * 2004-03-25 2012-01-25 独立行政法人科学技術振興機構 有機材料含有デバイスに適した基板の製造方法、および有機材料含有デバイスの製造方法
US7927933B2 (en) * 2005-02-16 2011-04-19 Imec Method to enhance the initiation of film growth
US7678712B2 (en) * 2005-03-22 2010-03-16 Honeywell International, Inc. Vapor phase treatment of dielectric materials
US8524616B2 (en) * 2008-11-12 2013-09-03 Microchip Technology Incorporated Method of nonstoichiometric CVD dielectric film surface passivation for film roughness control
JP5702173B2 (ja) * 2011-01-31 2015-04-15 ルネサスエレクトロニクス株式会社 半導体装置の製造方法および多孔質絶縁層の改質方法
ES2672099T3 (es) 2011-07-04 2018-06-12 Irbm - Science Park S.P.A. Antagonistas del receptor NK-1 para el tratamiento de la neovascularización corneal
US8664729B2 (en) * 2011-12-14 2014-03-04 Taiwan Semiconductor Manufacturing Company, Ltd. Methods and apparatus for reduced gate resistance finFET
AU2019223237A1 (en) 2018-02-26 2020-09-03 Ospedale San Raffaele S.R.L. NK-1 antagonists for use in the treatment of ocular pain
WO2021180885A1 (en) 2020-03-11 2021-09-16 Ospedale San Raffaele S.R.L. Treatment of stem cell deficiency

Family Cites Families (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH05259297A (ja) * 1992-03-09 1993-10-08 Oki Electric Ind Co Ltd 半導体素子の製造方法
EP0560617A3 (en) * 1992-03-13 1993-11-24 Kawasaki Steel Co Method of manufacturing insulating film on semiconductor device and apparatus for carrying out the same
JP3369622B2 (ja) 1992-03-13 2003-01-20 川崎マイクロエレクトロニクス株式会社 半導体装置の製造方法
US5470800A (en) 1992-04-03 1995-11-28 Sony Corporation Method for forming an interlayer film
JPH05343394A (ja) * 1992-06-08 1993-12-24 Nippon Telegr & Teleph Corp <Ntt> 熱酸化膜の形成方法
JPH06181205A (ja) 1992-12-15 1994-06-28 Fujitsu Ltd 半導体装置の製造方法
JPH0799191A (ja) 1993-05-07 1995-04-11 Sony Corp 半導体装置における絶縁層及びその形成方法
JPH0729901A (ja) 1993-07-08 1995-01-31 Kawasaki Steel Corp 半導体装置の製造方法
JPH0750295A (ja) 1993-08-05 1995-02-21 Fujitsu Ltd 半導体装置の製造方法
KR970007116B1 (ko) * 1993-08-31 1997-05-02 삼성전자 주식회사 반도체장치의 절연층 형성방법 및 그 형성장치
JPH07122552A (ja) 1993-10-20 1995-05-12 Sony Corp 半導体装置における絶縁膜形成方法
JP3484480B2 (ja) 1995-11-06 2004-01-06 富士通株式会社 半導体装置の製造方法
JPH09148324A (ja) 1995-11-27 1997-06-06 Fujitsu Ltd シリコン窒化膜の形成方法
JPH09205089A (ja) * 1996-01-25 1997-08-05 Sony Corp Teos膜の形成方法
JPH1174485A (ja) 1997-06-30 1999-03-16 Toshiba Corp 半導体装置およびその製造方法
JPH11288933A (ja) 1998-02-04 1999-10-19 Sony Corp 絶縁膜の形成方法及びp形半導体素子の製造方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
USD997490S1 (en) * 2021-11-17 2023-09-05 Figs, Inc. Lab coat

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